JPH04101286U - 高効率電源回路 - Google Patents
高効率電源回路Info
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- JPH04101286U JPH04101286U JP99491U JP99491U JPH04101286U JP H04101286 U JPH04101286 U JP H04101286U JP 99491 U JP99491 U JP 99491U JP 99491 U JP99491 U JP 99491U JP H04101286 U JPH04101286 U JP H04101286U
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- Dc-Dc Converters (AREA)
Abstract
(57)【要約】
【目的】 この考案は、特にパーソナルコンピュータ等
ポータブル機器に用いて好適なDC−DCコンバータ等
高効率電源回路に関し、軽負荷時にも、効率よく電力供
給が可能な高効率電源回路を提供することを目的とす
る。 【構成】 外部信号によりオンオフする第1のスイッチ
ング素子と、第1のスイッチング素子の状態に従い負荷
に対してエネルギを供給するインダクタと、整流ダイオ
ード、平滑コンデンサで構成されるDC−DCコンバー
タにおいて、上記整流ダイオードと並列に接続され、第
1のスイッチング素子と同期して両方向にオンオフ制御
を行う第2のスイッチング素子と、上記整流ダイオード
ならびに第2のスイッチング素子による電圧降下を検出
してインダクタに流れる電流の方向を検出して第2のス
イッチング素子をオンオフするコンパレータとを具備す
ることを特徴とする。
ポータブル機器に用いて好適なDC−DCコンバータ等
高効率電源回路に関し、軽負荷時にも、効率よく電力供
給が可能な高効率電源回路を提供することを目的とす
る。 【構成】 外部信号によりオンオフする第1のスイッチ
ング素子と、第1のスイッチング素子の状態に従い負荷
に対してエネルギを供給するインダクタと、整流ダイオ
ード、平滑コンデンサで構成されるDC−DCコンバー
タにおいて、上記整流ダイオードと並列に接続され、第
1のスイッチング素子と同期して両方向にオンオフ制御
を行う第2のスイッチング素子と、上記整流ダイオード
ならびに第2のスイッチング素子による電圧降下を検出
してインダクタに流れる電流の方向を検出して第2のス
イッチング素子をオンオフするコンパレータとを具備す
ることを特徴とする。
Description
【0001】
【0002】
この考案は、特にパーソナルコンピュータ等ポータブル機器に用いて好適な
DC−DCコンバータ等高効率電源回路に関する。
【0003】
パーソナルコンピュータ等ポータブル機器では、電源としてDC−DCコン
バータが用いられる。DC−DCコンバータの基本構成を図2に示す。DC−D
Cコンバータは、外部の信号によりON/OFFするバイポーラもしくはMOS
トランジスタで構成されるスイッチング素子21、エネルギを蓄積するコイルあ
るいは電圧の大きさを変換するチョーク等インダクタ素子22、平滑コンデンサ
23および整流ダイオード24で構成される。
【0004】
基本的動作は以下のとおりである。まず、スイッチング素子21がONすると
I0nなる電流が流れ、入力側から出力側へエネルギが供給される。また、スイッ
チング素子21がOFFすると、I0ff なる電流が流れインダクタ22に蓄積さ
れたエネルギが放出される。このとき整流ダイオード24の順方向電圧降下によ
りインダクタ22に蓄積されたエネルギの一部が失われる。
【0005】
ダイオードによる損失を少なくするために改良されたDC−DCコンバータの
構成を図3に示す。即ち、図2に示す構成に、スイッチング素子21とは別のス
イッチング素子21と同期して両方向スイッチング制御がなされるスイッチング
素子31が付加される。これらのタイミング動作上の関係は、スイッチング素子
21がONしているときスイッチング素子31はOFF、スイッチング素子21
がOFFしているときスイッチング素子31はONするという関係を持つ。両方
向スイッチング素子素子31のソース−ドレイン間の電圧降下はダイオード24
の順方向電圧降下に比してはるかに小さいことを利用したものである。
【0006】
図3に示す構成では、インダクタ22に蓄積されたエネルギが完全に放出さ
れた後に、スイッチング素子21がONする動作モードでは、つまり、負荷側で
消費されない余分なエネルギが電源側に戻る場合、負荷で消費されない余分なエ
ネルギ分も一旦インダクタ22に磁気エネルギとして蓄積され、これが電源側に
電気エネルギという形で戻ることになる。このように軽負荷側から電源側にエネ
ルギが戻るため、こと時に電力損失が発生し、電源効率が低下する。このため、
変動が大きい負荷に対しては、いかなる負荷状態でも電力を供給することができ
ない。また、これを第3図に示す回路構成で回避しようとする場合インダクタ2
2の容量が大きくなってしまう。
【0007】
本考案は上記事情に鑑みてなされたものであり、軽負荷時にも、効率よく電力
供給が可能な高効率電源回路を提供することを目的とする。
【0008】
【0009】
本考案は、外部信号によりオンオフする第1のスイッチング素子と、第1の
スイッチング素子の状態に従い負荷に対してエネルギを供給するインダクタと、
整流ダイオード、平滑コンデンサで構成されるDC−DCコンバータにおいて、
上記整流ダイオードと並列に接続され、第1のスイッチング素子と同期して両方
向にオンオフ制御を行う第2のスイッチング素子と、上記整流ダイオードならび
に第2のスイッチング素子による電圧降下を検出してインダクタに流れる電流の
方向を検出して第2のスイッチング素子をオンオフするコンパレータとを具備す
ることを特徴とする。
【0010】
【作用】
上述した構成中、コンパレータにてインダクタに流れる電流の方向を検知し
、そのコンパレータ出力により第2のスイッチング素子のON/OFFをコント
ロールすることにより、軽負荷時にも高効率の電源を実現する。このことにより
、軽負荷時にも効率が低下せず、また、インダクタ容量を大きくせずに済む。
【0011】
以下、図面を使用して本考案実施例について詳細に説明する。図1は本考案
の実施例を示す回路図である。
【0012】
図において、11は外部の信号によりON/OFFするバイポーラもしくはM
OSトランジスタで構成されるスイッチング素子、12はエネルギを蓄積するコ
イルあるいは電圧の大きさを変換するチョーク等インダクタ素子、13は平滑コ
ンデンサである。14はスイッチング素子11とは別の、スイッチング素子11
と同期して両方向スイッチング制御を行うスイッチング素子である。15はコン
パレータであり、スイッチング素子14の電圧降下を検出して、インダクタ12
に流れる電流の方向を検知し、その方向によりスイッチング素子14をON/O
FFする。尚、16、17は寄生ダイオードである。
【0013】
以下、本考案実施例の動作について詳細に説明する。図において、先ずスイッ
チング素子11がONになると、スイッチング素子14がONであった場合(ど
ういう動作モードの場合にONになっているかは後述する)、スイッチング素子
11→スイッチング素子14→GNDの経路でIon1 で示す電流が流れる。スイ
ッチング素子14には、コンパレータ15の出力でONになるような信号(ハイ
レベルの信号)が与えられるが、電流Ionが流れることにより、スイッチング素
子14の両端に若干の電圧降下が生じ、図中aで示す点が(+)、b点が(−)
の極性になる。そうなると、コンパレータ15の出力はローレベルに切り替わり
、スイッチング素子14はOFFする。電流がスイッチング素子14に流れなく
なってもコンパレータ15の出力はローレベルになっている。スイッチング素子
14がOFFすると、電源側から負荷側に電流Ion2 が流れ始める。
【0014】
次ぎに、スイッチング素子11がOFFすると、インダクタ12に蓄積された
エネルギが放出され電流Ioff1が流れる。このときスイッチング素子14はOF
Fしているが、スイッチング素子14の寄生ダイオード17を通して先ず流れる
。この時a点が(−)、b点が(+)となるため、コンパレータ15の出力はハ
イレベルになり、スイッチング素子14はONする。この時のスイッチング素子
14での電圧降下はかなり小さくなり、ダイオードを使用していた従来の方式に
比べて、効率が改善されることになる。インダクタ12に蓄えられたエネルギが
完全に放出されないうちにスイッチング素子11がONすると、この動作説明の
冒頭で説明した状態から同じ動作を繰り返す。
【0015】
次に、スイッチング素子11がOFFして、インダクタ12に蓄積されたエネ
ルギが完全に放出されても、まだスイッチング素子11がONしない場合、つま
り負荷が軽い場合、コンデンサ13に蓄積されたエネルギが、インダクタ12を
通してGND側に電流I0ff が流れる。この時、a点が(+)、b点が(−)に
なるため、スイッチング素子14にはローレベルの信号が与えられ、スイッチン
グ素子14は直ちにOFFする。従ってこの電流が流れなくなるため、負荷側か
ら電源側に電力が戻る動作モードが存在しなくなる。すなわち、軽負荷時にも電
源効率が低下しないことになる。実際には、Ioff2なる電流が流れてはじめてコ
ンパレータ15がスイッチング素子14をOFFするため、この間、ほんの僅か
の電力がインダクタ12に蓄積されて、Ioff3なる電流の経路で電源側に電力が
戻るが、戻る電力が極僅かであり、更にこのモードで損失される電力は更に小さ
いため、実使用上は問題にはならない。
【0016】
以上説明のように本考案荷よれば、軽負荷時にも効率が低下せず、また、イン
ダクタ容量を大きくせずに済むためコスト低減にも寄与する。
【図1】 本考案の実施例を示す回路図、
【図2】 従来例を示す回路図、
【図3】 従来例を示す回路図である。
11、14…スイッチング素子
12………インダクタ
13………コンデンサ
15………コンパレータ
16、17…寄生ダイオード
Claims (1)
- 【請求項1】 外部信号によりオンオフする第1のスイ
ッチング素子と、第1のスイッチング素子の状態に従い
負荷に対してエネルギを供給するインダクタと、整流ダ
イオード、平滑コンデンサで構成されるDC−DCコン
バータにおいて、上記整流ダイオードと並列に接続さ
れ、第1のスイッチング素子と同期して両方向にオンオ
フ制御を行う第2のスイッチング素子と、上記整流ダイ
オードならびに第2のスイッチング素子による電圧降下
を検出してインダクタに流れる電流の方向を検出して第
2のスイッチング素子をオンオフするコンパレータとを
具備することを特徴とする高効率電源回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP99491U JP2555245Y2 (ja) | 1991-01-17 | 1991-01-17 | 高効率電源回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP99491U JP2555245Y2 (ja) | 1991-01-17 | 1991-01-17 | 高効率電源回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH04101286U true JPH04101286U (ja) | 1992-09-01 |
JP2555245Y2 JP2555245Y2 (ja) | 1997-11-19 |
Family
ID=31728079
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP99491U Expired - Lifetime JP2555245Y2 (ja) | 1991-01-17 | 1991-01-17 | 高効率電源回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2555245Y2 (ja) |
Cited By (10)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2002526013A (ja) * | 1998-09-10 | 2002-08-13 | ローベルト ボツシユ ゲゼルシヤフト ミツト ベシユレンクテル ハフツング | 降圧チョーク変換器 |
US7135844B2 (en) | 2003-04-28 | 2006-11-14 | Torex Device Co., Ltd. | Control circuit for DC/DC converter |
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EP0617501B2 (en) † | 1993-03-23 | 2007-07-11 | Linear Technology Corporation | Control circuit for maintaining high efficiency over broad current ranges in a switching regulator circuit |
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US7876076B2 (en) | 2006-05-11 | 2011-01-25 | Fujitsu Semiconductor Limited | Circuit for preventing through current in DC-DC converter |
JP2015119614A (ja) * | 2013-11-15 | 2015-06-25 | 株式会社リコー | 蓄電状態調整回路、蓄電状態調整装置及び電池パック |
JP2015192563A (ja) * | 2014-03-28 | 2015-11-02 | ラピスセミコンダクタ株式会社 | 昇圧回路、半導体装置、及び昇圧回路の制御方法 |
-
1991
- 1991-01-17 JP JP99491U patent/JP2555245Y2/ja not_active Expired - Lifetime
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Also Published As
Publication number | Publication date |
---|---|
JP2555245Y2 (ja) | 1997-11-19 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 19970708 |
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EXPY | Cancellation because of completion of term |