JPH0382437U - - Google Patents
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- Publication number
- JPH0382437U JPH0382437U JP14226289U JP14226289U JPH0382437U JP H0382437 U JPH0382437 U JP H0382437U JP 14226289 U JP14226289 U JP 14226289U JP 14226289 U JP14226289 U JP 14226289U JP H0382437 U JPH0382437 U JP H0382437U
- Authority
- JP
- Japan
- Prior art keywords
- selection control
- interrupt signal
- input
- register
- registers
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 1
Landscapes
- Bus Control (AREA)
Description
第1図は本考案の一実施例のブロツク図である
。 R1〜Rn……第1…第nのレジスタ、S1〜
Sn……第1〜第nのセレクタ。
。 R1〜Rn……第1…第nのレジスタ、S1〜
Sn……第1〜第nのセレクタ。
Claims (1)
- 外部から入力された設定信号の選択制御値に応
じて選択制御信号を出力する複数のレジスタと、
このレジスタ毎に設けられ前記選択制御信号によ
り選択された入力の割込信号をCPUに出力する
複数のセレクタとを有することを特徴とするプロ
グラマブル割込信号選択回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP14226289U JPH0382437U (ja) | 1989-12-07 | 1989-12-07 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP14226289U JPH0382437U (ja) | 1989-12-07 | 1989-12-07 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0382437U true JPH0382437U (ja) | 1991-08-22 |
Family
ID=31689098
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP14226289U Pending JPH0382437U (ja) | 1989-12-07 | 1989-12-07 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0382437U (ja) |
-
1989
- 1989-12-07 JP JP14226289U patent/JPH0382437U/ja active Pending