JPH0265179U - - Google Patents

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JPH0265179U
JPH0265179U JP14367388U JP14367388U JPH0265179U JP H0265179 U JPH0265179 U JP H0265179U JP 14367388 U JP14367388 U JP 14367388U JP 14367388 U JP14367388 U JP 14367388U JP H0265179 U JPH0265179 U JP H0265179U
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Japan
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circuit
test
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parallel
input
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【図面の簡単な説明】
第1図は本考案の回路図であり、第2図は本考
案のパラレル―シリアル変換回路であり、第3図
は本考案のタイミング図である。 1〜4……回路ブロツク、5〜8……パラレル
―シリアル変換回路、9,20,30,31……
アンド回路、21……オア回路、22,23……
T型フリツプフロツプ、24……ワンシヨツトマ
ルチ回路、25……テスト入力端子、26……リ
セツトスイツチ、27……テスト出力端子、32
……インバータ、33〜50……クロツクドイン
バータ。

Claims (1)

    【実用新案登録請求の範囲】
  1. 所定の機能を満足するために、複数の回路ブロ
    ツクを有機的に結合、あるいは組み合わせた集積
    回路において、前記複数の回路ブロツクの入出力
    にそれぞれに対応して接続される複数のパラレル
    ―シリアル変換回路と、該複数のパラレル―シリ
    アル変換回路のいずれか1個に動作起動を指示す
    る起動指示回路と、前記複数のパラレル―シリア
    ル変換回路のそれぞれの出力を選択的に出力する
    選択回路と、単一のテスト入力端子によつて制御
    されるテストモードレジスタから構成され、前記
    単一のテスト入力端子に印加されるテスト開始信
    号に応じて前記テストモードレジスタがモード変
    化し、前記テストモードレジスタの計数内容に従
    つて前記起動指示回路と前記選択回路がそれぞれ
    制御されることにより、前記単一のテスト入力端
    子によつて前記複数の回路ブロツクの入出力信号
    を選択的にパラレル―シリアル変換し、かつ単一
    のテスト出力端子ヘデータアウトすることを特徴
    とする集積回路のテスト回路。
JP14367388U 1988-11-02 1988-11-02 Pending JPH0265179U (ja)

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JP14367388U JPH0265179U (ja) 1988-11-02 1988-11-02

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JP14367388U JPH0265179U (ja) 1988-11-02 1988-11-02

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JPH0265179U true JPH0265179U (ja) 1990-05-16

Family

ID=31410702

Family Applications (1)

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JP14367388U Pending JPH0265179U (ja) 1988-11-02 1988-11-02

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JP (1) JPH0265179U (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH04301782A (ja) * 1991-03-29 1992-10-26 Nec Eng Ltd テスト容易化回路

Cited By (1)

* Cited by examiner, † Cited by third party
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JPH04301782A (ja) * 1991-03-29 1992-10-26 Nec Eng Ltd テスト容易化回路

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