JPH0377474A - 画像入力装置 - Google Patents
画像入力装置Info
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- JPH0377474A JPH0377474A JP1212125A JP21212589A JPH0377474A JP H0377474 A JPH0377474 A JP H0377474A JP 1212125 A JP1212125 A JP 1212125A JP 21212589 A JP21212589 A JP 21212589A JP H0377474 A JPH0377474 A JP H0377474A
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- JP
- Japan
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- data
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- stored
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- Pending
Links
- 238000006243 chemical reaction Methods 0.000 claims abstract description 15
- 230000006866 deterioration Effects 0.000 abstract 1
- 238000010586 diagram Methods 0.000 description 3
- 101100328887 Caenorhabditis elegans col-34 gene Proteins 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 238000000034 method Methods 0.000 description 2
- 238000010276 construction Methods 0.000 description 1
- 230000007423 decrease Effects 0.000 description 1
- 230000006870 function Effects 0.000 description 1
- 238000004519 manufacturing process Methods 0.000 description 1
- 239000012528 membrane Substances 0.000 description 1
- 230000035945 sensitivity Effects 0.000 description 1
Landscapes
- Transforming Light Signals Into Electric Signals (AREA)
- Facsimile Image Signal Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(産業上の利用分野)
本発明は、画像入力装置に関するもので、特に光源や光
電変換素子の感度のばらつきを補正する技術に関する。
電変換素子の感度のばらつきを補正する技術に関する。
(従来の技術)
近年、ファクシミリの需要の増加や住所録テープ処理装
置1(Directory Tape Process
or)への期待により画像入力装置の開発が盛んに行な
われている。
置1(Directory Tape Process
or)への期待により画像入力装置の開発が盛んに行な
われている。
第3図は従来の画像入力装置の概要構成を示すものであ
る。第3図において、 12は光電変換手段。
る。第3図において、 12は光電変換手段。
13は符号化手段、 14は記憶手段である。
次に上記従来例の動作について説明する。符号化手段1
3は光電変換手段12からの出力を記憶手段14に蓄え
られたデータと比較しながら符号化を行う、記憶手段1
4に蓄えられたデータはシェーディングデータと呼ばれ
、光電変換手段12の出力のばらつきを補正するための
ものである。
3は光電変換手段12からの出力を記憶手段14に蓄え
られたデータと比較しながら符号化を行う、記憶手段1
4に蓄えられたデータはシェーディングデータと呼ばれ
、光電変換手段12の出力のばらつきを補正するための
ものである。
(発明が解決しようとする課題)
しかしながら上記従来の構成では、記憶手段を読取専用
メモリ(ROM)により構成した場合には。
メモリ(ROM)により構成した場合には。
生産時に各画像入力装置ごとに白い原稿などを読ませた
データをとる工程が必要であり、また光源の経時変化等
により正しく補正ができなくなり画質が低下するという
問題を有しており、記憶手段をランダムアクセスメモリ
(RAM)により構威した場合、−膜内には読み取り動
作前に原稿を押さえる白プラテンを読むことによりシェ
ーディングデータを得るが、この白プラテンが汚れてし
まうと正しい補正ができなくなり画質が低下するという
問題を有していた。
データをとる工程が必要であり、また光源の経時変化等
により正しく補正ができなくなり画質が低下するという
問題を有しており、記憶手段をランダムアクセスメモリ
(RAM)により構威した場合、−膜内には読み取り動
作前に原稿を押さえる白プラテンを読むことによりシェ
ーディングデータを得るが、この白プラテンが汚れてし
まうと正しい補正ができなくなり画質が低下するという
問題を有していた。
本発明は上記従来の問題を解決するものであり。
画質が低下しない画像入力装置を提供することを目的と
するものである。
するものである。
(課題を解決するための手段)
本発明は上記目的を達成するために、記憶手段をRAM
により構威し、符号化手段からの出力データと記憶手段
に蓄えられているデータを比較する手段を備えたもので
ある。
により構威し、符号化手段からの出力データと記憶手段
に蓄えられているデータを比較する手段を備えたもので
ある。
(作 用)
本発明は上記構成により、読み取り動作中に原稿の白の
部分によりシェーディングデータを記憶手段に蓄えるこ
とができる。
部分によりシェーディングデータを記憶手段に蓄えるこ
とができる。
(実施例)
第工図は本発明の一実施例における画像入力装置の概略
構成を示したものである。第1図において、12は光電
変換手段、13は符号化手段、14は記憶手段、15は
比較手段である。
構成を示したものである。第1図において、12は光電
変換手段、13は符号化手段、14は記憶手段、15は
比較手段である。
次に上記実施例の動作について説明する。上記実施例に
おいて、第3図の従来例と同様、符号化手段13は光電
変換手段12からの出力を記憶手段14に蓄えられたデ
ータと比較しながら符号化を行う。
おいて、第3図の従来例と同様、符号化手段13は光電
変換手段12からの出力を記憶手段14に蓄えられたデ
ータと比較しながら符号化を行う。
一方、符号化手段13からのデータと記憶手段14に蓄
えられているデータを比較手段15で比較し、符号化手
段13からのデータが記憶手段14に蓄えられているデ
ータより大きい場合は、符号化手段13からのデータを
記憶手段14に蓄える。
えられているデータを比較手段15で比較し、符号化手
段13からのデータが記憶手段14に蓄えられているデ
ータより大きい場合は、符号化手段13からのデータを
記憶手段14に蓄える。
第2図は第1図の実施例における画像入力装置の回路ブ
ロック構成を示すものである。第2図において、1は発
振器、2は装置全体を制御するCPU、3はプログラム
を蓄積するROM、4はワークエリアとシェーディング
データを蓄えるRAM、5はタイミング発生回路、6は
電荷結合素子(CCD)などによるイメージセンサ、7
はアナログデジタル変換器(A D C)、8,9はデ
ータラッチ、10はマグニチュードコンパレータ、11
はデータセレクタである。
ロック構成を示すものである。第2図において、1は発
振器、2は装置全体を制御するCPU、3はプログラム
を蓄積するROM、4はワークエリアとシェーディング
データを蓄えるRAM、5はタイミング発生回路、6は
電荷結合素子(CCD)などによるイメージセンサ、7
はアナログデジタル変換器(A D C)、8,9はデ
ータラッチ、10はマグニチュードコンパレータ、11
はデータセレクタである。
次に、上記のように構成された画像入力装置の動作につ
いて説明する。上記実施例において、イメージセンサ6
の出力をアナログデジタル変換器7においてデジタルデ
ータに変換し、RAM4に蓄えられているシェーディン
グデータとともにマグニチュードコンパレータlOに入
力し、マグニチュードコンパレータ10の出力がイメー
ジセンサ6からのデータがRAM4からのシェーディン
グデータよりも大きいときに対応しているときは、イメ
ージセンサ6からのデータをデータセレクタ11から出
力しRAM4に書き込む、なお、データラッチ8,9や
データバスへの出力のタイミングなどはタイミング発生
回路5により制御される。
いて説明する。上記実施例において、イメージセンサ6
の出力をアナログデジタル変換器7においてデジタルデ
ータに変換し、RAM4に蓄えられているシェーディン
グデータとともにマグニチュードコンパレータlOに入
力し、マグニチュードコンパレータ10の出力がイメー
ジセンサ6からのデータがRAM4からのシェーディン
グデータよりも大きいときに対応しているときは、イメ
ージセンサ6からのデータをデータセレクタ11から出
力しRAM4に書き込む、なお、データラッチ8,9や
データバスへの出力のタイミングなどはタイミング発生
回路5により制御される。
(発明の効果)
本発明は上記実施例より明らかなように、シェーディン
グROMが不要で、自プラテンの汚れの影響がない優れ
た画像入力装置を実現できるという効果を有する。
グROMが不要で、自プラテンの汚れの影響がない優れ
た画像入力装置を実現できるという効果を有する。
第1図は本発明の一実施例における画像入力装置の概略
構成図、第2図は第1図の実施例における回路ブロック
図、第3図は従来の画像入力装置の概略構成図である。 1 ・・・発振器、 2 ・・・CPU、 3ROM、
4 ・・・RAM、 5 ・・・タイミング
発生回路、 6 ・・・イメージセンサ、7・・・アナ
ログデジタル変換器、 8,9・・・データラッチ、1
0・・・マグニチュードコンパレータ、11・・・デー
タセレクタ。 12・・・光電変換手段、13・・・符号化手段、14
・・・記憶手段、15・・・比較手段。
構成図、第2図は第1図の実施例における回路ブロック
図、第3図は従来の画像入力装置の概略構成図である。 1 ・・・発振器、 2 ・・・CPU、 3ROM、
4 ・・・RAM、 5 ・・・タイミング
発生回路、 6 ・・・イメージセンサ、7・・・アナ
ログデジタル変換器、 8,9・・・データラッチ、1
0・・・マグニチュードコンパレータ、11・・・デー
タセレクタ。 12・・・光電変換手段、13・・・符号化手段、14
・・・記憶手段、15・・・比較手段。
Claims (2)
- (1)複数個の光電変換素子からなる光電変換手段と、
前記光電変換手段からの信号を各光電変換素子に対応し
たデータに変換する符号化手段と、前記データを各光電
変換素子に対応した場所に蓄える記憶手段と、前記符号
化手段からのデータと前記記憶手段に蓄えられているデ
ータを比較する比較手段を備え、前記符号化手段からの
データが前記記憶手段に蓄えられているデータより大き
い場合、前記符号化手段からのデータを前記記憶手段に
蓄えることにより、入力した各光電変換素子に対応する
データの最大値を前記記憶手段に記憶するように構成し
たことを特徴とする画像入力装置。 - (2)読み取り動作の前に記憶手段に予め定められた一
定の値を書き込む動作を行うことを特徴とする請求項(
1)記載の画像入力装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1212125A JPH0377474A (ja) | 1989-08-19 | 1989-08-19 | 画像入力装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1212125A JPH0377474A (ja) | 1989-08-19 | 1989-08-19 | 画像入力装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0377474A true JPH0377474A (ja) | 1991-04-03 |
Family
ID=16617301
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1212125A Pending JPH0377474A (ja) | 1989-08-19 | 1989-08-19 | 画像入力装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0377474A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH08274987A (ja) * | 1995-03-28 | 1996-10-18 | Nec Corp | シェーディング補正方式 |
US9702987B2 (en) | 2015-07-16 | 2017-07-11 | Kabushiki Kaisha Toshiba | Neutron measurement apparatus, neutron calculation apparatus, and neutron measurement method |
-
1989
- 1989-08-19 JP JP1212125A patent/JPH0377474A/ja active Pending
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH08274987A (ja) * | 1995-03-28 | 1996-10-18 | Nec Corp | シェーディング補正方式 |
US9702987B2 (en) | 2015-07-16 | 2017-07-11 | Kabushiki Kaisha Toshiba | Neutron measurement apparatus, neutron calculation apparatus, and neutron measurement method |
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