JPH0374068A - パッケージの電源供給方式 - Google Patents
パッケージの電源供給方式Info
- Publication number
- JPH0374068A JPH0374068A JP1208230A JP20823089A JPH0374068A JP H0374068 A JPH0374068 A JP H0374068A JP 1208230 A JP1208230 A JP 1208230A JP 20823089 A JP20823089 A JP 20823089A JP H0374068 A JPH0374068 A JP H0374068A
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- Japan
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- package
- connector
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- 238000003780 insertion Methods 0.000 abstract description 3
- 230000037431 insertion Effects 0.000 abstract description 3
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- 230000000694 effects Effects 0.000 description 3
- 230000001934 delay Effects 0.000 description 1
- 235000015250 liver sausages Nutrition 0.000 description 1
Landscapes
- Power Sources (AREA)
- Details Of Connecting Devices For Male And Female Coupling (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、コネクタを介して装着する電子回路配線板９
１の電源線３９に常時電源を供給してい・た、電子回路
のパッケージ８０はパッケージ端子８１をコネクタ９２
に挿入することで即時に交換機用の一’４８Ｖ、＋５Ｖ
のディジタル用、−５■のアナ□グ用、＋５ｖのアナロ
グ用、それぞれの電源が電源線３９を介しパッケージ８
０に供給される構造になっていた。しかし、電子回路の
パッケージ端子８１の長さには多少の相違があり先端が
不揃いであり、又、パッケージ８０を斜めに挿入した場
合コネクタ９２に接触さ、れるパッケージ端子８１の順
序が不均一になる。
１の電源線３９に常時電源を供給してい・た、電子回路
のパッケージ８０はパッケージ端子８１をコネクタ９２
に挿入することで即時に交換機用の一’４８Ｖ、＋５Ｖ
のディジタル用、−５■のアナ□グ用、＋５ｖのアナロ
グ用、それぞれの電源が電源線３９を介しパッケージ８
０に供給される構造になっていた。しかし、電子回路の
パッケージ端子８１の長さには多少の相違があり先端が
不揃いであり、又、パッケージ８０を斜めに挿入した場
合コネクタ９２に接触さ、れるパッケージ端子８１の順
序が不均一になる。
上述した従来のパッケージの電源供給方式は、はぼ同列
に並ぶパッケージ端子をモジュールのコネクタに挿入し
てパッケージへ電源供給する構成になっているので、通
常は電源供給パッケージのスイッチを操作することなく
抜き差しする電子回路のパッケージが、パッケージ端子
先端の不揃い、斜め挿入などのため、−４８Ｖ・＋５■
のディジタル用、−５■のアナログ用、＋５■のアナロ
グ用の順で電源の供給を受けられず、パッケージ内の集
積回路を確壊する機会があるという問題点があった。
に並ぶパッケージ端子をモジュールのコネクタに挿入し
てパッケージへ電源供給する構成になっているので、通
常は電源供給パッケージのスイッチを操作することなく
抜き差しする電子回路のパッケージが、パッケージ端子
先端の不揃い、斜め挿入などのため、−４８Ｖ・＋５■
のディジタル用、−５■のアナログ用、＋５■のアナロ
グ用の順で電源の供給を受けられず、パッケージ内の集
積回路を確壊する機会があるという問題点があった。
本発明の目的は上記問題点を解決したパッテーの電源供
給方式を提供することにある。
給方式を提供することにある。
本発明によるパッケージの電源供給方式は、パッケージ
端子を挿入してコネクタに接続する電子回路のパッケー
ジがパッケージ端子列の先端辺から深い位置に先端を配
し内部で短絡回路をもって接続する二つのパッケージ端
子を有し、これらの二つのパッケージ端子の一方から所
定の駆動電源を入力するときパッケージへ出力する複数
の電源を所定の順序の遅延をもってコネクタを介して前
記パッケージへ出力するスイッチ回路とを有する。
端子を挿入してコネクタに接続する電子回路のパッケー
ジがパッケージ端子列の先端辺から深い位置に先端を配
し内部で短絡回路をもって接続する二つのパッケージ端
子を有し、これらの二つのパッケージ端子の一方から所
定の駆動電源を入力するときパッケージへ出力する複数
の電源を所定の順序の遅延をもってコネクタを介して前
記パッケージへ出力するスイッチ回路とを有する。
上述の手段によるパッケージの電源供給方式は、コネク
タで駆動電源用の二つのパッケージ端子の一方に所定の
駆動電源を接続するとき挿着されたパッケージを介して
他方から駆動電源を帰還させるので、この駆動電源を入
力して駆動したスイッチ回路が所定の順序でパッケージ
へコネクタおよびパッケージ端子を介して電源投入でき
る。
タで駆動電源用の二つのパッケージ端子の一方に所定の
駆動電源を接続するとき挿着されたパッケージを介して
他方から駆動電源を帰還させるので、この駆動電源を入
力して駆動したスイッチ回路が所定の順序でパッケージ
へコネクタおよびパッケージ端子を介して電源投入でき
る。
次に本発明について図面を参照して説明する。
第１図は本発明の一実施例を示す構成斜視図である。第
１図には、モジュール１０に電子回路のパッケージ２０
および電源供給パッケージ３０が搭載される。モジュー
ル１０の裏面配線板１１にはパッケージ２０挿着用のコ
ネクタ１２．電源供給パッケージ３０からの電源線３１
．およびスイッチ回路４０が配備され、電源供給パッケ
ージ３０からの電源はスイッチ回路４０およびコネクタ
１２を介し、パッケージ２０のパッケージ端子２１に結
合する。
１図には、モジュール１０に電子回路のパッケージ２０
および電源供給パッケージ３０が搭載される。モジュー
ル１０の裏面配線板１１にはパッケージ２０挿着用のコ
ネクタ１２．電源供給パッケージ３０からの電源線３１
．およびスイッチ回路４０が配備され、電源供給パッケ
ージ３０からの電源はスイッチ回路４０およびコネクタ
１２を介し、パッケージ２０のパッケージ端子２１に結
合する。
第２図は第１図でのコネクタ１２とパッケージ端子２０
の関係の一例を示す平面図である。コネクタ１２は二つ
のコネクタ端子１３，１４を有しコネクタ端子１３は常
に“ハイレベル”の＋５■電源を接続する。パッケージ
２０の二つのパッケージ端子２３．２４のそれぞれはコ
ネクタ端子１３．１４のそれぞれに対応して結合し、パ
ッケージ２０の内部で短絡接続され、且つ他のパッケー
ジ端子より短かくコネクタ端子１３．１４には最後に接
触する。
の関係の一例を示す平面図である。コネクタ１２は二つ
のコネクタ端子１３，１４を有しコネクタ端子１３は常
に“ハイレベル”の＋５■電源を接続する。パッケージ
２０の二つのパッケージ端子２３．２４のそれぞれはコ
ネクタ端子１３．１４のそれぞれに対応して結合し、パ
ッケージ２０の内部で短絡接続され、且つ他のパッケー
ジ端子より短かくコネクタ端子１３．１４には最後に接
触する。
第３図はコネクタ１２にパッケージ２０が挿着された状
態の一例を示す接続図である。第２図を併せ参照すれば
、パッケージ２０がコネクタ１２に挿着されたとき＋５
ｖ電源はコネクタ端子１３−パッケージ端子２３・２４
−コネクタ端子１４を介して駆動電源としてスイッチ回
路４０を駆動する。駆動されたスイッチ回路４０は各種
電源をコネクタ１２を介してパッケージ２０へ出力する
。
態の一例を示す接続図である。第２図を併せ参照すれば
、パッケージ２０がコネクタ１２に挿着されたとき＋５
ｖ電源はコネクタ端子１３−パッケージ端子２３・２４
−コネクタ端子１４を介して駆動電源としてスイッチ回
路４０を駆動する。駆動されたスイッチ回路４０は各種
電源をコネクタ１２を介してパッケージ２０へ出力する
。
次に、第４図を参照してスイッチ回路４０について説明
する。第４図はスイッチ回路の一例を示す機能ブロック
図である。スイッチ回路４０はバッファ回路４１．リレ
ードライバ４２．遅延回路４３〜４５およびリレー４６
〜４９を有する。
する。第４図はスイッチ回路の一例を示す機能ブロック
図である。スイッチ回路４０はバッファ回路４１．リレ
ードライバ４２．遅延回路４３〜４５およびリレー４６
〜４９を有する。
スイッチ回路４０は駆動電源の“ハイレベル”信号を＋
５ｖ電源によりバッファ回路４１で受信し、バッファ回
路４１はリレードライバ４２．遅延回路４３〜４５のそ
れぞれへ出力する。遅延回路４３〜４５は番号の順序で
遅延が大きく、出力をリレードライバ４汐へ接続する。
５ｖ電源によりバッファ回路４１で受信し、バッファ回
路４１はリレードライバ４２．遅延回路４３〜４５のそ
れぞれへ出力する。遅延回路４３〜４５は番号の順序で
遅延が大きく、出力をリレードライバ４汐へ接続する。
リレードライ＝し
バ４ｔは入力順にリレー４６〜４９を順次駆動する。そ
れぞれのリレー４６〜４９は駆動により一４８Ｖ・＋５
ｖのディジタル用、 −５Ｖのアナログ用、＋５ｖのア
ナログ用それぞれの電源をこの順序でコネクタ１２を介
し、挿着されたパッケージ２０へ供給する。
れぞれのリレー４６〜４９は駆動により一４８Ｖ・＋５
ｖのディジタル用、 −５Ｖのアナログ用、＋５ｖのア
ナログ用それぞれの電源をこの順序でコネクタ１２を介
し、挿着されたパッケージ２０へ供給する。
以上説明した様に本発明は駆動電源用の短かいパッケー
ジ端子をパッケージが備え、遅延回路を内蔵するスイッ
チ回路を設けることにより、所定の電源供給の順序が的
確に行なわれるので、電子回路のパッケージ挿入時に生
じる集積回路の破壊を防ぐことができる効果がある。
ジ端子をパッケージが備え、遅延回路を内蔵するスイッ
チ回路を設けることにより、所定の電源供給の順序が的
確に行なわれるので、電子回路のパッケージ挿入時に生
じる集積回路の破壊を防ぐことができる効果がある。
第１図は本発明のパッケージの電源供給方式の一実施例
を示す構成図、第２図はパッケージ挿入前の部分詳細の
一例を示す平面図、第３図は、パッケージ挿入後の一例
を示す接続図、第４図は第１図・第３図のスイッチ回路
の一例を示す機能ブロック図、第５図は従来の一例を示
す構成図である。 １２・・・・・・コネクタ、１３，１４・・・・・・コ
ネクタ端子、２０・・・・・・パッケージ、２１，２３
，２４・・・・・・パッケージ端子、４０・・・・・・
スイッチ回路、４３゜４４．４５・・・・・・遅延回路
。
を示す構成図、第２図はパッケージ挿入前の部分詳細の
一例を示す平面図、第３図は、パッケージ挿入後の一例
を示す接続図、第４図は第１図・第３図のスイッチ回路
の一例を示す機能ブロック図、第５図は従来の一例を示
す構成図である。 １２・・・・・・コネクタ、１３，１４・・・・・・コ
ネクタ端子、２０・・・・・・パッケージ、２１，２３
，２４・・・・・・パッケージ端子、４０・・・・・・
スイッチ回路、４３゜４４．４５・・・・・・遅延回路
。
Claims (1)
- パッケージ端子を挿入してコネクタに接続する電気回路
のパッケージがパッケージ端子列の先端辺から深い位置
に先端を配し内部で短絡回路をもって接続する二つのパ
ッケージ端子を有し、これらの二つのパッケージ端子の
一方から所定の駆動電源を入力するときパッケージへ出
力する複数の電源を所定の順序の遅延をもってコネクタ
を介して前記パッケージへ出力するスイッチ回路とを有
することを特徴とするパッケージの電源供給方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1208230A JPH0374068A (ja) | 1989-08-11 | 1989-08-11 | パッケージの電源供給方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1208230A JPH0374068A (ja) | 1989-08-11 | 1989-08-11 | パッケージの電源供給方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0374068A true JPH0374068A (ja) | 1991-03-28 |
Family
ID=16552813
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1208230A Pending JPH0374068A (ja) | 1989-08-11 | 1989-08-11 | パッケージの電源供給方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0374068A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO1999018492A1 (fr) * | 1997-10-02 | 1999-04-15 | Omron Corporation | Machine de traitement de l'information |
| JP2018019618A (ja) * | 2016-08-02 | 2018-02-08 | 太平洋工業株式会社 | リールコントローラ及び電動リール |
-
1989
- 1989-08-11 JP JP1208230A patent/JPH0374068A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO1999018492A1 (fr) * | 1997-10-02 | 1999-04-15 | Omron Corporation | Machine de traitement de l'information |
| US6236171B1 (en) | 1997-10-02 | 2001-05-22 | Omron Corporation | Image reading device |
| JP2018019618A (ja) * | 2016-08-02 | 2018-02-08 | 太平洋工業株式会社 | リールコントローラ及び電動リール |
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