JPH0374052U - - Google Patents

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JPH0374052U
JPH0374052U JP13512389U JP13512389U JPH0374052U JP H0374052 U JPH0374052 U JP H0374052U JP 13512389 U JP13512389 U JP 13512389U JP 13512389 U JP13512389 U JP 13512389U JP H0374052 U JPH0374052 U JP H0374052U
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JP
Japan
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address
microprocessor
output port
auto
circuit
Prior art date
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JP13512389U
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Description

【図面の簡単な説明】
第1,2図は本考案のアドレス管理回路の一実
施例を示す図であり、第1図はそのアドレス管理
回路を適用したマイクロプロセツサのシステム図
、第2図はその作用を説明するためのタイミング
チヤートである。第3図は従来のマイクロプロセ
ツサのシステム図である。 11……CPU、12……出力ポート、13…
…アドレスオートインクリメント回路、14……
アドレスデゴード、15,16……ANDゲート
、17……ORゲート、18……アドレスバス、
19……アドレス管理回路、M〜Mn……メモ
リ。

Claims (1)

    【実用新案登録請求の範囲】
  1. マイクロプロセツサと該マイクロプロセツサの
    アクセスするメモリとの間に、出力ポートとアド
    レスオートインクリメント回路を設けたアドレス
    管理回路であつて、マイクロプロセツサが所定ア
    ドレスを出力ポートに出力すると、出力ポートが
    連続したアドレス空間の先頭アドレスとしてセツ
    トアツプしてアドレスオートインクリメント回路
    に出力し、アドレスオートインクリメント回路が
    マイクロプロセツサからクロツクが入力される毎
    に該先頭アドレスから順次アドレスをインクリメ
    ントしてメモリのアドレス指定を行うことを特徴
    とするアドレス管理回路。
JP13512389U 1989-11-20 1989-11-20 Pending JPH0374052U (ja)

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JP13512389U JPH0374052U (ja) 1989-11-20 1989-11-20

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JP13512389U JPH0374052U (ja) 1989-11-20 1989-11-20

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JPH0374052U true JPH0374052U (ja) 1991-07-25

Family

ID=31682412

Family Applications (1)

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JP13512389U Pending JPH0374052U (ja) 1989-11-20 1989-11-20

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JP (1) JPH0374052U (ja)

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