JPH0370469A - スイッチング電源の異常検出回路 - Google Patents
スイッチング電源の異常検出回路Info
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- JPH0370469A JPH0370469A JP20520889A JP20520889A JPH0370469A JP H0370469 A JPH0370469 A JP H0370469A JP 20520889 A JP20520889 A JP 20520889A JP 20520889 A JP20520889 A JP 20520889A JP H0370469 A JPH0370469 A JP H0370469A
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- 230000005856 abnormality Effects 0.000 title claims abstract description 31
- 238000001514 detection method Methods 0.000 claims abstract description 15
- 238000007599 discharging Methods 0.000 claims description 2
- 239000003990 capacitor Substances 0.000 abstract description 10
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- 230000007257 malfunction Effects 0.000 abstract description 2
- 230000002265 prevention Effects 0.000 abstract description 2
- 238000004804 winding Methods 0.000 description 5
- 238000010586 diagram Methods 0.000 description 3
- 238000003079 width control Methods 0.000 description 3
- 238000009499 grossing Methods 0.000 description 1
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
技術分野
本発明はスイッチング電源の異常検出回路に関し、特に
ＤＣ−ＤＣコンバータ等のスイッチング電源の出力の異
常を検出する異常検出回路に関するものである。
ＤＣ−ＤＣコンバータ等のスイッチング電源の出力の異
常を検出する異常検出回路に関するものである。
従来技術
従来のこの種の異常検出回路においては、特に異常検出
対象がＤＣ−ＤＣコンバータの場合、出力の直流電圧を
監視するようになっており、この電圧が異常に低下した
ときに異常信号を発生するように構成されている。
対象がＤＣ−ＤＣコンバータの場合、出力の直流電圧を
監視するようになっており、この電圧が異常に低下した
ときに異常信号を発生するように構成されている。
この様な従来の異常検出回路では、直流出力の異常を検
出する構成のために、例えば突然ＤＣ−ＤＣコンバータ
の主回路部のスイッチングトランジスタが破損しても、
異常検出までにはかなりの時間遅れを生じる。更には、
ＤＣ−ＤＣコンバータを並列に接続しつつ運転している
際に、−台のコンバータに異常が生じた場合、他のコン
バータにより正常に出力可能であれば、異常検出が不可
能であるという欠点がある。
出する構成のために、例えば突然ＤＣ−ＤＣコンバータ
の主回路部のスイッチングトランジスタが破損しても、
異常検出までにはかなりの時間遅れを生じる。更には、
ＤＣ−ＤＣコンバータを並列に接続しつつ運転している
際に、−台のコンバータに異常が生じた場合、他のコン
バータにより正常に出力可能であれば、異常検出が不可
能であるという欠点がある。
発明の目的
そこで、本発明はかかる従来のものの欠点を除去すべく
なされたものであり、その目的とするところは、異常検
出に遅れを生じることなく、またＤＣ−ＤＣコンバータ
の複数並列運転時における一台の異常をも正確に検出す
ることができるスイッチング電源の異常検出回路を提供
することにある。
なされたものであり、その目的とするところは、異常検
出に遅れを生じることなく、またＤＣ−ＤＣコンバータ
の複数並列運転時における一台の異常をも正確に検出す
ることができるスイッチング電源の異常検出回路を提供
することにある。
発明の構成
本発明によれば、スイッチング用のパルスを発生するパ
ルス発生手段と、このパルスに同期して入力電圧をスイ
ッチングするスイッチング手段とを含み、このスイッチ
ング出力を平滑化して直流電圧を得るようにしたスイッ
チング電源の異常検出回路であって、前記パルスにより
充電される充電手段と、この充１ｍ圧と基準電圧とを比
較する比較手段と、前記スイッチング出力により前記充
電手段を放電制御する放電制御手段とを含み、前記比較
手段の出力により異常検出をなすようにしたことを特徴
とする異常検出回路が得られる。
ルス発生手段と、このパルスに同期して入力電圧をスイ
ッチングするスイッチング手段とを含み、このスイッチ
ング出力を平滑化して直流電圧を得るようにしたスイッ
チング電源の異常検出回路であって、前記パルスにより
充電される充電手段と、この充１ｍ圧と基準電圧とを比
較する比較手段と、前記スイッチング出力により前記充
電手段を放電制御する放電制御手段とを含み、前記比較
手段の出力により異常検出をなすようにしたことを特徴
とする異常検出回路が得られる。
実施例
以下、図面を参照して本発明の実施例を詳細に説明する
。
。
第１図は本発明の実施例の回路図である。スイッチング
トランジスタ１はトランス２の１次巻線に直列に接続さ
れ、この１次巻線に印加される人力直流電圧をスイッチ
ングする。トランス２の２次巻線からスイッチング出力
が得られ、これが図示せぬ平滑回路において直流電圧と
される。
トランジスタ１はトランス２の１次巻線に直列に接続さ
れ、この１次巻線に印加される人力直流電圧をスイッチ
ングする。トランス２の２次巻線からスイッチング出力
が得られ、これが図示せぬ平滑回路において直流電圧と
される。
カレントトランス３はトランス２の２次側におけるスイ
ッチング出力パルスを検出するものである。この検出パ
ルスは一方向性ダイオード１３を介して抵抗１１．１２
による分圧回路へ入力されている。この分圧出力はトラ
ンジスタ９のベース入力となっている。
ッチング出力パルスを検出するものである。この検出パ
ルスは一方向性ダイオード１３を介して抵抗１１．１２
による分圧回路へ入力されている。この分圧出力はトラ
ンジスタ９のベース入力となっている。
一方、パルス発生器４が設けられており、このパルスＡ
はパルス幅制御駆動回路５にてスイッチングトランジス
タ１のスイッチングパルスとされている。
はパルス幅制御駆動回路５にてスイッチングトランジス
タ１のスイッチングパルスとされている。
また、パルス発生器４のパルスＡは抵抗６．ダイオード
７及びコンデンサ８からなる充電回路へ人力され、コン
デンサ８の充電がなされる。この充電電圧Ｂはレベル比
較器１０において、基準電圧Ｖ ｔ ｅ ｆとレベル比
較され、この比較出力がアンドゲート１４を介して異常
信号りとして導出される。
７及びコンデンサ８からなる充電回路へ人力され、コン
デンサ８の充電がなされる。この充電電圧Ｂはレベル比
較器１０において、基準電圧Ｖ ｔ ｅ ｆとレベル比
較され、この比較出力がアンドゲート１４を介して異常
信号りとして導出される。
トランジスタ９のコレクタ出力は小抵抗１３を介して充
電用コンデンサ８の充電出力Ｂに接続され、このトラン
ジスタ９のオン動作に同期してコンデンサ８の充電電圧
を略瞬時に放電制御する。
電用コンデンサ８の充電出力Ｂに接続され、このトラン
ジスタ９のオン動作に同期してコンデンサ８の充電電圧
を略瞬時に放電制御する。
第１図の動作について第２図のタイミングチャートを参
照しながら説明する。パルス発生器４は第２図Ａに示さ
れているごとくデユーティｌ／２のパルスを発生してい
る。パルス幅制御駆動回路５はＡの波形がロウレベルの
間ある適当な期間のみトランジスタ１を駆動するように
なっている。
照しながら説明する。パルス発生器４は第２図Ａに示さ
れているごとくデユーティｌ／２のパルスを発生してい
る。パルス幅制御駆動回路５はＡの波形がロウレベルの
間ある適当な期間のみトランジスタ１を駆動するように
なっている。
いま、トランジスタ１がパルス駆動されると、トランス
２の２次巻線にパルスが現われ、カレントトランス３の
１次巻線にパルス電流が流れる。
２の２次巻線にパルスが現われ、カレントトランス３の
１次巻線にパルス電流が流れる。
カレントトランス３．ダイオード１３．抵抗１１゜１２
で構成される電流検出回路により、トランジスタ１がオ
ンしている期間パルス電圧が０点に現われる（第２図の
期間ｔ２）。
で構成される電流検出回路により、トランジスタ１がオ
ンしている期間パルス電圧が０点に現われる（第２図の
期間ｔ２）。
一方、パルス発生器４の出力は、抵抗６、ダイオード７
、コンデンサ８の充電回路により、それがハイレベルの
時コンデンサ８に充電され第２図Ｂの波形のようになる
（第２図の期間ｔｌ）。
、コンデンサ８の充電回路により、それがハイレベルの
時コンデンサ８に充電され第２図Ｂの波形のようになる
（第２図の期間ｔｌ）。
そこで、次に０点にパルスが現われると、トランジスタ
９はオンし、抵抗１３の抵抗値は小さいからコンデンサ
８の電荷は急速に放電する（第２図の期間ｔ２）。従っ
て、Ｂ点の電圧は０点にパルスが正常に現われていれば
常に基準電圧を下回っており、よって比較器１０の出力
は常にロウレベルとなっており、電源異常信号は発生し
ない。
９はオンし、抵抗１３の抵抗値は小さいからコンデンサ
８の電荷は急速に放電する（第２図の期間ｔ２）。従っ
て、Ｂ点の電圧は０点にパルスが正常に現われていれば
常に基準電圧を下回っており、よって比較器１０の出力
は常にロウレベルとなっており、電源異常信号は発生し
ない。
次に、トランジスタ１または入力の直流電源側、または
出力側等に異常が発生し、第２図の期間ｔ８のＡ点の波
形がロウレベルの期間にカレントトランス３の１次側に
パルス電流が流れない、すなわち０点にパルスが現われ
ないとする。すると、Ｂ点の電圧つまりコンデンサ８の
電圧はｔ３の期間には降下せず、期間ｔ４でさらに高い
電圧に充電されて行き、ついには基準電圧Ｖ ｒ ｅ
Ｉを越える。
出力側等に異常が発生し、第２図の期間ｔ８のＡ点の波
形がロウレベルの期間にカレントトランス３の１次側に
パルス電流が流れない、すなわち０点にパルスが現われ
ないとする。すると、Ｂ点の電圧つまりコンデンサ８の
電圧はｔ３の期間には降下せず、期間ｔ４でさらに高い
電圧に充電されて行き、ついには基準電圧Ｖ ｒ ｅ
Ｉを越える。
基１ｍ電圧２．「のレベルをＢ点の電圧が越えると、比
較器１０の出力はハイレベルとなり、この時イニシャラ
イズ信号がハイレベルであれば、アンドゲート１４の出
力はハイレベルとなり電源異常信号が出力される。
較器１０の出力はハイレベルとなり、この時イニシャラ
イズ信号がハイレベルであれば、アンドゲート１４の出
力はハイレベルとなり電源異常信号が出力される。
イニシャライズ信号はスイッチング回路がスタートし正
常に達すると思われるまでの間、またスイッチング回路
がオフされている間はロウレベルに保たれ、異常信号が
出力されないようにしておくためである。いわゆる誤動
作防止のための信号である。
常に達すると思われるまでの間、またスイッチング回路
がオフされている間はロウレベルに保たれ、異常信号が
出力されないようにしておくためである。いわゆる誤動
作防止のための信号である。
発明の詳細
な説明したように本発明によれば、スイッチング電源の
主回路部のスイッチング電流パルスを常に監視すること
により、異常が発生してパルスが現われなくなったら即
座に異常検出信号を発生できるという効果がある。さら
に、本スイッチング電源を並列接続して使用した場合、
いずれかの電源に異常が生じてもそれを容易に検出でき
るという効果もある。
主回路部のスイッチング電流パルスを常に監視すること
により、異常が発生してパルスが現われなくなったら即
座に異常検出信号を発生できるという効果がある。さら
に、本スイッチング電源を並列接続して使用した場合、
いずれかの電源に異常が生じてもそれを容易に検出でき
るという効果もある。
第１図は本発明の実施例の回路図、第２図は第１図の回
路の各部信号波形図である。 主要部分の符号の説明 １・・・・・・スイッチングトランジスタ２・・・・・
・トランス ３・・・・・・カレントトランス ４・・・・・・パルス発生器 ５・・・・・・パルス幅制御駆動回路 ８・・・・・・コンデンサ ９・・・・・・放電用トランジスタ １０・・・・・・レベル比較器
路の各部信号波形図である。 主要部分の符号の説明 １・・・・・・スイッチングトランジスタ２・・・・・
・トランス ３・・・・・・カレントトランス ４・・・・・・パルス発生器 ５・・・・・・パルス幅制御駆動回路 ８・・・・・・コンデンサ ９・・・・・・放電用トランジスタ １０・・・・・・レベル比較器
Claims (1)
- （１）スイッチング用のパルスを発生するパルス発生手
段と、このパルスに同期して入力電圧をスイッチングす
るスイッチング手段とを含み、このスイッチング出力を
平滑化して直流電圧を得るようにしたスイッチング電源
の異常検出回路であって、前記パルスにより充電される
充電手段と、この充電電圧と基準電圧とを比較する比較
手段と、前記スイッチング出力により前記充電手段を放
電制御する放電制御手段とを含み、前記比較手段の出力
により異常検出をなすようにしたことを特徴とする異常
検出回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20520889A JP2797495B2 (ja) | 1989-08-08 | 1989-08-08 | スイッチング電源の異常検出回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20520889A JP2797495B2 (ja) | 1989-08-08 | 1989-08-08 | スイッチング電源の異常検出回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0370469A true JPH0370469A (ja) | 1991-03-26 |
| JP2797495B2 JP2797495B2 (ja) | 1998-09-17 |
Family
ID=16503192
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP20520889A Expired - Lifetime JP2797495B2 (ja) | 1989-08-08 | 1989-08-08 | スイッチング電源の異常検出回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2797495B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008504796A (ja) * | 2004-06-25 | 2008-02-14 | ゼネラル・エレクトリック・カンパニイ | 電源の動作不良状態を検出するためのシステムおよび方法 |
-
1989
- 1989-08-08 JP JP20520889A patent/JP2797495B2/ja not_active Expired - Lifetime
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008504796A (ja) * | 2004-06-25 | 2008-02-14 | ゼネラル・エレクトリック・カンパニイ | 電源の動作不良状態を検出するためのシステムおよび方法 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2797495B2 (ja) | 1998-09-17 |
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