JPH0354638A - 命令再試行処理方式 - Google Patents
命令再試行処理方式Info
- Publication number
- JPH0354638A JPH0354638A JP1189483A JP18948389A JPH0354638A JP H0354638 A JPH0354638 A JP H0354638A JP 1189483 A JP1189483 A JP 1189483A JP 18948389 A JP18948389 A JP 18948389A JP H0354638 A JPH0354638 A JP H0354638A
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- JP
- Japan
- Prior art keywords
- instruction
- error
- retrying
- hardware
- central processing
- Prior art date
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- 238000003672 processing method Methods 0.000 claims description 6
- 238000000034 method Methods 0.000 description 7
- 230000010365 information processing Effects 0.000 description 6
- 238000010586 diagram Methods 0.000 description 2
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- Retry When Errors Occur (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は情報処理装置に関し、特に情報処理装置の命令
再試行処理方式に関する。
再試行処理方式に関する。
従来の情報処理装置の命令再試行処理方式はハードウェ
アエラー発生時に起因するソフトウエアまたはファーム
ウェアの論理救済をすることに主眼がおかれ、したがっ
て命令再試行実行時のハードウェアは正常動作すること
を前提としており、ハードウェアの特性を考慮した電圧
，電流，クロックを可変して実行する命令再試行ではな
かった。
アエラー発生時に起因するソフトウエアまたはファーム
ウェアの論理救済をすることに主眼がおかれ、したがっ
て命令再試行実行時のハードウェアは正常動作すること
を前提としており、ハードウェアの特性を考慮した電圧
，電流，クロックを可変して実行する命令再試行ではな
かった。
上述した従来の情報処理装置の命令再試行処理方式はハ
ードウェアエラー発生時に起因するソフトウェアまたは
ファームウェアの論理救済を主眼としたものであり、こ
のため命令再試行実行時のハードウェアは正常動作する
ことを前提としている。したがって一時的なハードウェ
アエラーに対しては有効であるが、継続的なハードウェ
アエラーに対して命令再試行の成功確率が低いという欠
点がある。
ードウェアエラー発生時に起因するソフトウェアまたは
ファームウェアの論理救済を主眼としたものであり、こ
のため命令再試行実行時のハードウェアは正常動作する
ことを前提としている。したがって一時的なハードウェ
アエラーに対しては有効であるが、継続的なハードウェ
アエラーに対して命令再試行の成功確率が低いという欠
点がある。
本発明の目的はこのような欠点を可能な限り救い命令再
試行成功確率を高めた命令再試行処理方式を提供するこ
とにある。
試行成功確率を高めた命令再試行処理方式を提供するこ
とにある。
本発明の命令再試行処理方式は、ハードウェアエラーが
発生したことを検知するエラー検知器と、ハードウェア
情報を退避するための退避制御部と、命令再試行実行時
に使用するデータをエラーが発生したハードウェアに対
して復元するための復元制御部と、命令再試行実行時に
エラーが発生したハードウェアに対して動作指示を与え
て命令再試行を実行するための命令再試行実行制御部と
、通常のハードウェア状態による命令再試行に失敗した
ときに使用されるクロックを可変するためのクロック可
変制御部と、クロックを可変した状態による命令再試行
に失敗したときに使用される電圧，電流値を可変するた
めの電圧、電流可変制御部とを有する。
発生したことを検知するエラー検知器と、ハードウェア
情報を退避するための退避制御部と、命令再試行実行時
に使用するデータをエラーが発生したハードウェアに対
して復元するための復元制御部と、命令再試行実行時に
エラーが発生したハードウェアに対して動作指示を与え
て命令再試行を実行するための命令再試行実行制御部と
、通常のハードウェア状態による命令再試行に失敗した
ときに使用されるクロックを可変するためのクロック可
変制御部と、クロックを可変した状態による命令再試行
に失敗したときに使用される電圧，電流値を可変するた
めの電圧、電流可変制御部とを有する。
次に、この発明について図面を参照して説明する。
第１図は本発明の一実施例を示す構戒図である。
同図において診断プロセッサーはＣＰＵＩＯによって制
御される。ＣＰＵＩＯはエラー検知器２，退避制御部３
，復元制御部４，命令再試行実行制御部５，クロック可
変制御部６，電圧電流可変制御部７と入出力インタフェ
ース８を介して接続されている。
御される。ＣＰＵＩＯはエラー検知器２，退避制御部３
，復元制御部４，命令再試行実行制御部５，クロック可
変制御部６，電圧電流可変制御部７と入出力インタフェ
ース８を介して接続されている。
前記ＣＰＵＩＯはハードウェアエラーを発生した中央処
理装置１の命令再試行処理を行うものであり、そのプロ
グラムおよび各種データを記憶するメモリ９，ハードウ
ェア情報を退避しエラー情報を記録する記憶媒体１２，
命令再試行処理によって中央処理装置の時刻の矛盾を補
正する時刻補正タイマ１１を備えている。
理装置１の命令再試行処理を行うものであり、そのプロ
グラムおよび各種データを記憶するメモリ９，ハードウ
ェア情報を退避しエラー情報を記録する記憶媒体１２，
命令再試行処理によって中央処理装置の時刻の矛盾を補
正する時刻補正タイマ１１を備えている。
第２図は前記ＣＰＵＩＯによる中央処理装置の命令再試
行処理手順を示す流れ図である。
行処理手順を示す流れ図である。
中央処理装１ｉｆｌがハードウェアエラーを起こしエラ
ー検知器２によって検知されると（ステ，プ２０）、時
刻補正タイマ１１が起動され中央処理装置ｌのハードウ
ェア情報の退避が実行される（ステップ２１，ステップ
２２）。この退避データは退避制御部３から入出力イン
タフェース８を介してメモリ９に蓄えられる。そしてハ
ードウェア情報退避処理が終了すると、メモリ９に蓄え
られたデータは中央処理装置のエラーロギングとして記
憶媒体１２に記憶される（ステップ２３）。
ー検知器２によって検知されると（ステ，プ２０）、時
刻補正タイマ１１が起動され中央処理装置ｌのハードウ
ェア情報の退避が実行される（ステップ２１，ステップ
２２）。この退避データは退避制御部３から入出力イン
タフェース８を介してメモリ９に蓄えられる。そしてハ
ードウェア情報退避処理が終了すると、メモリ９に蓄え
られたデータは中央処理装置のエラーロギングとして記
憶媒体１２に記憶される（ステップ２３）。
次にメモリ９に蓄えられたハードウェア情報から命令再
試行可能なエラーか否かを判定し（ステ，ブ２４）、命
令再試行可能なエラーであればソフトウェアまたはファ
ームウェアの論理救済処理（ステップ２５）を実行する
。命令再試行可能なエラーか否かの判定は、例えば再試
行可能なエラーの種類をあらかじめ記憶媒体ｌ２に設定
している。
試行可能なエラーか否かを判定し（ステ，ブ２４）、命
令再試行可能なエラーであればソフトウェアまたはファ
ームウェアの論理救済処理（ステップ２５）を実行する
。命令再試行可能なエラーか否かの判定は、例えば再試
行可能なエラーの種類をあらかじめ記憶媒体ｌ２に設定
している。
次に、エラー状態になったままの中央処理装置１をイニ
シャライズしてエラー状態をリセットし（ステップ２６
）、中央処理装置１を初期化させる。続いて前記ステッ
プ２５により得られた論理救済ずみデータにより復元制
御部４が中央処理装置１のハードウェア状態をエラーが
起こる前の状態に復元し（ステップ２７，ステップ２８
）、命令再試行実行制御部５により中央処理装置１を起
動し、エラーが発生した命令の再実行（ステップ２９）
を通常のハードウェア状態で行う。
シャライズしてエラー状態をリセットし（ステップ２６
）、中央処理装置１を初期化させる。続いて前記ステッ
プ２５により得られた論理救済ずみデータにより復元制
御部４が中央処理装置１のハードウェア状態をエラーが
起こる前の状態に復元し（ステップ２７，ステップ２８
）、命令再試行実行制御部５により中央処理装置１を起
動し、エラーが発生した命令の再実行（ステップ２９）
を通常のハードウェア状態で行う。
この時、同種のエラーまたは新たなエラーが報告された
か，命令再試行成功時にあらかじめ決められたステータ
スが報告されたかどうかをＣＰＵ１０が入出力インタフ
ェース８を介してエラー検知器２を参照することにより
、命令再試行が成功したか否かの判定（ステップ３０）
が行なわれる。
か，命令再試行成功時にあらかじめ決められたステータ
スが報告されたかどうかをＣＰＵ１０が入出力インタフ
ェース８を介してエラー検知器２を参照することにより
、命令再試行が成功したか否かの判定（ステップ３０）
が行なわれる。
命令再試行が前記ステップ３０により戒功したと判定さ
れると前記ステップ２ｌで起動した時刻補正タイマ１１
をリセットし（ステップ４７）、命令再試行に要した時
間を計算し中央処理装置１に対して時刻補正処理（ステ
ップ４８）を行い、命令再試行実行制御部５を介して再
起動をかけて通常処理を再開させる。
れると前記ステップ２ｌで起動した時刻補正タイマ１１
をリセットし（ステップ４７）、命令再試行に要した時
間を計算し中央処理装置１に対して時刻補正処理（ステ
ップ４８）を行い、命令再試行実行制御部５を介して再
起動をかけて通常処理を再開させる。
前記ステップ３０で通常のハードウェア状態での命令再
試行が失敗したと判定された時は、クロック可変制御部
６を介して通常とは違ったクロ，クタイミングを中央処
理装置１に与え（ステップ３１，ステップ３２）、例え
ば中央処理装置１が通常処理動作をしているクロックタ
イミングが４０ｎｓであれば５０ｎｓヘクロックタイミ
ングを可変させる処理を行う。続いて前記ステップ２６
〜２９で行った同様の処理を前記ステップ２５で与えら
れたデータによりステップ３３〜３６で実行させ、クロ
ック状態を可変させたハードウエア状態で中央処理装置
１に対し命令再試行を実行させる。次に前記ステップ３
０で使用したアルゴリズムにより、命令再試行が成功し
たか否かの判定（ステップ３７）をする。
試行が失敗したと判定された時は、クロック可変制御部
６を介して通常とは違ったクロ，クタイミングを中央処
理装置１に与え（ステップ３１，ステップ３２）、例え
ば中央処理装置１が通常処理動作をしているクロックタ
イミングが４０ｎｓであれば５０ｎｓヘクロックタイミ
ングを可変させる処理を行う。続いて前記ステップ２６
〜２９で行った同様の処理を前記ステップ２５で与えら
れたデータによりステップ３３〜３６で実行させ、クロ
ック状態を可変させたハードウエア状態で中央処理装置
１に対し命令再試行を実行させる。次に前記ステップ３
０で使用したアルゴリズムにより、命令再試行が成功し
たか否かの判定（ステップ３７）をする。
命令再試行が成功μたと判定されれば前記ステップ３１
〜３２で可変したクロックタイミングを通常に戻し（ス
テップ４６）、前記ステップ４７〜４８と同様に時刻補
正を中央処理装置１に対して行い通常処理の再開をさせ
て終了する。
〜３２で可変したクロックタイミングを通常に戻し（ス
テップ４６）、前記ステップ４７〜４８と同様に時刻補
正を中央処理装置１に対して行い通常処理の再開をさせ
て終了する。
前記ステップ３７で命令再試行が失敗と判定した時は前
記ステップ３１〜３２で可変したクロックタイミングを
通常に戻し（ステップ３８）、電圧電流可変制御部７を
介して通常とは違った電圧，電流値を中央処理装置１に
与える（ステップ３９，ステップ４０）。例えば中央処
理装置ｌが通常処理動作をしている論理動作電圧が−３
，３ｖであれば−３．５■または−３． Ｏ Ｖへ電圧
値を可へさせる処理を行う。そして再び前記ステップ２
６〜２９で行った同様の処理を前記ステップ２５で与え
られたデータによりステップ４１〜４４で実行させ、電
圧，電流値を可変させたハードウェア状態で中央処理装
置１に対し命令再試行を実行させる。そして再び前記ス
テップ３０，ステップ３７で使用したアルゴリズムによ
り、命令再試行が或功したか否かの判定（ステップ４５
）をする。
記ステップ３１〜３２で可変したクロックタイミングを
通常に戻し（ステップ３８）、電圧電流可変制御部７を
介して通常とは違った電圧，電流値を中央処理装置１に
与える（ステップ３９，ステップ４０）。例えば中央処
理装置ｌが通常処理動作をしている論理動作電圧が−３
，３ｖであれば−３．５■または−３． Ｏ Ｖへ電圧
値を可へさせる処理を行う。そして再び前記ステップ２
６〜２９で行った同様の処理を前記ステップ２５で与え
られたデータによりステップ４１〜４４で実行させ、電
圧，電流値を可変させたハードウェア状態で中央処理装
置１に対し命令再試行を実行させる。そして再び前記ス
テップ３０，ステップ３７で使用したアルゴリズムによ
り、命令再試行が或功したか否かの判定（ステップ４５
）をする。
命令再試行が戊功したと判定されれば前記ステップ３９
〜４０で可変した電圧，電流値を通常に戻し（ステップ
４６）、前記ステップ４７〜４８と同様に時刻補正を中
央処理装置１に対して行い通常処理の再開をさせて終了
する。
〜４０で可変した電圧，電流値を通常に戻し（ステップ
４６）、前記ステップ４７〜４８と同様に時刻補正を中
央処理装置１に対して行い通常処理の再開をさせて終了
する。
前記ステップ４５で命令再試行が失敗と判定した時はク
ロックタイミングおよび電圧，電流値の可変によって救
うことの出来るエラーではなかったとし、中央処理装置
１に対して命令再試行失敗を報告（ステップ４９）して
終了する。
ロックタイミングおよび電圧，電流値の可変によって救
うことの出来るエラーではなかったとし、中央処理装置
１に対して命令再試行失敗を報告（ステップ４９）して
終了する。
以上説明したようにこの発明は、情報処理装置が命令再
試行可能なエラーが発生した場合にその情報処理装置の
ハードウェアエラー状態がイニシャライズによっても復
旧しない継続的なエラーであっても、クロックタイミン
グの可変や電圧，電流値の可変手段によってそれを回避
できる効果がある．
試行可能なエラーが発生した場合にその情報処理装置の
ハードウェアエラー状態がイニシャライズによっても復
旧しない継続的なエラーであっても、クロックタイミン
グの可変や電圧，電流値の可変手段によってそれを回避
できる効果がある．
第１図は本発明の一実施例を示す構戒図、第２図は動作
を示す流れ図である。 ２・・・・・・エラー検知器、３・・・・・・退避制御
部、４・・・・・・復元制御部、５・・・・・・命令再
試行実行制御部、６・・・・・・クロック可変制御部、
７・・・・・・電圧電流可変制御部。
を示す流れ図である。 ２・・・・・・エラー検知器、３・・・・・・退避制御
部、４・・・・・・復元制御部、５・・・・・・命令再
試行実行制御部、６・・・・・・クロック可変制御部、
７・・・・・・電圧電流可変制御部。
Claims (1)
- ハードウェアエラーが発生したことを検知するエラー検
知器と、ハードウェア情報を退避するための退避制御部
と、命令再試行実行時に使用するデータをエラーが発生
したハードウェアに対して復元するための復元制御部と
、命令再試行実行時にエラーが発生したハードウェアに
対して動作指示を与えて命令再試行を実行するための命
令再試行実行制御部と、通常のハードウェア状態による
命令再試行に失敗したときに使用されるクロックを可変
するためのクロック可変制御部と、クロックを可変した
状態による命令再試行に失敗したときに使用される電圧
、電流値を可変するための電圧、電流可変制御部とを有
することを特徴とする命令再試行処理方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1189483A JPH0354638A (ja) | 1989-07-21 | 1989-07-21 | 命令再試行処理方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1189483A JPH0354638A (ja) | 1989-07-21 | 1989-07-21 | 命令再試行処理方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0354638A true JPH0354638A (ja) | 1991-03-08 |
Family
ID=16242016
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1189483A Pending JPH0354638A (ja) | 1989-07-21 | 1989-07-21 | 命令再試行処理方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0354638A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6128752A (en) * | 1991-12-16 | 2000-10-03 | International Business Machines Corporation | Fault tolerant design for identification of AC defects including variance of cycle time to maintain system operation |
| CN107526667A (zh) * | 2017-07-28 | 2017-12-29 | 阿里巴巴集团控股有限公司 | 一种指标异常检测方法、装置以及电子设备 |
| WO2021010039A1 (ja) * | 2019-07-12 | 2021-01-21 | ソニー株式会社 | 情報処理装置、および情報処理方法、並びにプログラム |
-
1989
- 1989-07-21 JP JP1189483A patent/JPH0354638A/ja active Pending
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6128752A (en) * | 1991-12-16 | 2000-10-03 | International Business Machines Corporation | Fault tolerant design for identification of AC defects including variance of cycle time to maintain system operation |
| CN107526667A (zh) * | 2017-07-28 | 2017-12-29 | 阿里巴巴集团控股有限公司 | 一种指标异常检测方法、装置以及电子设备 |
| US10860453B2 (en) | 2017-07-28 | 2020-12-08 | Advanced New Technologies Co., Ltd. | Index anomaly detection method and apparatus, and electronic device |
| WO2021010039A1 (ja) * | 2019-07-12 | 2021-01-21 | ソニー株式会社 | 情報処理装置、および情報処理方法、並びにプログラム |
| US11983092B2 (en) | 2019-07-12 | 2024-05-14 | Sony Group Corporation | Information processing device and information processing method |
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