JPH0348930U - - Google Patents

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JPH0348930U
JPH0348930U JP11003889U JP11003889U JPH0348930U JP H0348930 U JPH0348930 U JP H0348930U JP 11003889 U JP11003889 U JP 11003889U JP 11003889 U JP11003889 U JP 11003889U JP H0348930 U JPH0348930 U JP H0348930U
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transistors
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Description

【図面の簡単な説明】
第１図ないし第５図は本考案の差動対スイツチ
回路の実施例を示し、第１図は第１実施例の結線
図、第２図は第１図の動作説明図、第３図は他の
結線例の説明図、第４図、第５図は第２実施例、
第３実施例の結線図、第６図は８ミリビデオテー
プレコーダの音声入力の切換回路のブロツク図、
第７図は従来例の結線図、第８図は４トランジス
タ帰還アンプ構成の差動対スイツチ回路の結線図
、第９図ａ，ｂ、第１０図ａ，ｂ、第１１図ａ，
ｂは第８図の構成説明図である。 ３１ａ〜３１ｄ……第１トランジスタを形成す
るトランジスタ、３２ａ〜３２ｄ……第２トラン
ジスタを形成するトランジスタ、４１ａ〜４１ｄ
……第３トランジスタを形成するトランジスタ、
３６……エミツタ抵抗、５３，５５……定電流源
、Ｖｃｃ……正バイアス電源端子。

Claims (1)

  1. 【実用新案登録請求の範囲】 ２入力信号の切換出力スイツチ又は１入力信号
    のリミツタスイツチを形成するトランジスタ構成
    の差動対スイツチ回路において、 差動対を形成する第１、第２トランジスタの負
    電位出力端子又は正電位出力端子を共通の抵抗路
    又は定電流源に接続し、 前記両トランジスタの前記正電位出力端子又は
    前記負電位出力端子に第３トランジスタの制御端
    子を接続し、 前記第３トランジスタの正電位出力端子、負電
    位出力端子を正バイアス電源、前記第１、第２ト
    ランジスタの前記負電位出力端子又は前記第１、
    第２トランジスタの前記正電位出力端子、アース
    あるいは負バイアス電源に接続し、 前記第１、第２トランジスタの制御端子を信号
    入力端子とし、前記第３トランジスタの前記正電
    位出力端子又は前記負電位出力端子を信号出力端
    子とした３トランジスタ帰還アンプ構成の差動対
    スイツチ回路。
JP11003889U 1989-09-20 1989-09-20 差動対スイッチ回路 Expired - Lifetime JP2526478Y2 (ja)

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JP2526478Y2 JP2526478Y2 (ja) 1997-02-19

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2007290854A (ja) * 2006-04-20 2007-11-08 Shisutematsukusu:Kk ゴミ収納補助具

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