JPH0337553U - - Google Patents

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JPH0337553U
JPH0337553U JP9775989U JP9775989U JPH0337553U JP H0337553 U JPH0337553 U JP H0337553U JP 9775989 U JP9775989 U JP 9775989U JP 9775989 U JP9775989 U JP 9775989U JP H0337553 U JPH0337553 U JP H0337553U
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shift register
waveform
sub
main
load signal
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JP9775989U
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  • Testing Electric Properties And Detecting Electric Faults (AREA)
  • Analogue/Digital Conversion (AREA)

Description

【図面の簡単な説明】
第１図は本考案に係る任意波形発生器の一実施
例を示す構成図、第２図はタイムチヤート、第３
図は出力波形の一例を示す図、第４図は従来の任
意波形発生器により得られる出力波形の一例を示
す図、第５図は従来の任意波形発生器の一例を示
す構成図である。 １０…主シフトレジスタ群、２０…副シフトレ
ジスタ群、３０…主波形メモリ、４０…副波形メ
モリ、５０…ロード信号発生回路、６０…シーケ
ンサ、３…ＤＡＣ、４…ローパスフイルタ。

Claims (1)

  1. 【実用新案登録請求の範囲】 多段のシフトレジスタより送出されるシリアル
    データをアナログ変換し、その後ローパスフイル
    タを介することにより、所定の波形を発生するデ
    ジタル型の任意波形発生器において、 前記多段のシフトレジスタは、Ｂビツト幅のシ
    フトレジスタ群と、Ｂビツト幅のシフトレジスタ
    をＮ−１段縦続し主シフトレジスタ群に後置され
    る副シフトレジスタ群より構成され、 前記主シ
    フトレジスタ群の各シフトレジスタに与える主波
    形データが記憶されたＮ個の主波形メモリ群と 前記副シフトレジスタ群の各シフトレジスタに
    与える副波形データが記憶されたＮ−１個の副波
    形メモリ群と、 前記主および副シフトレジスタ群の各シフトレ
    ジスタに前記主および副波形メモリの各メモリの
    波形データをそれぞれロードするためのロード信
    号を発生するロード信号発生回路と、 前記主および副波形メモリに与えるアドレスを
    発生すると共に、前記ロード信号発生回路のロー
    ド信号発生のタイミングを決定するための信号を
    発生するシーケンサ を具備し、前記ローパスフイルタの出力端より任
    意のサイズの波形が得られるようにしたことを特
    徴とする任意波形発生器。
JP9775989U 1989-08-22 1989-08-22 Pending JPH0337553U (ja)

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JPH0337553U true JPH0337553U (ja) 1991-04-11

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JP (1) JPH0337553U (ja)

Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS50145035A (ja) * 1974-05-10 1975-11-21
JPS6472218A (en) * 1986-09-02 1989-03-17 Us Energy Digital type programmable signal generator and signal generation therefor

Patent Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS50145035A (ja) * 1974-05-10 1975-11-21
JPS6472218A (en) * 1986-09-02 1989-03-17 Us Energy Digital type programmable signal generator and signal generation therefor

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