JPH03268329A - バンプ電極 - Google Patents

バンプ電極

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JPH03268329A
JPH03268329A JP6760990A JP6760990A JPH03268329A JP H03268329 A JPH03268329 A JP H03268329A JP 6760990 A JP6760990 A JP 6760990A JP 6760990 A JP6760990 A JP 6760990A JP H03268329 A JPH03268329 A JP H03268329A
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JP
Japan
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bump
bump electrode
transfer
electrode
substrate
Prior art date
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Pending
Application number
JP6760990A
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English (en)
Inventor
Hiromichi Watanabe
渡邊 広道
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujitsu Ltd
Original Assignee
Fujitsu Ltd
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Filing date
Publication date
Application filed by Fujitsu Ltd filed Critical Fujitsu Ltd
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔概要〕 金にてなる第1のバンプ電極の上に、金にてなる第2の
バンプ電極が搭載された2段構成のバンプ電極に関し、 同時に形成された多数のバンプ電極の高さ(上面)を揃
え、高背高のバンプ電極の形成を容易ならしめることを
目的とし、 1回目の転写によって絶縁基板に形成された該第1のバ
ンプ電極の上に、2回目の転写により該第2のバンプ電
極が形成されてなることを特徴とし構成する。
〔産業上の利用分野〕
本発明は、絶縁基板に転写により多数個を同時に形成し
たバンプ電極、特に第1の金バンプ電極の上に第2の金
バンプ電極を重ねた2段構成のバンプ電極に関する。
半導体装置等において、チップの新規実装方法としてフ
ィルムキャリアを使用するTAB (TapeAutm
ated Bonding)方式および、C O G 
(Cipe onGlass)方式が開発され、利用さ
れるようになった。
COG方式は、一般に金にてなる多数の転写用バンプ電
極を転写用ガラス基板に形成したのち、そのバンプ電極
を所望の基板やICチップ等に転写する方式であり、本
発明はCOG方式によって形成されバンプ電極の構成、
特に多数のバンプ電極の上面を同一面に揃え(背高を揃
え)、高背高のバンプ電極の形成を容易ならしめたもの
である。
〔従来の技術〕
第3図は従来のバンプ電極を転写形成した基板の側面図
、第5図は転写バンプ電極を形成したガラス基板の側面
図である。
第3図において、絶縁基板1の上面にはバンプ電極形成
用パッド2とパッド間の絶縁層3を形成し、一般に厚さ
2μm程度以下のアルミニウムにてなる各パッド2に被
着された金のバンプ電極4は、転写により形成されたも
のである。
第5図において、転写用バンプ電極を形成させるガラス
基板5は、上面にマスク6を形成し、マスク6の各透孔
部には転写用金バンプ7がめっきにより形成される。
金バンプ7を絶縁基板1のパッド2に転写する方法は、
例えばバンプ7の形成されたガラス基板5を約150°
Cに加熱し、パッド2の形成された基板lを約350℃
に加熱し、20g程度の押圧力で各バンプ7をパッド2
に押し付ける。
すると、パッド2とバンプ7との界面にアルミニウムと
金の合金が生成され、該合金によってバンプ7はパッド
2に被着する。
そこで、ガラス基板5を絶縁基板lから離すようにする
と、バンプ7はガラス基板5より剥離しバンプ電極4が
絶縁基板lに形成される。
絶縁基板lおよびガラス基板5の前記加熱は、例えば絶
縁基板1の固定台に収容したヒーターに通電し、ガラス
基板5を絶縁基板lに向けて押下する抵抗体キャピラリ
に通電する。
〔発明が解決しようとする課題〕
以上説明した如く形成された従来のバンプ電極4は、前
記加熱および押圧力により生じる絶縁基板1.ガラス基
板5の変形等によって、同一絶縁基板lに形成された多
数のバンプ電極4の上面のばらつきΔhが1μm以上に
なる。
かかるばらつきΔhはバンプ電極4をその接続相手、例
えばポリイミドフィルムに形成されリードに接続させた
とき、導通不良の要因になるという問題点があった。
また、従来方法によって例えば20μm程度の背高のバ
ンプ電極4を形成しようとすると、ガラス基板5に形成
するバンプ7を20μm以上の厚さにする必要がある。
しかし、バンプ7はlOμm程度以上に厚くすると、ガ
ラス基板5に対する被着力か低下し、ガラス基板5より
脱落し易いという問題点があった。
本発明の目的は、バンプ電極の上面のばらつきΔhを低
減せしめ(高さを揃え)、バンプ電極と接続相手との接
続不良をな(すと共に、10μm以上の高背高のバンプ
電極の形成を容易ならしめることである。
〔課題を解決するための手段〕
上記目的は、本発明の実施例を示す第1図によれば、金
にてなる第1のバンプ電極4の上に、金にてなる第2の
バンプ電極8が搭載された2段構成のバンプ電極とし、 1回目の転写によって絶縁基板lに形成された第1のバ
ンプ電極4の上に、2回目の転写により第2のバンプ電
極8が形成されてなることを特徴とするバンプ電極によ
り解決される。
〔作用〕
上記手段によれば、第1のバンプ電極の上に第2のバン
プ電極を搭載せしめて形成したことにより、第2のバン
プ電極の転写は、第1のバンプ電極の転写より緩やかな
条件、即ち転写時の温度。
押圧力の少なくとも一方を低減できるため、バンプ電極
が形成される絶縁基板および転写バンプを形成せしめた
ガラス基板の変形が少な(なり、第2のバンプ電極上面
のばらつきは、第1のバンプ電極上面のばらつきの17
2程度にすることが可能になる。
さらに、2段構成になる本発明のバンプ電極の高さを例
えば約20μmにするには、約10μmに形成された第
1.第2の転写用バンプを積み重ねればよい。そして、
高さ10μm程度の転写用バンプは転写用ガラス基板に
対する被着力が確保されるため、本発明による構成で高
さ20μmのバンプ電極を形成することは、容易かつ確
実になる。
〔実施例〕
以下に図面を用いて本発明の実施例による基板を説明す
る。
第1図は本発明の一実施例によるバンプ電極を形成した
基板の断面図、第2図は本発明の他の実施例によるバン
プ電極を形成した基板の断面図、第4図(イ)〜(ハ)
は第1図に示すバンプ電極の製造工程の説明図である。
第1図において、絶縁基板lの上面にはバンプ電極形成
用アルミニウムパッド2とパッド間の絶縁層3を形成し
、各パッド2には金にてなる第1のバンプ電極4が転写
により形成され、バンプ電極4の上には、金にてなりバ
ンプ電極4と同一径に作成された第2のバンプ電極8が
転写により形成されてなる。
第2図において、絶縁基板1の上面にはバンプ電極形成
用アルミニウムパッド2とパッド間の絶縁層3を形成し
、各パッド2には金にてなる第1のバンプ電極4が転写
により形成され、バンプ電極4の上には、金にてなりバ
ンプ電極4より小径に作成された第2のバンプ電極9が
転写により形成されてなる。
第4図(イ)において、絶縁基板1の上面にはバンプ電
極形成用アルミニウムパッド2とパッド間の絶縁層3を
形成する。
第4図(ロ)において、多数の各パッド2の上にバンプ
電極4を転写により形成させるが、該転写は従来と同一
方法、例えば転写バンプの形成されたガラス基板を約1
50℃に加熱し、パッド2の形成された基板1を約35
0°Cに加熱し、20μ程度の押圧力で各バンプ7をパ
ッド2に押し付け、パッド2とバンプ電極4との界面に
アルミニウムと金の合金を生成せしめる。
しかるのち第4図(ハ)において、バンプ電極4の上に
バンプ電極8を転写により形成させる。
金バンプ電極4に金バンプ電極8を転写によって形成さ
せるには、バンプ電極4をパッド2に転写形成させるよ
り温度および圧力の少なくとも一方を低くすることが可
能であり、例えば転写バンプの形成されたガラス基板を
約150℃に加熱し、パッド2の形成された基板1を約
300℃に加熱し、バンプ電極8をバンプ電極4に押し
付ける圧力を10μ程度にすることが可能である。
このような2段構成で形成されたバンプ電極は、バンプ
電極8の転写条件がバンプ電極4の転写条件より低温、
低圧力で行えるため、絶縁基板Iおよび転写用ガラス基
板の変形が少なくなり、バンプ電極8の上面のばらつき
Δh1を0.5μm以下にすることが容易である。
そして、バンプ電極4および8それぞれの高さを10μ
のにすれば、バンプ電極4にバンプ電極8を搭載せしめ
た全背高は約20μmとなり、高さ10μmの転写用バ
ンプは転写用ガラス基板に対する被着力が確保されるた
め、背高20μmのバンプ電極の形成が容易かつ確実に
なる。
さらに、第2図に示す如くバンプ電極4より小径のバン
プ電極9を転写形成するようにすれば、バンプ電極9の
形成条件はバンプ電極8の形成条件より一層の低温、低
圧力で可能であり、バンプ電極9の上面のばらつきΔh
2は、Δh+より小さくすることが可能になる。
〔発明の効果〕
以上説明したように本発明によれば、バンプ電極上面の
ばらつきが0.5μm以下になり、そのことによって接
続相手に対する接続不良をなくし信頼性が向上されたと
共に、10μm以上の高背高のバンプ電極が容易かつ確
実に形成できるようにした効果を有する。
【図面の簡単な説明】
第1図は本発明の一実施例によるバンプ電極を形成した
基板、 第2図は本発明の他の実施例によるバンプ電極を形成し
た基板、 第3図は従来のバンプ電極を形成した基板、第4図は第
1図に示すバンプ電極の製造工程図、第5図は転写バン
プ電極を形成したガラス基板、である。 図中において、 lは絶縁基板、 2はバンプ電極形成用のパッド、 4は第1のバンプ電極、 8.9は第2のバンプ電極、 を示す。

Claims (2)

    【特許請求の範囲】
  1. (1)金にてなる第1のバンプ電極(4)の上に、金に
    てなる第2のバンプ電極(8、9)が搭載された2段構
    成のバンプ電極であり、 1回目の転写によって絶縁基板(1)に形成された該第
    1のバンプ電極(4)の上に、2回目の転写により該第
    2のバンプ電極(8、9)が形成されてなることを特徴
    とするバンプ電極。
  2. (2)前記第2のバンプ電極(9)が前記第1のバンプ
    電極(4)より小径の小型であることを特徴とする前記
    請求項1記載のバンプ電極。
JP6760990A 1990-03-16 1990-03-16 バンプ電極 Pending JPH03268329A (ja)

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JP6760990A JPH03268329A (ja) 1990-03-16 1990-03-16 バンプ電極

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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP0792463A4 (en) * 1994-11-15 1998-06-24 Formfactor Inc ASSEMBLY OF SPRING ELEMENTS ON SEMICONDUCTOR COMPONENTS AND WAFERTEST PROCEDURE
EP0859686A4 (en) * 1995-05-26 1998-11-11 Formfactor Inc PRODUCTION OF CONNECTIONS AND FITTINGS WITH THE USE OF SACRED SUBSTRATE
US8783440B2 (en) 2011-12-28 2014-07-22 Ricoh Company, Limited Sheet member position correcting device and image forming apparatus

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP0792463A4 (en) * 1994-11-15 1998-06-24 Formfactor Inc ASSEMBLY OF SPRING ELEMENTS ON SEMICONDUCTOR COMPONENTS AND WAFERTEST PROCEDURE
EP0859686A4 (en) * 1995-05-26 1998-11-11 Formfactor Inc PRODUCTION OF CONNECTIONS AND FITTINGS WITH THE USE OF SACRED SUBSTRATE
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