JPH03256204A - 磁気記録再生装置の増幅器制御回路 - Google Patents
磁気記録再生装置の増幅器制御回路Info
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- JPH03256204A JPH03256204A JP2055430A JP5543090A JPH03256204A JP H03256204 A JPH03256204 A JP H03256204A JP 2055430 A JP2055430 A JP 2055430A JP 5543090 A JP5543090 A JP 5543090A JP H03256204 A JPH03256204 A JP H03256204A
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- 238000010586 diagram Methods 0.000 description 8
- 230000003321 amplification Effects 0.000 description 7
- 238000003199 nucleic acid amplification method Methods 0.000 description 7
- 238000000034 method Methods 0.000 description 5
- 230000000694 effects Effects 0.000 description 3
- 230000008929 regeneration Effects 0.000 description 1
- 238000011069 regeneration method Methods 0.000 description 1
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- Amplifiers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（産業上の利用分野）
本発明は磁気記録再生装置の記録増幅、再生増幅を行な
うヘットアンプＩＣ等の増幅器制御回路に関する。
うヘットアンプＩＣ等の増幅器制御回路に関する。
（従来の技術）
従来のＶＴＲ上で記録増幅部と再生増幅部により構成さ
れるヘッドアンプにおいては、記録部と再生部それぞれ
の回路で共用できる部分が非常に少ない、または共用で
きる部分がないために記録部と再生部の回路は完全に専
用化さ和、直流電源端子ＶＣＣも記録部、再生部で分離
されており、記録と両生の切換え制御は電源電斤を′ｊ
、える′−゛Ｅ源端ｒを選択することによって行なって
いた。
れるヘッドアンプにおいては、記録部と再生部それぞれ
の回路で共用できる部分が非常に少ない、または共用で
きる部分がないために記録部と再生部の回路は完全に専
用化さ和、直流電源端子ＶＣＣも記録部、再生部で分離
されており、記録と両生の切換え制御は電源電斤を′ｊ
、える′−゛Ｅ源端ｒを選択することによって行なって
いた。
カメラとＶＴＲが一体になったカメラ一体型Ｖ ’ｒ
Ｒては記録時においては実際に記録をしない間、すなわ
ちメカが起動するまでの間や、 時惇Ｉト中の間は記録
を行なわないのにかかわらず多くの電力を必要とする。
Ｒては記録時においては実際に記録をしない間、すなわ
ちメカが起動するまでの間や、 時惇Ｉト中の間は記録
を行なわないのにかかわらず多くの電力を必要とする。
このような期間は記録部１ｆ＋ｊ ［”回路をイ亨ＩＩ
さセて、ｊＨ＜（１３，人なｒ％力を６ｆｆｌ少させて
、ハッフリレで使用するときの動作時間を延ばすように
する必要がある。
さセて、ｊＨ＜（１３，人なｒ％力を６ｆｆｌ少させて
、ハッフリレで使用するときの動作時間を延ばすように
する必要がある。
しかしながら」−述した従来のヘッドアンプでは記録部
の動作、停止を切り換えるためには電源端子に与える電
圧の導通、非導通を切換えなければならない。電源を導
通または非導通させるためには、電源切換用の８咀の大
きいトランジスタやリレーを用いる必要かあるため、回
路が複雑になるとともにコストの面でも不利という欠点
がある。
の動作、停止を切り換えるためには電源端子に与える電
圧の導通、非導通を切換えなければならない。電源を導
通または非導通させるためには、電源切換用の８咀の大
きいトランジスタやリレーを用いる必要かあるため、回
路が複雑になるとともにコストの面でも不利という欠点
がある。
本発明は１記欠点のない磁気記録再生装置の増幅器制御
回路を提供することを目的とする。
回路を提供することを目的とする。
（課題を解決するための手段〕
本発明の磁気記録再生装置の増幅器制御回路は、
ベースか制御端子に接続された第１のトランジスタと、
第１のトランジスタにダーリントン接続された第２のト
ランジスタとからなる第１の駆動回路と、ベースが基準
電圧に接続された第３のトランジスタと、第３のトラン
ジスタにダーリントン接続された第４のトランジスタか
らなる第２の駆動回路とを制御端子から制御してスイッ
チ動作をさせるスイッチ回路と、 スイッチ回路の第１．第２の駆動回路のうち少なくとも
一方の動作を定電流供給の有無で伝達する第１のカレン
トミラー回路と、 第１のカレントミラー回路からの定電流供給の有無を１
以トの節点に伝達する第２のカレントミラー回路とを有
する。
第１のトランジスタにダーリントン接続された第２のト
ランジスタとからなる第１の駆動回路と、ベースが基準
電圧に接続された第３のトランジスタと、第３のトラン
ジスタにダーリントン接続された第４のトランジスタか
らなる第２の駆動回路とを制御端子から制御してスイッ
チ動作をさせるスイッチ回路と、 スイッチ回路の第１．第２の駆動回路のうち少なくとも
一方の動作を定電流供給の有無で伝達する第１のカレン
トミラー回路と、 第１のカレントミラー回路からの定電流供給の有無を１
以トの節点に伝達する第２のカレントミラー回路とを有
する。
制御端子に印加される制御信号によってスイッチ動作を
するスイッチ回路のオン・オフ状態を第１、第２のカレ
ントミラー回路を介して増幅器の所望の個所に伝達する
。
するスイッチ回路のオン・オフ状態を第１、第２のカレ
ントミラー回路を介して増幅器の所望の個所に伝達する
。
次に、本発明の実施例について図面を参照して説明する
。
。
′ｆＪ１１ｆｆｌ＋は本発明の磁気記録再生装置の増幅
器制御回路の第１の実施例を示すブロック図、第２図は
第１図の実施例の増幅器制御回路１１を詳細に示す回路
図である。
器制御回路の第１の実施例を示すブロック図、第２図は
第１図の実施例の増幅器制御回路１１を詳細に示す回路
図である。
ヘッドアンプＩＯは、再生用増幅器２と、記録用増幅器
１と、記録用増幅器１を制御する増幅器制御回路１１と
からなっている。
１と、記録用増幅器１を制御する増幅器制御回路１１と
からなっている。
再生用増幅器２は、電源端子６から電源を供給され、ヘ
ット３からの信号を増幅して、出力端子８に出力する。
ット３からの信号を増幅して、出力端子８に出力する。
記録用増幅器１は、電源端子７から電源を供給され、増
幅器制御１回路１１によってアクティブにされている時
は、入力端子９からの信号を増幅し、ヘッド４に出力す
る。増幅器制御回路１１は制御端子５に印加される制御
電圧により記録用増幅器１をアクティブまたはインアク
ティブにする。
幅器制御１回路１１によってアクティブにされている時
は、入力端子９からの信号を増幅し、ヘッド４に出力す
る。増幅器制御回路１１は制御端子５に印加される制御
電圧により記録用増幅器１をアクティブまたはインアク
ティブにする。
次に増幅器制御回路１１について第２図を参照して、さ
らに詳細に説明１−る。
らに詳細に説明１−る。
ダーリントン接続されたトランジスタＱｌ、Ｑ２と、ト
ランジスタＱ３． Ｑ４と、定電流源１１とが差動増幅
回路を形成している。トランジスタＱ１のベースには制
御端子５が接続され、トランジスタＱ３のベースにはス
レッショルド電圧ｖ８、（本実施例では２．５Ｖ）が印
加されている。トランジスタＱ６と、り′イオードを形
成するトランジスタｑ５とはカレントミラー回路を形成
し、トランジスタＱ５のコレクタにはトランジスタＱ４
のコレクタが接続されている。ダイオード接続されたト
ランジスタＱ７と、並列接続されたトランジスタＱ８１
１ Ｑ８２１〜＋Ｑａｎとはカレントミラー回路を形し
、トランジスタＱ７のコレクタはトランジスタｑ６のコ
レクタとともに定電流源Ｉ２を介して電源ＶＣＣに接続
されている。
ランジスタＱ３． Ｑ４と、定電流源１１とが差動増幅
回路を形成している。トランジスタＱ１のベースには制
御端子５が接続され、トランジスタＱ３のベースにはス
レッショルド電圧ｖ８、（本実施例では２．５Ｖ）が印
加されている。トランジスタＱ６と、り′イオードを形
成するトランジスタｑ５とはカレントミラー回路を形成
し、トランジスタＱ５のコレクタにはトランジスタＱ４
のコレクタが接続されている。ダイオード接続されたト
ランジスタＱ７と、並列接続されたトランジスタＱ８１
１ Ｑ８２１〜＋Ｑａｎとはカレントミラー回路を形し
、トランジスタＱ７のコレクタはトランジスタｑ６のコ
レクタとともに定電流源Ｉ２を介して電源ＶＣＣに接続
されている。
次に、本実施例の動作について説明する。
制御端子５には記録時にはＯＶ、記録停止時には５ｖか
印加される。まず、制御端子５に印加される電圧がＯｖ
の場合、電流Ｉ５が流れないので定電流Ｉ２はトランジ
スタＱ７に流れ、電流１４１＋ １４２＋〜、Ｌ□にも
分配電流が流れる。したがって、端子３１．３２．〜．
３ｍにそれぞれ接続された回路部分をアクティブにする
ことができる。
印加される。まず、制御端子５に印加される電圧がＯｖ
の場合、電流Ｉ５が流れないので定電流Ｉ２はトランジ
スタＱ７に流れ、電流１４１＋ １４２＋〜、Ｌ□にも
分配電流が流れる。したがって、端子３１．３２．〜．
３ｍにそれぞれ接続された回路部分をアクティブにする
ことができる。
逆に制御端子５に印加される電圧が５ｖの場合、出力電
流Ｉ５が流れ、Ｉ２＜１．５と設定しておけば、トラン
ジスタＱ７には電流が流れず、したがって電流１４１．
１４□、〜、Ｉ４゜も流れない。したがって端子３］、
３２．〜．３ｍにそれぞれ接続された回路部分をイン
アクティブにすることができる。
流Ｉ５が流れ、Ｉ２＜１．５と設定しておけば、トラン
ジスタＱ７には電流が流れず、したがって電流１４１．
１４□、〜、Ｉ４゜も流れない。したがって端子３］、
３２．〜．３ｍにそれぞれ接続された回路部分をイン
アクティブにすることができる。
このように本実施例はリレーなど消費電力の大きい素子
を使用せず増幅器をオン・オフできるので低消費電力型
となる。また、制御端子５のインピータンスはターリン
トン接続によりハイインピーダンスにされているので、
マイクロコンピュータなとからの制御出力端子と直結も
でき、バッファアンプなどを使用する必要がない。また
このように記録停止信号に応して記録増幅回路を停止さ
せることができることにより、記録増幅回路中に定常状
態に達するまでに時間がかかる回路を含む場合に、定常
状態に達するまで時間のかかる回路は動作させておき、
それ以外の回路はカットオフさせておくことにより回路
をすばやく動作せしめる事も可能となる。またトランジ
スタＱ７゜Ｑ８．、Ｑ８□、〜＋Ｑ８ｍからなるスイッ
チ回路を集積回路内に組み込む事は素子数の増大となる
が、外付のトランジスタやリレーで制御回路を構成する
のに比較してその費用はもとより回路のまとまりがよい
という面においても有利である。
を使用せず増幅器をオン・オフできるので低消費電力型
となる。また、制御端子５のインピータンスはターリン
トン接続によりハイインピーダンスにされているので、
マイクロコンピュータなとからの制御出力端子と直結も
でき、バッファアンプなどを使用する必要がない。また
このように記録停止信号に応して記録増幅回路を停止さ
せることができることにより、記録増幅回路中に定常状
態に達するまでに時間がかかる回路を含む場合に、定常
状態に達するまで時間のかかる回路は動作させておき、
それ以外の回路はカットオフさせておくことにより回路
をすばやく動作せしめる事も可能となる。またトランジ
スタＱ７゜Ｑ８．、Ｑ８□、〜＋Ｑ８ｍからなるスイッ
チ回路を集積回路内に組み込む事は素子数の増大となる
が、外付のトランジスタやリレーで制御回路を構成する
のに比較してその費用はもとより回路のまとまりがよい
という面においても有利である。
第３図は本発明の第２の実施例を示すブロック図、第４
図は第３図の増幅器制御回路を詳細に示す回路図である
。
図は第３図の増幅器制御回路を詳細に示す回路図である
。
本実施例は第１図の実施例において記録用と再生用で分
割されていた電源端子６，７をまとめ端子１５とし、記
録と再生の切換端子１２を設けるとともに、記録件ＩＬ
期間に応じて記録増幅回路をカットオフさせるための端
ｆを前記記録と再生の切換端子１２と兼用した。このよ
うな構成にすることにより、まず外部の電源電圧の切換
回路が必要なくなり、よって外部切換素子の減少及び回
路の簡素化を図るとともにコストの低減ができる。
割されていた電源端子６，７をまとめ端子１５とし、記
録と再生の切換端子１２を設けるとともに、記録件ＩＬ
期間に応じて記録増幅回路をカットオフさせるための端
ｆを前記記録と再生の切換端子１２と兼用した。このよ
うな構成にすることにより、まず外部の電源電圧の切換
回路が必要なくなり、よって外部切換素子の減少及び回
路の簡素化を図るとともにコストの低減ができる。
さらに記録と再生の切換端子と記録停止時に記録増幅回
路をカットオフさせる端子を兼用したことによりヘッド
アンプ部の制御回路の簡素化及び制御方法の単一化がで
きる。次に記録と再生の切換端子と記録停止時に記録増
幅回路をカットオフさせる機能を兼用させる方法につい
て述べる。１つの端子で記録と再生と、記録時の記録停
止時の３つを判断するためには１つの端子で３条件を判
断しなければならなく、その方法としては３つの電圧埴
、例えばＯＶ、 ２．５Ｖ、 ５Ｖを判断する方法、
または２電圧値プラス端子をオーブンにしたことを判断
する方法、さらに端子への電流の流人、流出、流さない
の３条件を判断する方法などがあるか、３電圧値を判断
する方法について第４図を用いて説明する。
路をカットオフさせる端子を兼用したことによりヘッド
アンプ部の制御回路の簡素化及び制御方法の単一化がで
きる。次に記録と再生の切換端子と記録停止時に記録増
幅回路をカットオフさせる機能を兼用させる方法につい
て述べる。１つの端子で記録と再生と、記録時の記録停
止時の３つを判断するためには１つの端子で３条件を判
断しなければならなく、その方法としては３つの電圧埴
、例えばＯＶ、 ２．５Ｖ、 ５Ｖを判断する方法、
または２電圧値プラス端子をオーブンにしたことを判断
する方法、さらに端子への電流の流人、流出、流さない
の３条件を判断する方法などがあるか、３電圧値を判断
する方法について第４図を用いて説明する。
端子１２には記録と再生と、記録停止信号にあたる記録
増幅回路カットオフの制御イ菖号か人力される。端子１
２ （７） ’１ｊｊ： ＪＪｇ カＯＶ時■■１生、
２．５Ｖ時記録で２．５Ｖ時に不必要ｌｉｄ路をカット
オフさせて、５Ｖ時に記録［１１路を動作させている。
増幅回路カットオフの制御イ菖号か人力される。端子１
２ （７） ’１ｊｊ： ＪＪｇ カＯＶ時■■１生、
２．５Ｖ時記録で２．５Ｖ時に不必要ｌｉｄ路をカット
オフさせて、５Ｖ時に記録［１１路を動作させている。
このためにＯｖ。
２．５Ｖ、 ５ Ｖを判断するためにスレッショルド電
圧ＶＩ１２． Ｖｌｌ：ｌをそれぞれ］、２５Ｖ、 ３
．７５Ｖに設定し、２つのスイッチ回路４４．４５によ
って制御する。すなわち端子１２の電圧かＯＶの時は再
生用電流源出力４１、４２．〜，４ｍたＣづに電流が流
れ、２．５■の時は記録用回路中、記録停止にかかわら
ず記録停止時も含め記録＋１．’？常Ｈｅｆ動作させる
回路のための電流源用力５１．５２．〜．５ｍたけに電
流が流れ、５ｖの時には電流源出力５］、 ５２．〜．
５ｍと共に記録時だけに動作させる（口）路のための電
流源出力６１．６２．〜６ｍにも電流が流れる。
圧ＶＩ１２． Ｖｌｌ：ｌをそれぞれ］、２５Ｖ、 ３
．７５Ｖに設定し、２つのスイッチ回路４４．４５によ
って制御する。すなわち端子１２の電圧かＯＶの時は再
生用電流源出力４１、４２．〜，４ｍたＣづに電流が流
れ、２．５■の時は記録用回路中、記録停止にかかわら
ず記録停止時も含め記録＋１．’？常Ｈｅｆ動作させる
回路のための電流源用力５１．５２．〜．５ｍたけに電
流が流れ、５ｖの時には電流源出力５］、 ５２．〜．
５ｍと共に記録時だけに動作させる（口）路のための電
流源出力６１．６２．〜６ｍにも電流が流れる。
以上説明した正うに本発明は、制御端子に印加する記録
停止信号によって磁気記録再生装置の中の少なくともヘ
ッドアンプの記録用増幅回路を停止させ、または、すで
にある記録と再生の切換端子と兼用することによって外
付回路を簡素化するとともにコストを低減し、さらに制
御を簡単にさせるとともに、ヘッドアンプに係る消費電
力を減少させることもできる効果がある。
停止信号によって磁気記録再生装置の中の少なくともヘ
ッドアンプの記録用増幅回路を停止させ、または、すで
にある記録と再生の切換端子と兼用することによって外
付回路を簡素化するとともにコストを低減し、さらに制
御を簡単にさせるとともに、ヘッドアンプに係る消費電
力を減少させることもできる効果がある。
第１図は本発明の磁気記録再生装置の増幅器制御回路の
第１の実施例を示すブロック図、第２図は第１図の実施
例の増幅器制御回路１１を詳細に示す回路図、第３図は
本発明の第２の実施例を示すブロック図、第４図は第３
図の増幅器制御回路を詳細に示す回路図である。 ０ １・・・・・・・・・・・・記録用増幅回路、２・・・
・・・・・・・・・再生用増幅回路、３．４・・・・・
・・・ヘッド、 ５・・・・・・・・・・・・制御端子、６・・・・・・
・・・・・・再生用電源端子、７・・・・・・・・・・
・・記録用電源端子、８・・・・・・・・・・・・再生
信号出力端子、９・・・・・・・・・・・・記録信号入
力端子、１０・・・・・・・・・・・・ヘッドアンプ、
１１・・・・・・・・・・・・増幅器制御回路、１２・
・・・・・・・・・記録、再生、記録停止制御端子、１
３・・・・・・・・・・・・回路切換制御部、１４・・
・・・・・・・・・・電源部、１５・・・・・・・・・
・・・電源端子、３１・・・・・・・・・・・・スイッ
チ部、３０・・・・・・・・・・・・電流分配部、３１
．３２．〜，３ｍ・・・電流出力端子、４＋、４２．〜
，４ｍ・・・再生回路用電流出力端子、５１．５２．〜
，５ｍ 、 ６１，６２．〜，６ｍ ・・・・・・記録
用電流出力端子、 １ ０） ４５・・・・・・・・スイッチ回路。
第１の実施例を示すブロック図、第２図は第１図の実施
例の増幅器制御回路１１を詳細に示す回路図、第３図は
本発明の第２の実施例を示すブロック図、第４図は第３
図の増幅器制御回路を詳細に示す回路図である。 ０ １・・・・・・・・・・・・記録用増幅回路、２・・・
・・・・・・・・・再生用増幅回路、３．４・・・・・
・・・ヘッド、 ５・・・・・・・・・・・・制御端子、６・・・・・・
・・・・・・再生用電源端子、７・・・・・・・・・・
・・記録用電源端子、８・・・・・・・・・・・・再生
信号出力端子、９・・・・・・・・・・・・記録信号入
力端子、１０・・・・・・・・・・・・ヘッドアンプ、
１１・・・・・・・・・・・・増幅器制御回路、１２・
・・・・・・・・・記録、再生、記録停止制御端子、１
３・・・・・・・・・・・・回路切換制御部、１４・・
・・・・・・・・・・電源部、１５・・・・・・・・・
・・・電源端子、３１・・・・・・・・・・・・スイッ
チ部、３０・・・・・・・・・・・・電流分配部、３１
．３２．〜，３ｍ・・・電流出力端子、４＋、４２．〜
，４ｍ・・・再生回路用電流出力端子、５１．５２．〜
，５ｍ 、 ６１，６２．〜，６ｍ ・・・・・・記録
用電流出力端子、 １ ０） ４５・・・・・・・・スイッチ回路。
Claims (1)
- 【特許請求の範囲】 １、ベースが制御端子に接続された第１のトランジスタ
と、第１のトランジスタにダーリントン接続された第２
のトランジスタとからなる第１の駆動回路と、ベースが
基準電圧に接続された第３のトランジスタと、第３のト
ランジスタにダーリントン接続された第４のトランジス
タからなる第２の駆動回路とを制御端子から制御してス
イッチ動作をさせるスイッチ回路と、 スイッチ回路の第１、第２の駆動回路のうち少なくとも
一方の動作を定電流供給の有無で伝達する第１のカレン
トミラー回路と、 第１のカレントミラー回路からの定電流供給の有無を１
以上の節点に伝達する第２のカレントミラー回路とを有
する、磁気記録再生装置の増幅器制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP02055430A JP3128801B2 (ja) | 1990-03-06 | 1990-03-06 | 磁気記録再生装置の増幅器制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP02055430A JP3128801B2 (ja) | 1990-03-06 | 1990-03-06 | 磁気記録再生装置の増幅器制御回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH03256204A true JPH03256204A (ja) | 1991-11-14 |
| JP3128801B2 JP3128801B2 (ja) | 2001-01-29 |
Family
ID=12998371
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP02055430A Expired - Fee Related JP3128801B2 (ja) | 1990-03-06 | 1990-03-06 | 磁気記録再生装置の増幅器制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3128801B2 (ja) |
-
1990
- 1990-03-06 JP JP02055430A patent/JP3128801B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JP3128801B2 (ja) | 2001-01-29 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |