JPH03204205A - 集積回路装置 - Google Patents
集積回路装置Info
- Publication number
- JPH03204205A JPH03204205A JP34286289A JP34286289A JPH03204205A JP H03204205 A JPH03204205 A JP H03204205A JP 34286289 A JP34286289 A JP 34286289A JP 34286289 A JP34286289 A JP 34286289A JP H03204205 A JPH03204205 A JP H03204205A
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- JP
- Japan
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- frequency
- mixer
- amplifier
- oscillation
- signal
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- Pending
Links
- 230000010355 oscillation Effects 0.000 claims abstract description 27
- 239000003990 capacitor Substances 0.000 abstract description 3
- 238000010586 diagram Methods 0.000 description 6
- 230000003321 amplification Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000003199 nucleic acid amplification method Methods 0.000 description 1
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、集積回路装置に関し、特に直接衛星放送受信
機（ＤＢＳ ＩＤＵ＞の発振器に用いられ２逓倍回路
を有する集積回路装置に関する。
機（ＤＢＳ ＩＤＵ＞の発振器に用いられ２逓倍回路
を有する集積回路装置に関する。
従来、この種の発振器は、第３図の回路図に示すように
、逆バイアスの（Ｖｔ、Ｏ〜３０Ｖ）のかかった直列抵
抗分の少ない可変容量ダイオード（以下バラクタダイオ
ードという）Ｄｌと容量Ｃ１とでつくられる容量０分と
共振線路３のインダクタし成分によるＬＣ成分から共振
周波数ｆ＝１／２πＦ］丁で−の発振共振部１と、この
発振共振部１からトランジスタＱ１に正帰還される発振
増幅部２とからなり、発振周波数１．４Ｇ〜２．４ Ｇ
Ｈｚの周波数を基本発振させる構造が用いられていた。
、逆バイアスの（Ｖｔ、Ｏ〜３０Ｖ）のかかった直列抵
抗分の少ない可変容量ダイオード（以下バラクタダイオ
ードという）Ｄｌと容量Ｃ１とでつくられる容量０分と
共振線路３のインダクタし成分によるＬＣ成分から共振
周波数ｆ＝１／２πＦ］丁で−の発振共振部１と、この
発振共振部１からトランジスタＱ１に正帰還される発振
増幅部２とからなり、発振周波数１．４Ｇ〜２．４ Ｇ
Ｈｚの周波数を基本発振させる構造が用いられていた。
上述した従来の発振器は、第３図の発振増幅部２の利得
が２．４ＧＨｚまで必要でこの利得が制御しにくい欠点
がある。また高い周波数で発振させるためには、発振共
振部１の容量Ｃ，の値を小さく選ばなければならず、そ
の容量変化が共振に対し大きなバラツキ量をもつことで
ある。またバラクタダイオードＤ、の周波数の上昇に伴
う直列抵抗分子ｓの増加により発振停止となる欠点があ
る。
が２．４ＧＨｚまで必要でこの利得が制御しにくい欠点
がある。また高い周波数で発振させるためには、発振共
振部１の容量Ｃ，の値を小さく選ばなければならず、そ
の容量変化が共振に対し大きなバラツキ量をもつことで
ある。またバラクタダイオードＤ、の周波数の上昇に伴
う直列抵抗分子ｓの増加により発振停止となる欠点があ
る。
本発明の目的は、所望の周波数の１／２の周波数を発振
させてモノリシックＩＣ内の二逓倍器により所望発振周
波数と得ることにより、簡単な構造で容易に構成される
集積回路装置を提供することにある。
させてモノリシックＩＣ内の二逓倍器により所望発振周
波数と得ることにより、簡単な構造で容易に構成される
集積回路装置を提供することにある。
本発明の集積回路装置の構成は、所望の発振周波数の１
／２の周波数を発振させる発振回路と、この発振回路の
周波数を２倍にする二逓倍回路と、この逓倍器の出力と
入力高周波信号とを混合する混合器と、この混合器の出
力から中間周波数信号を増幅する中間周波数増幅器とを
有し、これらを１チップ上に形成したことを特徴とする
集積回路装置。
／２の周波数を発振させる発振回路と、この発振回路の
周波数を２倍にする二逓倍回路と、この逓倍器の出力と
入力高周波信号とを混合する混合器と、この混合器の出
力から中間周波数信号を増幅する中間周波数増幅器とを
有し、これらを１チップ上に形成したことを特徴とする
集積回路装置。
次に、本発明について図面を参照して説明する。
第１図（ａ）、（ｂ）は本発明の第１の実施例を示すモ
ノリシックＩＣ回路のブロック図およびその部分詳細回
路図である。
ノリシックＩＣ回路のブロック図およびその部分詳細回
路図である。
本実施例のモノリシックＩＣ内には、混合器１１と発振
回路８と、二逓倍器９と、バッファアンプ１０．ＩＦア
ンプ１２とを有している。発振回路８は、外付けの容量
６とインダクタ７とで所望発振周波数の半分の周波数を
共振させ、規定発振周波数の半分の発振周波数を発振さ
せ、二逓倍器９により２逓倍して所望の規定発振周波数
を得て、バッファアンプ１０を介して混合器１１に入力
される。この混合器１１にはＲＦ入力端子１５．１６か
らのＲＦ倍信号入力され、このＲＦ倍信号発振出力の差
分がＩＦ増幅器１２を通じてＩＦ出力端子１７に出力さ
れる。
回路８と、二逓倍器９と、バッファアンプ１０．ＩＦア
ンプ１２とを有している。発振回路８は、外付けの容量
６とインダクタ７とで所望発振周波数の半分の周波数を
共振させ、規定発振周波数の半分の発振周波数を発振さ
せ、二逓倍器９により２逓倍して所望の規定発振周波数
を得て、バッファアンプ１０を介して混合器１１に入力
される。この混合器１１にはＲＦ入力端子１５．１６か
らのＲＦ倍信号入力され、このＲＦ倍信号発振出力の差
分がＩＦ増幅器１２を通じてＩＦ出力端子１７に出力さ
れる。
第１図（ｂ）において、ｏｓｃｓ部分のトランジスタ３
１．３２において所望発振周波数の半分の周波数を発振
させ、二逓倍器９部分のトランジスタ３５．３６には互
いに逆相の（位相差１８０°）の信号が入力されること
により、入力信号の２倍の周波数の信号がトランジスタ
３７゜３８に出力される。バッファアンプ１０部分のト
ランジスタ３９．４０により増幅され混合器１１のトラ
ンジスタ４１〜４４の差動増幅により、入力端子１５．
１６との差分が出力端子２７．２６に出力される。
１．３２において所望発振周波数の半分の周波数を発振
させ、二逓倍器９部分のトランジスタ３５．３６には互
いに逆相の（位相差１８０°）の信号が入力されること
により、入力信号の２倍の周波数の信号がトランジスタ
３７゜３８に出力される。バッファアンプ１０部分のト
ランジスタ３９．４０により増幅され混合器１１のトラ
ンジスタ４１〜４４の差動増幅により、入力端子１５．
１６との差分が出力端子２７．２６に出力される。
本実施例は、発振回路８で０．７２５〜０．８６ＧＨｚ
を発振させ、２逓倍器９で１．４５＞ １．７２ＧＨｚ
とし、これをＲＦ入力信号１．０４９〜１．３１８ＧＨ
ｚと混合器１１で混合し、ＩＦアンプ１２から４０２．
７８ＭＨｚのＩＦ信号を出力している。
を発振させ、２逓倍器９で１．４５＞ １．７２ＧＨｚ
とし、これをＲＦ入力信号１．０４９〜１．３１８ＧＨ
ｚと混合器１１で混合し、ＩＦアンプ１２から４０２．
７８ＭＨｚのＩＦ信号を出力している。
第２図は本発明の第２の実施例を示すモノリシックＩＣ
内のブロック図である０本実施例では、ＴＶチューナ用
としてＶＨＦ帯の周波数１５０〜５３０ＭＩｌｚを基本
波として二逓倍器９によりＵＨＦ帯の周波数５３５〜８
２４ＭＨｚを発振させることにより、出力周波数３０〜
５ＱＭＨｚを得るようにしている。この実施例では発振
周波数が小さくすむという利点がある。
内のブロック図である０本実施例では、ＴＶチューナ用
としてＶＨＦ帯の周波数１５０〜５３０ＭＩｌｚを基本
波として二逓倍器９によりＵＨＦ帯の周波数５３５〜８
２４ＭＨｚを発振させることにより、出力周波数３０〜
５ＱＭＨｚを得るようにしている。この実施例では発振
周波数が小さくすむという利点がある。
以上説明したように本発明の回路構成を採用することに
より、従来の発振器で発振させる周波数の２倍の発振周
波数が得られ、共振器部分を簡単に構成することができ
るという効果がある。また、従来の構成では発振器部分
で２ ＧＨｚ、 Ｉ ＧＨｚ対応のプリスケーラがそれ
ぞれ必要とするが、発振周波数が小さいなめ１ ［ｉＨ
ｚ対応のプリスケーラだけで動作する発振器を形成する
ことができ、ＩＣ化が容易であるという効果がある。
より、従来の発振器で発振させる周波数の２倍の発振周
波数が得られ、共振器部分を簡単に構成することができ
るという効果がある。また、従来の構成では発振器部分
で２ ＧＨｚ、 Ｉ ＧＨｚ対応のプリスケーラがそれ
ぞれ必要とするが、発振周波数が小さいなめ１ ［ｉＨ
ｚ対応のプリスケーラだけで動作する発振器を形成する
ことができ、ＩＣ化が容易であるという効果がある。
第１図（ａ）、（ｂ）は本発明の第１の実施例を示すブ
ロック図およびその部分回路図、第２図は本発明の第２
の実施例を示すブロック図、第３図は従来の発振器の一
例の回路図である。 １・・・発振共振部、２・・・発振増幅部、３・・・共
振線路、５・・・モノリシックＩＣ回路、６・・・容量
、７・・・インダクタ、８・・・発振器、９・・・二逓
倍器、１０・・・バッファアンプ、１１・・・混合器、
１２・・・ＩＦアンプ、１３．１４・・・ｏＳＣと接続
される入力端子、１５．１６・・・ＲＦ信号入力端子、
１７・・・出力端子、２４・・・Ｏ８Ｃバイアス端子、
２５・・・Ｖｃ０端子、２６．２７・・・出力端子、３
０・・・接地端子、３１．３２・・・ＯＳＣ部分のトラ
ンジスタ、３３〜３８・・・２逓倍器部分のトランジス
タ、３９．４０・・・ＯＳ ＣＢｕｆｆ ａｍｐ部分の
トランジスタ、４１〜４６・・・ＭＩＸ部分のトランジ
スタ、Ｃ１・・・容量、Ｄｌ・・・バラクタダイ７オー
ド。
ロック図およびその部分回路図、第２図は本発明の第２
の実施例を示すブロック図、第３図は従来の発振器の一
例の回路図である。 １・・・発振共振部、２・・・発振増幅部、３・・・共
振線路、５・・・モノリシックＩＣ回路、６・・・容量
、７・・・インダクタ、８・・・発振器、９・・・二逓
倍器、１０・・・バッファアンプ、１１・・・混合器、
１２・・・ＩＦアンプ、１３．１４・・・ｏＳＣと接続
される入力端子、１５．１６・・・ＲＦ信号入力端子、
１７・・・出力端子、２４・・・Ｏ８Ｃバイアス端子、
２５・・・Ｖｃ０端子、２６．２７・・・出力端子、３
０・・・接地端子、３１．３２・・・ＯＳＣ部分のトラ
ンジスタ、３３〜３８・・・２逓倍器部分のトランジス
タ、３９．４０・・・ＯＳ ＣＢｕｆｆ ａｍｐ部分の
トランジスタ、４１〜４６・・・ＭＩＸ部分のトランジ
スタ、Ｃ１・・・容量、Ｄｌ・・・バラクタダイ７オー
ド。
Claims (1)
- 所望の発振周波数の１／２の周波数を発振させる発振回
路と、この発振回路の周波数を２倍にする二逓倍回路と
、この逓倍器の出力と入力高周波信号とを混合する混合
器と、この混合器の出力から中間周波数信号を増幅する
中間周波数増幅器とを有し、これらを１チップ上に形成
したことを特徴とする集積回路装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP34286289A JPH03204205A (ja) | 1989-12-29 | 1989-12-29 | 集積回路装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP34286289A JPH03204205A (ja) | 1989-12-29 | 1989-12-29 | 集積回路装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH03204205A true JPH03204205A (ja) | 1991-09-05 |
Family
ID=18357072
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP34286289A Pending JPH03204205A (ja) | 1989-12-29 | 1989-12-29 | 集積回路装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH03204205A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH07122939A (ja) * | 1993-10-27 | 1995-05-12 | Nec Corp | 周波数逓倍・ミキサ回路 |
| JPH1174730A (ja) * | 1997-08-28 | 1999-03-16 | New Japan Radio Co Ltd | 周波数逓倍器 |
| JP2010283876A (ja) * | 2002-09-27 | 2010-12-16 | Thomson Licensing | テレビジョン信号チューナ用の電子的整合システム |
-
1989
- 1989-12-29 JP JP34286289A patent/JPH03204205A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH07122939A (ja) * | 1993-10-27 | 1995-05-12 | Nec Corp | 周波数逓倍・ミキサ回路 |
| JPH1174730A (ja) * | 1997-08-28 | 1999-03-16 | New Japan Radio Co Ltd | 周波数逓倍器 |
| JP2010283876A (ja) * | 2002-09-27 | 2010-12-16 | Thomson Licensing | テレビジョン信号チューナ用の電子的整合システム |
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