JPH03165054A - 計算機モジュール用リードレスチップキャリア - Google Patents
計算機モジュール用リードレスチップキャリアInfo
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- JPH03165054A JPH03165054A JP1303304A JP30330489A JPH03165054A JP H03165054 A JPH03165054 A JP H03165054A JP 1303304 A JP1303304 A JP 1303304A JP 30330489 A JP30330489 A JP 30330489A JP H03165054 A JPH03165054 A JP H03165054A
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- H05K2201/09209—Shape and layout details of conductors
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- H05K2201/09209—Shape and layout details of conductors
- H05K2201/095—Conductive through-holes or vias
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- H05K2203/00—Indexing scheme relating to apparatus or processes for manufacturing printed circuits covered by H05K3/00
- H05K2203/15—Position of the PCB during processing
- H05K2203/1581—Treating the backside of the PCB, e.g. for heating during soldering or providing a liquid coating on the backside
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
[産業上の利用分野]
本発明は計算機モジュールにおける半導体チップキャリ
アに関する。
アに関する。
[従来技術]
従来の計算機モジュールは第6図に示すように、半導体
1を搭載したリードレスチップキャリア2をモジュール
基板3上に搭載して接続し配線するようにしていた。
1を搭載したリードレスチップキャリア2をモジュール
基板3上に搭載して接続し配線するようにしていた。
上記リードレスチップキャリア2は第7図に示すような
断面形状になっていた。セラミック基板4のスルーホー
ル10には導体11が穴埋め印刷により充填、焼結され
、その表面には金属薄膜の整合層5がスパッタ、蒸着等
により形成される。さらにその上部には絶縁層5と配線
層7を必要な暦数だけ順次積み重ねて生成する。
断面形状になっていた。セラミック基板4のスルーホー
ル10には導体11が穴埋め印刷により充填、焼結され
、その表面には金属薄膜の整合層5がスパッタ、蒸着等
により形成される。さらにその上部には絶縁層5と配線
層7を必要な暦数だけ順次積み重ねて生成する。
そして、最後の表面層8には半導体1がCCBはんだ(
Controlled Co11apse Bondi
ng)9により接続される。また、上記導体11の表面
には整合層5との密着性を改善するため金属メッキが施
されたりする。
Controlled Co11apse Bondi
ng)9により接続される。また、上記導体11の表面
には整合層5との密着性を改善するため金属メッキが施
されたりする。
第8図はリードレスチップキャリア2の上記製造プロセ
スを示す図である。セラミック基板4内の導体11を焼
結して生成後、整合層5を生成し、その上部に絶縁層5
と配線層7を必要層数積み上げ、最後に表面層8を生成
する。
スを示す図である。セラミック基板4内の導体11を焼
結して生成後、整合層5を生成し、その上部に絶縁層5
と配線層7を必要層数積み上げ、最後に表面層8を生成
する。
[発明が解決しようとする課題]
上記従来のリードレスチップキャリアでは第9図に示す
ように、導体11表面とセラミック基板4間には10μ
m程度の段差が生じ、さらに、導体11が数μm程度の
粉体を焼結して生成するため、その表面にも数μm程度
の微細な凹凸が発生する。これらの凹凸に整合層を生成
すると第10図に示すように、ボイド13や段切れ12
等が発生し、配線層7との接続の信頼性が低下するとい
う問題があった。
ように、導体11表面とセラミック基板4間には10μ
m程度の段差が生じ、さらに、導体11が数μm程度の
粉体を焼結して生成するため、その表面にも数μm程度
の微細な凹凸が発生する。これらの凹凸に整合層を生成
すると第10図に示すように、ボイド13や段切れ12
等が発生し、配線層7との接続の信頼性が低下するとい
う問題があった。
本発明の目的は、上記導体11と配線層7間の接続の信
頼性を向上させた計算機モジュール用リードレスチップ
キャリアを提供することにある。
頼性を向上させた計算機モジュール用リードレスチップ
キャリアを提供することにある。
[課題を解決するための手段]
上記課題を解決するために、リードレスチップキャリア
用セラミック基板のスルーホール内導体の整合層接触部
の形状を平滑なクラウニング形にする。
用セラミック基板のスルーホール内導体の整合層接触部
の形状を平滑なクラウニング形にする。
さらに、上記導体の整合層接触部形状を上記リードレス
チップキャリア用セラミック基板表面からの盛り上がり
量が3μm以下となるようにする。
チップキャリア用セラミック基板表面からの盛り上がり
量が3μm以下となるようにする。
さらに、上記整合層接触部の表面を研磨テープにより研
磨して上記クラウニング形状に加工する。
磨して上記クラウニング形状に加工する。
さらに、上記導体表面にメッキ層を設け、上記メッキ層
表面から上記研磨加工を行うようにする。
表面から上記研磨加工を行うようにする。
[作用]
以上のように構成した本発明の計算機モジュール用リー
ドレスチップキャリアでは、導体11の表面を平滑なク
ラウニング形状とするので配線層7との接続を強固なも
のとなり、配線の信頼性が著しく高まる。
ドレスチップキャリアでは、導体11の表面を平滑なク
ラウニング形状とするので配線層7との接続を強固なも
のとなり、配線の信頼性が著しく高まる。
[実施例コ
第5図は本発明による導体11の表面の加工法を示す図
である。導体11が多数設けられたセラミック基板4の
表面に、砥粒を塗布した研磨テープ18を例えばゴム等
の弾性体の加圧ローラ17により押し当て、これを巻取
りながら研磨する。
である。導体11が多数設けられたセラミック基板4の
表面に、砥粒を塗布した研磨テープ18を例えばゴム等
の弾性体の加圧ローラ17により押し当て、これを巻取
りながら研磨する。
第1図は上記研磨加工を施した導体11上に整合N5を
メッキにより形成した場合の断面図である。導体5の表
面は平滑に、クラウニング形状に成型されるので、整合
層5を隙間無く強固に取り付けることができる。
メッキにより形成した場合の断面図である。導体5の表
面は平滑に、クラウニング形状に成型されるので、整合
層5を隙間無く強固に取り付けることができる。
第2図は、第1図に示した導体11の表面とセラミック
基板4間の段差と、リードレスチップキャリアの故障率
との関係を実際に調べた結果である。これより上記段差
が3μm以下とすることにより、上記故障率を略ゼロに
できることがわかる。したがって、本発明では上記段差
を3μm以下とするように、第5図に示した研磨方法に
より研磨する。
基板4間の段差と、リードレスチップキャリアの故障率
との関係を実際に調べた結果である。これより上記段差
が3μm以下とすることにより、上記故障率を略ゼロに
できることがわかる。したがって、本発明では上記段差
を3μm以下とするように、第5図に示した研磨方法に
より研磨する。
第3図は上記導体11の表面をメッキした場合の断面図
である。第1図に示したような形状の導体表面にメッキ
を施すと、メッキ層は15に示すように周辺部が盛り上
がった凹形の形状となり、整合層5との密着度を劣化さ
せる。したがって本発明では、上記導体5の表面を略セ
ラミック基板4の表面まで研磨してから上記メッキ層1
5を設けるようにする。
である。第1図に示したような形状の導体表面にメッキ
を施すと、メッキ層は15に示すように周辺部が盛り上
がった凹形の形状となり、整合層5との密着度を劣化さ
せる。したがって本発明では、上記導体5の表面を略セ
ラミック基板4の表面まで研磨してから上記メッキ層1
5を設けるようにする。
また、第3図に示したように、凹状に盛り土がったメッ
キ層を生成後、第5図に示した研磨法により平滑に研磨
してもよい。
キ層を生成後、第5図に示した研磨法により平滑に研磨
してもよい。
第4図は導体11表面の加工プロセスを示す図である。
セラミック基板4を焼結後、導体11をスルーホール部
にメッキし、その表面を平滑に研磨加工し、整合層5を
形成する。
にメッキし、その表面を平滑に研磨加工し、整合層5を
形成する。
つぎに、上記加工法にて得られた本発明のリードレスチ
ップキャリアにつき説明する。
ップキャリアにつき説明する。
まず、上記本発明の加工法によると、直径が0.1mm
のスルーホールを1万個程度備えた長さが100mmの
セラミック基板では、数100μm程度の反りが存在し
ても全導体の表面を十分良好に研磨することができる。
のスルーホールを1万個程度備えた長さが100mmの
セラミック基板では、数100μm程度の反りが存在し
ても全導体の表面を十分良好に研磨することができる。
次に、略1万個のスルーホール内の導体表面にニッケ
ルメッキを施した大きさ100mm平方、厚み1mm程
度のセラミック基板の表面に上記研磨加工を施す場合に
つき説明する。粒径5μmのアルミナ砥粒が塗布された
厚さ25μm、幅25mmの研磨テープ18を直径40
mm、長さ25mm、ゴム硬度45°の加圧ローラ17
によりIONの荷重で加圧し、毎分20cmの速度で送
り出し、同時に幅0.7mm、周波数30Hzの振動を
与える。また同時に、セラミック基板4を搭載するテー
ブルを毎分20cmの速度で16往復させながら25
m mの割り出し量で加工位置を割り出し、ビックフィ
ード方式で加工した。上記加工により、当初1段差が7
μm9表面凹凸が2μmであったメッキ層表面が、段差
が2μm9表面凹凸が0.1μm以内になり、極めて良
好な他の薄膜との整合状態を達成することができた。
ルメッキを施した大きさ100mm平方、厚み1mm程
度のセラミック基板の表面に上記研磨加工を施す場合に
つき説明する。粒径5μmのアルミナ砥粒が塗布された
厚さ25μm、幅25mmの研磨テープ18を直径40
mm、長さ25mm、ゴム硬度45°の加圧ローラ17
によりIONの荷重で加圧し、毎分20cmの速度で送
り出し、同時に幅0.7mm、周波数30Hzの振動を
与える。また同時に、セラミック基板4を搭載するテー
ブルを毎分20cmの速度で16往復させながら25
m mの割り出し量で加工位置を割り出し、ビックフィ
ード方式で加工した。上記加工により、当初1段差が7
μm9表面凹凸が2μmであったメッキ層表面が、段差
が2μm9表面凹凸が0.1μm以内になり、極めて良
好な他の薄膜との整合状態を達成することができた。
[発明の効果]
本発明により、スルーホールの導体部における断線、短
絡等の無い、信頼性の高い計算機モジュール用リードレ
スチップキャリアを生産することができる。
絡等の無い、信頼性の高い計算機モジュール用リードレ
スチップキャリアを生産することができる。
なお上記本発明においては、セラミック基板の反りによ
らず、良好な上記計算機モジュール用リードレスチップ
キャリアを得ることができる。
らず、良好な上記計算機モジュール用リードレスチップ
キャリアを得ることができる。
第1図は本発明によるスルーホール部の一実施例断面図
、第2図は本発明によるスルーホール部導体の段差と故
障率の関係を示す図、第3図はスルーホール部導体表面
にメッキ層を設けた場合の断面図、第4図は本発明によ
る加工プロセス図、第5図は本発明によるスルーホール
部導体表面の加工装置の説明図、第6図は従来のり一ド
レス半導体チップキャリアを搭載したモジュールの断面
図、第7図は従来のリードレス半導体チップキャリアの
断面図、第8図は従来のリードレス半導体チップキャリ
アの製造工程図、第9図は従来のスルーホール導体部の
断面形状図、第10図は従来のメッキ層を設けたスルー
ホール導体部の断面形状図である。 1・・・半導体、2・・・リードレスチップキャリア、
3・・・モジュール基板、4・・・セラミック基板、5
・・・整合層、6・・・絶縁層、7・・・配線層、8・
・・表面層、9・・・CCB、10・・・スルーホール
、11・・・導体、12・・・段切れ、13・・・ボイ
ド、 15・・・メッキ層、 17・・・加工用ローラ、 18・・・研磨テープ。
、第2図は本発明によるスルーホール部導体の段差と故
障率の関係を示す図、第3図はスルーホール部導体表面
にメッキ層を設けた場合の断面図、第4図は本発明によ
る加工プロセス図、第5図は本発明によるスルーホール
部導体表面の加工装置の説明図、第6図は従来のり一ド
レス半導体チップキャリアを搭載したモジュールの断面
図、第7図は従来のリードレス半導体チップキャリアの
断面図、第8図は従来のリードレス半導体チップキャリ
アの製造工程図、第9図は従来のスルーホール導体部の
断面形状図、第10図は従来のメッキ層を設けたスルー
ホール導体部の断面形状図である。 1・・・半導体、2・・・リードレスチップキャリア、
3・・・モジュール基板、4・・・セラミック基板、5
・・・整合層、6・・・絶縁層、7・・・配線層、8・
・・表面層、9・・・CCB、10・・・スルーホール
、11・・・導体、12・・・段切れ、13・・・ボイ
ド、 15・・・メッキ層、 17・・・加工用ローラ、 18・・・研磨テープ。
Claims (5)
- 1.半導体装置を搭載し、セラミック厚膜多層配線基板
に配置接続されるリードレスチップキャリアにおいて、
上記リードレスチップキャリア用セラミック基板のスル
ーホール内導体の整合層接触部の形状を、平滑なクラウ
ニング形としたことを特徴とする計算機モジュール用リ
ードレスチップキャリア。 - 2.請求項1において、上記導体の整合層接触部形状を
、上記リードレスチップキャリア用セラミック基板表面
からの盛り上がり量が3μm以下となるようにしたこと
を特徴とする計算機モジュール用リードレスチップキャ
リア。 - 3.請求項1において、上記整合層接触部の表面を研磨
テープにより研磨して上記クラウニング形状に加工した
ことを特徴とする計算機モジュール用リードレスチップ
キャリア。 - 4.請求項1において、上記導体表面にメッキ層を設け
、上記メッキ層表面を研磨テープにより研磨して上記ク
ラウニング形状に加工したことを特徴とする計算機モジ
ュール用リードレスチップキャリア。 - 5.請求項1ないし4記載の計算機モジュール用リード
レスチップキャリアを搭載したことを特徴とする大型計
算機用モジュール。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1303304A JP2633366B2 (ja) | 1989-11-24 | 1989-11-24 | 計算機モジュール用リードレスチップキャリア |
US08/225,921 US5473194A (en) | 1989-11-24 | 1994-04-11 | Chip carrier having through hole conductors |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1303304A JP2633366B2 (ja) | 1989-11-24 | 1989-11-24 | 計算機モジュール用リードレスチップキャリア |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH03165054A true JPH03165054A (ja) | 1991-07-17 |
JP2633366B2 JP2633366B2 (ja) | 1997-07-23 |
Family
ID=17919346
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