JPH03121449U - - Google Patents

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JPH03121449U
JPH03121449U JP3123890U JP3123890U JPH03121449U JP H03121449 U JPH03121449 U JP H03121449U JP 3123890 U JP3123890 U JP 3123890U JP 3123890 U JP3123890 U JP 3123890U JP H03121449 U JPH03121449 U JP H03121449U
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JP
Japan
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external terminal
data bus
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internal data
interface circuit
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JP3123890U
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Description

【図面の簡単な説明】
第1図は本考案のパラレルインターフエース回
路の一実施例を示すブロツク図、第2図は従来例
を示すブロツク図である。 1,2,31,32……インバータ、3……内
部バスバツフア、4……外部端子出力バツフア、
5,6,7,8……トランスフアゲート、9……
外部端子、10……内部データバス、13,14
,24,25……ANDゲート、15……IBF
フラグレジスタ、16……OBFフラグレジスタ
、18……データ書き込み信号、19……データ
読み出し信号、20……IBF出力端子、21…
…OBF出力端子、22……データバスバツフア
読み出し信号、23……データバスバツフア書き
込み信号、26,27……アドレスデコーダ、2
8……アドレスバス、29,30……内部バスバ
ツフア、41,42……ラツチ。

Claims (1)

  1. 【実用新案登録請求の範囲】 内部データバスと外部端子との間のデータの授
    受を行うためのマイクロコンピユータのパラレル
    インターフエース回路において、 外部からの書き込み信号に基づき、前記外部端
    子からのデータを記憶し、かつ、内部で発生され
    る書き込み信号に基づき前記内部データバスから
    、前記外部端子に出力すべきデータを記憶する記
    憶手段から、外部からの読み出し信号に基づき前
    記記憶手段の内容を前記外部端子に出力する第1
    のトランスフアゲート手段と、内部で発生される
    読み出し信号に基づき前記記憶手段の内容を、前
    記内部データバスに出力する第2のトランスフア
    ゲート手段とを有することを特徴としたパラレル
    インターフエース回路。
JP3123890U 1990-03-27 1990-03-27 Pending JPH03121449U (ja)

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Application Number Priority Date Filing Date Title
JP3123890U JPH03121449U (ja) 1990-03-27 1990-03-27

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JP3123890U JPH03121449U (ja) 1990-03-27 1990-03-27

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JPH03121449U true JPH03121449U (ja) 1991-12-12

Family

ID=31533982

Family Applications (1)

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JP3123890U Pending JPH03121449U (ja) 1990-03-27 1990-03-27

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