JPH0295166A - Dc−dcコンバータ - Google Patents
Dc−dcコンバータInfo
- Publication number
- JPH0295166A JPH0295166A JP24281288A JP24281288A JPH0295166A JP H0295166 A JPH0295166 A JP H0295166A JP 24281288 A JP24281288 A JP 24281288A JP 24281288 A JP24281288 A JP 24281288A JP H0295166 A JPH0295166 A JP H0295166A
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- Japan
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- coil
- control signal
- converter
- switching transistor
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- Pending
Links
- 239000004065 semiconductor Substances 0.000 claims description 3
- 239000003990 capacitor Substances 0.000 abstract description 22
- 230000003247 decreasing effect Effects 0.000 abstract 1
- 238000010586 diagram Methods 0.000 description 4
- 230000000694 effects Effects 0.000 description 3
- 230000007423 decrease Effects 0.000 description 2
- 238000005516 engineering process Methods 0.000 description 1
- 238000007373 indentation Methods 0.000 description 1
- 238000000034 method Methods 0.000 description 1
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
[産業上の利用分野]
本発明は、コイルを使用したDC−DCコンバータにお
けるコイルのスイッチング駆動方法に関する。
けるコイルのスイッチング駆動方法に関する。
[従来の技術]
従来のコイルを使用したDC−DCコンバータは、昇圧
型DC−DCコンバータの場合、第3図に示す如く、入
力電圧端子1 (以下、VIN端子という。)とGND
端子2の間にコイル4とスイッチングトランジスタ6を
直列に接続し、コイル4とスイッチングトランジスタ6
の接続箇所Aと出力電圧端子(以下、V OUT端子と
いう。)の間にダイオード5を接続し、V OUT端子
3とGND端子2の間に整流用コンデンサ7を接続した
回路構成になっていた。
型DC−DCコンバータの場合、第3図に示す如く、入
力電圧端子1 (以下、VIN端子という。)とGND
端子2の間にコイル4とスイッチングトランジスタ6を
直列に接続し、コイル4とスイッチングトランジスタ6
の接続箇所Aと出力電圧端子(以下、V OUT端子と
いう。)の間にダイオード5を接続し、V OUT端子
3とGND端子2の間に整流用コンデンサ7を接続した
回路構成になっていた。
〔発明が解決しようとする課題]
しかし、前述の従来技術では、スイッチングトランジス
タ6の導通状態の期間にコイル4にエネルギーを蓄え、
スイッチングトランジスタ6が非導通状態の期間にコイ
ル4に逆起電力が発生しダイオード5を通して整流用コ
ンデンサ7を充電する回路のため、スイッチングトラン
ジスタ6の導通状態の期間は、整流用コンデンサ7がら
のみ負荷9へ電流を供給するだけになり、V OUT端
子3の出力電圧が低下し、リプル電圧も大きくなるとい
う問題点を有していた。
タ6の導通状態の期間にコイル4にエネルギーを蓄え、
スイッチングトランジスタ6が非導通状態の期間にコイ
ル4に逆起電力が発生しダイオード5を通して整流用コ
ンデンサ7を充電する回路のため、スイッチングトラン
ジスタ6の導通状態の期間は、整流用コンデンサ7がら
のみ負荷9へ電流を供給するだけになり、V OUT端
子3の出力電圧が低下し、リプル電圧も大きくなるとい
う問題点を有していた。
そこで本発明はこのような問題点を解決するもので、そ
の目的とするところは、コイルを使用したDC−DCコ
ンバータにおいて、整流用コンデンサ7のみから負荷9
へ電流を供給する期間をなくし、出力電流能力の向上と
りプル電圧の低減を提供するところにある。
の目的とするところは、コイルを使用したDC−DCコ
ンバータにおいて、整流用コンデンサ7のみから負荷9
へ電流を供給する期間をなくし、出力電流能力の向上と
りプル電圧の低減を提供するところにある。
[課題を解決するための手段]
本発明のDC−DCコンバータは、コイルを使用したD
C−DCコンバータにおいて、入力電圧端子とGND端
子の間に2系統のコイルとスイッチングトランジスタを
直列に接続し、各系統のコイルとスイッチングトランジ
スタの接続箇所と出力電圧端子の間にダイオードを接続
した回路構成にし、一方のスイッチングトランジスタの
オン・オフ制御信号として、もう一方のスイッチングト
ランジスタのオン・オフ制御信号の位相反転信号を入力
することを特徴とする。
C−DCコンバータにおいて、入力電圧端子とGND端
子の間に2系統のコイルとスイッチングトランジスタを
直列に接続し、各系統のコイルとスイッチングトランジ
スタの接続箇所と出力電圧端子の間にダイオードを接続
した回路構成にし、一方のスイッチングトランジスタの
オン・オフ制御信号として、もう一方のスイッチングト
ランジスタのオン・オフ制御信号の位相反転信号を入力
することを特徴とする。
〔作 用]
本発明の上記の構成によれば、■、端子と整流用コンデ
ンサの間に接続されている2系統のコイルとスイッチン
グトランジスタのうち一方のスイッチングトランジスタ
のオン・オフ制御信号をもう一方のスイッチングトラン
ジスタのオン・オフ制御信号の位相反転信号としたので
、一方のコイルが整流用コンデンサに電流を供給しない
期間は、もう一方のコイルにより整流用コンデンサに電
流を供給する構成になるため、整流用コンデンサのみか
ら負荷へ電流を供給する期間がなくなり、最大出力電流
能力の向上とりプル電圧の低減を実現させることが可能
となる。
ンサの間に接続されている2系統のコイルとスイッチン
グトランジスタのうち一方のスイッチングトランジスタ
のオン・オフ制御信号をもう一方のスイッチングトラン
ジスタのオン・オフ制御信号の位相反転信号としたので
、一方のコイルが整流用コンデンサに電流を供給しない
期間は、もう一方のコイルにより整流用コンデンサに電
流を供給する構成になるため、整流用コンデンサのみか
ら負荷へ電流を供給する期間がなくなり、最大出力電流
能力の向上とりプル電圧の低減を実現させることが可能
となる。
[実 施 例]
以下、本発明について実施例に基づいて詳細に説明する
。第1図は、本発明の具体的な一実施例である昇圧型D
C’−DCコンバータの回路図を示す。lは、■、端子
、2は、GND端子、3は、Vouア端子、41.42
は、コイル、51.52は、ダイオード、61.62は
、スイッチングトランジスタ、7は、整流用コンデンサ
、8は、スイッチングトランジスタのオン・オフ制御信
号(以下、SW制御信号という。)9は、負荷、10は
、インバータである。
。第1図は、本発明の具体的な一実施例である昇圧型D
C’−DCコンバータの回路図を示す。lは、■、端子
、2は、GND端子、3は、Vouア端子、41.42
は、コイル、51.52は、ダイオード、61.62は
、スイッチングトランジスタ、7は、整流用コンデンサ
、8は、スイッチングトランジスタのオン・オフ制御信
号(以下、SW制御信号という。)9は、負荷、10は
、インバータである。
次に第1図の実施例におけるDC−DCコンバータの動
作を説明する。
作を説明する。
V IN端子1とGND端子2の間に入力電圧■1が印
加されると、スイッチングトランジスタ61の導通状態
では、VIN端子lからコイル41を通して電流11が
流れる。コイル41をL 41とするとコイル41を流
れる電流は時間tに比例して単調に増加し、 i + =V+ ・t/ L41 となる。但し、スイッチングトランジスタ61での電圧
降下は無視している。スイッチングトランジスタ61の
導通期間をtlとすると、コイル41に蓄えられるエネ
ルギーPLIは、スイッチングトランジスタ61のスイ
ッチング周波数をfとすると単位時間当たりでは、 となる。
加されると、スイッチングトランジスタ61の導通状態
では、VIN端子lからコイル41を通して電流11が
流れる。コイル41をL 41とするとコイル41を流
れる電流は時間tに比例して単調に増加し、 i + =V+ ・t/ L41 となる。但し、スイッチングトランジスタ61での電圧
降下は無視している。スイッチングトランジスタ61の
導通期間をtlとすると、コイル41に蓄えられるエネ
ルギーPLIは、スイッチングトランジスタ61のスイ
ッチング周波数をfとすると単位時間当たりでは、 となる。
次にスイッチングトランジスタ61が非導通状態になる
とコイル41に逆起電力が発生しダイオード51を通し
て電流12が流れ、整流用コンデンサ7を充電する。整
流用コンデンサ7の電圧、即ち出力電圧v8は、出力電
流Io、負荷抵抗RLとすると出力電力とコイルL81
に蓄積された電力が等しいので vo2 V+”・ t、2 となり、 2L4.・ 工6 となる。また、コイル41、ダイオード51を通して出
力の整流用コンデンサ7への充電電流12は、スイッチ
ングトランジスタ61の非導通期間のみで、 となる。但し、ダイオード51での電圧降下は無視して
いる。従って、負荷電流■8の増加に比例して出力電圧
V=が低下し、出力のりプル電圧も大きくなる。そこで
、本発明では■、端子1とGND端子2の間にSW制御
信号8の反転信号をゲート入力としたスイッチングトラ
ンジスタ62とコイル42を直列接続し、スイッチング
トランジスタ62とコイル42の接続箇所とVOIJT
端子3の間にダイオード52を接続した回路を付加する
。スイッチングトランジスタ61が導通状態の期間は、
コイル41、ダイオード51を通して整流用コンデンサ
7に充電電流は供給されないが、スイッチングトランジ
スタ62が非導通状態となりコイル42、ダイオード5
2を通して整流用コンデンサ7に充電電流が供給される
。従って、整流用コンデンサ7に充電電流が供給されな
い期間がなくなり出力電圧の低下を防ぐことができ、最
大出力電流能力が向上し、リプル電圧を低減させること
ができる。第1図の上記実施例は、昇圧型のDC−DC
コンバークの場合であるが、極性反転型のDC−DCコ
ンバータの場合でも実施は可能である。第2図にその具
体的な一実施例を示す。第1図の実施例に対してVIN
端子lとGND端子2の間に接続されているコイル41
.42とスイッチングトランジスタ61.62の配置が
反対になり、ダイオード51.52の向きが反対になっ
た回路構成になっているが、動作原理は全く同様である
。
とコイル41に逆起電力が発生しダイオード51を通し
て電流12が流れ、整流用コンデンサ7を充電する。整
流用コンデンサ7の電圧、即ち出力電圧v8は、出力電
流Io、負荷抵抗RLとすると出力電力とコイルL81
に蓄積された電力が等しいので vo2 V+”・ t、2 となり、 2L4.・ 工6 となる。また、コイル41、ダイオード51を通して出
力の整流用コンデンサ7への充電電流12は、スイッチ
ングトランジスタ61の非導通期間のみで、 となる。但し、ダイオード51での電圧降下は無視して
いる。従って、負荷電流■8の増加に比例して出力電圧
V=が低下し、出力のりプル電圧も大きくなる。そこで
、本発明では■、端子1とGND端子2の間にSW制御
信号8の反転信号をゲート入力としたスイッチングトラ
ンジスタ62とコイル42を直列接続し、スイッチング
トランジスタ62とコイル42の接続箇所とVOIJT
端子3の間にダイオード52を接続した回路を付加する
。スイッチングトランジスタ61が導通状態の期間は、
コイル41、ダイオード51を通して整流用コンデンサ
7に充電電流は供給されないが、スイッチングトランジ
スタ62が非導通状態となりコイル42、ダイオード5
2を通して整流用コンデンサ7に充電電流が供給される
。従って、整流用コンデンサ7に充電電流が供給されな
い期間がなくなり出力電圧の低下を防ぐことができ、最
大出力電流能力が向上し、リプル電圧を低減させること
ができる。第1図の上記実施例は、昇圧型のDC−DC
コンバークの場合であるが、極性反転型のDC−DCコ
ンバータの場合でも実施は可能である。第2図にその具
体的な一実施例を示す。第1図の実施例に対してVIN
端子lとGND端子2の間に接続されているコイル41
.42とスイッチングトランジスタ61.62の配置が
反対になり、ダイオード51.52の向きが反対になっ
た回路構成になっているが、動作原理は全く同様である
。
[発明の効果]
以上述べたように本発明によれば、出力の整流用コンデ
ンサのみから負荷へ電流を供給する期間をなくすように
構成したので、出力電圧の低下を防ぐことができ最大出
力電流能力の向上とりプル電圧を低減することができる
などすぐれた効果を有するものである。また、本発明の
スイッチングトランジスタやダイオードを同一の半導体
集積回路内に形成することは、機器の部品点数の削減・
基板における実装含有面積の減少につながり、機器の小
型化、信頼性の向上に寄与するなどすぐれた効果を有す
るものである。
ンサのみから負荷へ電流を供給する期間をなくすように
構成したので、出力電圧の低下を防ぐことができ最大出
力電流能力の向上とりプル電圧を低減することができる
などすぐれた効果を有するものである。また、本発明の
スイッチングトランジスタやダイオードを同一の半導体
集積回路内に形成することは、機器の部品点数の削減・
基板における実装含有面積の減少につながり、機器の小
型化、信頼性の向上に寄与するなどすぐれた効果を有す
るものである。
1 ・ ・ ・ ・ ・ ・ ・
2 ・ ・ ・ ・ ・ ・ ・
3 ・ ・ ・ ・ ・ ・ ・
4、41、42 ・
5、5 l、 52 ・
6、6 l、 62 ・
7 ・ ・ ・ ・ ・ ・ ・
8 ・ ・ ・ ・ ・ ・ ・
9 ・ ・ ・ ・ ・ ・ ・
l O・ ・ ・ ・ ・ ・ ・
VIN端子
GND端子
■iア端子
コイル
ダイオード
スイッチングトランジスタ
整流用コンデンサ
SW制御信号
負荷
インバータ
以上
第1図は、本発明の昇圧型DC−DCコンバータの一実
施例を示す回路図。 第2図は、本発明の極性反転型DC−DCコンバークの
一実施例を示す回路図。 第3図は、従来のDC−DCコンバータの回路図。 出願人 セイコーエプソン株式会社 代理人 弁理士 上 柳 雅 誉(他1名)窩 う ? 楽 図 回 名 凹
施例を示す回路図。 第2図は、本発明の極性反転型DC−DCコンバークの
一実施例を示す回路図。 第3図は、従来のDC−DCコンバータの回路図。 出願人 セイコーエプソン株式会社 代理人 弁理士 上 柳 雅 誉(他1名)窩 う ? 楽 図 回 名 凹
Claims (3)
- (1)コイルを使用したDC−DCコンバータにおいて
、入力電圧端子とGND端子の間に2系統のコイルとス
イッチングトランジスタを直列に接続し、各系統のコイ
ルとスイッチングトランジスタの接続箇所と出力電圧端
子の間にダイオードを接続した回路構成にし、一方のス
イッチングトランジスタのオン・オフ制御信号として、
もう一方のスイッチングトランジスタのオン・オフ制御
信号の位相反転信号を入力することを特徴とするDC−
DCコンバータ。 - (2)請求項1記載の2個のスイッチングトランジスタ
を同一の半導体集積回路上に形成することを特徴とする
DC−DCコンバータ。 - (3)請求項1記載の2個のスイッチングトランジスタ
と2個のダイオードを同一の半導体集積回路上に形成す
ることを特徴とするDC−DCコンバータ。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP24281288A JPH0295166A (ja) | 1988-09-28 | 1988-09-28 | Dc−dcコンバータ |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP24281288A JPH0295166A (ja) | 1988-09-28 | 1988-09-28 | Dc−dcコンバータ |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0295166A true JPH0295166A (ja) | 1990-04-05 |
Family
ID=17094657
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP24281288A Pending JPH0295166A (ja) | 1988-09-28 | 1988-09-28 | Dc−dcコンバータ |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0295166A (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0433567A (ja) * | 1990-05-30 | 1992-02-04 | Sanyo Electric Co Ltd | アクティブ・フィルタ |
JPH0498885U (ja) * | 1991-01-31 | 1992-08-26 | ||
JP2005168277A (ja) * | 2003-08-21 | 2005-06-23 | Marvell World Trade Ltd | デジタル低ドロップアウトレギュレータ |
-
1988
- 1988-09-28 JP JP24281288A patent/JPH0295166A/ja active Pending
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0433567A (ja) * | 1990-05-30 | 1992-02-04 | Sanyo Electric Co Ltd | アクティブ・フィルタ |
JPH0498885U (ja) * | 1991-01-31 | 1992-08-26 | ||
JP2005168277A (ja) * | 2003-08-21 | 2005-06-23 | Marvell World Trade Ltd | デジタル低ドロップアウトレギュレータ |
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