JPH0293834U - - Google Patents
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- Publication number
- JPH0293834U JPH0293834U JP293989U JP293989U JPH0293834U JP H0293834 U JPH0293834 U JP H0293834U JP 293989 U JP293989 U JP 293989U JP 293989 U JP293989 U JP 293989U JP H0293834 U JPH0293834 U JP H0293834U
- Authority
- JP
- Japan
- Prior art keywords
- mos transistor
- whose
- source
- drain
- potential
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 2
Landscapes
- Metal-Oxide And Bipolar Metal-Oxide Semiconductor Integrated Circuits (AREA)
Description
第１図ａは本考案に係るシユミツト回路の回路
図、第１図ｂは第１図ａで示されたシユミツト回
路のパターン配置例、第２図ａは従来の一般的な
シユミツト回路の回路図、第２図ｂは第２図ａで
示されたシユミツト回路のパターン配置例である
。 Ｑ１……第１ＭＯＳトランジスタ、Ｑ２……第
２ＭＯＳトランジスタ、Ｑ３……第３ＭＯＳトラ
ンジスタ、Ｑ４……第４ＭＯＳトランジスタ。
図、第１図ｂは第１図ａで示されたシユミツト回
路のパターン配置例、第２図ａは従来の一般的な
シユミツト回路の回路図、第２図ｂは第２図ａで
示されたシユミツト回路のパターン配置例である
。 Ｑ１……第１ＭＯＳトランジスタ、Ｑ２……第
２ＭＯＳトランジスタ、Ｑ３……第３ＭＯＳトラ
ンジスタ、Ｑ４……第４ＭＯＳトランジスタ。
Claims (1)
- 【実用新案登録請求の範囲】 ゲートが入力端子に接続され、ソースを第１電
位としている第１ＭＯＳトランジスタと、 ゲートが入力端子に接続され、ソースが前記第
１ＭＯＳトランジスタのドレインに接続されてい
る第２ＭＯＳトランジスタと、 ソースが前記第２ＭＯＳトランジスタのドレイ
ンに接続され、ドレインを第２電位としている第
３ＭＯＳトランジスタと、 ソースが前記第１ＭＯＳトランジスタのドレイ
ンに接続され、ドレインを第２電位としていて、
ゲートが前記第３ＭＯＳトランジスタのソースに
接続されている第４ＭＯＳトランジスタとを備え
たシユミツト回路において、 前記第４ＭＯＳトランジスタのソースを出力と
してあることを特徴とするシユミツト回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP293989U JPH0293834U (ja) | 1989-01-13 | 1989-01-13 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP293989U JPH0293834U (ja) | 1989-01-13 | 1989-01-13 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0293834U true JPH0293834U (ja) | 1990-07-25 |
Family
ID=31204138
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP293989U Pending JPH0293834U (ja) | 1989-01-13 | 1989-01-13 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0293834U (ja) |
-
1989
- 1989-01-13 JP JP293989U patent/JPH0293834U/ja active Pending