JPS6242335U - - Google Patents

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JPS6242335U
JPS6242335U JP5784586U JP5784586U JPS6242335U JP S6242335 U JPS6242335 U JP S6242335U JP 5784586 U JP5784586 U JP 5784586U JP 5784586 U JP5784586 U JP 5784586U JP S6242335 U JPS6242335 U JP S6242335U
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transistor
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supply terminal
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Description

【図面の簡単な説明】
第1図は従来のフリツプ・フロツプ回路を示す
構成図、第2図a〜eは第1図における動作信号
波形図、第3図は本考案の一実施例を示す回路図
、第4図a〜cは同実施例における動作信号波形
図である。 D,D……デイプリーシヨン型MIS・F
ET、E,E……エンハンスメント型MIS
・FET、E……スイツチング用MIS・FE
T、Q,……出力端、S……セツト入力端、R
……リセツト入力端、T……トリガ・パルス入力
端、q1,q2……寄生容量、VCCバイアス電
源、VSS……接続電源。
補正 昭61.9.18 図面の簡単な説明を次のように補正する。 明細書の第16頁7行目の「第4図a〜c」を
「第4図a〜e」に訂正する。

Claims (1)

    【実用新案登録請求の範囲】
  1. 第1の出力節点にゲートが接続され、かつ第2
    の出力節点と第1の電源端との間にソース・ドレ
    イン間が挿入された第1のトランジスタと、前記
    第2の出力節点にゲートが接続され、かつ前記第
    1の出力節点と前記第1の電源端との間にソース
    ・ドレイン間が挿入された第2のトランジスタと
    、前記第1の出力節点と第2の電源端との間にソ
    ース・ドレイン間が挿入された第3のトランジス
    タと、前記第2の出力節点と前記第2の電源端と
    の間にソース・ドレイン間が挿入された第4のト
    ランジスタと、前記第1の出力節点と前記第2の
    出力接点との間にソース・ドレイン間が挿入され
    た第5のトランジスタとを有し、前記第3のトラ
    ンジスタのゲートにセツト信号を与え、前記第5
    のトランジスタのゲートにトリガ信号を与えるこ
    とを特徴とするフリツプ・フロツプ回路。
JP5784586U 1986-04-17 1986-04-17 Expired JPS6320189Y2 (ja)

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JP5784586U JPS6320189Y2 (ja) 1986-04-17 1986-04-17

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JP5784586U JPS6320189Y2 (ja) 1986-04-17 1986-04-17

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Publication Number Publication Date
JPS6242335U true JPS6242335U (ja) 1987-03-13
JPS6320189Y2 JPS6320189Y2 (ja) 1988-06-06

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ID=30887910

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JP5784586U Expired JPS6320189Y2 (ja) 1986-04-17 1986-04-17

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JPS6320189Y2 (ja) 1988-06-06

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