JPH0284453U - - Google Patents
Info
- Publication number
- JPH0284453U JPH0284453U JP6662189U JP6662189U JPH0284453U JP H0284453 U JPH0284453 U JP H0284453U JP 6662189 U JP6662189 U JP 6662189U JP 6662189 U JP6662189 U JP 6662189U JP H0284453 U JPH0284453 U JP H0284453U
- Authority
- JP
- Japan
- Prior art keywords
- clock signal
- phase difference
- signal
- outputting
- forming
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000012544 monitoring process Methods 0.000 claims 3
- 239000003990 capacitor Substances 0.000 claims 2
- 230000001360 synchronised effect Effects 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 3
- 230000015572 biosynthetic process Effects 0.000 description 1
Landscapes
- Synchronisation In Digital Transmission Systems (AREA)
Description
第１図ａは、本考案の一実施例を示すブロツク
図、第１図ｂ，ｃは本考案の他の実施例を示す回
路図、第２図、第３図は本考案の説明に供するタ
イミングチヤート図、及び周波数特性図。 １……位相比較部、２……電圧制御発振器、３
……４進カウンタ、４，７……ＯＲ回路、５……
Ｄ型フリツプフロツプ回路、６……遅延回路、８
……形成クロツク信号出力端子、９……外部クロ
ツク信号入力端子、１０……パルス発生回路、１
１……鋸波発生回路、１２……サンプルホールド
回路、１３……２連スイツチ、１４……応答速度
設定部、１５……フオトカプラ。
図、第１図ｂ，ｃは本考案の他の実施例を示す回
路図、第２図、第３図は本考案の説明に供するタ
イミングチヤート図、及び周波数特性図。 １……位相比較部、２……電圧制御発振器、３
……４進カウンタ、４，７……ＯＲ回路、５……
Ｄ型フリツプフロツプ回路、６……遅延回路、８
……形成クロツク信号出力端子、９……外部クロ
ツク信号入力端子、１０……パルス発生回路、１
１……鋸波発生回路、１２……サンプルホールド
回路、１３……２連スイツチ、１４……応答速度
設定部、１５……フオトカプラ。
Claims (1)
- 【実用新案登録請求の範囲】 外部クロツク信号を入力し、これに同期する形
成クロツク信号を形成するクロツク同期回路であ
り、 前記形成クロツク信号と前記外部クロツク信号
との位相を比較し、位相差信号を出力する位相比
較手段と、 前記外部クロツク信号と前記形成クロツク信号
との位相関係を監視し、位相差が所定の範囲内に
在ることを示す第１の状態と該位相差が所定の範
囲外に在ることを示す第２の状態とからなる位相
差監視信号を出力する位相差監視手段と、 前記位相差信号を入力し、応答速度の異なる２
種類の制御信号を択一的に出力する制御信号出力
手段と、 前記制御信号のレベルに応答する周波数を有す
る前記形成クロツク信号を出力する形成クロツク
信号出力手段とを有し、 前記制御信号出力手段は、その入力端子と出力
端子間に介在する第１の抵抗と、一端がアースに
接続されると共に他端が第２の抵抗を介して前記
出力端子に接続されたコンデンサと、前記入力端
子と前記コンデンサの他端間に介在して実質的な
閉成と開放の各状態に変化するスイツチ手段とを
有し、該スイツチ手段が前記位相差監視信号の前
記第２の状態に対応して閉成すべく動作するよう
に構成したことを特徴とするクロツク同期回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6662189U JPH0284453U (ja) | 1989-06-07 | 1989-06-07 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6662189U JPH0284453U (ja) | 1989-06-07 | 1989-06-07 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0284453U true JPH0284453U (ja) | 1990-06-29 |
Family
ID=31292021
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6662189U Pending JPH0284453U (ja) | 1989-06-07 | 1989-06-07 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0284453U (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04271636A (ja) * | 1991-02-27 | 1992-09-28 | Sanyo Electric Co Ltd | インターフェイス回路 |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5128743A (ja) * | 1974-09-04 | 1976-03-11 | Matsushita Electric Ind Co Ltd | |
| JPS568927A (en) * | 1979-07-03 | 1981-01-29 | Nec Corp | Automatic digital phase control circuit |
| JPS5766517A (en) * | 1980-10-09 | 1982-04-22 | Arupain Kk | Pll circuit of pcm processor |
-
1989
- 1989-06-07 JP JP6662189U patent/JPH0284453U/ja active Pending
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5128743A (ja) * | 1974-09-04 | 1976-03-11 | Matsushita Electric Ind Co Ltd | |
| JPS568927A (en) * | 1979-07-03 | 1981-01-29 | Nec Corp | Automatic digital phase control circuit |
| JPS5766517A (en) * | 1980-10-09 | 1982-04-22 | Arupain Kk | Pll circuit of pcm processor |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04271636A (ja) * | 1991-02-27 | 1992-09-28 | Sanyo Electric Co Ltd | インターフェイス回路 |
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