JPH0245970A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
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- JPH0245970A JPH0245970A JP19746188A JP19746188A JPH0245970A JP H0245970 A JPH0245970 A JP H0245970A JP 19746188 A JP19746188 A JP 19746188A JP 19746188 A JP19746188 A JP 19746188A JP H0245970 A JPH0245970 A JP H0245970A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、三次元の半導体装置の製造方法に関するもの
である。
である。
従来の技術
2層の活性領域を有する従来の三次元の半導体装置の工
程順断面図を第2図に示し、以下、その工程の説明を行
う。尚、簡明化のため、図中にはシリコン基板上に形成
した1層めの回路素子の製造工程は省略し、2層めの回
路素子の製造工程のみを示した。
程順断面図を第2図に示し、以下、その工程の説明を行
う。尚、簡明化のため、図中にはシリコン基板上に形成
した1層めの回路素子の製造工程は省略し、2層めの回
路素子の製造工程のみを示した。
まず、第2図(、)に示すように、シリコン基板1上に
所定のLOCO92(素子分離領域)、ゲート酸化膜3
、ゲート電極4、ソース・ドレイン拡散層6、絶縁膜6
、コンタクトホール7、ポリシリコンの配線層8の形成
処理を行ったのち、これらを覆う層間の絶縁膜9を形成
する。その後、絶縁膜9に、シリコン層11をCVD法
により形成する。つづいて、レーザービームの照射によ
シシリコン層11の結晶化を行う。つぎに、第2図中)
に示すように、シリコン層11を、トランジスタを形成
する領域のみに残し、他はエツチング除去する。その後
ゲート酸化膜にゲート電極13、ソース・ドレイン拡散
層14を順次形成し2層めの活性領域にトランジスタを
形成する。その後、絶縁膜16で全体を覆う。つぎに、
第2図(0)に示すように、シリコン基板1上に形成し
た1層めのトランジスタと絶縁膜9上に形成した2層め
のトランジスタを接続するコンタクトホーA/16を形
成する。つづいて、2層めの配線層17を形成する。
所定のLOCO92(素子分離領域)、ゲート酸化膜3
、ゲート電極4、ソース・ドレイン拡散層6、絶縁膜6
、コンタクトホール7、ポリシリコンの配線層8の形成
処理を行ったのち、これらを覆う層間の絶縁膜9を形成
する。その後、絶縁膜9に、シリコン層11をCVD法
により形成する。つづいて、レーザービームの照射によ
シシリコン層11の結晶化を行う。つぎに、第2図中)
に示すように、シリコン層11を、トランジスタを形成
する領域のみに残し、他はエツチング除去する。その後
ゲート酸化膜にゲート電極13、ソース・ドレイン拡散
層14を順次形成し2層めの活性領域にトランジスタを
形成する。その後、絶縁膜16で全体を覆う。つぎに、
第2図(0)に示すように、シリコン基板1上に形成し
た1層めのトランジスタと絶縁膜9上に形成した2層め
のトランジスタを接続するコンタクトホーA/16を形
成する。つづいて、2層めの配線層17を形成する。
最後に、配線層および素子を保護するための絶縁膜18
を形成し、2層の活性領域を有する半導体装置の製造工
程を終了する。
を形成し、2層の活性領域を有する半導体装置の製造工
程を終了する。
発明が解決しようとする課題
しかしながら、上記方法によ92層の活性領域を有する
半導体装置で形成した場合、2層めの活性領域に形成し
たトランジスタの特性が悪い。それは、2層めの活性領
域の結晶に問題があるためである。つまり、結晶性が悪
いため、ゲートに電圧を印加しなくても、ソース・ドレ
イン間に微小電流が流れてしまい、回路としての機能の
妨げとなる。
半導体装置で形成した場合、2層めの活性領域に形成し
たトランジスタの特性が悪い。それは、2層めの活性領
域の結晶に問題があるためである。つまり、結晶性が悪
いため、ゲートに電圧を印加しなくても、ソース・ドレ
イン間に微小電流が流れてしまい、回路としての機能の
妨げとなる。
課題を解決するための手段
2層めの活性領域を、結晶性を有する絶縁膜であるMq
o−A12o3膜上に形成し、レーザービームの照射を
行うことにより、2層めの活性層であるシリコン層の結
晶性が向上する。
o−A12o3膜上に形成し、レーザービームの照射を
行うことにより、2層めの活性層であるシリコン層の結
晶性が向上する。
作 用
本発明は、2層めの活性層の結晶性を向上させ、2層め
の活性領域に形成したトランジスタの特性の向上を計り
、三次元の半導体装置の製造を容易にする。
の活性領域に形成したトランジスタの特性の向上を計り
、三次元の半導体装置の製造を容易にする。
実施例
本発明にかかる2層の活性領域を有する三次元の半導体
装置の工程順断面図を第1図に示し、以下、その工程の
説明を行う。尚、簡明化のため、図中には、シリコン基
板上に形成した1層めの回路素子の製造工程は省略し、
2層めの回路素子の製造工程のみを示した。
装置の工程順断面図を第1図に示し、以下、その工程の
説明を行う。尚、簡明化のため、図中には、シリコン基
板上に形成した1層めの回路素子の製造工程は省略し、
2層めの回路素子の製造工程のみを示した。
まず、第1図(a)に示すように、シリコン基板1上に
所定のLOGO32,ゲート酸化膜3、ゲート電極4、
ソース・ドレイン拡散層6、絶縁膜6、コンタクトホー
/L/ 7 、ポリシリコンの配線層8の形成処理を行
ったのち、これらを覆う層間の絶縁膜9を形成する。つ
ぎに、第1図(b)に示すように、絶縁膜9上に、反応
ガスとして、A(IcI!3.MtxC112゜C02
,H2を用いて、約800〜900℃の雰囲気中で厚さ
1000〜5ooo人のMqO,s、Al2O3膜10
の成長を行う。つぎに、酸素雰素雰囲気中で、MqQ、
A12o3膜1oにレーザービームの照射を行い、アニ
ールする。その後、2層めの活性層となるシリコン層1
1を約50oO人形成する。
所定のLOGO32,ゲート酸化膜3、ゲート電極4、
ソース・ドレイン拡散層6、絶縁膜6、コンタクトホー
/L/ 7 、ポリシリコンの配線層8の形成処理を行
ったのち、これらを覆う層間の絶縁膜9を形成する。つ
ぎに、第1図(b)に示すように、絶縁膜9上に、反応
ガスとして、A(IcI!3.MtxC112゜C02
,H2を用いて、約800〜900℃の雰囲気中で厚さ
1000〜5ooo人のMqO,s、Al2O3膜10
の成長を行う。つぎに、酸素雰素雰囲気中で、MqQ、
A12o3膜1oにレーザービームの照射を行い、アニ
ールする。その後、2層めの活性層となるシリコン層1
1を約50oO人形成する。
つづいて、レーザービーム照射によりシリコン層11の
結晶化を行う。その後、第1図(c)に示すように、シ
リコン層11を、トランジスタを形成する領域にのみ残
し、他はエツチング除去する。その後、ゲート酸化膜1
2、ゲート電極13、ソース・ドレイン拡散層14を順
次・形成し、2層めの活性領域に、トランジスタを形成
する。つづいて、絶縁膜16で全体を覆う。つぎに、シ
リコン基板1上に形成した1層めのトランジスタとMq
O。
結晶化を行う。その後、第1図(c)に示すように、シ
リコン層11を、トランジスタを形成する領域にのみ残
し、他はエツチング除去する。その後、ゲート酸化膜1
2、ゲート電極13、ソース・ドレイン拡散層14を順
次・形成し、2層めの活性領域に、トランジスタを形成
する。つづいて、絶縁膜16で全体を覆う。つぎに、シ
リコン基板1上に形成した1層めのトランジスタとMq
O。
Al2O3膜11上に形成した2層めのトランジスタを
接続するコンタクトホー/L’16を形成する。
接続するコンタクトホー/L’16を形成する。
その後、2層めの配線層17を形成する。最後に、配線
層および素子を保護するための絶縁膜18を形成し、2
層の活性領域を有する半導体装置の製造工程を終了する
。
層および素子を保護するための絶縁膜18を形成し、2
層の活性領域を有する半導体装置の製造工程を終了する
。
尚、本実施例では、2層の活性領域を有する三次元の半
導体装置の製造工程について説明したが、本発明は、多
層の活性領域を有する三次元の半導体装置全般において
応用できるものである。
導体装置の製造工程について説明したが、本発明は、多
層の活性領域を有する三次元の半導体装置全般において
応用できるものである。
発明の効果
本発明によれば、2層めの活性領域を、結晶性を有する
絶縁膜であるMqO,Al2O3膜上に形成するため、
2層めの活性領域の結晶性が良くなり、2層めの活性領
域に形成したトランジスタの特性が向上する。これによ
り、三次元の半導体装置の機能が向上する。
絶縁膜であるMqO,Al2O3膜上に形成するため、
2層めの活性領域の結晶性が良くなり、2層めの活性領
域に形成したトランジスタの特性が向上する。これによ
り、三次元の半導体装置の機能が向上する。
第1図は本発明の一実施例における半導体装置の製造工
程を説明するだめの工程II([断面図、第2図は従来
の技術を説明するだめの工程順断面図である。 1・・・・・・シリコン基板、2・・・・・・LOCO
3,3・・・・・・ゲート酸化膜、4・・・・・・ゲー
ト電極、6・・・・・・拡散層、e・・・・・・絶縁膜
、7・・・・・・コンタクトホール、8・・・・・・配
線層、9・・・・・・絶縁膜、1o・・・・・・Mqo
−Al2O3層、11・・・・・・シリコン層、12・
・・・・・ゲート酸化膜、13・・・・・・ゲート電極
、14・・・・・・拡散層、16・・・・・・絶縁膜、
16・・・・・・コンタクトホール、17・・・・・・
配線Jl、1a・・・・・・絶縁膜。
程を説明するだめの工程II([断面図、第2図は従来
の技術を説明するだめの工程順断面図である。 1・・・・・・シリコン基板、2・・・・・・LOCO
3,3・・・・・・ゲート酸化膜、4・・・・・・ゲー
ト電極、6・・・・・・拡散層、e・・・・・・絶縁膜
、7・・・・・・コンタクトホール、8・・・・・・配
線層、9・・・・・・絶縁膜、1o・・・・・・Mqo
−Al2O3層、11・・・・・・シリコン層、12・
・・・・・ゲート酸化膜、13・・・・・・ゲート電極
、14・・・・・・拡散層、16・・・・・・絶縁膜、
16・・・・・・コンタクトホール、17・・・・・・
配線Jl、1a・・・・・・絶縁膜。
Claims (1)
- 回路素子を設けた半導体基板上に絶縁膜を被着する工程
と、上記絶縁膜上にMgO・Al_2O_3膜を被着す
る工程と、上記MgO・Al_2O_3膜上にシリコン
膜を被着し、活性領域を形成する工程を含むことを特徴
とする半導体装置の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP19746188A JPH0245970A (ja) | 1988-08-08 | 1988-08-08 | 半導体装置の製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP19746188A JPH0245970A (ja) | 1988-08-08 | 1988-08-08 | 半導体装置の製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0245970A true JPH0245970A (ja) | 1990-02-15 |
Family
ID=16374886
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP19746188A Pending JPH0245970A (ja) | 1988-08-08 | 1988-08-08 | 半導体装置の製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0245970A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5156987A (en) * | 1991-12-18 | 1992-10-20 | Micron Technology, Inc. | High performance thin film transistor (TFT) by solid phase epitaxial regrowth |
-
1988
- 1988-08-08 JP JP19746188A patent/JPH0245970A/ja active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5156987A (en) * | 1991-12-18 | 1992-10-20 | Micron Technology, Inc. | High performance thin film transistor (TFT) by solid phase epitaxial regrowth |
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