JPH02247571A - Waveform measuring instrument - Google Patents

Waveform measuring instrument

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JPH02247571A
JPH02247571A JP6848689A JP6848689A JPH02247571A JP H02247571 A JPH02247571 A JP H02247571A JP 6848689 A JP6848689 A JP 6848689A JP 6848689 A JP6848689 A JP 6848689A JP H02247571 A JPH02247571 A JP H02247571A
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JP
Japan
Prior art keywords
signal
data
memory
trigger
time
Prior art date
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Pending
Application number
JP6848689A
Other languages
Japanese (ja)
Inventor
Toru Kitamura
透 北村
Kaoru Kimizuka
君塚 薫
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Yokogawa Electric Corp
Original Assignee
Yokogawa Electric Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Yokogawa Electric Corp filed Critical Yokogawa Electric Corp
Priority to JP6848689A priority Critical patent/JPH02247571A/en
Publication of JPH02247571A publication Critical patent/JPH02247571A/en
Pending legal-status Critical Current

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  • Measurement Of Current Or Voltage (AREA)

Abstract

PURPOSE:To observe a disappearing signal without using any external trigger signal by setting preset data every time a trigger signal is outputted and outputting a data fetch inhibition signal to a memory when a counter enters a full-count state. CONSTITUTION:A trigger circuit 3 outputs the trigger signal TG to a presettable counter 5 every time a measurement signal A falls. The counter 5 outputs a carry CRY to the memory 4 when the signal TG is not inputted even a constant time after the circuit 3 outputs the signal TG last and the counted value CD becomes a full-count value. Consequently, the memory 4 quits fetching the output data D1 of an A/D converter 2. Consequently, when the data length of the memory 4 is sufficiently long as compared with the number of data inputted within the constant time, the waveform data D2 of a signal A almost at the point of time when the circuit 3 outputs the signal TG last is left in the memory 4. This data D2 is read out by a read circuit to observe the waveform state of the signal almost at the point of time when the signal A is stopped.

Description

【発明の詳細な説明】 〈産業上の利用分野〉 本発明は、デジタルオシロスコープなどのデジタル処理
技術を用いた波形測定装置に関し、詳しくは、トリガ機
能の改良に関するものである。
DETAILED DESCRIPTION OF THE INVENTION <Industrial Application Field> The present invention relates to a waveform measuring device using digital processing technology, such as a digital oscilloscope, and specifically relates to improvement of a trigger function.

〈従来の技術〉 例えば、パルス幅変調信号(PWM)で駆動されるスイ
ッチング電源やモータの電源オフ時のパルス信号は、第
4図に示すように、時間の経過に従ってデユーティレシ
オが高くなって最終的には消滅する。
<Prior art> For example, as shown in Fig. 4, the duty ratio of the pulse signal when turning off the power of a switching power supply or motor driven by a pulse width modulation signal (PWM) increases as time passes. It will eventually disappear.

従来、このようなパルス信号の波形変化の状態をl12
11するのにあたっては、例えば電源オフ信号をトリガ
信号として用い、このトリガ信号を検出した時点以降の
所望時間内のデータを収り込むことが行われている。
Conventionally, the state of waveform change of such a pulse signal is expressed as l12.
11, for example, a power-off signal is used as a trigger signal, and data within a desired time period after the trigger signal is detected is collected.

〈発明が解決しようとする課題〉 しかし、このような方法によれば、電源オフ信号をトリ
ガ信号とする外部トリガ信号回路を設けなければならず
、装置全体の回路が増えることになる。
<Problems to be Solved by the Invention> However, according to such a method, it is necessary to provide an external trigger signal circuit that uses the power off signal as a trigger signal, which increases the number of circuits in the entire device.

また、既知のパルス信号であれば所望のデータ取り込み
のための適切な条件設定が行えるが、未知のパルス信号
の場合には試行錯誤を繰り返しながら最適な条件設定を
求めなければならず、迅速な測定が行えない。
Furthermore, if the pulse signal is known, it is possible to set appropriate conditions for acquiring the desired data, but in the case of an unknown pulse signal, it is necessary to find the optimal condition settings through trial and error. Measurement cannot be performed.

さらに、電源オフ以外の故障により結果的にパルス信号
が消滅してしまうことがあるが、その変化の状態を電源
オフ信号をトリガ信号として測定することは不可能であ
り、別途測定装置を用意しなければならない。
Furthermore, failures other than power off may result in the pulse signal disappearing, but it is impossible to measure the state of this change using the power off signal as a trigger signal, so a separate measuring device must be prepared. There must be.

本発明は、このような点に着目したものであり、その目
的は、外部トリガ信号を用いることなく消滅信号の波形
観測が行える波形測定装置を提供することにある。
The present invention has focused on such a point, and an object thereof is to provide a waveform measuring device that can observe the waveform of an extinction signal without using an external trigger signal.

く課題を解決するための手段〉 本発明の波形測定装置は、 測定信号をサンプリングしてデジタル信号に変換するA
/D変換器と、 このA/D変換器の出力データを格納するファーストイ
ン・ファーストアウトのメモリと、前記測定信号の変化
点を検出してトリガ信号を出力するトリガ回路と、 このトリガ回路から1へリガ信号が出力される毎にプリ
セットデータが設定され、フルカウントに達した時点で
キャリー信号を前記メモリにデータ取込禁止信号として
出力するプリセッタブルカウンタ、 を設けたことを特徴とする。
Means for Solving the Problems〉 The waveform measuring device of the present invention has the following features: A that samples a measurement signal and converts it into a digital signal.
A/D converter, a first-in/first-out memory that stores the output data of this A/D converter, a trigger circuit that detects the change point of the measurement signal and outputs a trigger signal, and from this trigger circuit. The present invention is characterized by providing a presettable counter in which preset data is set every time a trigger signal is outputted, and a carry signal is outputted to the memory as a data acquisition prohibition signal when a full count is reached.

く作用〉 本発明のプリセッタブルカウンタはトリガ回路からトリ
ガ信号が加えられた後に一定期間トリガ信号が加えられ
ないことによりキャリー信号を発生し、このキャリー信
号をデータ取込禁止信号としてメモリに加える。
Function> The presettable counter of the present invention generates a carry signal when no trigger signal is applied for a certain period after a trigger signal is applied from the trigger circuit, and this carry signal is applied to the memory as a data acquisition prohibition signal.

これにより、メモリにはトリガ回路から最後にトリガ信
号が出力された時点近傍の測定信号の波形データが残る
ことになる。
As a result, the waveform data of the measurement signal near the time when the trigger signal was last output from the trigger circuit remains in the memory.

〈実施例〉 以下、図面を用いて本発明の実施例を詳細に説明する。<Example> Embodiments of the present invention will be described in detail below with reference to the drawings.

第1図は、本発明の一実施例を示す構成説明図である0
図において、測定信号Aが入力される入力端子1はA/
D変換器2およびトリガ回路3に接続されている。A/
D変換器2は測定信号Aをサンプリングしてデジタル信
号り、に変換し、その出力データD、をファーストイン
・ファーストアウト(FIFO)のメモリ4に加える。
FIG. 1 is a configuration explanatory diagram showing one embodiment of the present invention.
In the figure, input terminal 1 to which measurement signal A is input is A/
It is connected to the D converter 2 and the trigger circuit 3. A/
The D converter 2 samples the measurement signal A, converts it into a digital signal, and adds the output data D to a first-in first-out (FIFO) memory 4.

このメモリ4はA/D変換器2から加えられるデータD
、を順次格納するが、データが記憶容量を超えた場合に
は順次古いデータを消去更新してい<、トリガ回路3は
測定信号Aの変化点を検出してトリガ信号TGをプリセ
ッタブルカウンタ5に出力する。プリセッタブルカウン
タ5にはタロツク発生器6からクロックパルスCLKが
入力されるとともに、入力端子7に入力されるプリセッ
トデータSETがラッチ8を介して入力される。そして
、このプリセッタブルカウンタ5のキャリー信号CRY
はメモリ4にデータ取込禁止信号として加えられている
This memory 4 stores data D added from the A/D converter 2.
, are stored sequentially, but when the data exceeds the storage capacity, the old data is sequentially erased and updated. Output. A clock pulse CLK is inputted to the presettable counter 5 from a tarlock generator 6, and preset data SET inputted to an input terminal 7 is inputted via a latch 8. The carry signal CRY of this presettable counter 5
is added to the memory 4 as a data import prohibition signal.

第2図は第1図の動作の一例を示すタイミングチャート
であり、(a)は入力端子1に入力される矩形波の測定
信号Aを示し、(b)はクロック発生器6からプリセッ
タブルカウンタ5に入力されるクロックCLKを示し、
(c)はトリガ回路3から出力されるトリガ信号1゛G
を示し、(d)はプリセッタブルカウンタ5のカウント
ICDを示し、(e)はプリセッタブルカウンタ5のキ
ャリー出力CRYを示している。
FIG. 2 is a timing chart showing an example of the operation of FIG. Indicates the clock CLK input to 5,
(c) is the trigger signal 1゛G output from the trigger circuit 3.
, (d) shows the count ICD of the presettable counter 5, and (e) shows the carry output CRY of the presettable counter 5.

なお、プリセッタブルカウンタ5はカウント値CDが“
m″′に達したらフルカウントになってキャリーCRY
を出力し、プリセットデータSETとしては“n  (
n(m)が入力され、クロックCLKの周期はtとする
Note that the presettable counter 5 has a count value CD of “
When m″′ is reached, it becomes full count and carry CRY
is output, and the preset data SET is “n (
It is assumed that n(m) is input and the period of the clock CLK is t.

トリガ回路3は測定信号Aの立ち下がりを検出する毎に
トリガ信号1゛Gをプリセッタブルカウンタ5に出力す
る。プリセッタブルカウンタ5は、トリガ信号TGが加
えられることによりラッチ8を介して入力されるプリセ
ットデータSET (本実施例では“nN)を読み込み
、それ以降はこのプリセットデータS E ’f’を開
始カウント値としてタロツクCLKに応じて1カウント
ずつカウントアツプしていく。
The trigger circuit 3 outputs a trigger signal 1'G to the presettable counter 5 every time it detects a falling edge of the measurement signal A. The presettable counter 5 reads the preset data SET (in this embodiment, "nN") inputted via the latch 8 when the trigger signal TG is applied, and from then on, this preset data S E 'f' is used as the starting count. The value is incremented by one count in response to the tarokk CLK.

すなわち、第2図の■の部分では、プリセッタプルカウ
ンタ5のカウント値CDがフルカウントになる前にトリ
ガ信号TGが加えられるのでキャリーCRYは出力され
ない。
That is, in the part (■) in FIG. 2, the carry CRY is not output because the trigger signal TG is applied before the count value CD of the presetter pull counter 5 reaches the full count.

これに対し、第2図の■の部分では、トリガ回路3がi
&後にトリガ信号TGを出力してから(m−n)・を時
間経過しても新しいトリガ信号TGが入力されず、プリ
セッタブルカウンタ5のカウント値CDはフルカウント
“m″なってキャリーCRYをメモリ4に出力する。
On the other hand, in the part (■) of FIG. 2, the trigger circuit 3
& After that, a new trigger signal TG is not input even after (m-n) hours have elapsed since the output of the trigger signal TG, and the count value CD of the presettable counter 5 reaches the full count "m" and the carry CRY is stored in the memory. Output to 4.

メモリ4は、このプリセッタブルカウンタ5から加えら
れるキャリーCRYに従ってA/D変換器2の出力デー
タD1の取り込みを中止する。これにより、メモリ4の
データ長が(m−n)・を時間に入力されるデータの数
に比べて十分長いものとすると、メモリ4内にはトリガ
回路3が最後にトリガ信号′「Gを出力した時点前後の
測定信号Aの波形データD2が残っていることになる。
The memory 4 stops taking in the output data D1 of the A/D converter 2 in accordance with the carry CRY added from the presettable counter 5. As a result, assuming that the data length of the memory 4 is (m-n)· which is sufficiently long compared to the number of data input in a time, the trigger circuit 3 finally sends the trigger signal 'G' in the memory 4. This means that the waveform data D2 of the measurement signal A before and after the output point remains.

従って、このメモリ4に残っている波形データD2を図
示しないデータ読み出し回路で表示回路に読み出すこと
により、測定信号Aが停止した前後の測定信号Aの波形
の状態を観測できる。
Therefore, by reading out the waveform data D2 remaining in the memory 4 to the display circuit using a data reading circuit (not shown), it is possible to observe the state of the waveform of the measurement signal A before and after the measurement signal A stops.

このように構成することにより、従来のような外部トリ
ガ回路を用いることなく前述第4図のように時間の経過
に応じて消滅するPWM信号の推移状態を観測すること
ができ、装置の簡略化が図れるとともに迅速測定が行え
る。
With this configuration, it is possible to observe the transition state of the PWM signal that disappears over time as shown in Fig. 4 without using a conventional external trigger circuit, which simplifies the device. This allows for rapid measurement.

また、電源オン以外の故障によって測定信号Aが消滅し
た場合にもその推移の様子を収りこぼすことなく確実に
観測することができ、再現性の困難な故障原因の解析に
好適である。
In addition, even if the measurement signal A disappears due to a failure other than power-on, its transition can be reliably observed without any loss of control, which is suitable for analyzing the cause of a failure that is difficult to reproduce.

なお、このように構成される波形測定装置は、第3図の
ような減衰波形の減衰推移の観測にも有効である。
Note that the waveform measuring device configured in this manner is also effective for observing the attenuation transition of the attenuation waveform as shown in FIG.

〈発明の効果〉 以上説明したように、本発明によれば、比較的簡単な構
成で、外部トリガ信号を用いることなく消滅信号の波形
観測が行える波形測定装置が実現でき、実用上の効果は
大きい。
<Effects of the Invention> As explained above, according to the present invention, it is possible to realize a waveform measuring device that can observe the waveform of a annihilation signal with a relatively simple configuration without using an external trigger signal, and the practical effects are big.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は本発明の一実施例を示す構成説明図、第2図は
第1図の動作を説明するタイミングチャート、第3図お
よび第4図は測定信号の具体例を示す波形図である。 1・・・測定信号入力端子、2・・・A/D変換器、3
・・・トリガ回路、4・・・メモリ、5・・・プリセッ
タブルカウンタ、6・・・クロック発生器、7・・・プ
リセット第3図 +を漕Xフ
FIG. 1 is a configuration explanatory diagram showing one embodiment of the present invention, FIG. 2 is a timing chart explaining the operation of FIG. 1, and FIGS. 3 and 4 are waveform diagrams showing specific examples of measurement signals. . 1... Measurement signal input terminal, 2... A/D converter, 3
...Trigger circuit, 4...Memory, 5...Presettable counter, 6...Clock generator, 7...Preset Figure 3

Claims (1)

【特許請求の範囲】 測定信号をサンプリングしてデジタル信号に変換するA
/D変換器と、 このA/D変換器の出力データを格納するファーストイ
ン・ファーストアウトのメモリと、前記測定信号の変化
点を検出してトリガ信号を出力するトリガ回路と、 このトリガ回路からトリガ信号が出力される毎にプリセ
ットデータが設定され、フルカウントに達した時点でキ
ャリー信号を前記メモリにデータ取込禁止信号として出
力するプリセッタブルカウンタ、 を設けたことを特徴とする波形測定装置。
[Claims] A for sampling a measurement signal and converting it into a digital signal
A/D converter, a first-in/first-out memory that stores the output data of this A/D converter, a trigger circuit that detects the change point of the measurement signal and outputs a trigger signal, and from this trigger circuit. A waveform measuring device comprising: a presettable counter in which preset data is set every time a trigger signal is output, and a carry signal is output as a data import prohibition signal to the memory when a full count is reached.
JP6848689A 1989-03-20 1989-03-20 Waveform measuring instrument Pending JPH02247571A (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP6848689A JPH02247571A (en) 1989-03-20 1989-03-20 Waveform measuring instrument

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JP6848689A JPH02247571A (en) 1989-03-20 1989-03-20 Waveform measuring instrument

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ID=13375065

Family Applications (1)

Application Number Title Priority Date Filing Date
JP6848689A Pending JPH02247571A (en) 1989-03-20 1989-03-20 Waveform measuring instrument

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2009503458A (en) * 2005-07-28 2009-01-29 ローデ ウント シュワルツ ゲーエムベーハー ウント コー カーゲー Method and system for digital triggering of a signal based on two trigger events separated by a time interval

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Publication number Priority date Publication date Assignee Title
JPS5732338A (en) * 1980-08-01 1982-02-22 Japan Steel Works Ltd:The Refining method for titanium-containing steel by electroslag remelting method
JPS6310463B2 (en) * 1983-09-08 1988-03-07 Furuno Electric Co

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