JPH02117124A - 位置検出用マーク - Google Patents
位置検出用マークInfo
- Publication number
- JPH02117124A JPH02117124A JP63269463A JP26946388A JPH02117124A JP H02117124 A JPH02117124 A JP H02117124A JP 63269463 A JP63269463 A JP 63269463A JP 26946388 A JP26946388 A JP 26946388A JP H02117124 A JPH02117124 A JP H02117124A
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- JP
- Japan
- Prior art keywords
- alignment mark
- position detection
- surface protective
- protective film
- alignment
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
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- 239000000758 substrate Substances 0.000 claims abstract description 12
- 238000001514 detection method Methods 0.000 claims description 36
- 238000010894 electron beam technology Methods 0.000 abstract description 16
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 abstract description 8
- 229910052710 silicon Inorganic materials 0.000 abstract description 8
- 239000010703 silicon Substances 0.000 abstract description 8
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Landscapes
- Exposure And Positioning Against Photoresist Photosensitive Materials (AREA)
- Design And Manufacture Of Integrated Circuits (AREA)
- Semiconductor Memories (AREA)
- Exposure Of Semiconductors, Excluding Electron Or Ion Beam Exposure (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(産業上の利用分野)
本発明は、半導体装置に対して電子ビームを照射する時
の位置検出用マークに関するものである。
の位置検出用マークに関するものである。
(従来の技術)
近年、メモリーやゲートアレイ等のMO8型半導体装置
の活発な開発が行われている。半導体装置完成後に電子
ビーム照射によりトランジスタ特性を変化させて、DR
AMの冗長フユーズ切断、スタンダードセルの配線切り
換え、また、ROMの情報書き込み等が行われるように
なってきたため、半導体装置上の電子ビーム照射位置を
精度良く検出する必要性が高まってきた。
の活発な開発が行われている。半導体装置完成後に電子
ビーム照射によりトランジスタ特性を変化させて、DR
AMの冗長フユーズ切断、スタンダードセルの配線切り
換え、また、ROMの情報書き込み等が行われるように
なってきたため、半導体装置上の電子ビーム照射位置を
精度良く検出する必要性が高まってきた。
以下に従来の位置検出用マークについて図面を参照して
説明する。
説明する。
第2図は、従来の位置検出用マークの断面を示したもの
であり、11はシリコン基板、12は絶縁膜、16は位
置検出用マーク領域である。シリコン基板11をドライ
エツチングすることにより凸型、もしくは凹型の形状の
位置検出用マークが形成される。
であり、11はシリコン基板、12は絶縁膜、16は位
置検出用マーク領域である。シリコン基板11をドライ
エツチングすることにより凸型、もしくは凹型の形状の
位置検出用マークが形成される。
第2図の場合は、凸型の位置検出用マークである。
このように構成された位置検出用マークについて、以下
その動作を説明する。位置検出用マーク領域16に対し
電子ビームを走査的に照射していくと、シリコン基板1
1のエツチング段差部において、反射電子もしくは二次
電子の信号強度が変化する。
その動作を説明する。位置検出用マーク領域16に対し
電子ビームを走査的に照射していくと、シリコン基板1
1のエツチング段差部において、反射電子もしくは二次
電子の信号強度が変化する。
この信号強度の変化を検知して、半導体装置上の電子ビ
ーム照射位置の検出を行う。
ーム照射位置の検出を行う。
(発明が解決しようとするIalK)
しかしながら上記の従来の構成では、位置検出用マーク
形成後に半導体装置製造工程があるため、位置検出用マ
ーク上に層間膜や表面保護膜等の絶縁膜12が形成され
る。この位置検出用マーク上の絶縁膜12が電子ビーム
照射によって帯電し、段差部での反射電子もしくは二次
電子の信号強度の変化量が減少するため、さらには、位
置検出用マーク上の絶縁膜12が丸みを持つ形状となる
ため、位置検出精度が劣化するという問題を有していた
。
形成後に半導体装置製造工程があるため、位置検出用マ
ーク上に層間膜や表面保護膜等の絶縁膜12が形成され
る。この位置検出用マーク上の絶縁膜12が電子ビーム
照射によって帯電し、段差部での反射電子もしくは二次
電子の信号強度の変化量が減少するため、さらには、位
置検出用マーク上の絶縁膜12が丸みを持つ形状となる
ため、位置検出精度が劣化するという問題を有していた
。
本発明は、上記した従来の問題点を解決するもので、従
来の半導体装置の製造工程に変更をもたらすことなく1
位置検出用マークの帯電量を減少せしめ、位置検出精度
を向上することのできる位置検出用マークを提供するこ
とを目的とする。
来の半導体装置の製造工程に変更をもたらすことなく1
位置検出用マークの帯電量を減少せしめ、位置検出精度
を向上することのできる位置検出用マークを提供するこ
とを目的とする。
(課題を解決するための手段)
この目的を達成するために5本発明の位置検出用マーク
は、半導体基板と電気的に導通した配線膜上に、表面保
護膜がパターン形成される構成を有している。
は、半導体基板と電気的に導通した配線膜上に、表面保
護膜がパターン形成される構成を有している。
(作 用)
この構成によって、電子ビーム照射による位置検出時に
、位置検出用マークの微小面積部である表面保護膜での
み帯電し、前記位置検出用マークを構成する表面保護膜
以外の配線膜は半導体基板に電気的に導通しているため
帯電せず、位置検出時の帯電量が著しく減少するため、
精度よく位置検出することができる。
、位置検出用マークの微小面積部である表面保護膜での
み帯電し、前記位置検出用マークを構成する表面保護膜
以外の配線膜は半導体基板に電気的に導通しているため
帯電せず、位置検出時の帯電量が著しく減少するため、
精度よく位置検出することができる。
(実施例)
以下本発明の一実施例について図面を参照しながら説明
する。
する。
第1図は1本発明の一実施例における位置検出用マーク
の断面を示したものである。1はシリコン基板、2は層
間絶縁膜、4は配線膜、5は表面保護膜、6は位置検出
用マーク領域である。シリコン基板1と配線膜4とは層
間絶縁膜2に開口されたコンタクト窓3を通じて電気的
に導通している0位置検出用マークでの表面保護膜5は
、配線II4上に所望のパターン形状に形成され1位置
検出用マークに占める表面保護膜5の面積は微小である
。
の断面を示したものである。1はシリコン基板、2は層
間絶縁膜、4は配線膜、5は表面保護膜、6は位置検出
用マーク領域である。シリコン基板1と配線膜4とは層
間絶縁膜2に開口されたコンタクト窓3を通じて電気的
に導通している0位置検出用マークでの表面保護膜5は
、配線II4上に所望のパターン形状に形成され1位置
検出用マークに占める表面保護膜5の面積は微小である
。
以上のように構成された位置検出用マークについて、以
下その動作を説明する。位置検出用マーク領域6を、電
子ビームが走査的に照射されていくと、配線膜4と表面
保護膜5の境界で、反射電子もしくは二次電子の信号強
度が変化する。この信号強度の変化を検知して、半導体
装置上の電子ビーム照射位置の検出を行う、この時、位
置検出用マークの表面保護膜5でのみ電子ビーム照射に
より帯電し、表面保護膜5以外の位置検出用マークを構
成する配線膜4に照射された電子はコンタクト窓3を通
じてシリコン基板1に流出するため帯電しない。
下その動作を説明する。位置検出用マーク領域6を、電
子ビームが走査的に照射されていくと、配線膜4と表面
保護膜5の境界で、反射電子もしくは二次電子の信号強
度が変化する。この信号強度の変化を検知して、半導体
装置上の電子ビーム照射位置の検出を行う、この時、位
置検出用マークの表面保護膜5でのみ電子ビーム照射に
より帯電し、表面保護膜5以外の位置検出用マークを構
成する配線膜4に照射された電子はコンタクト窓3を通
じてシリコン基板1に流出するため帯電しない。
以上のように本実施例によれば、位置検出用マークの帯
電量が少なく、電子ビーム照射時の位置検出ができ、位
置検出の精度が向上する。
電量が少なく、電子ビーム照射時の位置検出ができ、位
置検出の精度が向上する。
(発明の効果)
本発明は、従来の半導体装置の製造工程を何ら変更する
ことなく、電子ビーム照射による帯電量が少ない位置検
出用マークを形成することができ。
ことなく、電子ビーム照射による帯電量が少ない位置検
出用マークを形成することができ。
位置検出精度が向上するという効果を得ることができる
。
。
第1図は1本発明の一実施例における位置検出用マーク
の断面図、第2図は、従来の位置検出用マークの断面図
である。 1 ・・・シリコン基板、 3・・・コンタクト窓、 5・・・表面保護膜。 −ク領域。 2・・・層間絶縁膜、 4 ・・・配線膜、 6・・・位置検出用マ
の断面図、第2図は、従来の位置検出用マークの断面図
である。 1 ・・・シリコン基板、 3・・・コンタクト窓、 5・・・表面保護膜。 −ク領域。 2・・・層間絶縁膜、 4 ・・・配線膜、 6・・・位置検出用マ
Claims (1)
- 半導体基板に電気的に導通した配線膜と、前記配線膜上
にパターン形成された表面保護膜とから構成されること
を特徴とする位置検出用マーク。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63269463A JPH02117124A (ja) | 1988-10-27 | 1988-10-27 | 位置検出用マーク |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63269463A JPH02117124A (ja) | 1988-10-27 | 1988-10-27 | 位置検出用マーク |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH02117124A true JPH02117124A (ja) | 1990-05-01 |
Family
ID=17472788
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP63269463A Pending JPH02117124A (ja) | 1988-10-27 | 1988-10-27 | 位置検出用マーク |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH02117124A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100419054B1 (ko) * | 1996-10-25 | 2004-05-22 | 주식회사 하이닉스반도체 | 반도체메모리소자의제조방법 |
JP2020021773A (ja) * | 2018-07-30 | 2020-02-06 | 株式会社デンソー | 半導体装置の製造方法 |
-
1988
- 1988-10-27 JP JP63269463A patent/JPH02117124A/ja active Pending
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100419054B1 (ko) * | 1996-10-25 | 2004-05-22 | 주식회사 하이닉스반도체 | 반도체메모리소자의제조방법 |
JP2020021773A (ja) * | 2018-07-30 | 2020-02-06 | 株式会社デンソー | 半導体装置の製造方法 |
WO2020027130A1 (ja) * | 2018-07-30 | 2020-02-06 | 株式会社デンソー | 半導体装置の製造方法 |
US11967564B2 (en) | 2018-07-30 | 2024-04-23 | Denso Corporation | Method for manufacturing semiconductor device |
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