JPH02103916U - - Google Patents

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JPH02103916U
JPH02103916U JP1336989U JP1336989U JPH02103916U JP H02103916 U JPH02103916 U JP H02103916U JP 1336989 U JP1336989 U JP 1336989U JP 1336989 U JP1336989 U JP 1336989U JP H02103916 U JPH02103916 U JP H02103916U
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transistor
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  • Control Of Amplification And Gain Control (AREA)

Description

【図面の簡単な説明】
第1図は、本考案の可変利得回路の実施例を示
す回路図、第2図は、可変利得回路のより具体的
な実施例を示す回路図、第3図は、従来の圧縮回
路を示す為の回路図である。 1:入力端子、2:出力端子、3,5:電流ミ
ラー回路、4:演算増幅器、6,7:定電流源回
路、8,9:基準電圧源回路。

Claims (1)

    【実用新案登録請求の範囲】
  1. 入力信号が供給されるダイオード型の第1のト
    ランジスタと第2のトランジスタのエミツタが共
    通接続されて第1の定電流源回路を介して接地さ
    れ、該第1と該第2のトランジスタのコレクタが
    夫々第1の電流ミラー回路の出力段及びバイアス
    段に接続されてなる信号入力段の差動増幅器と、
    第3と第4のトランジスタのエミツタが共通接続
    されて第2の定電流源回路を介して接地され、該
    第3と該第4のトランジスタのコレクタが夫々第
    2の電流ミラー回路の出力段及びバイアス段に接
    続されてなる信号出力段の差動増幅器と、該第1
    のトランジスタと該第1の電流ミラー回路の出力
    段のトランジスタとの接続点が反転入力端子に接
    続され、第1の基準電圧源が非反転端子に接続さ
    れ、該第2と該第3のトランジスタのベースがそ
    の出力端に接続されてなる演算増幅器とを具えた
    ことを特徴とする可変利得回路。
JP1989013369U 1989-02-07 1989-02-07 可変利得回路 Expired - Lifetime JPH066612Y2 (ja)

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JP1989013369U JPH066612Y2 (ja) 1989-02-07 1989-02-07 可変利得回路

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JPH02103916U true JPH02103916U (ja) 1990-08-17
JPH066612Y2 JPH066612Y2 (ja) 1994-02-16

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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6238012A (ja) * 1985-08-12 1987-02-19 Toshiba Corp 可変利得回路

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6238012A (ja) * 1985-08-12 1987-02-19 Toshiba Corp 可変利得回路

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JPH066612Y2 (ja) 1994-02-16

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