JPS61103917U - - Google Patents

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JPS61103917U
JPS61103917U JP18637284U JP18637284U JPS61103917U JP S61103917 U JPS61103917 U JP S61103917U JP 18637284 U JP18637284 U JP 18637284U JP 18637284 U JP18637284 U JP 18637284U JP S61103917 U JPS61103917 U JP S61103917U
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JP
Japan
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bipolar transistor
fet
drain
collector
sources
Prior art date
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JP18637284U
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Description

【図面の簡単な説明】
第1図及び第2図は差動アンプの従来例を示す
回路図、第3図は本考案の実施例を示す回路図、
第4図は本考案の他の実施例を示す回路図である
。 主要部分の符号の説明、1,2……NPNトラ
ンジスタ、3,6,15……定電流源、4,5,
11,12……FET、13,14……PNPト
ランジスタ。

Claims (1)

    【実用新案登録請求の範囲】
  1. ゲートが入力端をなしかつソースが互いに共通
    接続された定電流源に接続された第1及び第2F
    ETと、ベースが前記第1FETのドレインに接
    続された第1バイポーラトランジスタと、ベース
    が前記第2FETのドレインに接続されかつコレ
    クタが前記第1バイポーラトランジスタのコレク
    タと共に前記第1及び第2FETのソースに接続
    された第2バイポーラトランジスタとを含み、前
    記第2バイポーラトランジスタのエミツタが出力
    端をなすことを特徴とする差動アンプ。
JP18637284U 1984-12-07 1984-12-07 Pending JPS61103917U (ja)

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JP18637284U JPS61103917U (ja) 1984-12-07 1984-12-07

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Application Number Priority Date Filing Date Title
JP18637284U JPS61103917U (ja) 1984-12-07 1984-12-07

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Publication Number Publication Date
JPS61103917U true JPS61103917U (ja) 1986-07-02

Family

ID=30743839

Family Applications (1)

Application Number Title Priority Date Filing Date
JP18637284U Pending JPS61103917U (ja) 1984-12-07 1984-12-07

Country Status (1)

Country Link
JP (1) JPS61103917U (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0239708A (ja) * 1988-07-29 1990-02-08 Toshiba Corp 差動増幅回路

Cited By (1)

* Cited by examiner, † Cited by third party
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JPH0239708A (ja) * 1988-07-29 1990-02-08 Toshiba Corp 差動増幅回路

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