JPH0187274U - - Google Patents

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JPH0187274U
JPH0187274U JP18192887U JP18192887U JPH0187274U JP H0187274 U JPH0187274 U JP H0187274U JP 18192887 U JP18192887 U JP 18192887U JP 18192887 U JP18192887 U JP 18192887U JP H0187274 U JPH0187274 U JP H0187274U
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Description

【図面の簡単な説明】
第1図はこの考案の一実施例のブロツク図、第
2図はこの考案に用いるビツトマツプメモリの構
成を示す図、第3図は従来の応答ビデオ模擬装置
のブロツク図である。 1……計算機、2……パラレル/シリアル変換
書込回路、3……ビツトマツプメモリ、4……ス
キヤンタイミング発生回路、5……論理和ゲート

Claims (1)

  1. 【実用新案登録請求の範囲】 模擬目標の応答コードと応答レンジを出力する
    計算機と、 前記応答レンジに相当するアドレスから応答コ
    ード長に相当するアドレス期間だけ1目標1ビツ
    ト幅でアドレス方向に応答コードを複数記録可能
    なビツトマツプメモリと、 スキヤンレンジをアドレスとして前記ビツトマ
    ツプメモリより応答コードを読み出すスキヤンタ
    イミング発生回路とからなることを特徴とする2
    次監視レーダ応答ビデオ模擬装置。
JP18192887U 1987-12-01 1987-12-01 Pending JPH0187274U (ja)

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JP18192887U JPH0187274U (ja) 1987-12-01 1987-12-01

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JPH0187274U true JPH0187274U (ja) 1989-06-08

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JP18192887U Pending JPH0187274U (ja) 1987-12-01 1987-12-01

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JP (1) JPH0187274U (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2009281820A (ja) * 2008-05-21 2009-12-03 Toshiba Corp モードsシミュレータ

Cited By (1)

* Cited by examiner, † Cited by third party
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JP2009281820A (ja) * 2008-05-21 2009-12-03 Toshiba Corp モードsシミュレータ

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