JPH03124248U - - Google Patents
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- Publication number
- JPH03124248U JPH03124248U JP3297790U JP3297790U JPH03124248U JP H03124248 U JPH03124248 U JP H03124248U JP 3297790 U JP3297790 U JP 3297790U JP 3297790 U JP3297790 U JP 3297790U JP H03124248 U JPH03124248 U JP H03124248U
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- data
- dma
- mode setting
- output
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 2
- 238000013500 data storage Methods 0.000 description 1
Landscapes
- Bus Control (AREA)
Description
第１図は本考案の一実施例の構成図、第２図は
第１図の動作を説明するタイミングチヤート、第
３図は第１図のメモリのデータ格納状態説明図で
ある。 １……モード設定回路、２……ＣＰＵ、３……
データ選択回路、４……ＤＭＡタイミング生成回
路、５……アドレスカウンタ、６……バツフア、
７……メモリ。
第１図の動作を説明するタイミングチヤート、第
３図は第１図のメモリのデータ格納状態説明図で
ある。 １……モード設定回路、２……ＣＰＵ、３……
データ選択回路、４……ＤＭＡタイミング生成回
路、５……アドレスカウンタ、６……バツフア、
７……メモリ。
Claims (1)
- 【実用新案登録請求の範囲】 ＣＰＵによりデータの転送モードが設定される
モード設定回路と、 該モード設定回路の出力信号に従つて転送デー
タを選択するデータ選択回路と、 外部から加えられる制御信号及び前記モード設
定回路の出力信号に従つてＤＭＡデータ転送を実
行するための複数のタイミング信号を生成するＤ
ＭＡタイミング生成回路と、 前記データ選択回路から出力されるデータを格
納するメモリと、 前記ＤＭＡタイミング生成回路から出力される
タイミング信号に基づいて該メモリのアドレスを
決定するアドレスカウンタ、 とで構成されたことを特徴とするＤＭＡ転送装置
。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3297790U JPH03124248U (ja) | 1990-03-29 | 1990-03-29 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3297790U JPH03124248U (ja) | 1990-03-29 | 1990-03-29 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH03124248U true JPH03124248U (ja) | 1991-12-17 |
Family
ID=31536286
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3297790U Pending JPH03124248U (ja) | 1990-03-29 | 1990-03-29 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH03124248U (ja) |
-
1990
- 1990-03-29 JP JP3297790U patent/JPH03124248U/ja active Pending
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