JPH0136343Y2 - - Google Patents
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- Publication number
- JPH0136343Y2 JPH0136343Y2 JP11449183U JP11449183U JPH0136343Y2 JP H0136343 Y2 JPH0136343 Y2 JP H0136343Y2 JP 11449183 U JP11449183 U JP 11449183U JP 11449183 U JP11449183 U JP 11449183U JP H0136343 Y2 JPH0136343 Y2 JP H0136343Y2
- Authority
- JP
- Japan
- Prior art keywords
- amplifier
- circuit
- output
- turned
- operating status
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
- 238000001514 detection method Methods 0.000 claims description 10
- 230000005856 abnormality Effects 0.000 description 9
- 239000003990 capacitor Substances 0.000 description 2
- 230000002159 abnormal effect Effects 0.000 description 1
- 238000012790 confirmation Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000006641 stabilisation Effects 0.000 description 1
- 238000011105 stabilization Methods 0.000 description 1
Landscapes
- Tests Of Electronic Circuits (AREA)
- Amplifiers (AREA)
Description
【考案の詳細な説明】
本考案はオーデイオアンプに於ける動作状況の
チエツクと検出を表示する動作表示装置に関す
る。
チエツクと検出を表示する動作表示装置に関す
る。
オーデイオアンプは電源投入時より数秒間は動
作状態の不安定性及びDCオフセツトの安定時間
確保の為にリレー等の電子的な切換装置により負
荷側とアンプ出力は遮断されている。
作状態の不安定性及びDCオフセツトの安定時間
確保の為にリレー等の電子的な切換装置により負
荷側とアンプ出力は遮断されている。
本考案はこの遮断時間を利用し、電源ON時よ
り複数の検出回路の出力を順次確認出来る様にす
るもので、以下図面を参照して詳細な説明を行
う。
り複数の検出回路の出力を順次確認出来る様にす
るもので、以下図面を参照して詳細な説明を行
う。
図は本考案の一実施例である。
増幅器２０とスピーカ２１の間にリレー９′が
設けられ、この増幅器２０の電源＋Ｂ投入時プロ
グラマブルダウンカウンタ６のロード端子Ｒは抵
抗器３によりＨレベルであり、このとき上記カウ
ンタ６は初期値９にロードされる。その後抵抗
１、コンデンサー２による時定数でトランジスタ
４はスイツチングされロード端子ＲはＬレベルに
なり、クロツク５の出力をダウンカウントする。
カウンタ６の出力Ａ，Ｂ，Ｃ，Ｄは初期値９より
順次カウントダウンする。カウンタ６のこれら出
力は、BCDデシマルデコーダ７の入力端子に接
続されている。BCDデシマルデコーダは出力端
子９〜０を有し、これら出力端子はカウンタ６の
出力に応じて順次Ｈレベルになる。BCDデシマ
ルデコーダ７の各出力に接続された複数のＲ−Ｓ
F.F１０−０〜１０−９のセツト側入力がＨと
なると出力ＱはＨとなる。
設けられ、この増幅器２０の電源＋Ｂ投入時プロ
グラマブルダウンカウンタ６のロード端子Ｒは抵
抗器３によりＨレベルであり、このとき上記カウ
ンタ６は初期値９にロードされる。その後抵抗
１、コンデンサー２による時定数でトランジスタ
４はスイツチングされロード端子ＲはＬレベルに
なり、クロツク５の出力をダウンカウントする。
カウンタ６の出力Ａ，Ｂ，Ｃ，Ｄは初期値９より
順次カウントダウンする。カウンタ６のこれら出
力は、BCDデシマルデコーダ７の入力端子に接
続されている。BCDデシマルデコーダは出力端
子９〜０を有し、これら出力端子はカウンタ６の
出力に応じて順次Ｈレベルになる。BCDデシマ
ルデコーダ７の各出力に接続された複数のＲ−Ｓ
F.F１０−０〜１０−９のセツト側入力がＨと
なると出力ＱはＨとなる。
BCDデシマルデコーダ７の出力０がＨレベル
になると、カウンタ停止入力C1NがＨとなりカウ
ンタは停止すると共に増幅器出力側と負荷側に接
続された切換器をONにし、この時点で電源ON
時よりのミユーテイング動作は終了する。
になると、カウンタ停止入力C1NがＨとなりカウ
ンタは停止すると共に増幅器出力側と負荷側に接
続された切換器をONにし、この時点で電源ON
時よりのミユーテイング動作は終了する。
カウンタ６の出力９〜０までの間に要する時間
は任意に設定することが出来、Ｒ−Ｓ F.F１０
−０〜１０−９の出力はカウンタ６の値により順
次Ｈレベルとなり、２入力AND１２−０〜１２
−９の一方の入力端子がＨとなる。この時アンプ
内の異常検出回路１４−０〜１４−９等が異常を
検出した場合Ｌレベルとなる様に動作すると
AND回路出力はＨとならずにトランジスタ１６
−０〜１６−９のうちの対応するものがオフであ
り正常を指示するランプ１８−０〜１８−９のう
ち対応するものは点灯しない。
は任意に設定することが出来、Ｒ−Ｓ F.F１０
−０〜１０−９の出力はカウンタ６の値により順
次Ｈレベルとなり、２入力AND１２−０〜１２
−９の一方の入力端子がＨとなる。この時アンプ
内の異常検出回路１４−０〜１４−９等が異常を
検出した場合Ｌレベルとなる様に動作すると
AND回路出力はＨとならずにトランジスタ１６
−０〜１６−９のうちの対応するものがオフであ
り正常を指示するランプ１８−０〜１８−９のう
ち対応するものは点灯しない。
異常検出回路が増幅器２０の動作を正常と判断
するとＨレベルとなり表示用ランプ１８−０〜１
８−９のドライバー用トランジスタ１６−０〜１
６−９はONしランプは点灯する。
するとＨレベルとなり表示用ランプ１８−０〜１
８−９のドライバー用トランジスタ１６−０〜１
６−９はONしランプは点灯する。
この様に異常検出回路は電源ONより設定され
た時間を経過してから増幅器の動作状態を判断す
ることになる。従つて例えば増幅器のDCオフセ
ツト電圧の異常を上記異常検出回路の一つが検出
する様にしてもよい。一般に電源ON直後に於て
はDCオフセツト電圧はプラスマイナスに大きく
変動し、このあと安定となるので電源ON直後に
検出確認すると正常でも異常と判断される。この
為この安定後にF.F回路がＨとなる様にクロツク
周波数を設定すればこの様な誤表示を発生する事
がない。又、温度検出回路の異常を上記異常検出
回路の一つにより検出する様に構成することも出
来る。一般に増幅器内部の温度は電源ONより時
間経過をしないと上昇しないので時間経過後にF.
F回路がＨとなる様にF.F回路を選定する。又抵
抗器１とコンデンサ２の時定数を選定することに
より最適時間を定めることが出来る。
た時間を経過してから増幅器の動作状態を判断す
ることになる。従つて例えば増幅器のDCオフセ
ツト電圧の異常を上記異常検出回路の一つが検出
する様にしてもよい。一般に電源ON直後に於て
はDCオフセツト電圧はプラスマイナスに大きく
変動し、このあと安定となるので電源ON直後に
検出確認すると正常でも異常と判断される。この
為この安定後にF.F回路がＨとなる様にクロツク
周波数を設定すればこの様な誤表示を発生する事
がない。又、温度検出回路の異常を上記異常検出
回路の一つにより検出する様に構成することも出
来る。一般に増幅器内部の温度は電源ONより時
間経過をしないと上昇しないので時間経過後にF.
F回路がＨとなる様にF.F回路を選定する。又抵
抗器１とコンデンサ２の時定数を選定することに
より最適時間を定めることが出来る。
以上の様に本考案によれば、増幅器の各動作状
態をその最適時刻において表示することが出来、
その実用的効果は大きい。
態をその最適時刻において表示することが出来、
その実用的効果は大きい。
図は本考案の一実施例である。
５……クロツク、６……ダウンカウンタ、７…
…デコーダ、１４−０〜１４−９……異常検出回
路。
…デコーダ、１４−０〜１４−９……異常検出回
路。
Claims (1)
- オーデイオ増幅器と、該増幅器の電源投入時よ
り所定の時間経過後カウントを開始するダウンカ
ウンタと該ダウンカウンタの計数値に応じた出力
端子にパルスを発生するデコーダと、上記増幅器
と負荷との間に接続されたリレーと、最終カウン
ト時に上記リレーをオンにする手段と、上記デコ
ーダの出力端子に接続されたフリツプフロツプ
と、各フリツプフロツプの出力端が一方の入力端
子に接続された論理積回路と、上記論理積回路の
他方の入力端子に接続され、上記増幅器の動作状
況を検出する検出回路と、上記論理積回路出力端
に接続され、上記増幅器の動作状況を表示する表
示回路とを備えたオーデイオ増幅器の動作状況表
示回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11449183U JPS6022013U (ja) | 1983-07-22 | 1983-07-22 | オ−デイオ増幅器の動作状況表示回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11449183U JPS6022013U (ja) | 1983-07-22 | 1983-07-22 | オ−デイオ増幅器の動作状況表示回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6022013U JPS6022013U (ja) | 1985-02-15 |
| JPH0136343Y2 true JPH0136343Y2 (ja) | 1989-11-06 |
Family
ID=30264641
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11449183U Granted JPS6022013U (ja) | 1983-07-22 | 1983-07-22 | オ−デイオ増幅器の動作状況表示回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6022013U (ja) |
-
1983
- 1983-07-22 JP JP11449183U patent/JPS6022013U/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6022013U (ja) | 1985-02-15 |
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