JPH0134424B2 - - Google Patents
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- JPH0134424B2 JPH0134424B2 JP57068362A JP6836282A JPH0134424B2 JP H0134424 B2 JPH0134424 B2 JP H0134424B2 JP 57068362 A JP57068362 A JP 57068362A JP 6836282 A JP6836282 A JP 6836282A JP H0134424 B2 JPH0134424 B2 JP H0134424B2
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- Japan
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- signal
- compression
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- 230000006835 compression Effects 0.000 claims description 48
- 238000007906 compression Methods 0.000 claims description 48
- 230000005540 biological transmission Effects 0.000 description 15
- 230000006837 decompression Effects 0.000 description 9
- 238000010586 diagram Methods 0.000 description 6
- 230000006870 function Effects 0.000 description 2
- 230000006866 deterioration Effects 0.000 description 1
- 238000005070 sampling Methods 0.000 description 1
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-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N1/00—Scanning, transmission or reproduction of documents or the like, e.g. facsimile transmission; Details thereof
- H04N1/41—Bandwidth or redundancy reduction
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- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
Description
【発明の詳細な説明】
本発明は、フアクシミリなど２次元画像の走査
により得られる画信号の帯域圧縮をおこなう帯域
圧縮装置に関するものである。
により得られる画信号の帯域圧縮をおこなう帯域
圧縮装置に関するものである。
帯域圧縮によるフアクシミリ装置においては、
伝送符号数を極力少くすること、すなわち圧縮率
を高めることに努力が払われており、入力画情報
の符号数も可能な限り少くするということが、一
般に行なわれており、帯域圧縮装置の各回路は、
入力画情報の一主走査線当りの符号数に合わせて
設計される。
伝送符号数を極力少くすること、すなわち圧縮率
を高めることに努力が払われており、入力画情報
の符号数も可能な限り少くするということが、一
般に行なわれており、帯域圧縮装置の各回路は、
入力画情報の一主走査線当りの符号数に合わせて
設計される。
第１図に帯域圧縮装置を用いたフアクシミリシ
ステムの一般的な構成を示す。原画１を画像読取
装置２で走査により主走査線単位の画信号として
読み取り、読み取つた画信号は帯域圧縮装置３で
圧縮符号化したのち、伝送路４を経由して復元装
置５へ伝送する。復元装置５は受け取つた圧縮符
号化された画信号を、原画信号へ復元し、画像記
録装置６は復元された原画信号にもとずいて再生
画７を記録する。
ステムの一般的な構成を示す。原画１を画像読取
装置２で走査により主走査線単位の画信号として
読み取り、読み取つた画信号は帯域圧縮装置３で
圧縮符号化したのち、伝送路４を経由して復元装
置５へ伝送する。復元装置５は受け取つた圧縮符
号化された画信号を、原画信号へ復元し、画像記
録装置６は復元された原画信号にもとずいて再生
画７を記録する。
従来、第１図に示したフアクシミリシステムに
おいて、画像読取装置２の画像読取密度やドラム
径が変わつたり、原画１の主走査線長が変わつた
場合、高い圧縮率を実現するため、圧縮装置３へ
送られる一主走査線当り画素数ｍが変化するたび
に、圧縮装置３および復元装置５で処理する一主
走査線当り画素数ｎを原画の一主走査線当り画素
数ｍと合わせなければならないという欠点を有し
ていた。
おいて、画像読取装置２の画像読取密度やドラム
径が変わつたり、原画１の主走査線長が変わつた
場合、高い圧縮率を実現するため、圧縮装置３へ
送られる一主走査線当り画素数ｍが変化するたび
に、圧縮装置３および復元装置５で処理する一主
走査線当り画素数ｎを原画の一主走査線当り画素
数ｍと合わせなければならないという欠点を有し
ていた。
一方、一般にフアクシミリシステムにおいて伝
送される原画サイズや画像読取装置の規格（画像
読取密度、ドラム径）は、利用者の目的や要求に
より頻繁に変化する。そのたびに、圧縮装置３や
復元装置５の一主走査線当り画素数ｎを、読み込
まれる一主走査線当り画素数ｍと合わせる作業を
おこなうのは、フアクシミリシステムの操作性が
著しく悪化するばかりでなく、設定値ｎの変更時
に誤りが発生するとフアクシミリシステム全体の
運用に支障をきたす。
送される原画サイズや画像読取装置の規格（画像
読取密度、ドラム径）は、利用者の目的や要求に
より頻繁に変化する。そのたびに、圧縮装置３や
復元装置５の一主走査線当り画素数ｎを、読み込
まれる一主走査線当り画素数ｍと合わせる作業を
おこなうのは、フアクシミリシステムの操作性が
著しく悪化するばかりでなく、設定値ｎの変更時
に誤りが発生するとフアクシミリシステム全体の
運用に支障をきたす。
また圧縮装置３および復元装置５は、圧縮処理
する一主走査線当り画素数ｎが変化すると、これ
に関連する回路は数十ケ所に及び、圧縮処理する
一主走査線当りの画素数ｎが異なる仕様のものに
変更するのは数十ケ所の回路変更をおこなわなけ
ればならない。
する一主走査線当り画素数ｎが変化すると、これ
に関連する回路は数十ケ所に及び、圧縮処理する
一主走査線当りの画素数ｎが異なる仕様のものに
変更するのは数十ケ所の回路変更をおこなわなけ
ればならない。
本発明は、従来の圧縮復元装置間で発生してい
た上記のような欠点をとり除き、帯域圧縮装置内
部で処理する一主走査線当り画素数ｎを、圧縮装
置に読み込まれる原画情報の一主走査線当り画素
数ｍと関係なく、一定とすることにより、操作性
を向上させ、回路構成が簡略化された帯域圧縮装
置を提供することを目的とする。
た上記のような欠点をとり除き、帯域圧縮装置内
部で処理する一主走査線当り画素数ｎを、圧縮装
置に読み込まれる原画情報の一主走査線当り画素
数ｍと関係なく、一定とすることにより、操作性
を向上させ、回路構成が簡略化された帯域圧縮装
置を提供することを目的とする。
以下、本発明の一実施例について、図面を用い
説明する。
説明する。
以下の実施例は、２値信号を取扱うフアクシミ
リ装置であるが、本発明は中間調帯域圧縮フアク
シミリ装置にも適応できる。
リ装置であるが、本発明は中間調帯域圧縮フアク
シミリ装置にも適応できる。
第２図イ〜ハは、本発明の原理を示す図であつ
て、同図イは、画像読取装置より圧縮装置に送ら
れる一主走査線分の画信号、同図ロは同信号イに
白又は黒の（以降、便宜上白として説明する）仮
想原画を追加した圧縮装置内部で圧縮処理される
一主走査線分の画信号、同図ハは各信号イ，ロの
走査方向をそれぞれ示している。第２図イ〜ロで
真の原画信号は斜線で示し、ｎｍとする。
て、同図イは、画像読取装置より圧縮装置に送ら
れる一主走査線分の画信号、同図ロは同信号イに
白又は黒の（以降、便宜上白として説明する）仮
想原画を追加した圧縮装置内部で圧縮処理される
一主走査線分の画信号、同図ハは各信号イ，ロの
走査方向をそれぞれ示している。第２図イ〜ロで
真の原画信号は斜線で示し、ｎｍとする。
本発明の圧縮装置は、画信号読取装置より読み
込んだ原画信号イに、白い仮想原画をｖ（＝ｎ−
ｍ）画素追加し、圧縮処理する画信号ロを形成し
たのち、画信号ロを圧縮符号化して伝送する。白
い仮想原画を追加したのち圧縮処理するために、
画信号ロの圧縮率は原画信号イの圧縮率と比較し
て低下するが、追加部分は変化点が少いために圧
縮率は著しく高く、追加符号数が5000〜10000画
素であつても、符号数の増加は一主走査線当り20
〜40ビツトであるため圧縮率の低下は著しく少さ
い。
込んだ原画信号イに、白い仮想原画をｖ（＝ｎ−
ｍ）画素追加し、圧縮処理する画信号ロを形成し
たのち、画信号ロを圧縮符号化して伝送する。白
い仮想原画を追加したのち圧縮処理するために、
画信号ロの圧縮率は原画信号イの圧縮率と比較し
て低下するが、追加部分は変化点が少いために圧
縮率は著しく高く、追加符号数が5000〜10000画
素であつても、符号数の増加は一主走査線当り20
〜40ビツトであるため圧縮率の低下は著しく少さ
い。
第３図は、第１図に示したフアクシミリシステ
ムに本発明を適用した本発明の一実施例のブロツ
ク図を示している。
ムに本発明を適用した本発明の一実施例のブロツ
ク図を示している。
画像読取装置２より圧縮装置３へ送られた原画
信号は、仮想原画追加回路３ａで圧縮処理する一
主走査線当りの画素数をｎとされ、圧縮符号化伝
送回路３ｂで圧縮符号化処理がおこなわれ、伝送
路４へ送出される。伝送路４を経由して送られた
圧縮符号化信号は、復元装置５で原画信号に復元
される。第３図に示した系において、圧縮符号化
伝送回路３ｂと、復元装置５は圧縮処理する一主
走査線当り画素数ｎが固定された原画信号に対す
る圧縮復元処理をするだけでよく、従来のような
ｎが可変のものと比べ回路が簡略化されている。
信号は、仮想原画追加回路３ａで圧縮処理する一
主走査線当りの画素数をｎとされ、圧縮符号化伝
送回路３ｂで圧縮符号化処理がおこなわれ、伝送
路４へ送出される。伝送路４を経由して送られた
圧縮符号化信号は、復元装置５で原画信号に復元
される。第３図に示した系において、圧縮符号化
伝送回路３ｂと、復元装置５は圧縮処理する一主
走査線当り画素数ｎが固定された原画信号に対す
る圧縮復元処理をするだけでよく、従来のような
ｎが可変のものと比べ回路が簡略化されている。
たとえば帯域圧縮装置は、一主走査線分の画情
報の圧縮符号化が圧縮符号化伝送回路３ｂで完了
すると、符号化データの最後に一定の特殊な終結
符号を追加し復元装置５へ送出する。したがつて
終結符号追加回路（図示せず）においては、本発
明のように圧縮処理する一主走査線当り画素数ｎ
が固定の圧縮復元装置は、画信号の符号数をカウ
ントする回路が固定でよいが、従来のようにｎが
可変の圧縮復元装置はｎが変わるたびに画信号の
符号数をカウントする回路を変更しなければなら
ない。なお、仮想原画追加回路３ａで追加された
白い仮想原画は、復元装置５の出力端あるいは画
像記録装置６で除去して再生画７を得ることがで
きるほか、仮想原画除去をおこなわずに再生画を
記録しても、再生画の末端に若干の白い余白が出
現するだけで、フアクシミリシステム運用上、問
題とならない。
報の圧縮符号化が圧縮符号化伝送回路３ｂで完了
すると、符号化データの最後に一定の特殊な終結
符号を追加し復元装置５へ送出する。したがつて
終結符号追加回路（図示せず）においては、本発
明のように圧縮処理する一主走査線当り画素数ｎ
が固定の圧縮復元装置は、画信号の符号数をカウ
ントする回路が固定でよいが、従来のようにｎが
可変の圧縮復元装置はｎが変わるたびに画信号の
符号数をカウントする回路を変更しなければなら
ない。なお、仮想原画追加回路３ａで追加された
白い仮想原画は、復元装置５の出力端あるいは画
像記録装置６で除去して再生画７を得ることがで
きるほか、仮想原画除去をおこなわずに再生画を
記録しても、再生画の末端に若干の白い余白が出
現するだけで、フアクシミリシステム運用上、問
題とならない。
次に仮想原画追加回路３ａについて説明する。
画像読取装置２においては、通常１主走査線を走
査する時間は決まつており、これをTsとする。
このTsより短い時間Teの中にｍ画素が存在する。
１画素を走査するのに要する時間をTpとすると、
mTp＝Teの関係が成立する。付加する画素数を
ｖ（ｖ＝ｎ−ｍ）とし、vTpの値が大きくなると、
（ｍ＋ｖ）TpTsとなり、帯域圧縮装置の圧縮符
号化伝送回路３ｂは、画像読取装置２が一主走査
している間に、ｎ画素を受けとれなくなる。（ｍ
＋ｖ）Tp＜Tsの場合には、仮想原画追加回路３
ａは単に白い仮想原画をｖ画素分追加すればよい
が、（ｍ＋ｖ）TpTsの場合には、１画素の走査
時間Tpを、１画素が圧縮符号化伝送回路３ｂへ
送られる時間Tcへ変更する機能を、仮想原画追
加回路３ａにもたせねばならない。つまり、ｖの
値にかかわらず（ｍ＋ｖ）TcTsが成り立つよ
うに、TpをTcへ変換するようにすればよい。
画像読取装置２においては、通常１主走査線を走
査する時間は決まつており、これをTsとする。
このTsより短い時間Teの中にｍ画素が存在する。
１画素を走査するのに要する時間をTpとすると、
mTp＝Teの関係が成立する。付加する画素数を
ｖ（ｖ＝ｎ−ｍ）とし、vTpの値が大きくなると、
（ｍ＋ｖ）TpTsとなり、帯域圧縮装置の圧縮符
号化伝送回路３ｂは、画像読取装置２が一主走査
している間に、ｎ画素を受けとれなくなる。（ｍ
＋ｖ）Tp＜Tsの場合には、仮想原画追加回路３
ａは単に白い仮想原画をｖ画素分追加すればよい
が、（ｍ＋ｖ）TpTsの場合には、１画素の走査
時間Tpを、１画素が圧縮符号化伝送回路３ｂへ
送られる時間Tcへ変更する機能を、仮想原画追
加回路３ａにもたせねばならない。つまり、ｖの
値にかかわらず（ｍ＋ｖ）TcTsが成り立つよ
うに、TpをTcへ変換するようにすればよい。
第４図は、この機能を持つた仮想原画追加回路
３ａの一実施例であり、第５図Ａ，Ｂはその動作
タイミングを示している。第４図で、画像読取装
置より入力した原画信号ｂをラインメモリ回路４
ａに取り込み、一主走査線取り込み完了後、仮想
原画追加信号制御回路４ｂの制御により、ゲート
回路４ｃを経由して一主走査線分の原画信号と、
それに続いて仮想原画信号が圧縮符号化伝送回路
３ｂへ、データ信号ｆとして送出される。第５図
Ａはラインメモリ回路４ａの動作タイミングを示
し、同図Ｂはラインメモリ回路４ａより読み出さ
れた原画信号ｂを、圧縮符号化するデータ信号ｆ
へ変換する読み出し時の動作タイミングを示して
いる。
３ａの一実施例であり、第５図Ａ，Ｂはその動作
タイミングを示している。第４図で、画像読取装
置より入力した原画信号ｂをラインメモリ回路４
ａに取り込み、一主走査線取り込み完了後、仮想
原画追加信号制御回路４ｂの制御により、ゲート
回路４ｃを経由して一主走査線分の原画信号と、
それに続いて仮想原画信号が圧縮符号化伝送回路
３ｂへ、データ信号ｆとして送出される。第５図
Ａはラインメモリ回路４ａの動作タイミングを示
し、同図Ｂはラインメモリ回路４ａより読み出さ
れた原画信号ｂを、圧縮符号化するデータ信号ｆ
へ変換する読み出し時の動作タイミングを示して
いる。
第４図、第５図Ａ，Ｂを用いて動作を詳細に説
明する。画像読取装置より原画信号ｂ、原画信号
をサンプリングするためのスロトーブ信号（周期
Tp）、および、一主走査線が走査中であることを
示す走査中信号ａが、ラインメモリ回路４ａに入
力する。ラインメモリ回路４ａは走査中信号ａが
オンしている間、原画信号ｂをラインメモリ回路
４ａ内部のメモリに書き込む（WRITE動作）。
走査中信号ａがオフすると、ラインメモリ回路４
ａ内部のメモリより原画信号ｂが、リードデータ
信号ｄとして読み出される（READ動作）。この
際、リードデータ信号ｄはクロツク信号（周期
Tc）に同期して読み出される。ただし、クロツ
ク信号の周期Tcは、ストローブ信号の周期と比
べ、十分高速であり、（ｍ＋ｖ）Tc＜Tsが成り立
つように設定されている。
明する。画像読取装置より原画信号ｂ、原画信号
をサンプリングするためのスロトーブ信号（周期
Tp）、および、一主走査線が走査中であることを
示す走査中信号ａが、ラインメモリ回路４ａに入
力する。ラインメモリ回路４ａは走査中信号ａが
オンしている間、原画信号ｂをラインメモリ回路
４ａ内部のメモリに書き込む（WRITE動作）。
走査中信号ａがオフすると、ラインメモリ回路４
ａ内部のメモリより原画信号ｂが、リードデータ
信号ｄとして読み出される（READ動作）。この
際、リードデータ信号ｄはクロツク信号（周期
Tc）に同期して読み出される。ただし、クロツ
ク信号の周期Tcは、ストローブ信号の周期と比
べ、十分高速であり、（ｍ＋ｖ）Tc＜Tsが成り立
つように設定されている。
仮想原画追加信号制御回路４ｂは、リードデー
タ信号ｄが、走査中信号ａの指示に基いてライン
メモリ回路４ａより出力されると、圧縮符号化伝
送回路３ｂへ圧縮動作を命ずるイネーブル信号ｃ
を出力すると共に、データ信号ｆを出力している
ゲート回路４ｃへゲート信号ｅを入力する。ゲー
ト信号ｅはリードデータ信号ｄが出力されている
間、つまりｍ画素分オンしている。またイネーブ
ル信号は、つねにｎ画素分オンしているので、圧
縮符号化伝送回路３ｂはデータ信号ｆとしては、
ｍ画素分の原画信号と（ｎ−ｍ）画素分の仮想原
画信号を受けとる。つまり、圧縮符号化伝送回路
３ｂは原画信号ｂの一主走査線当り画素数ｍとか
かわりなく、つねにｎ画素分のデータを受けと
る。
タ信号ｄが、走査中信号ａの指示に基いてライン
メモリ回路４ａより出力されると、圧縮符号化伝
送回路３ｂへ圧縮動作を命ずるイネーブル信号ｃ
を出力すると共に、データ信号ｆを出力している
ゲート回路４ｃへゲート信号ｅを入力する。ゲー
ト信号ｅはリードデータ信号ｄが出力されている
間、つまりｍ画素分オンしている。またイネーブ
ル信号は、つねにｎ画素分オンしているので、圧
縮符号化伝送回路３ｂはデータ信号ｆとしては、
ｍ画素分の原画信号と（ｎ−ｍ）画素分の仮想原
画信号を受けとる。つまり、圧縮符号化伝送回路
３ｂは原画信号ｂの一主走査線当り画素数ｍとか
かわりなく、つねにｎ画素分のデータを受けと
る。
以上本発明について第１図に示したフアクシミ
リシステムを例として詳述したが、本発明が２次
元画像の走査により得られる画信号の帯域圧縮処
理をおこなう装置すべてに適応できることは言う
までもない。
リシステムを例として詳述したが、本発明が２次
元画像の走査により得られる画信号の帯域圧縮処
理をおこなう装置すべてに適応できることは言う
までもない。
以上、詳述した如く本発明の帯域圧縮装置は、
内部で処理する一主走査線当り画素数ｎを圧縮装
置に読み込まれる一主走査線当り画素数ｍと関係
なく、一定とすることにより、帯域圧縮装置の回
路構成を簡略化し、操作性を向上させることがで
きる。
内部で処理する一主走査線当り画素数ｎを圧縮装
置に読み込まれる一主走査線当り画素数ｍと関係
なく、一定とすることにより、帯域圧縮装置の回
路構成を簡略化し、操作性を向上させることがで
きる。
第１図は帯域圧縮を用いたフアクシミリシステ
ムの構成を示すブロツク図、第２図イ〜ハは本発
明の原理を示す図、第３図は本発明の一実施例に
おける帯域圧縮装置を示すブロツク図、第４図は
同装置の要部を示すブロツク図、第５図Ａ，Ｂは
第４図のブロツクの動作タイミングを示す図であ
る。 １……原画、２……画像読取装置、３……圧縮
装置、４……伝送路、５……復元装置、６……画
像記録装置、７……再生画、３ａ……仮想原画追
加回路、３ｂ……圧縮符号化伝送回路、４ａ……
ラインメモリ回路、４ｂ……仮想原画追加信号制
御回路、４ｃ……ゲート回路。
ムの構成を示すブロツク図、第２図イ〜ハは本発
明の原理を示す図、第３図は本発明の一実施例に
おける帯域圧縮装置を示すブロツク図、第４図は
同装置の要部を示すブロツク図、第５図Ａ，Ｂは
第４図のブロツクの動作タイミングを示す図であ
る。 １……原画、２……画像読取装置、３……圧縮
装置、４……伝送路、５……復元装置、６……画
像記録装置、７……再生画、３ａ……仮想原画追
加回路、３ｂ……圧縮符号化伝送回路、４ａ……
ラインメモリ回路、４ｂ……仮想原画追加信号制
御回路、４ｃ……ゲート回路。
Claims (1)
- １ 原画情報に白または黒の仮想原画を追加し
て、一走査線当りの画素数を、前記原画情報の長
さに関係なく一定とする仮想画素追加手段と、前
記長さが一定にされた画情報を圧縮する圧縮手段
とを備えたことを特徴とする帯域圧縮装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57068362A JPS58184874A (ja) | 1982-04-22 | 1982-04-22 | 帯域圧縮装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57068362A JPS58184874A (ja) | 1982-04-22 | 1982-04-22 | 帯域圧縮装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS58184874A JPS58184874A (ja) | 1983-10-28 |
| JPH0134424B2 true JPH0134424B2 (ja) | 1989-07-19 |
Family
ID=13371601
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57068362A Granted JPS58184874A (ja) | 1982-04-22 | 1982-04-22 | 帯域圧縮装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58184874A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US10355008B2 (en) | 2013-03-15 | 2019-07-16 | Micron Technology, Inc. | Floating gate memory cells in vertical memory |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS56157173A (en) * | 1980-05-07 | 1981-12-04 | Sanyo Electric Co Ltd | Picture signal compression circuit |
-
1982
- 1982-04-22 JP JP57068362A patent/JPS58184874A/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS56157173A (en) * | 1980-05-07 | 1981-12-04 | Sanyo Electric Co Ltd | Picture signal compression circuit |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US10355008B2 (en) | 2013-03-15 | 2019-07-16 | Micron Technology, Inc. | Floating gate memory cells in vertical memory |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS58184874A (ja) | 1983-10-28 |
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