JPH01319953A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
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- JPH01319953A JPH01319953A JP63154422A JP15442288A JPH01319953A JP H01319953 A JPH01319953 A JP H01319953A JP 63154422 A JP63154422 A JP 63154422A JP 15442288 A JP15442288 A JP 15442288A JP H01319953 A JPH01319953 A JP H01319953A
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- 239000004065 semiconductor Substances 0.000 title claims description 11
- 238000004519 manufacturing process Methods 0.000 title claims description 4
- 238000000034 method Methods 0.000 claims description 14
- 210000000078 claw Anatomy 0.000 description 4
- 238000010438 heat treatment Methods 0.000 description 3
- 230000007547 defect Effects 0.000 description 2
- 230000004308 accommodation Effects 0.000 description 1
- 238000010586 diagram Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 244000144992 flock Species 0.000 description 1
- 239000002184 metal Substances 0.000 description 1
- 238000004904 shortening Methods 0.000 description 1
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は半導体装置の製造方法に関し、特に半導体素子
搭載部(以下アイランドと称す)のないリードフレーム
を用いて半導体素子(以下チップ)とリードフレームと
をボンディングワイヤーにてボンディングする方法に関
する。
搭載部(以下アイランドと称す)のないリードフレーム
を用いて半導体素子(以下チップ)とリードフレームと
をボンディングワイヤーにてボンディングする方法に関
する。
従来、この種のワイヤーボンディング方法には第7図の
ようにワイヤーボンディング装置の加熱ブロック10上
のボンディング場所にリードフレーム2とチップ3を別
々に供給し、吸着穴8を介して真空吸着等によりチップ
3を固定した後、チップ上の電極とリードフレームの端
子をボンディングワイヤー4で接続するボンディングを
行うワイヤ、−ボンディング方法とフィルムキ■リアを
使用するTAB方法とがある。
ようにワイヤーボンディング装置の加熱ブロック10上
のボンディング場所にリードフレーム2とチップ3を別
々に供給し、吸着穴8を介して真空吸着等によりチップ
3を固定した後、チップ上の電極とリードフレームの端
子をボンディングワイヤー4で接続するボンディングを
行うワイヤ、−ボンディング方法とフィルムキ■リアを
使用するTAB方法とがある。
上述したワイヤーボンディング方法では、(1)ワイヤ
ーボンディング時において、ボンディング部に供給され
たチップの固定が困難である。
ーボンディング時において、ボンディング部に供給され
たチップの固定が困難である。
(2)ワイヤーボンディング装置にリードフレーム供給
・収納部及びチップ供給機能等が必要であり装置が複雑
である。
・収納部及びチップ供給機能等が必要であり装置が複雑
である。
(3)ワイヤーボンディング時にリードフレームとチッ
プの供給が個々にあるのでワイヤーボンディング丁程処
理速度が遅い。
プの供給が個々にあるのでワイヤーボンディング丁程処
理速度が遅い。
(4)ワイヤーボンディング後の運搬時にワイヤー切t
し及びワイヤー形状不良が発生する。
し及びワイヤー形状不良が発生する。
(3)ワイヤーボンディング部位に供給されたチップ、
リードフレームの位置精度が悪い。
リードフレームの位置精度が悪い。
また、フィルムキャリアを用いた従来のTAB方式では
、 (1)チップ上にリード接着用のバンプを形成するので
千ツブの価格が高い。
、 (1)チップ上にリード接着用のバンプを形成するので
千ツブの価格が高い。
(2)チ・ソフ゛主面の電極パッド位置く電極パッド上
にバンプか形成されている)に合わせてフィルムキャ・
ツアーFに接続用のリードを形成するのでフィルムキャ
リアがチップ設計に対応して必要となり汎用性が非常に
少ない。
にバンプか形成されている)に合わせてフィルムキャ・
ツアーFに接続用のリードを形成するのでフィルムキャ
リアがチップ設計に対応して必要となり汎用性が非常に
少ない。
(3)接続リード数が100本以上になるとリード、7
)先端も非常に細<O,1mn以下が要求され内部接続
リード部の曲り等も発生し歩留りが悪くなる。
)先端も非常に細<O,1mn以下が要求され内部接続
リード部の曲り等も発生し歩留りが悪くなる。
(4)ボンディング装置が特殊な為、設備価格が高額で
あるという欠点がある。
あるという欠点がある。
本発明はチップとリードフレームを簡便な方法で供給で
きるボンディング方法を採用して、L述の問題点を解決
することを目的としている。
きるボンディング方法を採用して、L述の問題点を解決
することを目的としている。
本発明の樹脂封止型半導体装置の製造方法はアイランド
なしのリードフレームを使用し、チップ及びリードフレ
ームを搭載・固定できるキャリアーボード上にチップ及
びり・〜ドフレームを搭載・固定した後、キャリアーボ
ードを移動してチップ及びリードフレームを同時にワイ
ヤー1代・fイング位置に供給し、金属細線によりチッ
プト、の電極とリードフレームのリード端子を接続する
ボンディングを行うという構成とな−っている、この方
法に、よれば、ワイヤーボンディング位置でキャリアー
ボードごとリードフレーム及びチップを加熱することも
可能であり、あらかじめキャリアーボードごとリードフ
レーム及びチップを加熱しておきワイヤーボンディング
するごとも可能であり、ワイヤーボンディング時間を短
縮できる長所がある。
なしのリードフレームを使用し、チップ及びリードフレ
ームを搭載・固定できるキャリアーボード上にチップ及
びり・〜ドフレームを搭載・固定した後、キャリアーボ
ードを移動してチップ及びリードフレームを同時にワイ
ヤー1代・fイング位置に供給し、金属細線によりチッ
プト、の電極とリードフレームのリード端子を接続する
ボンディングを行うという構成とな−っている、この方
法に、よれば、ワイヤーボンディング位置でキャリアー
ボードごとリードフレーム及びチップを加熱することも
可能であり、あらかじめキャリアーボードごとリードフ
レーム及びチップを加熱しておきワイヤーボンディング
するごとも可能であり、ワイヤーボンディング時間を短
縮できる長所がある。
〔実施例1〕
次に、本発明について図面を参照して説明す二)
第1図は本発明の一実施例を示す図で、キャリー1”
、1i−ド1にチップ3とリードフレーl\2を搭載
した状態の平面図であり、右側の部分(A−A′側)は
ワイヤーボンディングが済んでボンディングワイヤー4
か取付けられた状態を示してい乙、第2図は同第1図、
A−A ’の部分断面図であ1)、第3 r31は同実
施例の斜視図である。キャリア= 、+i−−ト1 )
−のリードフレーム搭載部6は凹形状Sこな−)ており
、チップ搭載部5はさらに凹になっでいう。
、1i−ド1にチップ3とリードフレーl\2を搭載
した状態の平面図であり、右側の部分(A−A′側)は
ワイヤーボンディングが済んでボンディングワイヤー4
か取付けられた状態を示してい乙、第2図は同第1図、
A−A ’の部分断面図であ1)、第3 r31は同実
施例の斜視図である。キャリア= 、+i−−ト1 )
−のリードフレーム搭載部6は凹形状Sこな−)ており
、チップ搭載部5はさらに凹になっでいう。
あらかじめ、リードフレーム2及びチップ3を一トヤリ
アーホード1上にセットし、キャリアーボード1ごとワ
イヤーボンディング部に供給し、ワイヤ・−ボンディン
グを行い、そのまま次工程へ搬送するので装置が簡単な
構造となり、処理速度が向上すると共にワイヤー切れ等
を防げる。また、キャリアーホード自体でリードフレー
ム及びチラノ°搭載時の精度が容易に出るので処理速度
向上・信頼性向−ヒが計れる。
アーホード1上にセットし、キャリアーボード1ごとワ
イヤーボンディング部に供給し、ワイヤ・−ボンディン
グを行い、そのまま次工程へ搬送するので装置が簡単な
構造となり、処理速度が向上すると共にワイヤー切れ等
を防げる。また、キャリアーホード自体でリードフレー
ム及びチラノ°搭載時の精度が容易に出るので処理速度
向上・信頼性向−ヒが計れる。
〔実施例2〕
第4図は本発明の実施例2の部分断面図である。キャリ
アーホード1はそのチップ搭載部分に、ワイヤーボンデ
ィング装置のボンディング位置に設置した加熱用固定フ
ロック7まで通じる吸着穴8がある。この実施例では、
吸着穴8を使った真空吸着によってキャリアボード1上
にチップ3をより確実に固定できるため正確かつ容易に
ワイヤーボンディングできるという利点からろ。この固
定ブロック7は従来技術で使用しているものが使用でき
る。更に第5図のようにキャリアーボード内部に吸着穴
8をつくること4こよりキャリアーボード1はほとんど
のワイヤーボンディング装置lに適用できる。
アーホード1はそのチップ搭載部分に、ワイヤーボンデ
ィング装置のボンディング位置に設置した加熱用固定フ
ロック7まで通じる吸着穴8がある。この実施例では、
吸着穴8を使った真空吸着によってキャリアボード1上
にチップ3をより確実に固定できるため正確かつ容易に
ワイヤーボンディングできるという利点からろ。この固
定ブロック7は従来技術で使用しているものが使用でき
る。更に第5図のようにキャリアーボード内部に吸着穴
8をつくること4こよりキャリアーボード1はほとんど
のワイヤーボンディング装置lに適用できる。
〔実施例3〕
第6図は本発明実施例3を示す平面図である。
チップ3はキャリアーボード1のチップ搭載部に固定用
ツメ9を設け、チップ3を固定用ツメで4方向から固定
する構造のキャリアーボード1を用いている。この他は
先の実施例と同じである。固定用ツメはフレキシブルで
あるためチップサイズにかかわらずチップの保持・固定
が可能である。
ツメ9を設け、チップ3を固定用ツメで4方向から固定
する構造のキャリアーボード1を用いている。この他は
先の実施例と同じである。固定用ツメはフレキシブルで
あるためチップサイズにかかわらずチップの保持・固定
が可能である。
以上説明したように本発明はアイランドなしリードフレ
ームとチップとをキャリアーボードにセットしてワイヤ
ーボンディングする事により、(1>チップにバンブを
形成する必要がなく、TAB法に比較し2てチップ、装
置価格が安く又、リードフレームを使用するのでキャリ
アであるリードフI・−ム及び装置が低コストである。
ームとチップとをキャリアーボードにセットしてワイヤ
ーボンディングする事により、(1>チップにバンブを
形成する必要がなく、TAB法に比較し2てチップ、装
置価格が安く又、リードフレームを使用するのでキャリ
アであるリードフI・−ム及び装置が低コストである。
に:)ワイヤーボンディング装置には、半導体素子供給
機能が不要であり装置が単純になる。
機能が不要であり装置が単純になる。
(3)ワイヤーボンディング部位にはあらかじめリード
フレーム及びチップがセットされている火ヤリアーボー
ドが供給され そこでワイヤーボンディングを行うため
ワ・イヤーボンディング工程処理速度が速い。
フレーム及びチップがセットされている火ヤリアーボー
ドが供給され そこでワイヤーボンディングを行うため
ワ・イヤーボンディング工程処理速度が速い。
(4)ワイヤーボンディング後の運搬もキャリアーホー
ドごと行うためワイヤー切れ及びワイヤー形状不良がな
くなる。
ドごと行うためワイヤー切れ及びワイヤー形状不良がな
くなる。
(5)ワイヤーボンディング時のチップ、リードフレー
ムの位置精度が良くチップの保持・固定も確実でありワ
イヤーボンディング精度も向上するという効果がある。
ムの位置精度が良くチップの保持・固定も確実でありワ
イヤーボンディング精度も向上するという効果がある。
第1図は本発明の第1の実施例に用いたキャリアーボー
ドの平面図、第2図は第1図の部分断面図、第3図はキ
ャリアーボード上にチップを搭載した時の一例を示す斜
視図、第4図、第5図は本発明第2の実施例に用いたキ
ャリアーボードの部分断面図、第6図は本発明第3の実
施例に用いたキャリアーボードの部分断面図、第7図は
従来のアイランドなしボンディング方法を示すワイヤー
ボンディング装置の部分断面図である。 1・・・キャリアーボード、2・・・リードフレーム、
3・・・チップ、4・・・ボンディングワイヤー、5・
・・チップ搭載部、6・・・リードフレーム搭載部、7
・・・固定ブロック、8・・・吸着穴、9・・・固定用
ツメ、10・・・加熱ブロックや 第 1 図 第4 図 第 6 図 第7 図
ドの平面図、第2図は第1図の部分断面図、第3図はキ
ャリアーボード上にチップを搭載した時の一例を示す斜
視図、第4図、第5図は本発明第2の実施例に用いたキ
ャリアーボードの部分断面図、第6図は本発明第3の実
施例に用いたキャリアーボードの部分断面図、第7図は
従来のアイランドなしボンディング方法を示すワイヤー
ボンディング装置の部分断面図である。 1・・・キャリアーボード、2・・・リードフレーム、
3・・・チップ、4・・・ボンディングワイヤー、5・
・・チップ搭載部、6・・・リードフレーム搭載部、7
・・・固定ブロック、8・・・吸着穴、9・・・固定用
ツメ、10・・・加熱ブロックや 第 1 図 第4 図 第 6 図 第7 図
Claims (1)
- 半導体素子搭載部のないリードフレームと半導体素子
とをキャリアーボード上に保持・固定した後、前記キャ
リアーボードを移動して半導体素子をワイヤーボンディ
ング位置に移動せしめて前記リードフレームと半導体素
子とをボンディングワイヤーにてボンディングする工程
とを有することを特徴とする半導体装置の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63154422A JPH01319953A (ja) | 1988-06-21 | 1988-06-21 | 半導体装置の製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63154422A JPH01319953A (ja) | 1988-06-21 | 1988-06-21 | 半導体装置の製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH01319953A true JPH01319953A (ja) | 1989-12-26 |
Family
ID=15583817
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP63154422A Pending JPH01319953A (ja) | 1988-06-21 | 1988-06-21 | 半導体装置の製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH01319953A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0776039A3 (en) * | 1995-11-21 | 1999-04-07 | Texas Instruments Incorporated | Improvements in or relating to semiconductor packages |
-
1988
- 1988-06-21 JP JP63154422A patent/JPH01319953A/ja active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0776039A3 (en) * | 1995-11-21 | 1999-04-07 | Texas Instruments Incorporated | Improvements in or relating to semiconductor packages |
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