JPH01245622A - Ｄ／ａ変換方法 - Google Patents
Ｄ／ａ変換方法Info
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- JPH01245622A JPH01245622A JP7418088A JP7418088A JPH01245622A JP H01245622 A JPH01245622 A JP H01245622A JP 7418088 A JP7418088 A JP 7418088A JP 7418088 A JP7418088 A JP 7418088A JP H01245622 A JPH01245622 A JP H01245622A
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- pwm signal
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- 238000006243 chemical reaction Methods 0.000 title claims abstract description 22
- 238000000034 method Methods 0.000 title claims description 18
- 230000010354 integration Effects 0.000 abstract description 24
- 238000005070 sampling Methods 0.000 abstract description 8
- 101100236764 Caenorhabditis elegans mcu-1 gene Proteins 0.000 abstract description 3
- 230000004044 response Effects 0.000 abstract description 3
- 238000010586 diagram Methods 0.000 description 5
- 230000004043 responsiveness Effects 0.000 description 5
- 239000003990 capacitor Substances 0.000 description 4
- 230000000694 effects Effects 0.000 description 4
- 230000000052 comparative effect Effects 0.000 description 3
- 238000012935 Averaging Methods 0.000 description 2
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- 101710170230 Antimicrobial peptide 1 Proteins 0.000 description 1
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- 238000007796 conventional method Methods 0.000 description 1
- 238000007599 discharging Methods 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
Landscapes
- Analogue/Digital Conversion (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、ワンチップＭＣＵにおいて所定の演算結果と
して得られるデジタル信号（例えば指示信号あるいは被
制御機器に対する制御信号等）を、該ワンチップＭＣＵ
からＰＷＭ（パルス幅変調）信号として出力するように
構成されている測定機器あるいは制御システムにおける
Ｄ／Ａ （デジタル／アナログ）変換方法に関する。
して得られるデジタル信号（例えば指示信号あるいは被
制御機器に対する制御信号等）を、該ワンチップＭＣＵ
からＰＷＭ（パルス幅変調）信号として出力するように
構成されている測定機器あるいは制御システムにおける
Ｄ／Ａ （デジタル／アナログ）変換方法に関する。
従来のこの種のＤ／Ａ変換方法としては、一般に、第３
図に示すように、ワンチップＭＣＵＯＩから出力される
デジタル信号としてのＰＷＭ信号（個々に所定のデユー
ティ比を有するようにパルス幅変調されたパルス信号列
）Ｘを、例えば図示するようなＲＣフィルター０２によ
り平均化積分することにより、前記ＰＷＭ信号ａに対応
するアナログ信号■。Ｕ、を出力端子０３から得る、と
いう手段が用いられていた。
図に示すように、ワンチップＭＣＵＯＩから出力される
デジタル信号としてのＰＷＭ信号（個々に所定のデユー
ティ比を有するようにパルス幅変調されたパルス信号列
）Ｘを、例えば図示するようなＲＣフィルター０２によ
り平均化積分することにより、前記ＰＷＭ信号ａに対応
するアナログ信号■。Ｕ、を出力端子０３から得る、と
いう手段が用いられていた。
しかしながら、上記従来方法による場合には、非常に安
価かつ簡素な回路構成で実現できるという利点はあるも
のの、前記ＰＷＭ信号Ｘの個々のパルス信号に対して１
：１に対応するアナログ信号■。ｕｌを得ることは不可
能であり、また、平均化積分手段としてＲＣフィルター
０２を用いているためにＰＷＭ信号ａの変化に対する応
答が遅くなる、つまり、分解能および応答性に劣るとい
う問題があった。
価かつ簡素な回路構成で実現できるという利点はあるも
のの、前記ＰＷＭ信号Ｘの個々のパルス信号に対して１
：１に対応するアナログ信号■。ｕｌを得ることは不可
能であり、また、平均化積分手段としてＲＣフィルター
０２を用いているためにＰＷＭ信号ａの変化に対する応
答が遅くなる、つまり、分解能および応答性に劣るとい
う問題があった。
そこで、このような分解能および応答性の悪さが無視で
きない場合には、第４図の比較例に示すように、例えば
１６ビソ）Ｄ／Ａ変換器０４を用いてワンチップＭＣＵ
から出力されたデジタル信号（１６ビツト）をＤ／Ａ変
換する、という手段が採用されるが、この場合には非常
に高価なり／Ａ変換器０４を使用しなければならず、ま
た、回路構成の複雑化を招くという欠点がある。
きない場合には、第４図の比較例に示すように、例えば
１６ビソ）Ｄ／Ａ変換器０４を用いてワンチップＭＣＵ
から出力されたデジタル信号（１６ビツト）をＤ／Ａ変
換する、という手段が採用されるが、この場合には非常
に高価なり／Ａ変換器０４を使用しなければならず、ま
た、回路構成の複雑化を招くという欠点がある。
本発明は、かかる従来実情に鑑みてなされたものであっ
て、その目的は、比較的安価でかつ簡素な回路構成で実
現できながらも、ワンチップＭＣＵから出力されるデジ
タル信号としてのＰＷＭ信号の個々のパルス信号に対す
る分解能、および、そのＰＷＭ信号の変化に対する応答
性に優れたＤ／Ａ変換方法を開発・提供せんとすること
にある。
て、その目的は、比較的安価でかつ簡素な回路構成で実
現できながらも、ワンチップＭＣＵから出力されるデジ
タル信号としてのＰＷＭ信号の個々のパルス信号に対す
る分解能、および、そのＰＷＭ信号の変化に対する応答
性に優れたＤ／Ａ変換方法を開発・提供せんとすること
にある。
上記目的を達成するために、本発明によるＤ／Ａ変換方
法は、 ワンチップＭＣＵから出力されるデジタル信号のＰＷＭ
信号の個々のパルス信号を利用してそのデユーティ比に
応じた時間で基準電圧の積分を行なわせ、その積分値の
ホールド値を出力させる、という手段を採用した点に特
徴がある。
法は、 ワンチップＭＣＵから出力されるデジタル信号のＰＷＭ
信号の個々のパルス信号を利用してそのデユーティ比に
応じた時間で基準電圧の積分を行なわせ、その積分値の
ホールド値を出力させる、という手段を採用した点に特
徴がある。
かかる特徴ある手段を採用したことにより発揮される作
用は次の通りである。
用は次の通りである。
即ち、上記本発明に係るＤ／Ａ変換方法においては、後
述する実施例の説明から、もより一層明らかとなるよう
に、ワンチップＭＣＵから出力されるデジタル信号のＰ
ＷＭ信号の個々のパルス信号について、各別に、そのデ
ユーティ比の値に応じたアナログ信号を得られるように
しているから、１ザンプリングについて１つのＰＷＭパ
ルス信号に対するアナログ信号出力を得ることができ、
しかも、そのアナログ信号を得るための基準電圧に対す
る積分時間の制御を、そのＰＷＭパルス信号自体を利用
して行うようにしているから、たった１パルス分という
極く短い時間遅れが生じるだけで済む。
述する実施例の説明から、もより一層明らかとなるよう
に、ワンチップＭＣＵから出力されるデジタル信号のＰ
ＷＭ信号の個々のパルス信号について、各別に、そのデ
ユーティ比の値に応じたアナログ信号を得られるように
しているから、１ザンプリングについて１つのＰＷＭパ
ルス信号に対するアナログ信号出力を得ることができ、
しかも、そのアナログ信号を得るための基準電圧に対す
る積分時間の制御を、そのＰＷＭパルス信号自体を利用
して行うようにしているから、たった１パルス分という
極く短い時間遅れが生じるだけで済む。
かくして、本発明方法によれば、先に示した比較例の場
合のように非常に高価で複雑なり／Ａ変換器を用いる必
要無く、比較的安価でかつ簡素な回路を構成するだけで
、ワンチップＭＣＵから出力されるＰＷＭ信号の個々の
パルス信号に対する分解能、および、そのＰＷＭ信号の
変化に対する応答性を、共に飛躍的に向上させることが
できるようになった。
合のように非常に高価で複雑なり／Ａ変換器を用いる必
要無く、比較的安価でかつ簡素な回路を構成するだけで
、ワンチップＭＣＵから出力されるＰＷＭ信号の個々の
パルス信号に対する分解能、および、そのＰＷＭ信号の
変化に対する応答性を、共に飛躍的に向上させることが
できるようになった。
以下、本発明に係るＤ／Ａ変換方法の具体的な一実施例
を図面（第１図および第２図）に基いて説明する。
を図面（第１図および第２図）に基いて説明する。
第１図は本発明方法を適用して構成されたシステムの要
部（Ｄ／Ａ変換器）の概略構成を示し、第２図はその各
部における動作あるいは信号波形のタイミングチャート
を示している。
部（Ｄ／Ａ変換器）の概略構成を示し、第２図はその各
部における動作あるいは信号波形のタイミングチャート
を示している。
第１図の概略構成図において、１はワンチップＭＣＵ
（マイクロコンピュータ−）であって、Ａ／Ｄ変換後の
入力信号（図示せず）に基いて所定の演算処理を行った
結果として得られるデジタル信号（例えば指示信号ある
いは被制御機器に対する制御信号等）を、ＰＷＭ（パル
ス幅変調）信号Ｘとして、後述するＤ／Ａ変換回路２に
対する制御信号Ａ、 Ｂと共に出力するように構成され
ている。
（マイクロコンピュータ−）であって、Ａ／Ｄ変換後の
入力信号（図示せず）に基いて所定の演算処理を行った
結果として得られるデジタル信号（例えば指示信号ある
いは被制御機器に対する制御信号等）を、ＰＷＭ（パル
ス幅変調）信号Ｘとして、後述するＤ／Ａ変換回路２に
対する制御信号Ａ、 Ｂと共に出力するように構成され
ている。
前記Ｄ／Ａ変換回路２は、前記ワンチップＭＣＵ１から
与えられるＰＷＭ信号を、それと共に与えられる制御信
号Ａ、Ｂに基いてアナログ信号に変換するものであって
、基本的には、リセット−積分／逆積分−サンプリング
というＬＤ／Ａ変換サイクルを繰り返すように、基準信
号■（積分用の一■８．逆積分用の＋ＶＲ）を発生する
ための基準信号発生手段３と、積分／逆積分タイミング
設定手段４を介して前記基準信号発生部３から与えられ
た基準信号−ＶＲ，（＋ＶＲ）を積分（逆積分）するた
めの積分手段５と、トリガー手段６により制御されるサ
ンプリングタイミング設定手段７を介して前記積分手段
５から与えられた積分および逆積分の結果（電圧）を次
の結果が与えられるまで保持して出力端子９から出力し
続けるサンプルホールド手段８とから構成されており、
各手段の詳細構成は下記の通りである。
与えられるＰＷＭ信号を、それと共に与えられる制御信
号Ａ、Ｂに基いてアナログ信号に変換するものであって
、基本的には、リセット−積分／逆積分−サンプリング
というＬＤ／Ａ変換サイクルを繰り返すように、基準信
号■（積分用の一■８．逆積分用の＋ＶＲ）を発生する
ための基準信号発生手段３と、積分／逆積分タイミング
設定手段４を介して前記基準信号発生部３から与えられ
た基準信号−ＶＲ，（＋ＶＲ）を積分（逆積分）するた
めの積分手段５と、トリガー手段６により制御されるサ
ンプリングタイミング設定手段７を介して前記積分手段
５から与えられた積分および逆積分の結果（電圧）を次
の結果が与えられるまで保持して出力端子９から出力し
続けるサンプルホールド手段８とから構成されており、
各手段の詳細構成は下記の通りである。
即ち、第２図の動作および信号波形タイミングチャート
に示されるように、前記基準信号発生手段３は、ＰＷＭ
信号信号名ｉｇｈレベルのときに、５ＷＩ−ＡがＯＮ、
５ＷＩ−ＢがＯＦＦになって、基準信号■として積分用
の一■、を出力し、ＰＷＭ信号信号名ｏｗレヘレベとき
に、５ＷＩ−ＡがＯＦＦ、５ＷＩ−ＢがＯＮになって、
基準信号Ｖとして逆積分用の＋ｙ、を出力する（第２図
においては、ＰＷＭ信号信号名ユーティ比ＤＴが５０％
から７５％に変化した場合を例示している）。
に示されるように、前記基準信号発生手段３は、ＰＷＭ
信号信号名ｉｇｈレベルのときに、５ＷＩ−ＡがＯＮ、
５ＷＩ−ＢがＯＦＦになって、基準信号■として積分用
の一■、を出力し、ＰＷＭ信号信号名ｏｗレヘレベとき
に、５ＷＩ−ＡがＯＦＦ、５ＷＩ−ＢがＯＮになって、
基準信号Ｖとして逆積分用の＋ｙ、を出力する（第２図
においては、ＰＷＭ信号信号名ユーティ比ＤＴが５０％
から７５％に変化した場合を例示している）。
前記積分／逆積分タイミング設定手段４は、制御信号Ａ
がｌ（ｉ ｇ ｈレベルのときにＯＦＦとなり、ＬＯＷ
レヘレベときにはＯＮとなって前記基準信号−ＶＲ（＋
ＶＲ）を積分手段５へ供給するように動作するスイッチ
ＳＷ２を備えている。
がｌ（ｉ ｇ ｈレベルのときにＯＦＦとなり、ＬＯＷ
レヘレベときにはＯＮとなって前記基準信号−ＶＲ（＋
ＶＲ）を積分手段５へ供給するように動作するスイッチ
ＳＷ２を備えている。
前記積分手段５は、増幅器ＡＭＰ１．固定抵抗Ｒ＋、
コンデンサーＣ３およびリセット用スイッチＳＷ３か
ら構成され、そのリセット用スイッチＳＷ３は、制御信
号ＢがＨｉｇｈレベルのときにＯＮとなって放電による
リセット動作を行い、ＬＯＷレベルのときにはＯＦＦと
なる。
コンデンサーＣ３およびリセット用スイッチＳＷ３か
ら構成され、そのリセット用スイッチＳＷ３は、制御信
号ＢがＨｉｇｈレベルのときにＯＮとなって放電による
リセット動作を行い、ＬＯＷレベルのときにはＯＦＦと
なる。
前記サンプリングタイミング設定手段７は、制御信号Ａ
がＬｏｗレベルからＨｉ ｇ ｈレベルに立ち上がった
ときにのみ、前記トリガー手段６（コンデンサーＣ２と
固定抵抗Ｒ２とから成る）からの立ち上がり信号を受け
て瞬時的にＯＮとなって、積分手段５から与えられた積
分および逆積分の結果（電圧）を前記サンプルホールド
手段８（増幅器ＡＭＰ ２とコンデンサー〇３等から成
る）へ供給するように動作するスイッチＳＷ４を備えて
いる。
がＬｏｗレベルからＨｉ ｇ ｈレベルに立ち上がった
ときにのみ、前記トリガー手段６（コンデンサーＣ２と
固定抵抗Ｒ２とから成る）からの立ち上がり信号を受け
て瞬時的にＯＮとなって、積分手段５から与えられた積
分および逆積分の結果（電圧）を前記サンプルホールド
手段８（増幅器ＡＭＰ ２とコンデンサー〇３等から成
る）へ供給するように動作するスイッチＳＷ４を備えて
いる。
以上のように構成されたＤ／Ａ変換回路２においては、
第２図のタイミングチャートからも明らかなように、ワ
ンチップＭＣＵ１から与えられる制御信号（Ａ、Ｂ）の
組み合わせが、（Ｈｉ ｇ ｈ。
第２図のタイミングチャートからも明らかなように、ワ
ンチップＭＣＵ１から与えられる制御信号（Ａ、Ｂ）の
組み合わせが、（Ｈｉ ｇ ｈ。
Ｈｉｇｈ）ときにはＳＷ２がＯＦＦ、ＳＷ３がＯＮ、Ｓ
Ｗ４がＯＦＦになるリセット動作を行い、（Ｌ ｏ ｗ
、 Ｌ ｏ ｗ）ときにはＳＷ２がＯＮ、 ＳＷ３がＯ
ＦＦ、ＳＷ４がＯＦＦになる積分（−■８に対する積分
）／逆積分（十ＶＲに対する積分）動作を行い、（Ｈｉ
ｇｈ（立ち上がり）、Ｌｏｗ）のときにはＳＷ２がＯＦ
Ｆ、ＳＷ３がＯＦＦ、 ＳＷ４がＯＮ（瞬時的立ち上が
り）からＯＦＦになるサンプリング動作を行う。
Ｗ４がＯＦＦになるリセット動作を行い、（Ｌ ｏ ｗ
、 Ｌ ｏ ｗ）ときにはＳＷ２がＯＮ、 ＳＷ３がＯ
ＦＦ、ＳＷ４がＯＦＦになる積分（−■８に対する積分
）／逆積分（十ＶＲに対する積分）動作を行い、（Ｈｉ
ｇｈ（立ち上がり）、Ｌｏｗ）のときにはＳＷ２がＯＦ
Ｆ、ＳＷ３がＯＦＦ、 ＳＷ４がＯＮ（瞬時的立ち上が
り）からＯＦＦになるサンプリング動作を行う。
つまり、前記積分／逆積分期間においては、ＰＷＭ信号
信号名ｉｇｈレヘルレベに基準信号−■８が積分され、
ＰＷＭ信号信号名 ｏ ｗレベルに切り換わると、それ
までの積分値から＋■８のサンプリング期間までの積分
値が差し引かれることになり、従って、積分手段５から
の出力電圧Ｖ。ｌｌＴｌは第２図の下から２段目のグラ
フに示すようなものになり、その積分／逆積分期間にお
ける最終値がサンプルホールド手段８にラッチされ、従
って、サンプルホールド手段８からの出力電圧Ｖ。ＬＩ
Ｔ□は第２図の最下段に示すようなものになり、かくし
て、Ｉ Ｄ／Ａ変換サイクルにおいては、ＰＷＭ信号信
号名とつのパルス信号のデユーティ比ＤＴに対応するア
ナログ信号■。ＵＴ□が得られることになる。
信号名ｉｇｈレヘルレベに基準信号−■８が積分され、
ＰＷＭ信号信号名 ｏ ｗレベルに切り換わると、それ
までの積分値から＋■８のサンプリング期間までの積分
値が差し引かれることになり、従って、積分手段５から
の出力電圧Ｖ。ｌｌＴｌは第２図の下から２段目のグラ
フに示すようなものになり、その積分／逆積分期間にお
ける最終値がサンプルホールド手段８にラッチされ、従
って、サンプルホールド手段８からの出力電圧Ｖ。ＬＩ
Ｔ□は第２図の最下段に示すようなものになり、かくし
て、Ｉ Ｄ／Ａ変換サイクルにおいては、ＰＷＭ信号信
号名とつのパルス信号のデユーティ比ＤＴに対応するア
ナログ信号■。ＵＴ□が得られることになる。
なお、アナログ信号■。１ＩＴ２とＰＷＭ信号のデユー
ティ比ＤＴ （％）との関係は、 Ｃ１・ Ｒ７ ここで、 ｔ ：１／３サイクルの時間 ＶＲ：基準電圧 Ｃ１：積分コンデンサー容量 ＲＩ ：積分抵抗値 で表される。従って、夫々の定数を適宜に選定すること
によって、ＰＷＭ信号信号名デユーティ比に応じたアナ
ログ信号Ｖ。ＵＴ２を得ることができるのである。
ティ比ＤＴ （％）との関係は、 Ｃ１・ Ｒ７ ここで、 ｔ ：１／３サイクルの時間 ＶＲ：基準電圧 Ｃ１：積分コンデンサー容量 ＲＩ ：積分抵抗値 で表される。従って、夫々の定数を適宜に選定すること
によって、ＰＷＭ信号信号名デユーティ比に応じたアナ
ログ信号Ｖ。ＵＴ２を得ることができるのである。
以上詳述したところから明らかなように、本発明に係る
Ｄ／Ａ変換方法によれば、ワンチップＭＣＵから出力さ
れるデジタル信号のＰＷＭ信号の個々のパルス信号を利
用してそのデユーティ比に応じた時間で基準電圧の積分
を行なわセ、その積分値のホールド値を出力させるよう
にしたことにより、非常に高価で複雑なり／Ａ変換器を
用いる必要のない比較的安価でかつ簡素な回路構成で実
現できながら、かつ、１サンプリングについて１つのＰ
ＷＭパルス信号に対するアナログ信号出力を殆ど時間遅
れがない状態で得ることができ、もって、ＰＷＭ信号の
個々のパルス信号に対する分解能、および、そのＰ’Ｗ
Ｍ信号の変化に対する応答性を、共に飛躍的に向上させ
ることができる、という優れた効果が発揮されるに至っ
た。
Ｄ／Ａ変換方法によれば、ワンチップＭＣＵから出力さ
れるデジタル信号のＰＷＭ信号の個々のパルス信号を利
用してそのデユーティ比に応じた時間で基準電圧の積分
を行なわセ、その積分値のホールド値を出力させるよう
にしたことにより、非常に高価で複雑なり／Ａ変換器を
用いる必要のない比較的安価でかつ簡素な回路構成で実
現できながら、かつ、１サンプリングについて１つのＰ
ＷＭパルス信号に対するアナログ信号出力を殆ど時間遅
れがない状態で得ることができ、もって、ＰＷＭ信号の
個々のパルス信号に対する分解能、および、そのＰ’Ｗ
Ｍ信号の変化に対する応答性を、共に飛躍的に向上させ
ることができる、という優れた効果が発揮されるに至っ
た。
第１図および第２図は、本発明に係るＤ／Ａ変換方法を
適用して構成されたＤ／Ａ変換システムの具体的な一実
施例を示し、第１図は概略構成図であり、第２図はその
動作の説明・図である。 そして、第３図および第４図は本発明の技術的背景なら
びに従来技術の問題点を説明す・るものであって、第３
図は従来一般のＤ／Ａ変換システムの概略構成図を示し
、また、第４図は比較例のＤ／Ａ変換システムの概略構
成図を示している。 １ ・・・・・・ワンチップＭＣＵ。 Ｘ ・・・・・・ＰＷＭ信号、 ＤＴ ・・・・・・デユーティ比、Ｖ （−Ｖ□、
＋Ｖ＋＋）・旧・・基準電圧、ＶＯＵＴ□ ・・・・・
・アナログ信号。 出願人 株式会社 堀 場 製 作 所代理人 弁理士
藤 本 英 夫
適用して構成されたＤ／Ａ変換システムの具体的な一実
施例を示し、第１図は概略構成図であり、第２図はその
動作の説明・図である。 そして、第３図および第４図は本発明の技術的背景なら
びに従来技術の問題点を説明す・るものであって、第３
図は従来一般のＤ／Ａ変換システムの概略構成図を示し
、また、第４図は比較例のＤ／Ａ変換システムの概略構
成図を示している。 １ ・・・・・・ワンチップＭＣＵ。 Ｘ ・・・・・・ＰＷＭ信号、 ＤＴ ・・・・・・デユーティ比、Ｖ （−Ｖ□、
＋Ｖ＋＋）・旧・・基準電圧、ＶＯＵＴ□ ・・・・・
・アナログ信号。 出願人 株式会社 堀 場 製 作 所代理人 弁理士
藤 本 英 夫
Claims (1)
- 【特許請求の範囲】 ワンチップＭＣＵから出力されるデジタル信号のＰＷＭ
信号をアナログ信号に変換するＤ／Ａ変換方法であって
、 前記ＰＷＭ信号の個々のパルス信号を利用してそのデュ
ーティ比に応じた時間で基準電圧の積分を行なわせ、そ
の積分値のホールド値を出力させることを特徴とするＤ
／Ａ変換方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7418088A JPH01245622A (ja) | 1988-03-26 | 1988-03-26 | Ｄ／ａ変換方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7418088A JPH01245622A (ja) | 1988-03-26 | 1988-03-26 | Ｄ／ａ変換方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01245622A true JPH01245622A (ja) | 1989-09-29 |
Family
ID=13539714
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7418088A Pending JPH01245622A (ja) | 1988-03-26 | 1988-03-26 | Ｄ／ａ変換方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01245622A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0951146A1 (en) * | 1998-04-14 | 1999-10-20 | MAGNETI MARELLI S.p.A. | A digital-to-analog converter |
| DE102005031387B4 (de) * | 2005-02-22 | 2014-08-14 | Mitsubishi Denki K.K. | Signalverarbeitungsschaltung |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57129528A (en) * | 1981-02-04 | 1982-08-11 | Mitsubishi Electric Corp | Digital-to-analog converter |
| JPS57135520A (en) * | 1981-02-13 | 1982-08-21 | Toshiba Corp | D/a converter |
| JPS6045536B2 (ja) * | 1982-03-25 | 1985-10-09 | 日本エランコ株式会社 | 硬質カプセル |
-
1988
- 1988-03-26 JP JP7418088A patent/JPH01245622A/ja active Pending
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|---|---|---|---|---|
| JPS57129528A (en) * | 1981-02-04 | 1982-08-11 | Mitsubishi Electric Corp | Digital-to-analog converter |
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|---|---|---|---|---|
| EP0951146A1 (en) * | 1998-04-14 | 1999-10-20 | MAGNETI MARELLI S.p.A. | A digital-to-analog converter |
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