JPH01121198U - - Google Patents

Info

Publication number
JPH01121198U
JPH01121198U JP1429188U JP1429188U JPH01121198U JP H01121198 U JPH01121198 U JP H01121198U JP 1429188 U JP1429188 U JP 1429188U JP 1429188 U JP1429188 U JP 1429188U JP H01121198 U JPH01121198 U JP H01121198U
Authority
JP
Japan
Prior art keywords
address
signal
control signal
mode
data transfer
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP1429188U
Other languages
English (en)
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed filed Critical
Priority to JP1429188U priority Critical patent/JPH01121198U/ja
Publication of JPH01121198U publication Critical patent/JPH01121198U/ja
Pending legal-status Critical Current

Links

Landscapes

  • Dram (AREA)

Description

【図面の簡単な説明】
第1図は本考案の一実施例を示すブロツク図、
第2図は第1図に示された実施例の動作を説明す
るための各部信号の波形図、第3図及び第4図は
それぞれ従来の画像用メモリの一例のブロツク図
及び動作を説明するための各部信号の波形図であ
る。 1……メモリアレイ、2……アドレスカウンタ
、3……切換スイツチ、4……アドレスデコーダ
、5……シリアルポインタ、6……切換スイツチ
、7……シリアルカウンタ、8……データレジス
タ、9……RAM入出力バツフア、10……シリ
アル入出力バツフア、11,11a……タイミン
グジエネレータ。

Claims (1)

    【実用新案登録請求の範囲】
  1. 行アドレス信号によりメモリセルアレイの行線
    を選択するアドレスデコーダと、前記メモリセル
    アレイの選択された行線と対応するメモリセルの
    データを行ごとにシリアルに入出力するシリアル
    入出力ポート部と、このシリアル入出力ポート部
    のシリアル入出力の開始点を設定する列アドレス
    を記憶するシリアルカウンタと、行アドレス制御
    信号、列アドレス制御信号及びデータ転送制御信
    号を含む制御信号を入力し前記各部の動作を制御
    するタイミング信号を発生するタイミングジエネ
    レータとを有する画像用メモリにおいて、前記デ
    ータ転送制御信号がデータ転送モードにあり、切
    換制御信号が外部アドレスモードにあるときに外
    部からの行アドレス信号を取込んで記憶し、前記
    データ転送モードが解除されるごとに記憶された
    行アドレスに1アドレス加算して再記憶するアド
    レスカウンタと、前記切換制御信号により前記外
    部からの行アドレス信号と前記アドレスカウンタ
    からの行アドレス信号とを切換え前記アドレスデ
    コーダへ伝達する第1の切換スイツチと、前記デ
    ータ転送制御信号がデータ転送モードにあり、前
    記切換制御信号が外部アドレスモードにあるとき
    に外部からの列アドレス信号を取込んで記憶し、
    内部アドレスモードにあるときは記憶されている
    列アドレスを保持するシリアルポインタと、前記
    切換制御信号により前記外部からの列アドレス信
    号と前記シリアルポインタからの列アドレス信号
    とを切換え前記シリアルカウンタへ伝達する第2
    の切換スイツチとを設け、前記タイミングジエネ
    レータに、前記内部アドレスモード及び外部アド
    レスモードを設定するための前記切換制御信号を
    発生する機能を持たせたことを特徴とする画像用
    メモリ。
JP1429188U 1988-02-04 1988-02-04 Pending JPH01121198U (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP1429188U JPH01121198U (ja) 1988-02-04 1988-02-04

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP1429188U JPH01121198U (ja) 1988-02-04 1988-02-04

Publications (1)

Publication Number Publication Date
JPH01121198U true JPH01121198U (ja) 1989-08-16

Family

ID=31225359

Family Applications (1)

Application Number Title Priority Date Filing Date
JP1429188U Pending JPH01121198U (ja) 1988-02-04 1988-02-04

Country Status (1)

Country Link
JP (1) JPH01121198U (ja)

Similar Documents

Publication Publication Date Title
JPH10302462A (ja) 半導体記憶装置
JPH01121198U (ja)
JPH0443593B2 (ja)
JPS6145839B2 (ja)
SU1578706A1 (ru) Устройство дл ввода информации от аналоговых датчиков
JPH074009Y2 (ja) 超音波診断装置
JPS61114351A (ja) メモリ制御装置
SU1743848A1 (ru) Устройство дл формировани сигналов управлени роботом
JP2917285B2 (ja) 画像メモリ装置
JP2978253B2 (ja) 半導体記憶装置
JPH0445063Y2 (ja)
JP2932627B2 (ja) 表示装置
RU1835555C (ru) Устройство дл отображени информации на матричном индикаторе
JPS6181278U (ja)
JPS62135257U (ja)
JPS62176898U (ja)
JPH044344U (ja)
JPS62117633U (ja)
JPH02127891A (ja) デジタル回線使用中制御回路
JPS63126338A (ja) デ−タ送受信回路
JPH038388U (ja)
JPH02113170U (ja)
JPH01146196A (ja) リフレツシユ回路
JPS61173989U (ja)
JPH0166697U (ja)