JP7482649B2 - 撮像装置、デバイス、制御方法、及びプログラム - Google Patents
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Description
図1に、本実施形態の画像解析システムの構成例を示す。以下では、一例として、このシステムが特定人物追跡システムである場合について説明する。ただし、これに限られず、画像を解析して所定の情報出力を行う任意のシステムに、以下の議論を適用することができる。本システムは、撮像装置110a~110dと、ネットワーク120と、入出力装置130とを含んで構成される。なお、撮像装置110a~110dは、それぞれ、例えば撮像した画像を記録可能なデバイスを着脱可能なスロットを有し、そのスロットに着脱可能デバイス100a~100dが挿入されることにより、着脱可能デバイス100a~100dと接続される。なお、以下では、着脱可能デバイス100a~100dを「着脱可能デバイス100」と表記し、撮像装置110a~110dを「撮像装置110」と表記する。
(撮像装置の構成)
続いて、撮像装置110の構成について説明する。図2は、撮像装置110のハードウェア構成例を示す図である。撮像装置110は、そのハードウェア構成として、例えば、撮像部201、画像処理部202、演算処理部203、配信部204、SD I/F部205を含む。なお、I/Fは、インタフェースの略語である。
図4に、着脱可能デバイス100のハードウェア構成例を示す。着脱可能デバイス100は、一例として、I/F部401、FPGA402、SDコントローラ403、記憶部404、及び、FPGA405を含んで構成される。着脱可能デバイス100は、撮像装置110が有するSD I/F部205の着脱ソケットに挿抜できる形状で、すなわちSD規格に則った形状で成形されるものとする。
図6に、入出力装置130のハードウェア構成例を示す。入出力装置130は、一般的なPC等のコンピュータとして構成され、例えば、図6に示すように、CPU等のプロセッサ601、RAM602やROM603等のメモリ、HDD604等の記憶装置、及び、通信I/F605を含んで構成される。入出力装置130は、プロセッサ601が、メモリや記憶装置に格納されたプログラムを実行することにより、各種機能を実行することができる。
続いて、システム内で実行される処理の流れの例について説明する。なお、以下の各処理のうち撮像装置110が実行する処理は、例えば、演算処理部203内のプロセッサがメモリ等に記憶されたプログラムを実行することによって実現される。ただし、これは一例に過ぎず、後述の処理の一部又は全部が、専用のハードウェアによって実現されてもよい。また、着脱可能デバイス100や入出力装置130が実行する処理についても、各装置におけるプロセッサがメモリ等に記憶されたプログラムを実行することによって実現されてもよいし、処理の一部又は全部を、専用のハードウェアによって実現してもよい。
図8に、システムで実行される画像解析処理の一連の流れを概略的に示す。本処理では、まず、ユーザによって、撮像装置110に着脱可能デバイス100が装着される(S801)。撮像装置110は、着脱可能デバイス100の初期化シーケンスを実行する(S802)。この初期化シーケンスでは、撮像装置110が着脱可能デバイス100へ電源を供給し、撮像装置110と着脱可能デバイス100との間で所定のコマンドが送受信されることにより、撮像装置110が、着脱可能デバイス100を使用可能な状態にする。
図9を用いて、撮像装置110が、自装置に装着されたデバイスに解析処理機能を構成可能な論理回路再構成機能を有するか否かを判定することにより、そのデバイスを分類する処理の流れの例について説明する。本処理は、図8のS803の処理に対応する。なお、本処理は、着脱可能デバイス100等のデバイスが撮像装置110に装着された又は抜去された場合や、撮像装置110の電源がオンとなった際に実行されうる。本処理では、撮像装置110が、着脱可能デバイス100の記憶部404に保存されている着脱可能デバイス100のデバイス情報を読み出して、着脱可能デバイス100の種別を判定する。
続いて、着脱可能デバイス100が解析処理機能を構成可能な論理回路再構成機能を有するか否かを判定する別の処理について説明する。本処理では、着脱可能デバイスの端子処理を検出することにより判定を実行する。着脱可能デバイスの端子処理について、図22(A)及び図22(B)を用いて説明する。図22(A)は、着脱可能デバイス100のSD I/Fの端子部の論理を示し、図22(B)は、着脱可能デバイス100のI/F部401の回路構成を示す。
続いて、図26(A)及び図26(B)を用いて、SDカードの初期化シーケンス中のレスポンスの引数値に基づいて、着脱可能デバイス100が論理回路再構成機能を有するか否かを判定する処理について説明する。図26(A)は、SDカードの初期化シーケンス中のレスポンスの一部の構造を示している。レスポンス2611及びレスポンス2621は、初期化コマンドACMD41の異なる2つ状態を示している。レスポンス2611内のビット2612及びレスポンス2621内のビット2622は、BUSY状態を示すビットである。レスポンス2611内のビット2613及びビット2614と、レスポンス2621内のビット2623及びビット2624は、リザーブビットである。初期化コマンドACMD41のレスポンスにおいてビット2612やビット2622が「0」の場合は、着脱可能デバイス100がBUSY状態であると判定され、その他のレスポンス引数部は有効なレスポンスとして処理されない。一方、ビット2612やビット2622が「1」に設定されると、着脱可能デバイス100のBUSY状態が解除されたと判定され、レスポンス2611及びレスポンス2621の引数が、有効なレスポンスの引数値として認識される。リザーブビットは、機能として定義されていないビットであり、通常は、「0」が格納されて、接続した撮像装置110によって無視される。一方で、レスポンス2611では、着脱可能デバイス100が論理回路再構成機能を有することを示す引数値が、リザーブビットに設定される。なお、レスポンス2611は、BUSYビット2612には「0」が格納されているため、SD規格では無効なレスポンスとして取り扱われる。すなわち、SD規格において無効なレスポンスの形式で、着脱可能デバイス100が論理回路再構成機能を有するか否かを示す情報が着脱可能デバイス100から撮像装置100へ通知される。これに対して、レスポンス2621は、BUSYビット2622に「1」が格納され、リザーブビット(ビット2613及びビット2614)に「0」が格納されることにより、BUSY状態が解除されたことを示すことができる。レスポンス2621は、SD規格に準拠した有効なレスポンスとして扱われる。
なお、撮像装置110が着脱可能デバイス100へ解析処理回路データを書き込む処理は、上述のような構成と異なる構成で実行可能である。以下では、その処理について説明する。
Claims (37)
- 撮像装置から取得されたデータに対する解析処理に対応する論理回路を有するデバイスを着脱可能な装着機構を有する撮像装置であって、
前記装着機構が有する複数の端子を用いて、前記デバイスとの間で複数の通信を並行して行うように、前記複数の端子が接続する信号を設定する設定手段と、
前記論理回路を構成可能なデバイスが前記装着機構に装着された場合に、当該デバイスに関するデバイス情報に基づいて、前記デバイスの論理回路を構成させるための回路データを決定する決定手段と、
決定した前記回路データを、前記複数の通信を用いて前記デバイスへ送信する送信手段と、
を有することを特徴とする撮像装置。 - 前記デバイスが解析処理に対応する論理回路を構成可能であるか否かを判定する判定手段をさらに有する、ことを特徴とする請求項1に記載の撮像装置。
- 前記判定手段は、前記デバイス情報に基づいて、前記デバイスが解析処理に対応する論理回路を構成可能であるか否かを判定する、ことを特徴とする請求項2に記載の撮像装置。
- 前記デバイス情報は、前記デバイスに含まれる、解析処理に対応する論理回路を構成可能な構成手段に関する情報を含む、ことを特徴とする請求項1から3のいずれか1項に記載の撮像装置。
- 前記デバイスに対して前記デバイス情報を要求するコマンドを送信し、前記デバイスから前記コマンドに対するレスポンスの引数値によって、前記デバイス情報を取得する取得手段を有する、ことを特徴とする請求項1から4のいずれか1項に記載の撮像装置。
- 前記デバイスがフィールドプログラマブルゲートアレイ(FPGA)によって解析処理に対応する論理回路を構成可能である場合、前記デバイス情報は、前記デバイスのハードウェア構成情報と、前記FPGAの種別の情報と、論理回路構成の制約情報と、端子接続情報と、周辺回路の情報との少なくともいずれかを示す情報、又は、前記デバイスのハードウェア構成情報と、前記FPGAの種別の情報と、論理回路構成の制約情報と、端子接続情報と、周辺回路の情報との少なくともいずれかを特定可能な情報を含む、ことを特徴とする請求項1から5のいずれか1項に記載の撮像装置。
- 撮像装置から取得されたデータに対する解析処理に対応する論理回路を有するデバイスを着脱可能な装着機構を有する撮像装置であって、
前記装着機構を介して、前記装着機構が対応している所定の規格のコマンドではないコマンドを送信して、レスポンスを受信したか否かに基づいて、前記装着機構に装着された前記デバイスが解析処理に対応する論理回路を構成可能であるか否かを判定する判定手段と、
前記デバイスが解析処理に対応する論理回路を構成可能であると判定された場合に、前記デバイスに関するデバイス情報に基づいて、前記デバイスの論理回路を構成させるための回路データを決定する決定手段と、
決定した前記回路データを前記デバイスへ送信する送信手段と、
を有することを特徴とする撮像装置。 - 撮像装置から取得されたデータに対する解析処理に対応する論理回路を有するデバイスを着脱可能な装着機構を有する撮像装置であって、
前記装着機構が含む複数の端子の一部への入力信号のパターンと、前記複数の端子の別の一部への出力信号のパターンとを比較することにより、前記装着機構に装着された前記デバイスが解析処理に対応する論理回路を構成可能であるか否かを判定する判定手段と、
前記デバイスが解析処理に対応する論理回路を構成可能であると判定された場合に、前記デバイスに関するデバイス情報に基づいて、前記デバイスの論理回路を構成させるための回路データを決定する決定手段と、
決定した前記回路データを前記デバイスへ送信する送信手段と、
を有することを特徴とする撮像装置。 - 前記決定手段は、前記デバイスに実行させるべき処理に基づいて、前記回路データを決定する、ことを特徴とする請求項1から8のいずれか1項に記載の撮像装置。
- 前記決定手段は、前記撮像装置に関する情報に基づいて、前記回路データを決定する、ことを特徴とする請求項1から9のいずれか1項に記載の撮像装置。
- 前記撮像装置に関する情報は、前記撮像装置が解析処理を実行させる画像データのサイズと、色差/色空間情報と、画像フォーマットと、量子化ビット数との少なくともいずれかを示す情報、又は、前記撮像装置が解析処理を実行させる画像データのサイズと、色差/色空間情報と、画像フォーマットと、量子化ビット数との少なくともいずれかを特定可能な情報を含む、ことを特徴とする請求項10に記載の撮像装置。
- 前記撮像装置に関する情報は、前記撮像装置が供給可能な電力と、前記撮像装置の動作条件と、通信速度と、の少なくともいずれかを示す情報、又は、前記撮像装置が供給可能な電力と、前記撮像装置の動作条件と、通信速度と、の少なくともいずれかを特定可能な情報を含む、ことを特徴とする請求項10又は請求項11に記載の撮像装置。
- 前記デバイスへ提供することができる回路データを保持する保持手段をさらに有し、
前記送信手段は、決定した前記回路データを前記保持手段から取得して、前記デバイスへ送信する、ことを特徴とする請求項1から12のいずれか1項に記載の撮像装置。 - 前記決定手段が決定した前記回路データを、前記撮像装置および前記デバイスと異なる装置から取得する手段をさらに有し、
前記送信手段は、取得した前記回路データを前記デバイスへ送信する、ことを特徴とする請求項1から13のいずれか1項に記載の撮像装置。 - 前記設定手段は、前記複数の端子のうちの第1の端子を用いて、前記デバイスの初期化処理を実行し、前記複数の端子のうちの第2の端子を用いて、前記デバイスへ前記回路データを送信するように、前記複数の端子が接続する信号を設定する、ことを特徴とする請求項1から6のいずれか1項に記載の撮像装置。
- 前記回路データは、前記デバイスに構成される回路の情報と設定値の情報とを含み、
前記設定手段は、前記複数の端子のうちの第1の端子を用いて、前記回路の情報を前記デバイスへ送信し、前記複数の端子のうちの第2の端子を用いて、前記設定値の情報を前記デバイスへ送信するように、前記複数の端子が接続する信号を設定する、ことを特徴とする請求項1から6のいずれか1項に記載の撮像装置。 - 着脱可能な装着機構を有する撮像装置に装着されるデバイスであって、
前記撮像装置から取得されたデータに対する解析処理に対応する論理回路を構成可能な構成手段と、
前記撮像装置に装着された場合に、前記装着機構に対応する複数の端子を用いて、前記撮像装置との間で複数の通信を並行して行うように前記複数の端子が接続する信号を設定する手段と、
前記撮像装置に装着された場合に、前記デバイスが前記構成手段を有することを前記撮像装置が特定することを可能とする通信を前記複数の端子を介して実行する実行手段と、
を有し、
前記構成手段は、前記通信に基づいて前記撮像装置から回路データが取得された場合に、前記回路データに基づいて前記論理回路を構成する、
ことを特徴とするデバイス。 - 前記実行手段は、前記通信として、前記デバイスに関するデバイス情報を送信する、ことを特徴とする請求項17に記載のデバイス。
- 前記デバイス情報は、前記構成手段に関する情報を含む、ことを特徴とする請求項18に記載のデバイス。
- 前記実行手段は、前記撮像装置から前記デバイス情報を要求するコマンドを受信した場合に、前記コマンドに対するレスポンスの引数値として前記デバイス情報を送信する、ことを特徴とする請求項18又は19に記載のデバイス。
- 前記構成手段は、フィールドプログラマブルゲートアレイ(FPGA)であり、
前記デバイス情報は、前記デバイスのハードウェア構成情報と、前記FPGAの種別の情報と、論理回路構成の制約情報と、端子接続情報と、周辺回路の情報との少なくともいずれかを示す情報、又は、前記デバイスのハードウェア構成情報と、前記FPGAの種別の情報と、論理回路構成の制約情報と、端子接続情報と、周辺回路の情報との少なくともいずれかを特定可能な情報を含む、ことを特徴とする請求項18から20のいずれか1項に記載のデバイス。 - 前記実行手段は、前記通信として、前記撮像装置からの電源の供給が開始されてからクロックが供給されるまでの前記装着機構に対応する複数の端子の一部における状態を変更して、前記撮像装置にその状態を特定させる、ことを特徴とする請求項17に記載のデバイス。
- 前記複数の端子が接続する信号を設定する手段は、前記複数の端子のうちの第1の端子を用いて、前記デバイスの初期化処理のための通信が実行され、前記複数の端子のうちの第2の端子を用いて、前記撮像装置から前記回路データを受信するように、前記複数の端子が接続する信号を設定する、ことを特徴とする請求項17から21のいずれか1項に記載のデバイス。
- 前記回路データは、前記デバイスに構成される回路の情報と設定値の情報とを含み、
前記複数の端子が接続する信号を設定する手段は、前記複数の端子のうちの第1の端子を用いて、前記回路の情報を前記撮像装置から受信し、前記複数の端子のうちの第2の端子を用いて、前記設定値の情報を前記撮像装置から受信するように、前記複数の端子が接続する信号を設定する、ことを特徴とする請求項17から21のいずれか1項に記載のデバイス。 - 着脱可能な装着機構を有する撮像装置に装着されるデバイスであって、
前記撮像装置から取得されたデータに対する解析処理に対応する論理回路を構成可能な構成手段と、
前記撮像装置に装着された場合に、前記デバイスが前記構成手段を有することを前記撮像装置が特定することを可能とする通信を実行する実行手段と、
を有し、
前記構成手段は、前記通信に基づいて前記撮像装置から回路データが取得された場合に、前記回路データに基づいて前記論理回路を構成し、
前記実行手段は、前記通信として、前記装着機構に対応する所定の規格のコマンドではないコマンドを受信した場合に、前記構成手段を有することを示すためのレスポンスを送信する、ことを特徴とするデバイス。 - 着脱可能な装着機構を有する撮像装置に装着されるデバイスであって、
前記撮像装置から取得されたデータに対する解析処理に対応する論理回路を構成可能な構成手段と、
前記撮像装置に装着された場合に、前記デバイスが前記構成手段を有することを前記撮像装置が特定することを可能とする通信を実行する実行手段と、
を有し、
前記構成手段は、前記通信に基づいて前記撮像装置から回路データが取得された場合に、前記回路データに基づいて前記論理回路を構成し、
前記実行手段は、前記通信として、前記装着機構に対応する複数の端子の一部へ入力されたパターンを、前記複数の端子の別の一部から出力する、ことを特徴とするデバイス。 - 前記撮像装置から取得されたデータを記憶可能な記憶手段をさらに有する、ことを特徴とする請求項17から26のいずれか1項に記載のデバイス。
- 前記撮像装置から受信したデータに基づいて、当該データを前記構成手段の設定を行う設定手段と前記記憶手段とのいずれに転送するかを判定する判定手段をさらに有する、ことを特徴とする請求項27に記載のデバイス。
- 前記撮像装置から取得されたデータを記憶可能な記憶手段をさらに有し、
前記デバイス情報は、前記記憶手段に記憶され、
前記実行手段は、前記撮像装置からの前記デバイスの読み出しの要求に応じて、前記デバイス情報を前記撮像装置へ送信する、ことを特徴とする請求項18から21のいずれか1項に記載のデバイス。 - 前記回路データを保持するための不揮発性の記憶手段を有しない、ことを特徴とする請求項17から29のいずれか1項に記載のデバイス。
- 撮像装置から取得されたデータに対する解析処理に対応する論理回路を有するデバイスを着脱可能な装着機構を有する撮像装置によって実行される制御方法であって、
前記装着機構が有する複数の端子を用いて、前記デバイスとの間で複数の通信を並行して行うように、前記複数の端子が接続する信号を設定することと、
前記論理回路を構成可能なデバイスが前記装着機構に装着された場合に、当該デバイスに関するデバイス情報に基づいて、前記デバイスの論理回路を構成させるための回路データを決定することと、
決定した前記回路データを前記複数の通信を用いて前記デバイスへ送信することと、
を含むことを特徴とする制御方法。 - 撮像装置から取得されたデータに対する解析処理に対応する論理回路を有するデバイスを着脱可能な装着機構を有する撮像装置によって実行される制御方法であって、
前記装着機構を介して、前記装着機構が対応している所定の規格のコマンドではないコマンドを送信して、レスポンスを受信したか否かに基づいて、前記装着機構に装着された前記デバイスが解析処理に対応する論理回路を構成可能であるか否かを判定することと、
前記デバイスが解析処理に対応する論理回路を構成可能であると判定された場合に、前記デバイスに関するデバイス情報に基づいて、前記デバイスの論理回路を構成させるための回路データを決定することと、
決定した前記回路データを前記デバイスへ送信することと、
を含むことを特徴とする制御方法。 - 撮像装置から取得されたデータに対する解析処理に対応する論理回路を有するデバイスを着脱可能な装着機構を有する撮像装置によって実行される制御方法であって、
前記装着機構が含む複数の端子の一部への入力信号のパターンと、前記複数の端子の別の一部への出力信号のパターンとを比較することにより、前記装着機構に装着された前記デバイスが解析処理に対応する論理回路を構成可能であるか否かを判定することと、
前記デバイスが解析処理に対応する論理回路を構成可能であると判定された場合に、前記デバイスに関するデバイス情報に基づいて、前記デバイスの論理回路を構成させるための回路データを決定することと、
決定した前記回路データを前記デバイスへ送信することと、
を含むことを特徴とする制御方法。 - 着脱可能な装着機構を有する撮像装置に装着され、前記撮像装置から取得されたデータに対する解析処理に対応する論理回路を構成可能な構成手段を有するデバイスによって実行される制御方法であって、
前記撮像装置に装着された場合に、前記装着機構に対応する複数の端子を用いて、前記撮像装置との間で複数の通信を並行して行うように前記複数の端子が接続する信号を設定することと、
前記撮像装置に装着された場合に、前記デバイスが前記構成手段を有することを前記撮像装置が特定することを可能とする通信を前記複数の端子を介して実行することと、
前記通信に基づいて前記撮像装置から回路データを取得した場合に、前記回路データに基づいて前記論理回路を構成することと、
を含むことを特徴とする制御方法。 - 着脱可能な装着機構を有する撮像装置に装着され、前記撮像装置から取得されたデータに対する解析処理に対応する論理回路を構成可能な構成手段を有するデバイスによって実行される制御方法であって、
前記撮像装置に装着された場合に、前記デバイスが前記構成手段を有することを前記撮像装置が特定することを可能とする通信を実行することと、
前記通信に基づいて前記撮像装置から回路データを取得した場合に、前記回路データに基づいて前記論理回路を構成することと、を含み、
前記通信では、前記装着機構に対応する所定の規格のコマンドではないコマンドを受信した場合に、前記構成手段を有することを示すためのレスポンスを送信することと、
を含むことを特徴とする制御方法。 - 着脱可能な装着機構を有する撮像装置に装着され、前記撮像装置から取得されたデータに対する解析処理に対応する論理回路を構成可能な構成手段を有するデバイスによって実行される制御方法であって、
前記撮像装置に装着された場合に、前記デバイスが前記構成手段を有することを前記撮像装置が特定することを可能とする通信を実行することと、
前記通信に基づいて前記撮像装置から回路データを取得した場合に、前記回路データに基づいて前記論理回路を構成することと、
前記通信として、前記装着機構に対応する複数の端子の一部へ入力されたパターンを、前記複数の端子の別の一部から出力することと、
を含むことを特徴とする制御方法。 - コンピュータに、請求項31から36のいずれか1項に記載の制御方法を実行させるためのプログラム。
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