JP6914132B2 - Pwmコンバータ制御装置 - Google Patents
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Description
〔制御システム〕
図1は、本発明の実施形態によるPWMコンバータ制御装置を含む制御システムの構成例を示す全体図である。この制御システムは、PWMコンバータ制御装置1、PWMコンバータ2、系統電源3、リアクタ4、電流検出器5、電圧検出器6及び平滑用コンデンサ7を備えて構成される。
次に、図1に示したPWMコンバータ制御装置1について詳細に説明する。図2は、PWMコンバータ制御装置1の構成例を示すブロック図である。このPWMコンバータ制御装置1は、端子電圧指令算出部10、d軸制御部11、q軸制御部12、ワインドアップ防止部13及び座標変換部14,15を備えている。
〔数1〕
v1 *=√(vd *2+vq *2) ・・・(1)
次に、図2に示したd軸制御部11について詳細に説明する。図3は、d軸制御部11の構成例を示すブロック図である。このd軸制御部11は、乗算器20,27、リミッタ21,24、減算器22,25,28、端子電圧制御器23及び電流制御器26を備えている。
次に、図2に示したq軸制御部12について詳細に説明する。図4は、q軸制御部12の構成例を示すブロック図である。このq軸制御部12は、減算器30,33、バス電圧制御器31、演算器32、電流制御器34、乗算器35及び加算器36を備えている。
〔数2〕
id=(e1/Xd)(1−ebus/e1)≦e1/Xd ・・・(2)
前記式(2)は、d軸リアクタンスXdが大きい場合、d軸電流フィードバックidが小さくなることを示している。
次に、図2に示したワインドアップ防止部13について詳細に説明する。図5は、ワインドアップ防止部13の構成例を示すブロック図である。このワインドアップ防止部13は、乗算器40、減算器41、リミッタ42及び演算器43を備えている。
〔数3〕
Ki=Ki */(1+P0×ε2) ・・・(3)
次に、図2に示したPWMコンバータ制御装置1によるシミュレーション結果について説明する。図7は、計算機シミュレーション結果を示す図である。この計算機シミュレーション結果は、系統電源3の電圧を200Vrmsとして、計算機を用いて得られたものである。
2 PWMコンバータ
3 系統電源
4 リアクタ
5 電流検出器
6 電圧検出器
7 平滑用コンデンサ
10 端子電圧指令算出部
11 d軸制御部
12 q軸制御部
13 ワインドアップ防止部
14,15 座標変換部
20 乗算器
21,24,42 リミッタ
22,25,28,30,33,41 減算器
23 端子電圧制御器
26,34 電流制御器
27,35,40 乗算器
31 バス電圧制御器
32,43 演算器
36 加算器
ebus バス電圧フィードバック
ebus * バス電圧指令
v1 * 端子電圧指令フィードバック
Ki 可変積分ゲイン
IR R相電流フィードバック
IS S相電流フィードバック
IT T相電流フィードバック
id d軸電流フィードバック
iq q軸電流フィードバック
id * d軸電流指令
iq * q軸電流指令
vd * d軸電圧指令
vq * q軸電圧指令
VR * R相電圧指令
VS * S相電圧指令
VT * T相電圧指令
e1 ^ 電源電圧フィードフォワード補償
e1 電源電圧フィードバック
e1 * 電源電圧指令
Xd ^ d軸リアクタンス補償
Xq ^ q軸リアクタンス補償
Xd d軸リアクタンス
Xq q軸リアクタンス
α iqにより位相が90°進むd軸電圧
β −idにより位相が90°進むq軸電圧
v1-1,v1-2 端子電圧
Claims (3)
- 系統電源から供給された交流電力を直流電力に変換するPWMコンバータに対し、直流側のバス電圧が所定の設定電圧に一致するように制御するPWMコンバータ制御装置において、
前記PWMコンバータを制御するd軸電圧指令及びq軸電圧指令に基づいて、前記系統電源側の系統電源電圧を端子電圧指令フィードバックとして生成する端子電圧指令算出部と、
前記バス電圧として検出されたバス電圧フィードバックに所定のゲインを乗算して電源電圧指令を求め、当該電源電圧指令から前記端子電圧指令算出部により生成された前記端子電圧指令フィードバックを減算して端子電圧偏差を求め、当該端子電圧偏差が0となるようにd軸電流指令を求め、当該d軸電流指令と前記系統電源側の3相電流から得られたd軸電流フィードバックとの間の偏差が0となるように、比例制御及び積分制御にて前記d軸電圧指令を求めるd軸制御部と、
所定のバス電圧指令と前記バス電圧フィードバックとの間のバス電圧偏差が0となるようにq軸電流指令を求め、当該q軸電流指令と前記系統電源側の3相電流から得られたq軸電流フィードバックとの間の偏差が0となるように、比例制御及び積分制御にて電圧指令を求め、当該電圧指令に、前記d軸電流指令に基づいて算出された補償電圧を加算し、前記q軸電圧指令を求めるq軸制御部と、
を備えたことを特徴とするPWMコンバータ制御装置。 - 請求項1に記載のPWMコンバータ制御装置において、
前記d軸制御部は、
前記バス電圧フィードバックに前記所定のゲインを乗算し、前記電源電圧指令を求める第1の乗算器と、
前記第1の乗算器により求めた前記電源電圧指令から前記端子電圧指令フィードバックを減算し、前記端子電圧偏差を求める第1の減算器と、
前記第1の減算器により求めた前記端子電圧偏差が0となるように、電流指令を生成する端子電圧制御器と、
前記端子電圧制御器により生成した前記電流指令に対し、0から所定のマイナスの値までの範囲で制限を加え、制限後の前記電流指令を前記d軸電流指令として求める第1のリミッタと、
前記第1のリミッタにより求めた前記d軸電流指令から前記d軸電流フィードバックを減算し、d軸電流偏差を求める第2の減算器と、
前記第2の減算器により求めた前記d軸電流偏差が0となるように、前記比例制御及び前記積分制御にて前記d軸電圧指令を求める電流制御器と、
を備えたことを特徴とするPWMコンバータ制御装置。 - 請求項1または2に記載のPWMコンバータ制御装置において、
さらに、前記d軸制御部及び前記q軸制御部における前記積分制御のワインドアップを防止するための積分ゲインを求めるワインドアップ防止部を備え、
前記ワインドアップ防止部は、
前記バス電圧フィードバックに所定のバス電圧利用率を乗算し、乗算後のバス電圧フィードバックを求める第2の乗算器と、
前記第2の乗算器により求めた前記乗算後のバス電圧フィードバックから、前記端子電圧指令算出部により生成された前記端子電圧指令フィードバックを減算し、電圧偏差を求める第3の減算器と、
前記第3の減算器により求めた前記電圧偏差に対し、0から所定のマイナスの値までの範囲で制限を加え、制限後の電圧偏差を求める第2のリミッタと、
前記第2のリミッタにより求めた前記制限後の電圧偏差がマイナスの場合、前記積分制御のワインドアップを防止するための積分ゲインを求める演算器と、
を備えたことを特徴とするPWMコンバータ制御装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
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JP2017141435A JP6914132B2 (ja) | 2017-07-21 | 2017-07-21 | Pwmコンバータ制御装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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JP2017141435A JP6914132B2 (ja) | 2017-07-21 | 2017-07-21 | Pwmコンバータ制御装置 |
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JP2019022401A JP2019022401A (ja) | 2019-02-07 |
JP6914132B2 true JP6914132B2 (ja) | 2021-08-04 |
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Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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JP2017141435A Active JP6914132B2 (ja) | 2017-07-21 | 2017-07-21 | Pwmコンバータ制御装置 |
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