JP6879505B2 - デバッグシステム - Google Patents
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Description
10 遊技機
100 主制御基板
110 遊技機制御用マイクロコンピュータ
111 CPU部
112 ROM部
113 RAM部
115 外部バスインターフェース
200 コネクタ付ケーブル
20 デバッグ制御用PC
30 中継装置
32 メモリ部
34 外部バスインターフェース
35 通信制御部
40 ネットワーク
Claims (7)
- 遊技機の主たる制御を行う主制御基板に設けられるワンチップ構造の遊技機制御用マイクロコンピュータと、該遊技機制御用マイクロコンピュータが遊技機制御を行うために用いる遊技機制御用のプログラムやデータに含まれるバグを除去するデバッグ作業に利用するデバッグ装置と、前記遊技機制御用マイクロコンピュータと前記デバッグ装置との間に接続される中継装置と、からなるデバッグシステムであって、
前記中継装置は、少なくとも、前記デバッグ装置から供給される前記遊技機制御用のプログラムやデータを記憶する記憶手段と、前記遊技機制御用マイクロコンピュータの外部バスインターフェースに対応した外部バスインターフェースと、を備え、
前記遊技機制御用マイクロコンピュータは、少なくとも、前記遊技機制御用のプログラムやデータを記憶するROM部と、該ROM部から前記遊技機制御用のプログラムやデータを読み出して実行するCPU部と、該CPU部が前記中継装置の前記記憶手段へアクセス可能なアドレスが定義された外部バスインターフェースと、を備え、
前記遊技機制御用マイクロコンピュータの前記CPU部が、前記遊技機制御用のプログラムやデータの読み出し先を前記ROM部から前記中継装置の前記記憶手段に変更し、前記デバッグ装置から前記中継装置の前記記憶手段に記憶された前記遊技機制御用のプログラムやデータを、前記遊技機制御用マイクロコンピュータの前記CPU部が読み出して実行することにより、前記遊技機制御用のプログラムやデータを更新できるようにしたことを特徴とするデバッグシステム。 - 前記遊技機制御用マイクロコンピュータの前記CPU部は、リセット信号を契機として、前記記憶手段に記憶された前記遊技機制御用のプログラムやデータを読み出すようにしたことを特徴とする請求項1に記載のデバッグシステム。
- 前記遊技機制御用マイクロコンピュータの前記CPU部は、前記中継装置からの割込み信号を契機として、前記記憶手段に記憶された前記遊技機制御用のプログラムやデータを読み出すようにしたことを特徴とする請求項1に記載のデバッグシステム。
- 前記中継装置は、1つの前記遊技機における前記遊技機制御用マイクロコンピュータと1対1で接続し、
前記デバッグ装置は、複数の前記中継装置と接続可能とし、
前記デバッグ装置から複数の前記中継装置へ前記遊技機制御用のプログラムやデータを書き込むことで、該当する前記中継装置と接続された各遊技機の前記遊技機制御用マイクロコンピュータに実行させる前記遊技機制御用のプログラムやデータをまとめて更新するようにしたことを特徴とする請求項1〜請求項3の何れか1項に記載のデバッグシステム。 - 前記中継装置には、自機の識別番号を設定可能な識別番号設定手段を設け、
前記デバッグ装置は、前記中継装置の前記識別番号設定手段に設定されている前記識別番号によって、当該中継装置が接続されている前記遊技機を識別するようにしたことを特徴とする請求項4に記載のデバッグシステム。 - 前記デバッグ装置は、1又は複数の前記遊技機を括ってグループ識別情報を設定して、当該グループの各遊技機に対応する前記中継装置へ前記グループ識別情報を送信し、
前記デバッグ装置より前記グループ識別情報を受信した前記中継装置は、受信した前記グループ識別情報をグループ識別情報記憶手段に記憶するようにしたことを特徴とする請求項5に記載のデバッグシステム。 - 前記中継装置は、前記グループ識別情報記憶手段に記憶されている前記グループ識別情報に応じたグループ識別表示を行う表示手段を備えることを特徴とする請求項6に記載のデバッグシステム。
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