JP6702175B2 - 負荷駆動装置 - Google Patents
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この負荷駆動装置は、
外部装置(2)に対して電気接続されることで前記外部装置からの入力信号に基づいて前記負荷回路の制御信号を生成及び出力するように設けられた主制御部(411)と、前記主制御部から出力された前記制御信号を前記負荷回路へ出力するように設けられた出力部(412)と、前記出力部における異常を検出するように設けられた出力段異常検出部(414)と、を備えた1つの集積回路で構成される主制御回路(41)と、
前記外部装置及び前記負荷回路に対して前記主制御回路と並列に電気接続されることで、前記出力段異常検出部によって前記異常が検出された場合に前記負荷回路の駆動を制御するフェールセーフ制御信号を生成するとともに前記フェールセーフ制御信号を前記負荷回路へ出力するように設けられた副制御回路(42)と、
を備える。
前記主制御部から出力された前記制御信号を格納するように設けられたポート出力レジスタ(416)と、
前記主制御回路における前記負荷回路との接続端子(M_OUT)に対して電気接続されることで、前記主制御回路から前記負荷回路への信号出力状態を格納するように設けられたポート入力レジスタ(417)と、
前記ポート出力レジスタから前記接続端子へ信号伝達可能に、且つ前記接続端子から前記ポート入力レジスタへ信号伝達可能に、前記ポート出力レジスタ及び前記ポート入力レジスタに対して電気接続された入出力ポート(418)と、
を備えていてもよい。
この場合、前記出力段異常検出部は、前記ポート出力レジスタにおける格納状態と前記ポート入力レジスタにおける格納状態とを比較することで、前記出力部における異常を検出するように構成され得る。
以下、本発明の実施形態を、図面に基づいて説明する。なお、実施形態に対して適用可能な各種の変更については、変形例として、一連の実施形態の説明の後に、まとめて説明する。
以下、本実施形態の構成による動作及び効果について説明する。上位ECU2と負荷回路3とを負荷駆動装置4に対して電気接続することによって、電気負荷システム1が構成される。このとき、主制御回路41と副制御回路42とは、上位ECU2に対して並列に電気接続される。また、主制御回路41と副制御回路42とは、負荷回路3に対して並列に電気接続される。
本開示は、上記実施形態に記載された具体的例示に限定されるものではない。即ち、上記実施形態に対しては、適宜変更が可能である。以下、代表的な変形例について説明する。以下の変形例の説明においては、上記実施形態と異なる部分についてのみ説明する。また、上記実施形態と変形例とにおいて、互いに同一又は均等である部分には、同一符号が付されている。したがって、以下の変形例の説明において、上記実施形態と同一の符号を有する構成要素に関しては、技術的矛盾又は特段の追加説明なき限り、上記実施形態における説明が適宜援用され得る。
2 上位ECU(外部装置)
3 負荷回路
31 電気負荷
4 負荷駆動装置
41 主制御回路
411 主制御部
412 出力部
414 第二異常検出部
42 副制御回路
Claims (4)
- 電気負荷(31)を含む負荷回路(3)に対して電気接続されることで前記負荷回路の駆動を制御するように構成された負荷駆動装置(4)であって、
外部装置(2)に対して電気接続されることで前記外部装置からの入力信号に基づいて前記負荷回路の制御信号を生成及び出力するように設けられた主制御部(411)と、前記主制御部から出力された前記制御信号を前記負荷回路へ出力するように設けられた出力部(412)と、前記出力部における異常を検出するように設けられた出力段異常検出部(414)と、を備えた1つの集積回路で構成される主制御回路(41)と、
前記外部装置及び前記負荷回路に対して前記主制御回路と並列に電気接続されることで、前記出力段異常検出部によって前記異常が検出された場合に前記負荷回路の駆動を制御するフェールセーフ制御信号を生成するとともに前記フェールセーフ制御信号を前記負荷回路へ出力するように設けられた副制御回路(42)と、
を備えた負荷駆動装置。 - 前記出力部は、
前記主制御部から出力された前記制御信号を格納するように設けられたポート出力レジスタ(416)と、
前記主制御回路における前記負荷回路との接続端子(M_OUT)に対して電気接続されることで、前記主制御回路から前記負荷回路への信号出力状態を格納するように設けられたポート入力レジスタ(417)と、
前記ポート出力レジスタから前記接続端子へ信号伝達可能に、且つ前記接続端子から前記ポート入力レジスタへ信号伝達可能に、前記ポート出力レジスタ及び前記ポート入力レジスタに対して電気接続された入出力ポート(418)と、
を備え、
前記出力段異常検出部は、前記ポート出力レジスタにおける格納状態と前記ポート入力レジスタにおける格納状態とを比較することで、前記出力部における異常を検出するように構成された、
請求項1に記載の負荷駆動装置。 - 前記負荷回路は、
前記主制御回路に対して電気接続されることで前記制御信号を受信するとともに、前記副制御回路に対して電気接続されることで前記フェールセーフ制御信号を受信するように、前記負荷駆動装置と前記電気負荷との間に設けられるスイッチング素子(33)をさらに含む、請求項1又は2に記載の負荷駆動装置。 - 前記負荷駆動装置は、
前記主制御回路に対して電気接続されることで前記制御信号を受信するとともに、前記負荷回路に対して電気接続されるように設けられた信号遮断回路(34)を備え、
前記信号遮断回路は、前記出力段異常検出部によって前記異常が検出された場合には前記制御信号を前記負荷回路へ信号伝達しないように構成された、請求項1又は2に記載の負荷駆動装置。
Priority Applications (1)
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JP2016251039A JP6702175B2 (ja) | 2016-12-26 | 2016-12-26 | 負荷駆動装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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JP2016251039A JP6702175B2 (ja) | 2016-12-26 | 2016-12-26 | 負荷駆動装置 |
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Publication Number | Publication Date |
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JP2018106367A JP2018106367A (ja) | 2018-07-05 |
JP6702175B2 true JP6702175B2 (ja) | 2020-05-27 |
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ID=62788029
Family Applications (1)
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JP2016251039A Active JP6702175B2 (ja) | 2016-12-26 | 2016-12-26 | 負荷駆動装置 |
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2016
- 2016-12-26 JP JP2016251039A patent/JP6702175B2/ja active Active
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JP2018106367A (ja) | 2018-07-05 |
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