JP6673021B2 - メモリおよび情報処理装置 - Google Patents
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Description
Claims (9)
- 情報を記憶するメモリ部と、
前記メモリ部のアクセスを制御するアクセス制御部と、
前記メモリ部に関するメモリ情報を保持するメモリ情報保持部と、
前記アクセス制御部によりアクセスされた前記メモリ部のアクセス情報が格納されるアクセス情報保持部と、
前記アクセス情報保持部に格納されるアクセス情報の格納位置を示す格納情報を保持する格納情報保持部と、
前記格納情報保持部に保持された格納情報を用いて、前記アクセス情報保持部から読み出された情報からアクセス情報を含むアクセス情報コードを抽出する抽出部と、
前記メモリ部のエラーに基づく読み出し要求に基づいて、前記メモリ情報保持部に保持されたメモリ情報を出力し、前記読み出し要求の要求元から出力されるメモリ情報の受信応答に基づいて、受信応答の受信サイクル中に、前記抽出部が抽出したアクセス情報コードを出力する入出力制御部と
を備えることを特徴とするメモリ。 - 前記入出力制御部は、前記読み出し要求に基づいて、前記メモリ情報保持部に保持されたメモリ情報を複数の部分メモリ情報に分けて出力し、前記複数の部分メモリ情報の出力にそれぞれに対応する受信応答の受信サイクル中に、アクセス情報コードを複数に分けた部分アクセス情報コードのそれぞれを出力すること
を特徴とする請求項1記載のメモリ。 - 前記格納情報保持部は、前記アクセス情報保持部に設けられる複数のアクセス情報保持領域のいずれかを示す位置情報と、前記抽出部によるアクセス情報コードの抽出に使用される格納情報とを、前記メモリ情報保持部に設けられる複数のメモリ情報保持領域のそれぞれに対応して保持する複数の格納情報保持領域を有し、
前記アクセス制御部は、前記読み出し要求により示されるメモリ情報保持領域に保持されたメモリ情報を前記入出力制御部に出力させ、前記読み出し要求により示されるメモリ情報保持領域に対応する格納情報保持領域に保持された位置情報と格納情報とを読み出し、読み出した位置情報により示されるアクセス情報保持領域に保持されたアクセス情報に基づいて前記抽出部に抽出させたアクセス情報コードを前記入出力制御部に出力させること
を特徴とする請求項1または請求項2記載のメモリ。 - 前記複数の格納情報保持領域の各々は、格納情報に紐付けられる対応コードを保持し、
前記格納情報保持部は、さらに、複数の対応コードと格納情報との対応関係を保持する情報連結部を備えること
を特徴とする請求項3記載のメモリ。 - 前記複数の格納情報保持領域の各々に保持される格納情報は、アクセス情報保持領域において有効なアクセス情報が保持されたビットを示し、
前記抽出部は、格納情報に基づいて、前記アクセス情報保持部から読み出された複数ビットのアクセス情報のうち、有効なアクセス情報を含む所定数のビットを抽出することで、アクセス情報コードを生成すること
を特徴とする請求項3または請求項4記載のメモリ。 - クロックの周波数を逓倍して逓倍クロックを生成するクロック逓倍部を備え、
前記入出力制御部は、クロックに同期してメモリ情報を出力し、クロックに同期して前記受信応答を受信し、受信応答を受信したクロックサイクル中に、逓倍クロックに同期してアクセス情報コードを出力すること
を特徴とする請求項1ないし請求項5のいずれか1項記載のメモリ。 - 前記メモリ部に搭載される複数のメモリチップと、
前記アクセス制御部、前記メモリ情報保持部、前記アクセス情報保持部、前記格納情報保持部、前記抽出部および前記入出力制御部を含み、前記複数のメモリチップのアクセスを制御する制御チップと
を備えることを特徴とする請求項1ないし請求項6のいずれか1項記載のメモリ。 - 前記入出力制御部は、読み出し要求を示すデータを、双方向のシリアルデータ線を介してクロックに同期して受信し、前記メモリ情報保持部から読み出したメモリ情報を、クロック線を介して受信するクロックに同期して前記シリアルデータ線に出力し、前記クロックに同期して前記シリアルデータ線を介して受信した前記受信応答に基づいて、前記アクセス情報コードを前記シリアルデータ線に出力すること
を特徴とする請求項1ないし請求項7のいずれか1項記載のメモリ。 - メモリと、メモリにアクセスするプロセッサと、メモリを制御する制御装置とを備える情報処理装置において、
前記メモリは、
情報を記憶するメモリ部と、
前記プロセッサからのメモリアクセス要求に基づいて、前記メモリ部のアクセスを制御するアクセス制御部と、
前記メモリ部に関するメモリ情報を保持するメモリ情報保持部と、
前記アクセス制御部によりアクセスされた前記メモリ部のアクセス情報が格納されるアクセス情報保持部と、
前記アクセス情報保持部に格納されるアクセス情報の格納位置を示す格納情報を保持する格納情報保持部と、
前記格納情報保持部に保持された格納情報を用いて、前記アクセス情報保持部から読み出された情報からアクセス情報を含むアクセス情報コードを抽出する抽出部と、
読み出し要求に基づいて、前記メモリ情報保持部に保持されたメモリ情報を出力し、前記読み出し要求の要求元から出力されるメモリ情報の受信応答に基づいて、受信応答のサイクル中に、前記抽出部が抽出したアクセス情報コードを出力するメモリ側入出力制御部と
を備え、
前記制御装置は、
前記プロセッサにより検出された前記メモリ部のエラーに基づいて、前記読み出し要求を前記メモリに出力し、前記メモリからのメモリ情報の受信に基づく受信応答の出力後、受信応答のサイクル中にアクセス情報コードを受信する装置側入出力制御部と、
前記装置側入出力制御部が前記メモリから受信したアクセス情報コードを記憶するコード記憶部と
を備えることを特徴とする情報処理装置。
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