JP6483867B2 - トランスミッタ - Google Patents
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Description
デュアルバンド入力回路は、第1のバンド入力端と、第2のバンド入力端と、第1のバンド入力端及び第2のバンド入力端に接続された2つのデジタルプリディストーション(DPD)コンポーネントとを含み、第1のバンド入力端によって入力された第1のベースバンド信号と第2のバンド入力端によって入力された第2のベースバンド信号とを出力するように構成され、第1のベースバンド信号及び第2のベースバンド信号は、出力される前にDPDコンポーネントによって処理され、
モジュロ回路は、入力された第1のベースバンド信号及び第2のベースバンド信号にモジュロ処理を実行し、対応する第1のベースバンド信号モジュラス値及び対応する第2のベースバンド信号モジュラス値を出力するように構成され、
信号分離回路は、ルックアップテーブルを記憶しているメモリと乗算器とを含み、DPDコンポーネントによって入力された第1のベースバンド信号及び第2のベースバンド信号、並びに、モジュロ回路からの第1のベースバンド信号モジュラス値及び第2のベースバンド信号モジュラス値を受信し、ルックアップテーブル及び乗算器に基づいてそれぞれ信号分離処理を実行して多重分離信号を取得するように構成され、
変調回路は信号分離回路に接続され、信号分離回路によって出力された多重分離信号を受信し、多重分離信号に合成処理を実行して、2つの対応する処理信号を取得し、2つの対応する処理信号を対応する動作周波数に変調し、2つの処理信号をデュアルバンド電力増幅器に出力する。
それぞれDPDコンポーネントの出力端に接続され、DPDコンポーネントによって処理された第1のベースバンド信号及び第2のベースバンド信号にモジュロ処理を実行し、DPDコンポーネントによって処理された対応する第1のベースバンド信号モジュラス値及び対応する第2のベースバンド信号モジュラス値を取得するように構成される。
信号分離回路は、2つのDPDコンポーネントによって入力された第1のベースバンド信号及び第2のベースバンド信号を受信し、2つのDPDコンポーネントの各々によって入力された第1のベースバンド信号及び第2のベースバンドについて、乗算器のうち1つを用いて第1のベースバンド信号を2DLUTのうち1つの出力で乗算し、乗算器のうち別の1つを用いて第2のベースバンド信号を2DLUTのうち別の1つの出力で乗算し、第1の信号、第2の信号、第3の信号及び第4の信号を取得し、第1の信号、第2の信号、第3の信号及び第4の信号を変調回路に出力するように構成され、
第1のベースバンド信号及び第2のベースバンド信号は、同じDPDコンポーネントの入力端に入力され、DPD処理が施された第1のベースバンド信号及び第2のベースバンド信号は、出力端で別々に出力される。
信号分離回路において、メモリに記憶されたルックアップテーブルは1次元ルックアップテーブル(1DLUT)であり、メモリには1DLUTが4つ存在し、乗算器の数は1DLUTの数と同じであり、各乗算器の入力が1DLUTの出力であるとき、各1DLUTの入力は、加算器によって出力された第1のベースバンド信号モジュラス値と第2のベースバンド信号モジュラス値との和であり、
信号分離回路は、2つのDPDコンポーネントによって入力された第1のベースバンド信号及び第2のベースバンド信号を受信し、2つのDPDコンポーネントの各々からの第1のベースバンド信号及び第2のベースバンドについて、乗算器のうち1つを用いて第1のベースバンド信号を2DLUTのうち1つの出力で乗算し、乗算器のうち別の1つを用いて第2のベースバンド信号を2DLUTのうち別の1つの出力で乗算し、第1の信号、第2の信号、第3の信号及び第4の信号を取得し、第1の信号、第2の信号、第3の信号及び第4の信号を変調回路に出力するように構成される。第1のベースバンド信号及び第2のベースバンド信号は、同じDPDコンポーネントの入力端に入力され、DPD処理が施された第1のベースバンド信号及び第2のベースバンド信号は、出力端で別々に出力される。
変調回路は、DUCのうちの2つを用いて、第1の信号及び第2の信号に対して1対1のアップコンバージョンを実行して、第1の信号及び第2の信号の周波数をfc_bandAに変更し、他の2つのDUCを用いて、第3の信号及び第4の信号に対して1対1のアップコンバージョンを実行して、第3の信号及び第4の信号の周波数をfc_bandBに変更し、DUCに交差接続された加算器を用いて、アップコンバージョン処理が施された第1の信号をアップコンバージョン処理が施された第3の信号に、アップコンバージョン処理が施された第2の信号をアップコンバージョン処理が施された第4の信号に、それぞれ加算して、第1の加算信号及び第2の加算信号を取得するように構成され、第1の加算信号及び第2の加算信号に対して、各加算器に接続されたDACを用いてデジタルアナログ変換が実行され、変調回路は、AQMにより、デジタルアナログ変換の施された第1の加算信号及び第2の加算信号をそれぞれ対応する無線周波動作周波数に変調し、第1の加算信号及び第2の加算信号をデュアル入力デュアルバンド電力増幅器に入力するように構成される。
信号分離回路は、乗算器に接続されていない2DLUTの出力を第5の信号として、第5の信号を変調回路に直接出力し、DPDコンポーネントによって入力され且つ1つの信号に合成された第1のベースバンド信号及び第2のベースバンド信号を受信し、DPDコンポーネントの各々からの合成された各信号について、第1のベースバンド信号及び第2のベースバンド信号が合成された信号を、乗算器の1つに接続された2DLUTのうち1つの出力で乗算して、第6の信号及び第7の信号を取得し、第6の信号及び第7の信号を変調回路に出力するように構成される。
信号分離回路は、2DLUTの出力を第5の信号として、第5の信号を変調回路に直接出力し、DPDコンポーネントによって入力され且つ1つの信号に合成された第1のベースバンド信号及び第2のベースバンド信号を受信し、DPDコンポーネントの各々からの合成された各信号について、乗算器を用いて、受信された第1のベースバンド信号モジュラス値及び第2のベースバンド信号モジュラス値を、第1のベースバンド信号及び第2のベースバンド信号が合成された信号で乗算して、第6の信号及び第7の信号を取得し、第6の信号及び第7の信号を変調回路に出力するように構成される。
信号分離回路において、メモリに記憶されたルックアップテーブルは1次元ルックアップテーブル(1DLUT)であり、メモリには1DLUTが3つ存在し、加算器によって出力される第1のベースバンド信号モジュラス値と第2のベースバンド信号モジュラス値との和は各1DLUTに入力され、1DLUTのうち2つはそれぞれ1つの乗算器に接続され、各乗算器の入力は1DLUTの出力であり、
信号分離回路は、乗算器に接続されていない1DLUTの出力を第5の信号として、第5の信号を変調回路に直接出力し、DPDコンポーネントによって入力され且つ1つの信号に合成された第1のベースバンド信号及び第2のベースバンド信号を受信し、DPDコンポーネントの各々からの合成された各信号について、第1のベースバンド信号及び第2のベースバンド信号が合成された信号を、乗算器に接続された1DLUTのうち1つの出力で乗算して、第6の信号及び第7の信号を取得し、第6の信号及び第7の信号を変調回路に出力するように構成される。
信号分離回路において、メモリに記憶されたルックアップテーブルは1次元ルックアップテーブル(1DLUT)であり、メモリには1DLUTが1つ存在し、加算器によって出力される第1のベースバンド信号モジュラス値と第2のベースバンド信号モジュラス値との和は1DLUTに入力され、
信号分離回路は、1DLUTの出力を第5の信号として、第5の信号を変調回路に直接出力し、DPDコンポーネントによって入力され且つ1つの信号に合成された第1のベースバンド信号及び第2のベースバンド信号を受信し、DPDコンポーネントの各々からの合成された各信号について、乗算器を用いて、受信された第1のベースバンド信号モジュラス値及び第2のベースバンド信号モジュラス値を、第1のベースバンド信号及び第2のベースバンド信号が合成された信号で乗算して、第6の信号及び第7の信号を取得し、第6の信号及び第7の信号を変調回路に出力するように構成される。
変調回路は、信号分離回路に直接接続されたDACによって出力されたエンベロープ信号をデュアルバンド電力増幅器に入力し、DUCコンポーネントを用いて第6の信号にアップコンバージョンを実行して第6の信号の周波数をfc_bandAに変更し、別のDUCコンポーネントを用いて第7の信号にアップコンバージョンを実行して第7の信号の周波数をfc_bandBに変更し、加算器を用いて、アップコンバージョン処理が施された第7の信号を、アップコンバージョン処理が施された第6の信号に加算して、第3の加算信号を取得し、加算器に接続されたDACを用いて第3の加算信号にデジタルアナログ変換を実行し、AQMコンポーネントを用いて、変換後に得られた第3の加算信号を対応する無線周波動作周波数に変調し、第3の加算信号をデュアルバンド電力増幅器に入力するように構成される。
DPDコンポーネント:digital pre-distortion、デジタルプリディストーションコンポーネント;
DUCコンポーネント:digital up-conversion、デジタルアップコンバージョンコンポーネント;
DAC:digital-analog convertor、デジタルアナログ変換器;
AQM:analog quadrate modulation、アナログ直角変調;
PA:power amplifier、電力増幅器。
図3に示されるように、図3は、本願の実施形態1に係るデュアルバンドデュアル入力電力増幅器トランスミッタのアーキテクチャ図である。デュアルバンドデュアル入力電力増幅器トランスミッタは、主に、デュアルバンド入力回路1と、モジュロ回路2と、信号分離回路3と、変調回路4と、デュアルバンド電力増幅器5とを備える。
本願の実施形態1で開示されたデュアルバンドデュアル入力電力増幅器トランスミッタによれば、図4に示されるように、図4は、本願の実施形態2に係るデュアルバンドデュアル入力電力増幅器トランスミッタの概略構造図である。デュアルバンドデュアル入力電力増幅器トランスミッタは、デュアルバンド入力回路と、モジュロ回路と、信号分離回路3と、変調回路と、デュアルバンド電力増幅器5(図中PAで表される)とを備える。
本願の実施形態1及び実施形態2に開示されたデュアルバンドデュアル入力電力増幅器トランスミッタに基づき、図5に示されるように、図5は、本発明の実施形態3に係る、デュアルバンドデュアル入力電力増幅器トランスミッタの概略構造図である。デュアルバンドデュアル入力電力増幅器トランスミッタは、デュアルバンド入力回路、モジュロ回路、加算器6、信号分離回路3、変調回路及びデュアルバンド電力増幅器5(PA)を備える。
本願の実施形態1及び実施形態2に開示されたデュアルバンドデュアル入力電力増幅器トランスミッタに基づき、図6に示されるように、図6は、本発明の実施形態4に係る、デュアルバンドデュアル入力電力増幅器トランスミッタの概略構造図である。デュアルバンドデュアル入力電力増幅器トランスミッタは、デュアルバンド入力回路、モジュロ回路、信号分離回路3、変調回路及びデュアルバンド電力増幅器5(図中PA)を備える。
本願の実施形態1及び実施形態4に開示されたデュアルバンドデュアル入力電力増幅器トランスミッタによれば、図7に示されるように、図7は、本願の実施形態5に係る、デュアルバンドデュアル入力電力増幅器トランスミッタの概略構造図である。デュアルバンドデュアル入力電力増幅器トランスミッタは、デュアルバンド入力回路、モジュロ回路、加算器6、信号分離回路3、変調回路及びデュアルバンド電力増幅器5(図中PA)を備える。
Claims (10)
- デュアルバンド入力回路、モジュロ回路、信号分離回路、変調回路及びデュアルバンド電力増幅器を備えるトランスミッタであって、
前記デュアルバンド入力回路は、第1のバンド入力端と、第2のバンド入力端と、前記第1のバンド入力端及び前記第2のバンド入力端に接続された2つのデジタルプリディストーション(DPD)コンポーネントとを有し、前記第1のバンド入力端によって入力された第1のベースバンド信号と前記第2のバンド入力端によって入力された第2のベースバンド信号とを出力するように構成され、前記第1のベースバンド信号及び前記第2のベースバンド信号は、出力される前に前記DPDコンポーネントによって処理され、
前記モジュロ回路は、入力された前記第1のベースバンド信号及び前記第2のベースバンド信号にモジュロ処理を実行し、対応する第1のベースバンド信号モジュラス値及び対応する第2のベースバンド信号モジュラス値を出力するように構成され、
前記信号分離回路は、ルックアップテーブルを記憶しているメモリと乗算器とを有し、前記DPDコンポーネントによって入力された前記第1のベースバンド信号及び前記第2のベースバンド信号、並びに、前記モジュロ回路からの前記第1のベースバンド信号モジュラス値及び前記第2のベースバンド信号モジュラス値を受信し、前記ルックアップテーブル及び前記乗算器に基づいてそれぞれ信号分離処理を実行して多重分離信号を取得するように構成され、
前記変調回路は前記信号分離回路に接続され、前記信号分離回路によって出力された前記多重分離信号を受信し、前記多重分離信号に合成処理を実行して、2つの対応する処理信号を取得し、前記2つの対応する処理信号を対応する動作周波数に変調し、前記2つの処理信号を前記デュアルバンド電力増幅器に出力する、
トランスミッタ。 - 前記モジュロ回路は2つのモジュロユニットを有し、前記2つのモジュロユニットは、それぞれ前記第1のバンド入力端及び前記第2のバンド入力端に接続され、前記第1のバンド入力端によって入力された前記第1のベースバンド信号と前記第2のバンド入力端によって入力された前記第2のベースバンド信号とにそれぞれモジュロ処理を実行して、前記対応する第1のベースバンド信号モジュラス値及び前記対応する第2のベースバンド信号モジュラス値を取得するように構成され、又は、
それぞれ前記DPDコンポーネントの出力端に接続され、前記DPDコンポーネントによって処理された前記第1のベースバンド信号及び前記第2のベースバンド信号にモジュロ処理を実行して、前記DPDコンポーネントによって処理された前記対応する第1のベースバンド信号モジュラス値及び前記対応する第2のベースバンド信号モジュラス値を取得するように構成される、
請求項1に記載のトランスミッタ。 - 前記信号分離回路において、前記メモリに記憶された前記ルックアップテーブルは2次元ルックアップテーブル(2DLUT)であり、前記メモリには前記2DLUTが4つ存在し、前記第1のベースバンド信号モジュラス値及び前記第2のベースバンド信号モジュラス値は各2DLUTに入力され、前記乗算器の数は前記2DLUTの数と同じであり、各乗算器の入力は各2DLUTの出力であり、
前記信号分離回路は、2つの前記DPDコンポーネントによって入力された前記第1のベースバンド信号及び前記第2のベースバンド信号を受信し、2つの前記DPDコンポーネントの各々によって入力された前記第1のベースバンド信号及び前記第2のベースバンドについて、前記乗算器のうち1つを用いて前記第1のベースバンド信号を前記2DLUTのうち1つの出力で乗算し、前記乗算器のうち別の1つを用いて前記第2のベースバンド信号を前記2DLUTのうち別の1つの出力で乗算し、第1の信号、第2の信号、第3の信号及び第4の信号を取得し、前記第1の信号、前記第2の信号、前記第3の信号及び第4の信号を前記変調回路に出力するように構成され、
前記第1のベースバンド信号及び前記第2のベースバンド信号は、同じDPDコンポーネントの入力端に入力され、DPD処理が施された前記第1のベースバンド信号及び前記第2のベースバンド信号は、出力端で別々に出力される、
請求項1又は2に記載のトランスミッタ。 - 前記モジュロ回路の後に設けられる加算器を更に備え、
前記加算器は、前記モジュロ回路の前記2つのモジュロユニットの出力を入力として用いて、前記モジュロ回路によって実行されたモジュロ処理の後に得られた前記第1のベースバンド信号モジュラス値と前記第2のベースバンド信号モジュラス値との和を取得するように構成され、
前記信号分離回路において、前記メモリに記憶された前記ルックアップテーブルは1次元ルックアップテーブル(1DLUT)であり、前記メモリには前記1DLUTが4つ存在し、前記乗算器の数は前記1DLUTの数と同じであり、各乗算器の入力が前記1DLUTの出力であるとき、各1DLUTの入力は、前記加算器によって出力された前記第1のベースバンド信号モジュラス値と前記第2のベースバンド信号モジュラス値との前記和であり、
前記信号分離回路は、2つの前記DPDコンポーネントによって入力された前記第1のベースバンド信号及び前記第2のベースバンド信号を受信し、前記2つのDPDコンポーネントの各々からの前記第1のベースバンド信号及び前記第2のベースバンドについて、前記乗算器のうち1つを用いて前記第1のベースバンド信号を前記2DLUTのうち1つで乗算し、前記乗算器のうち別の1つを用いて前記第2のベースバンド信号を前記2DLUTのうち別の1つの出力で乗算して、第1の信号、第2の信号、第3の信号及び第4の信号を取得し、前記第1の信号、前記第2の信号、前記第3の信号及び第4の信号を前記変調回路に出力するように構成され、
前記第1のベースバンド信号及び前記第2のベースバンド信号は、同じDPDコンポーネントの入力端に入力され、DPD処理が施された前記第1のベースバンド信号及び前記第2のベースバンド信号は、出力端で別々に出力される、
請求項1又は2に記載のトランスミッタ。 - 前記変調回路は、入力端がそれぞれ前記信号分離回路に接続された4つのデジタルアップコンバージョン(DUC)コンポーネントと、前記DUCに交差接続された2つの加算器と、前記加算器に接続されたデジタルアナログ変換器(DAC)と、前記DACに接続されたアナログ直角変調(AQM)コンポーネントとを含み、
前記変調回路は、前記DUCのうちの2つを用いて、前記第1の信号及び前記第2の信号に対して1対1のアップコンバージョンを実行して、前記第1の信号及び前記第2の信号の周波数をfc_bandAに変更し、他の2つの前記DUCを用いて、前記第3の信号及び前記第4の信号に対して1対1のアップコンバージョンを実行して、前記第3の信号及び前記第4の信号の周波数をfc_bandBに変更し、前記DUCに交差接続された前記加算器を用いて、アップコンバージョン処理が施された前記第1の信号をアップコンバージョン処理が施された前記第3の信号に、アップコンバージョン処理が施された前記第2の信号をアップコンバージョン処理が施された前記第4の信号に、それぞれ加算して、第1の加算信号及び第2の加算信号を取得するように構成され、前記第1の加算信号及び前記第2の加算信号に対して、各加算器に接続されたDACを用いてデジタルアナログ変換が実行され、前記変調回路は、前記AQMコンポーネントを用いて、デジタルアナログ変換の施された前記第1の加算信号及び前記第2の加算信号をそれぞれ対応する無線周波動作周波数に変調し、前記第1の加算信号及び前記第2の加算信号を前記デュアルバンド電力増幅器に入力するように構成される、
請求項1乃至4のいずれか一項に記載のトランスミッタ。 - 前記信号分離回路において、前記メモリに記憶された前記ルックアップテーブルは2次元ルックアップテーブル(2DLUT)であり、前記メモリには前記2DLUTが3つ存在し、前記第1のベースバンド信号モジュラス値及び前記第2のベースバンド信号モジュラス値は各2DLUTに入力され、前記2DLUTのうち2つがそれぞれ1つの乗算器に接続され、各乗算器の入力は各2DLUTの出力であり、
前記信号分離回路は、乗算器に接続されていない前記2DLUTの出力を第5の信号として用い、前記第5の信号を前記変調回路に直接出力し、前記DPDコンポーネントによって入力され且つ1つの信号に合成された前記第1のベースバンド信号及び前記第2のベースバンド信号を受信し、前記DPDコンポーネントの各々からの合成された各信号について、前記第1のベースバンド信号及び前記第2のベースバンド信号が合成された前記信号を、前記乗算器の1つに接続された前記2DLUTのうち1つの前記出力で乗算して、第6の信号及び第7の信号を取得し、前記第6の信号及び前記第7の信号を前記変調回路に出力するように構成される、
請求項1又は2に記載のトランスミッタ。 - 前記信号分離回路において、前記メモリに記憶された前記ルックアップテーブルは2次元ルックアップテーブル(2DLUT)であり、前記メモリには前記2DLUTが1つ存在し、前記第1のベースバンド信号モジュラス値及び第2のベースバンド信号モジュラス値は前記2DLUTに入力され、
前記信号分離回路は、前記2DLUTの出力を第5の信号として、前記第5の信号を前記変調回路に直接出力し、前記DPDコンポーネントによって入力され且つ1つの信号に合成された前記第1のベースバンド信号及び前記第2のベースバンド信号を受信し、前記DPDコンポーネントの各々からの合成された各信号について、前記乗算器を用いて、受信された前記第1のベースバンド信号モジュラス値及び前記第2のベースバンド信号モジュラス値を、前記第1のベースバンド信号及び前記第2のベースバンド信号が合成された前記信号で乗算して、第6の信号及び第7の信号を取得し、前記第6の信号及び前記第7の信号を前記変調回路に出力するように構成される、
請求項1又は2に記載のトランスミッタ。 - 前記モジュロ回路の後に設けられる加算器を更に備え、
前記加算器は、前記モジュロ回路の前記2つのモジュロユニットの出力を入力として用いて、前記モジュロ回路によって実行されたモジュロ処理の後に得られた前記第1のベースバンド信号モジュラス値と前記第2のベースバンド信号モジュラス値の和を取得するように構成され、
前記信号分離回路において、前記メモリに記憶された前記ルックアップテーブルは1次元ルックアップテーブル(1DLUT)であり、前記メモリには前記1DLUTが3つ存在し、前記加算器によって出力される前記第1のベースバンド信号モジュラス値と前記第2のベースバンド信号モジュラス値との和は各1DLUTに入力され、前記1DLUTのうち2つはそれぞれ1つの乗算器に接続され、各乗算器の入力は前記1DLUTの出力であり、
前記信号分離回路は、乗算器に接続されていない前記1DLUTの出力を第5の信号として用いて、前記第5の信号を前記変調回路に直接出力し、前記DPDコンポーネントによって入力され且つ1つの信号に合成された前記第1のベースバンド信号及び前記第2のベースバンド信号を受信し、前記DPDコンポーネントの各々からの合成された各信号について、前記第1のベースバンド信号及び前記第2のベースバンド信号が合成された前記信号を、前記乗算器に接続された前記1DLUTのうち1つの前記出力で乗算して、第6の信号及び第7の信号を取得し、前記第6の信号及び前記第7の信号を前記変調回路に出力するように構成される、
請求項2に記載のトランスミッタ。 - 前記モジュロ回路の後に設けられる加算器を更に備え、
前記加算器は、前記モジュロ回路の前記2つのモジュロユニットの出力を入力として用いて、前記モジュロ回路によって実行されたモジュロ処理の後に得られた前記ベースバンド信号モジュラス値の和を取得するように構成され、
前記信号分離回路において、前記メモリに記憶された前記ルックアップテーブルは1次元ルックアップテーブル(1DLUT)であり、前記メモリには前記1DLUTが1つ存在し、前記加算器によって出力される前記第1のベースバンド信号モジュラス値と前記第2のベースバンド信号モジュラス値との和は前記1DLUTに入力され、
前記信号分離回路は、前記1DLUTの出力を第5の信号として用いて、前記第5の信号を前記変調回路に直接出力し、前記DPDコンポーネントによって入力され且つ1つの信号に合成された前記第1のベースバンド信号及び前記第2のベースバンド信号を受信し、前記DPDコンポーネントの各々からの合成された各信号について、前記乗算器を用いて、受信された前記第1のベースバンド信号モジュラス値と前記第2のベースバンド信号モジュラス値の和を、前記第1のベースバンド信号及び前記第2のベースバンド信号が合成された前記信号で乗算して、第6の信号及び第7の信号を取得し、前記第6の信号及び前記第7の信号を前記変調回路に出力するように構成される、
請求項2に記載のトランスミッタ。 - 前記変調回路は、前記信号分離回路の前記乗算器に接続されていない、前記ルックアップテーブルを記憶する前記メモリの端に直接接続されたデジタルアナログコンバータ(DAC)と、前記信号分離回路の2つの乗算器の出力端にそれぞれ接続された2つのデジタルアップコンバージョン(DUC)コンポーネントと、前記2つのDUCに接続された加算器と、前記加算器に接続された別のDACと、前記別のDACに接続されたアナログ直角変調(AQM)コンポーネントとを含み、前記ルックアップテーブルは1DLUT又は2DLUTを含み、
前記変調回路は、前記信号分離回路に直接接続された前記DACによって出力されたエンベロープ信号を前記デュアルバンド電力増幅器に入力し、前記DUCコンポーネントを用いて前記第6の信号にアップコンバージョンを実行して前記第6の信号の周波数をfc_bandAに変更し、前記別のDUCコンポーネントを用いて前記第7の信号にアップコンバージョンを実行して前記第7の信号の周波数をfc_bandBに変更し、前記加算器を用いて、アップコンバージョン処理が施された前記第7の信号を、アップコンバージョン処理が施された前記第6の信号に加算して、第3の加算信号を取得し、前記加算器に接続された前記DACを用いて前記第3の加算信号にデジタルアナログ変換を実行し、前記AQMコンポーネントを用いて、変換後に得られた前記第3の加算信号を対応する無線周波動作周波数に変調し、前記第3の加算信号を前記デュアルバンド電力増幅器に入力するように構成される、
請求項6又は8に記載のトランスミッタ。
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