JP6450955B2 - Game machine - Google Patents
Game machine Download PDFInfo
- Publication number
- JP6450955B2 JP6450955B2 JP2017233635A JP2017233635A JP6450955B2 JP 6450955 B2 JP6450955 B2 JP 6450955B2 JP 2017233635 A JP2017233635 A JP 2017233635A JP 2017233635 A JP2017233635 A JP 2017233635A JP 6450955 B2 JP6450955 B2 JP 6450955B2
- Authority
- JP
- Japan
- Prior art keywords
- area
- register
- separate
- use area
- processing module
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Active
Links
- 238000012545 processing Methods 0.000 claims description 75
- 238000000034 method Methods 0.000 claims description 44
- 230000008569 process Effects 0.000 claims description 34
- 238000012360 testing method Methods 0.000 claims description 6
- 230000000694 effects Effects 0.000 description 18
- 238000003780 insertion Methods 0.000 description 9
- 230000037431 insertion Effects 0.000 description 9
- 230000002093 peripheral effect Effects 0.000 description 9
- 239000004973 liquid crystal related substance Substances 0.000 description 8
- 238000005034 decoration Methods 0.000 description 6
- 230000005856 abnormality Effects 0.000 description 4
- FFBHFFJDDLITSX-UHFFFAOYSA-N benzyl N-[2-hydroxy-4-(3-oxomorpholin-4-yl)phenyl]carbamate Chemical compound OC1=C(NC(=O)OCC2=CC=CC=C2)C=CC(=C1)N1CCOCC1=O FFBHFFJDDLITSX-UHFFFAOYSA-N 0.000 description 4
- 230000005284 excitation Effects 0.000 description 4
- 230000006870 function Effects 0.000 description 4
- 238000009987 spinning Methods 0.000 description 4
- 230000007704 transition Effects 0.000 description 4
- 230000005540 biological transmission Effects 0.000 description 3
- 238000004891 communication Methods 0.000 description 3
- 238000012790 confirmation Methods 0.000 description 3
- 238000001514 detection method Methods 0.000 description 3
- 238000004519 manufacturing process Methods 0.000 description 3
- 238000003860 storage Methods 0.000 description 3
- 238000004804 winding Methods 0.000 description 3
- 102100024061 Integrator complex subunit 1 Human genes 0.000 description 2
- 101710092857 Integrator complex subunit 1 Proteins 0.000 description 2
- 238000010586 diagram Methods 0.000 description 2
- 238000012986 modification Methods 0.000 description 2
- 230000004048 modification Effects 0.000 description 2
- 238000003825 pressing Methods 0.000 description 2
- 238000012546 transfer Methods 0.000 description 2
- 101710170230 Antimicrobial peptide 1 Proteins 0.000 description 1
- 101001092912 Haloferax volcanii (strain ATCC 29605 / DSM 3757 / JCM 8879 / NBRC 14742 / NCIMB 2012 / VKM B-1768 / DS2) Small archaeal modifier protein 1 Proteins 0.000 description 1
- 101000801088 Homo sapiens Transmembrane protein 201 Proteins 0.000 description 1
- XEEYBQQBJWHFJM-UHFFFAOYSA-N Iron Chemical group [Fe] XEEYBQQBJWHFJM-UHFFFAOYSA-N 0.000 description 1
- 102100033708 Transmembrane protein 201 Human genes 0.000 description 1
- 230000002159 abnormal effect Effects 0.000 description 1
- 230000009471 action Effects 0.000 description 1
- 239000013256 coordination polymer Substances 0.000 description 1
- 238000012937 correction Methods 0.000 description 1
- 239000013078 crystal Substances 0.000 description 1
- 238000011161 development Methods 0.000 description 1
- 238000009434 installation Methods 0.000 description 1
- 238000012544 monitoring process Methods 0.000 description 1
- 238000005457 optimization Methods 0.000 description 1
Images
Landscapes
- Pinball Game Machines (AREA)
- Slot Machines And Peripheral Devices (AREA)
Description
本発明は、主に、風俗営業等の規制及び業務の適正化等に関する法律第2条第1項に規定するぱちんこ屋の営業に供される回胴式遊技機、ぱちんこ遊技機等の遊技機に関する。
The present invention mainly relates to revolving game machines, pachinko game machines, and the like used for the business of pachinko shops specified in
特許文献1に、電源投入時に、電源断時にバックアップRAM領域に保存しておいたチェックサムに基づいてバックアップRAM領域に記憶されている最終記憶内容が正常であるか否かの確認を行い、正常である場合には最終記憶内容に基づいて制御状態を電源断前の状態に復旧させる制御を行う技術が記載されている。
チェックサムが電源断の前後で同一でなくなり異常となるのは、純粋な故障の他、不正行為が介在する場合もあり得、不正な改造その他の変更を防止する観点から、チェックサム確認処理等のセキュリティ関連処理は、遊技機規則で定める試験関連の信号処理等と同様、本来、主基板すなわち主制御装置の制御領域(4.5KB等)とデータ領域(3.0KB等)を合わせた規定容量内の使用領域とは別の記憶領域である別領域に記述でき、このようにすれば、使用領域内に記述できる遊技制御処理に充てる容量を増やすことができて好ましいと考えられる。特に、これまで専ら周辺制御装置で決定していた押し順役等についての正解の押し順等を知らせるアシストタイムATの作動を、主制御装置で決定するメインAT化への移行に伴い、使用領域内のより一層の節約が求められる。 The checksum is not the same before and after the power is cut off and it becomes abnormal. In addition to a pure failure, there may be cases where fraudulent acts are involved. Checksum check processing, etc. from the viewpoint of preventing unauthorized modification and other changes The security-related processing is essentially a regulation that combines the control area (4.5KB, etc.) and the data area (3.0KB, etc.) of the main board, that is, the main control device, in the same way as the test-related signal processing, etc. stipulated in the gaming machine rules. It can be described in another area, which is a storage area different from the used area in the capacity, and it is considered preferable to increase the capacity for game control processing that can be described in the used area. In particular, with the shift to the main AT, which is determined by the main control device, the operation of the assist time AT that informs the correct push order of the push order that has been exclusively determined by the peripheral control device so far Further savings are required.
本発明の課題は、使用領域と別領域の役割分担の明確さ及び公正さを担保しながら、遊技の進行を制御する遊技制御処理以外の、セキュリティ関連や試験関連等の、本来の遊技制御を適正化等する目的のために設ける別処理モジュールを適切に記述でき、使用領域内の遊技制御処理に充てる容量を増やすことができる遊技機を提供することにある。 The object of the present invention is to perform original game control, such as security-related and test-related, other than the game control processing that controls the progress of the game while ensuring the clarity and fairness of the division of roles between the use area and the other area. It is an object of the present invention to provide a gaming machine that can appropriately describe another processing module provided for the purpose of optimization, etc., and can increase the capacity allocated to the game control processing in the use area.
図面の符号を括弧内に付記して例示する。
遊技の進行を制御する遊技制御処理を記述する所定の容量内の使用領域と、前記遊技制
御処理を記述せず、セキュリティに関する処理を行う別処理モジュール(例えば、E_S
AMP1)を記述する別領域とを区分したメモリー(ROM,RWM)をもつメインCP
Uを備える遊技機を前提とする。
The reference numerals of the drawings are illustrated in parentheses for illustration.
A use area within a predetermined capacity that describes a game control process for controlling the progress of the game, and another processing module that does not describe the game control process and performs a process related to security (for example, E_S
Main CP with memory (ROM, RWM) separated from other area describing AMP1)
Assume a gaming machine with U.
ここで、別処理モジュールは、セキュリティに関する処理に代えて、または、加えて試験に関する処理を行ってもよい。 Here, the separate processing module may perform a process related to the test instead of or in addition to the security related process.
以上の遊技機において、
前記使用領域には、割込みを禁止した後、前記別領域に記述した前記別処理モジュール(E_SAMP1)を呼び出して実行させる処理手続を記述していると共に、
前記別領域には、前記メインCPUの内部レジスタにおける表レジスタ(AF,BC,DE,HLの各レジスタ)と裏レジスタ(AF’,BC’,DE’,HL’の各レジスタ)とを交換した後に前記別処理モジュール(E_SAMP1)を実行し、前記別処理モジュールの実行後に前記裏レジスタ(AF’,BC’,DE’,HL’の各レジスタ)と前記表レジスタ(AF,BC,DE,HLの各レジスタ)とを交換する処理手続を記述しており、
前記別領域から前記使用領域に復帰した際には割込みを許可する仕様にしており、
前記使用領域では前記裏レジスタは未使用で、かつ、前記使用領域での割込み処理では
、前記表レジスタを前記使用領域のスタック領域に退避させて保護する仕様にしている。
なお、前記内部レジスタには、スタックポインタSP及びプログラムカウンタPCは含まない。また、Rレジスタ(リフレッシュレジスタ)は、保護の必要がないことから除外している。さらに、別処理モジュールの実行前後で、Qレジスタ、Iレジスタ、IXレジスタ,IYレジスタは不変を前提にしている。
In the above gaming machines,
The use area describes a processing procedure for calling and executing the separate processing module (E_SAMP1) described in the separate area after prohibiting interruption.
In the separate area, the front register (AF, BC, DE, and HL registers) and the back register (AF ′, BC ′, DE ′, and HL ′ registers) in the internal registers of the main CPU are replaced. The separate processing module (E_SAMP1) is executed later, and the back register (AF ′, BC ′, DE ′, HL ′ registers) and the front register (AF, BC, DE, HL) are executed after the execution of the separate processing module. Of each register) and the processing procedure to exchange
When returning from the separate area to the use area, it is designed to allow interrupts.
The back register is not used in the used area, and in the interrupt processing in the used area, the front register is saved in the stack area of the used area for protection.
The internal register does not include the stack pointer SP and the program counter PC. The R register (refresh register) is excluded because it does not need to be protected. Furthermore, the Q register, I register, IX register, and IY register are assumed to be unchanged before and after the execution of another processing module.
これにより、別領域に記述した別処理モジュールの実行中は、割込みが禁止されるため、別領域から使用領域のデータを書き換えることはない。しかも、別処理モジュールを実行する前に、内部レジスタにおける表レジスタと裏レジスタとを交換して、別処理モジュール呼び出し前の表レジスタの内容(データ)を裏レジスタに退避して保護し、別処理モジュールの実行後に、裏レジスタと表レジスタとを交換して、裏レジスタに退避した内容を表レジスタに復帰させるため、別処理モジュールの実行により表レジスタの内容が一時的に破壊されても、別処理モジュールの実行前後で使用領域における表レジスタの同一性は保たれる。したがって、別処理モジュールの実行により、使用領域の遊技制御処理が影響されることはなく、使用領域と別領域の役割分担の明確さ及び公正さを担保できながら、遊技制御処理以外の別処理モジュールを別領域に適切に記述でき、使用領域内の遊技制御処理に充てる容量を適切に増やすことができる。しかも、使用領域では、割込みを禁止した後、別処理モジュールを呼び出す命令のみを記述すればよいことから、使用領域の容量を大きく節約できる。
また、前記使用領域では前記裏レジスタは未使用で、かつ、前記使用領域での割込み処
理では、前記表レジスタを前記使用領域のスタック領域に退避させて保護する仕様にして
いる。これにより、別領域において、裏レジスタを用いて表レジスタの内容を保護するこ
とができ、使用領域から別領域の別処理モジュールを呼び出す際のレジスタの保護を、使
用領域の容量を食うことなく、適切に行える。
As a result, interrupts are prohibited during execution of another processing module described in another area, so that data in the used area is not rewritten from another area. In addition, before executing the separate processing module, the front register and back register in the internal register are exchanged, and the contents (data) of the front register before calling the separate processing module are saved and protected in the back register. After executing the module, the back register and the front register are exchanged, and the contents saved in the back register are restored to the front register. Therefore, even if the contents of the front register are temporarily destroyed by executing another processing module, The identity of the table register in the used area is maintained before and after execution of the processing module. Therefore, the execution of the separate processing module does not affect the game control process in the used area, and the separate processing module other than the game control process can ensure the clarity and fairness of the division of roles between the used area and the separate area. Can be appropriately described in another area, and the capacity for game control processing in the use area can be increased appropriately. In addition, since it is sufficient to describe only an instruction for calling another processing module after prohibiting an interrupt in the use area, the capacity of the use area can be greatly saved.
Further, the back register is not used in the used area, and in the interrupt processing in the used area, the front register is saved in the stack area of the used area for protection. As a result, the contents of the front register can be protected by using the back register in another area, and the protection of the register when calling another processing module in the other area from the used area without consuming the capacity of the used area, Can be done properly.
以上のもので、前記別領域に、前記使用領域への復帰直前に割込みを許可する処理手続を記述している。
これにより、使用領域に割込みを許可する処理手続を記述する場合に比べて、使用領域の容量をより一層少なくすることができる。
The processing procedure for permitting an interrupt immediately before returning to the use area is described in the separate area.
Thereby, the capacity of the used area can be further reduced as compared with the case where a processing procedure for permitting an interrupt to the used area is described.
図1に、本発明を適用する回胴式遊技機を示す。回胴式遊技機は、一般にパチスロと呼ばれ、遊技機規則、すなわち平成16年(2004年)1月30日の国家公安委員会規則第1での改正を経た昭和60年(1985年)2月12日の国家公安委員会規則第4「遊技機の認定及び型式の検定等に関する規則」に適合するスロットマシンである。以下、用語及びその技術内容は現行の遊技機規則に準ずる。 FIG. 1 shows a swivel game machine to which the present invention is applied. The swivel type gaming machine is generally called a pachislot machine. In 1985, after revisions to the gaming machine rules, that is, the National Public Safety Commission Regulation No. 1 on January 30, 2004 (2004), 2 It is a slot machine that conforms to the National Public Safety Commission Regulation No. 4 “Rules for Game Machine Approval and Type Approval” on May 12. Hereinafter, terms and their technical contents are in accordance with the existing game machine rules.
遊技機筐体8Bは、リアキャビネット8R及びキャビネット枠8W、扉状の上下フロントキャビネット8E,8Fを備える。上フロントキャビネット8Eには、動画や所定の情報をフルカラーで映し出す演出表示装置7を構成する液晶表示装置70、リールパネル8、上装飾ランプ81,左装飾ランプ82,右装飾ランプ83,液晶表示装置70の角に臨む4つのアクセント装飾ランプ84,リールパネル8の上・左・右に臨むパネル装飾ランプ85を備える。下フロントキャビネット8Fには、操作部8S、腰部パネル8P、左下装飾ランプ86、右下装飾ランプ87を備える。81〜87の総称として、装飾ランプ88という。91〜94はBGMや各種効果音等を出音するスピーカ、8Mはメダル払出口、8Gはメダル受皿、8Tは灰皿である。なお、左右は、遊技機に対面した遊技者目線における左右を意味する。以下、同様である。
The
リールパネル8の透明な表示窓80の内部には、複数の可変表示要素となる左リール1L、中リール1C、右リール1Rを備え、それぞれのリール帯10L,10C,10Rの外周に全部で21コマ又は20コマ配列した図柄のうち連続する3コマを窓越しに臨ませている。定常回転時を含む通常の正転時、各図柄は上から下にスクロールする。表示窓80の窓越しに表示される複数列及び複数段の図柄表示位置、すなわち、左・中・右リール1L,1C,1Rの3列とそれぞれの上・中・下の3段との、列と段で特定される3×3=9個の図柄表示位置において、例えば中段ライン(左中−中中−右中)のみを有効ラインとしている。なお、他のラインを含めて2本以上のラインを有効ラインとしてもよい。
The
操作部8Sには、遊技媒体たる遊技メダルを投入するメダル投入口2、遊技者操作を演出に関与させるプッシュボタンPBとダイヤルDAをもつジョグダイヤルJD、貯留装置の電磁的記録すなわちクレジットから一回の遊技に必要な規定数例えば3枚(3BET)の掛けメダルを引き落とすベットボタン3、クレジットに残る数のメダルをメダル受皿8Gに落す精算ボタン4、各リール1L,1C,1Rの可変表示(回転)を開始させるスタートスイッチとなるスタートレバー5、各リール1L,1C,1Rに対応して設け、対応するリールの可変表示(回転)を個別に停止させるストップスイッチとなる左ストップボタン6L、中ストップボタン6C、右ストップボタン6R、メダル投入口2下流のメダル詰り時に押すメダル返却ボタン20、ドアキー穴8Kを備える。
The
リールパネル8には、現時のクレジット数を表示させるクレジット表示器DL1、入賞による払出メダル枚数を表示させるペイアウト表示器DL2、充当掛けメダルが1枚、2枚、3枚になる毎に点灯させる1〜3枚ランプEL1〜3、掛けメダルが受付可能なとき点灯させるベットランプELb、スタートレバー5による始動操作が可能なとき点灯させるスタートランプELs、再遊技に係る図柄の組合せが表示されたとき点灯させるリプレイランプELrを含む遊技基本ランプ類30を備える。また、ストップボタン6L,6C,6Rを押す順番に正解した時に投入メダル数を超える高配当のメダルを払出す押し順小役についての正解の押し順や狙うべき図柄を報知させるアシストタイムATの作動中に、液晶表示装置70でのナビ報知と共に点灯させる左停止ランプ71、中停止ランプ72、右停止ランプ73を含む演出表示装置70を構成する遊技演出ランプ類700を備える。
The
ベットランプELbの点灯時、掛けメダルが0の状態でメダル投入口2からメダル1枚を入れると1枚ランプEL1が点灯し、さらに1枚入れると2枚ランプEL2が点灯し、さらに1枚入れると3枚ランプEL3が点灯し、規定数に達する。規定数の掛けメダルになると、スタートランプELsが点灯し、スタートレバー5による始動操作が可能になる。規定数に達した状態からスタートレバー5を操作しないでメダル投入口2にさらにメダルを入れると、クレジット表示器DL1のカウンタを進め、所定上限数である50枚まで貯留可能となる。入賞により払出されたメダルも50枚まではクレジットに加算され、50枚を超えて払出されたメダルは、メダル払出口8Mからメダル受皿8Gに受止められる。
When the bet lamp ELb is lit, if one medal is inserted from the
図2に示すように、遊技機筐体8Bの内部に組込む制御装置CNは、遊技の進行を管理し、内部抽せん、入賞によるメダルの払出し、再遊技の作動、役物の作動、アシストタイムATの作動等の遊技者利益に関係する主遊技制御を実行させる所謂メイン側と呼ばれる遊技機規則でいう主基板に対応する主制御装置MCと、この主制御装置MCから一方向性通信仕様に従って送信する情報を受信して主制御装置MCでの決定事項に基づいて演出制御を実行させる所謂サブ側と呼ばれる遊技機規則でいう周辺基板に対応する周辺制御装置SCとを含む。一方向性通信仕様とは、主基板に関して遊技機規則で規定する「周辺基板が送信する信号を受信することができるものでないこと」を満たす通信仕様をいう。
As shown in FIG. 2, the control device CN incorporated in the inside of the
主制御装置MCは、読み出し専用のリードオンリーメモリROM及び読み書き可能なリードライトメモリーRWMを内蔵したZ80互換チップから成る8ビットのメインCPUを備え、例えば12MHzのシステムクロック動作環境下で使用している。メインCPUは、基本的なZ80仕様に所定の遊技機用拡張仕様を適用している。 The main controller MC includes an 8-bit main CPU composed of a Z80 compatible chip incorporating a read-only read-only memory ROM and a readable / writable read / write memory RWM, and is used in a system clock operating environment of 12 MHz, for example. . The main CPU applies a predetermined extended specification for gaming machines to the basic Z80 specification.
メインCPUの入力ポートI1には、各リール1L,1C,1Rのインデックスセンサ11L,11C,11R(IDs)、各ストップボタン6L,6C,6R、ベットボタン3、精算ボタン4、スタートレバー5、メダル投入口2の下流に設ける投入メダルセンサ21、遊技機筐体8Bに内蔵するメダル払出装置HPの出口に設ける払出メダルセンサ23の各信号を入力している。出力ポートO1から、各ストップボタン6L,6C,6Rの内蔵LED61,62,63を、モータドライバ回路Dr1を介して各リール1L,1C,1Rに駆動軸SHを結合させる各ステッピングモータ12L,12C,12R(SM)を、LEDドライバ回路Dr2を介して遊技基本ランプ類30を、ソレノイドドライバ回路Dr3を介してリール始動後に追投入されるメダルをメダル受皿8Gに落すメダルブロッカー22を、モータドライバ回路Dr4を介してメダル払出装置HPのメダル払出モータ24を各制御している。
The input port I1 of the main CPU includes
各インデックスセンサIDsは、各リールの内側に取付ける半円帯状のインデックスID(1Li,1Ci,1Ri)のオンエッジとオフエッジとを半周毎に検出し、最先のオンエッジ又はオフエッジの検出が全リールについてされた後、ストップボタン6L,6C,6Rの受付を可能にする。各ステッピングモータSMは、鉄芯外周に多数のロータ小歯をもつ永久磁石内蔵式のロータRmと、磁極内周に複数のステータ小歯をもつ複数組の磁極にA相、B相、C相(Aバー相(Aの反転相))、D相(Bバー相(Bの反転相))の巻線を巻回したステータSwとを有し、定常回転時、一の巻線をオンにする1相励磁と、一の巻線及び隣接する他の巻線をオンにする2相励磁とを、一割込み時間例えばt=1.49ms毎に交互に繰返す1−2相励磁により、励磁パルスの1ステップ更新により半ステップ角(2ステップ更新により1ステップ角)ずつ変位させ、504のステップ更新で一回転させる。また、励磁パルスのステップ更新方向を変更することにより正転と逆転とを可能にしている。
Each index sensor IDs detects an on-edge and an off-edge of a semicircular belt-shaped index ID (1Li, 1Ci, 1Ri) attached to the inside of each reel every half circle, and the first on-edge or off-edge is detected for all reels. After that, the
メインCPUのROM上には、スタートレバー5の操作を契機に、ハード又はソフトウェア上で高速更新する例えば2バイトカウンタから抽出する乱数値が、その取り得る0〜65535の範囲内において役に対応づけて区分した何れの当せんエリアに属するかに応じて、入賞、再遊技の作動、役物の作動に係る何れかの当せん役又は不当せんを決定する内部抽せん手段K、スタートレバー5の操作後で且つ前遊技の開始から4.1秒経過後に全リールを正転側に加速処理して定常回転速度に到達させる回胴回転装置制御手段V1と各リールを対応するストップボタンの操作により個別に停止させて有効ラインに当せん役に対応した図柄の組合せの表示を許容させる回転停止装置制御手段V2とを含むリール制御手段V、遊技結果が入賞なら所定配当数のメダルを払出すメダル払出手段M、遊技結果が再遊技の作動なら次ゲームの掛けメダルを同一規定数で自動投入するメダル自動投入手段N、遊技結果が役物作動中等への移行を伴うのなら遊技状態を移行させる遊技状態移行手段J、所定のフリーズ抽せんにより当せん役別に定めた所定確率により各リールを逆回転等させる所定の回胴演出の当否を決定するフリーズ抽せん手段W、その当せんに係る回胴演出を実行させる回胴演出実行手段Gを設けている。
On the ROM of the main CPU, a random number value extracted from, for example, a 2-byte counter that is updated at high speed on hardware or software when the
また、メインCPUのROM上には、アシストタイムATの作動を内部当せん役等と関連付けた所定作動条件下で決定するAT作動決定手段H1、アシストタイムATの作動を延長させることとなる継続ゲーム数等の上乗せを内部当せん役等と関連付けた所定上乗せ条件下で決定するAT上乗せ決定手段H2、アシストタイムATの作動決定から作動終了までを管理するAT継続管理手段H3、押し順小役についての正解押し順等のAT指示情報を主制御装置MCで管理するペイアウト表示器DL2の表示機能を借りて構築するメインモニタMAに出力させると共に周辺制御装置SCで管理する液晶表示装置70等に出力させるAT指示情報出力手段H4を設けている。
Further, on the ROM of the main CPU, AT operation determining means H1 for determining the operation of the assist time AT under a predetermined operation condition associated with the internal winning combination, etc., the number of continuous games that will extend the operation of the assist time AT AT addition determining means H2 for determining the addition of the like, etc., under the predetermined additional condition associated with the internal winning combination, AT continuing management means H3 for managing the operation of the assist time AT from the end of the operation to the end of the operation, correct answer for the push order small combination The AT instruction information such as the pressing order is output to the main monitor MA constructed by borrowing the display function of the payout display DL2 managed by the main control device MC, and is also output to the liquid
周辺制御装置SCは、外付けする読み出し専用のリードオンリーメモリROMと、内蔵及び外付けする読み書き可能なリードライトメモリーRWMをもつ32ビットRISC(Reduced Instruction Set Computer)チップマイコンから成るサブCPUを備え、例えば約200MHzのシステムクロック動作環境下で使用している。サブCPUは、リアルタイムオペレーティングシステムRTOS(Real−Time Operating System)の管理下、演出表示や音声に関するタスクに割当てるCPU時間、優先順位を制御することにより、適切且つ効率的なタスクの並行処理を可能にしている。 The peripheral control device SC includes a sub CPU composed of a read-only read-only memory ROM attached externally and a 32-bit RISC (Reduced Instruction Set Computer) chip microcomputer having a built-in and external read / write memory RWM. For example, it is used under a system clock operating environment of about 200 MHz. Under the control of the real-time operating system RTOS (Real-Time Operating System), the sub CPU enables appropriate and efficient parallel processing of tasks by controlling the CPU time and priority assigned to tasks related to presentation display and audio. ing.
サブCPUの入力ポートI2には、主制御装置MCからの送信情報、ジョグダイヤルJDの信号を入力している。主制御装置MCからの送信情報すなわち周辺制御装置NCの受信情報には、メイン側初期化完了情報、ベットボタン3の操作情報を含むメダル投入情報、スタートレバー5の操作情報を含むリール始動情報、内部抽せんによる当せんフラグ情報、ストップボタン6L,6C,6Rの操作情報、遊技結果情報、遊技状態情報、フリーズ及び回胴演出情報、AT作動情報、AT指示情報、AT上乗せ情報、AT終了情報、エラー情報等、主制御装置MCで検出し又は決定若しくは実行する各種情報が含まれる。
Transmission information from the main controller MC and a signal of the jog dial JD are input to the input port I2 of the sub CPU. The transmission information from the main control device MC, that is, the reception information of the peripheral control device NC includes main-side initialization completion information, medal insertion information including operation information of the bet button 3, reel start information including operation information of the
サブCPUは、I2Cのマイクロコントローラとしても機能し、CPU内蔵I2CのシリアルクロックラインSCLとシリアルデータラインSDAに、リアルタイムクロックRTCのシリアルクロックラインSCLとシリアルデータラインSDAを接続している。シリアルクロックラインSCLとシリアルデータラインSDAとは、それぞれ、抵抗rpを介してサブCPUの主動作電位vdd=3.3Vにプルアップしている。 The sub CPU also functions as an I2C microcontroller, and connects the serial clock line SCL and serial data line SDA of the real-time clock RTC to the serial clock line SCL and serial data line SDA of the CPU built-in I2C. The serial clock line SCL and the serial data line SDA are each pulled up to the main operating potential vdd = 3.3V of the sub CPU via the resistor rp.
リアルタイムクロックRTCの時刻データは、遊技機メーカー等により、生産時に、日本標準或は国際標準の時計電波に基づく正確な現在時刻により、書き込み時の時刻例えば2015年12月25日金曜日15時30分45秒等と書かれる。この後、リアルタイムクロックRTCの内蔵水晶振動子による基準クロックに基づいて継続的に時刻更新がされる。一月31日の大の月、一月30日又は28日の小の月、4年に一回の2月29日のうるう年の補正も自動的にされる。リアルタイムクロックRTCの時計機能は、遊技機の電源オンオフに拘らず、二次電池等のバックアップ電源BTにより例えば10年以上の長期間にわたり継続的に維持される。 The time data of the real-time clock RTC is written by a gaming machine manufacturer, etc. at the time of production based on the current time based on the Japanese standard or international standard clock radio wave, for example, Friday, December 25, 2015 at 15:30 It is written as 45 seconds. Thereafter, the time is continuously updated based on the reference clock by the built-in crystal resonator of the real-time clock RTC. The correction of the leap year on February 29, once every four years, is also automatically done, the major month of January 31, the minor month of January 30 or 28. The clock function of the real-time clock RTC is continuously maintained over a long period of time, for example, 10 years or longer by a backup power source BT such as a secondary battery, regardless of whether the gaming machine is powered on or off.
サブCPUのROM上には、主制御装置MCからの受信情報に基づいて、液晶表示装置70等にAT指示情報出力手段H4から出力するAT指示情報に従ったナビ例えば正解押し順が「左中右」ならストップボタン位置に対応させて「123」等を表示させるナビ手段X1、ナビ手段X1の表示に連動してスピーカ91〜94から操作すべきストップボタンが左か中か右かを音声で知らせる音声ナビ手段X2、遊技状態、回胴演出、AT期間等に応じて液晶表示装置70に映し出す動画展開等を変更表示させる演出表示手段Y1、これに連動してスピーカ91〜94から効果音やBGMを出音させる効果音出力手段Y2を設けている。
On the ROM of the sub CPU, the navigation in accordance with the AT instruction information output from the AT instruction information output means H4 to the liquid
サブCPUのCPU内蔵バスにはI2CコントローラI2Cnを接続しており、このI2CコントローラI2CnのシリアルクロックラインSCLとシリアルデータラインSDAを、表示窓80に臨む9つの図柄をリール帯10L,10C,10Rの背面から照明するリールバックランプBL1〜9を制御するLDEドライバDr5のシリアルクロックラインSCLとシリアルデータラインSDAに接続し、装飾ランプ88を制御するLEDドライバDr6のシリアルクロックラインSCLとシリアルデータラインSDAに接続し、遊技演出ランプ類700を制御するLEDドライバDr7のシリアルクロックラインSCLとシリアルデータラインSDAに接続している。これらLED関連のI2Cデバイスのタスクは、リアルタイムクロックRTCよりも優先順位を高くしている。なお、シリアルクロックラインSCLとシリアルデータラインSDAとは、それぞれ、抵抗rpを介してサブCPUの主動作電位vdd=3.3Vにプルアップしている。液晶表示装置70は、VDP(Video Display Processor)、出力ポートO2、LCDドライバ回路Dr8を介して制御している。スピーカ91〜94からの音声は、音声IC、出力ポートO2、パワーアンプ回路Dr9を介して制御している。
The I2C controller I2Cn is connected to the CPU built-in bus of the sub CPU, and the nine clocks facing the
図3に、主制御装置MCのメインCPUのROM及びRWMのメモリーマップを示す。内部抽せん手段K、リール制御手段V、メダル払出手段M、メダル自動投入手段N、遊技状態移行手段J、フリーズ抽せん手段W、回胴演出実行手段G、AT作動決定手段H1、AT上乗せ決定手段H2、AT継続管理手段H3、AT指示情報出力手段H4を各機能させ、遊技の進行を制御する遊技制御処理のプログラム命令コードは、使用領域における規定容量(制御領域4.5KB)内のアドレス0000H〜11FFHに記述し、同遊技制御処理のプログラムデータは、使用領域における規定容量(データ領域3.0KB)内のアドレス1200H〜1DF3Hに記述している。
FIG. 3 shows a memory map of the ROM and RWM of the main CPU of the main controller MC. Internal lottery means K, reel control means V, medal payout means M, medal automatic insertion means N, game state transition means J, freeze lottery means W, spinning drum effect execution means G, AT operation determination means H1, AT addition determination means H2 The program instruction code of the game control process for controlling the progress of the game by causing the AT continuation management means H3 and the AT instruction information output means H4 to function is the
未使用領域、コメント領域の後ろ、アドレス1F00H〜2FBFHに、不正な改造その他の変更を防止する観点からのセキュリティ関連処理及び遊技機規則で定める試験関連信号処理等を担う、遊技制御処理以外の別処理モジュールのプログラム命令コード及びデータを記述している。プログラム管理エリア、ハード的に領域のないエリアの後ろ、アドレスF000H〜F1FFHの512バイトに使用領域のRWMを、アドレスF200H〜F3FFHの512バイトに別領域のRWMを設けている。F400H〜FFFFHはハード的に領域のないエリアである。なお、使用領域における遊技制御処理のプログラム命令コード及び別領域における別処理モジュールのプログラム命令コードは、アセンブラ言語で記述している。 Other than the game control processing, responsible for security related processing from the viewpoint of preventing unauthorized modification and other changes to the unused area, the comment area, and addresses 1F00H to 2FBFH, and test related signal processing defined by the gaming machine rules The program instruction code and data of the processing module are described. A program management area, an area having no hardware area, an RWM of a use area is provided in 512 bytes of addresses F000H to F1FFH, and an RWM of another area is provided in 512 bytes of addresses F200H to F3FFH. F400H to FFFFH are areas having no hardware area. Note that the program instruction code of the game control process in the use area and the program instruction code of another process module in another area are described in an assembler language.
使用領域のRWMのうち、F000H〜F13FHに使用領域のプログラムに係るタイマ、カウンタ、フラグ等のワーク領域を確保し、未使用領域の後ろ、F1C0H〜F1FFHに使用領域のスタック領域を確保している。 Of the RWM in the used area, work areas such as timers, counters, and flags related to the used area program are secured in F000H to F13FH, and the used area stack area is secured in the F1C0H to F1FFH after the unused area. .
別領域のRWMのうち、F200H〜F20FHの未使用領域の後ろ、F210H〜F22FHに別領域のプログラムに係るタイマ、カウンタ、フラグ等のワーク領域を確保し、F230H〜F246Hに別領域のスタック領域を確保している。F247H〜F3FFHは未使用、F400H〜FFFFHはハード的に領域のないエリアである。 Among the RWMs in another area, a work area such as a timer, a counter, a flag, etc. related to a program in another area is secured in F210H to F22FH after an unused area in F200H to F20FH, and a stack area in another area is allocated in F230H to F246H. Secured. F247H to F3FFH are unused, and F400H to FFFFH are areas where there is no area in terms of hardware.
図4に示すように、使用領域に記述する遊技制御処理は、一割込み時間例えばt=1.49ms毎に実行する割込み処理INT1、上記各手段K〜H4を統括管理し、一遊技を進行させる遊技メイン処理、別領域に記述する複数の別処理モジュールを構成する別領域処理1,2・・・をそれぞれ呼び出す複数の別領域呼び出し処理1,2・・・を含む。図示は省略したが、使用領域には、電源投入時の初期化処理、電断時のバックアップ処理等も記述している。なお、本実施形態では、外部割込み、マスク不能な割込みNMIは未使用である。
As shown in FIG. 4, the game control process described in the use area is an interrupt process INT1 executed every interrupt time, for example, every t = 1.49 ms, and the above-mentioned means K to H4 are collectively managed to advance one game. The game main process, and a plurality of different area calling processes 1, 2,... For calling the
使用領域で使用するメインCPUの内部レジスタは、次のとおりである。
1)Qレジスタ;遊技機用拡張仕様の8ビット専用レジスタ。キューレジスタと呼ぶ。
上位はF0H固定で、F000H〜F0FFHのRWMアクセスに使う。
2)Iレジスタ;割込み先アドレスの上位8ビットを記憶する専用レジスタ。
3)Aレジスタ;演算処理やデータ転送に使う8ビットのアキュムレータ。
The internal registers of the main CPU used in the usage area are as follows.
1) Q register; 8-bit dedicated register with extended specifications for gaming machines. This is called a queue register.
The upper part is fixed to F0H and used for RWM access from F000H to F0FFH.
2) I register: A dedicated register that stores the upper 8 bits of the interrupt destination address.
3) A register; 8-bit accumulator used for arithmetic processing and data transfer.
4)Fレジスタ;各種演算結果を保持する8ビットのフラグレジスタ。
s(最上位ビット)は、演算結果が負のとき1にセットされるサインフラグ。
zは、演算の結果、全ビットが0のとき1にセットされるゼロフラグ。
tzは、データ転送命令(LD;ロード)の実行により、全ビットが0のとき1にセットされる(値の変わる)遊技機用拡張仕様の特定ビットフラグ。ティーゼットフラグと呼ぶ。第2ゼロフラグともいう。
hは、プログラマーが関与できないハーフキャリーフラグ。
*は、未定義。
p/vは、パリティオーバーフローフラグ。
nは、プログラマーが関与できない加減算フラグ。
cは、演算の結果、桁上げ又はボロー発生時に1がセットされるキャリーフラグ。
なお、Fレジスタは、AレジスタとレジスタペアAFを構成する。
4) F register: 8-bit flag register that holds the results of various operations.
s (most significant bit) is a sign flag that is set to 1 when the operation result is negative.
z is a zero flag that is set to 1 when all bits are 0 as a result of operation.
tz is a specific bit flag of an extended specification for gaming machines that is set to 1 (changes in value) when all bits are 0 by execution of a data transfer instruction (LD; load). Called the Tizet flag. Also called a second zero flag.
h is a half-carry flag that a programmer cannot be involved in.
* Is undefined.
p / v is a parity overflow flag.
n is an addition / subtraction flag that the programmer cannot participate in.
c is a carry flag that is set to 1 when a carry or borrow occurs as a result of an operation.
Note that the F register constitutes an A register and a register pair AF.
5)B,C,D,E,H,Lレジスタ;8ビットの汎用レジスタ。
BC,DE,HLの16ビットのレジスタペアとなる。
6)IX,IYレジスタ;インデックスアドレッシング用16ビット専用レジスタ。
IXh,IYhは上位8ビット,IXl,IYlは下位8ビットを示す。
7)A’,F’,B’,C’,D’,E’,H’,L’レジスタ;
A,F,B,C,D,E,H,Lの表レジスタと交換命令によりデータ交換可能な裏レジスタであり、A’とF’でAF’、B’とC’でBC’、D’とE’でDE’、H’とL’でHL’の、それぞれペアの裏レジスタとなる。
5) B, C, D, E, H, L registers; 8-bit general purpose registers.
It becomes a 16-bit register pair of BC, DE, and HL.
6) IX and IY registers; 16-bit dedicated registers for index addressing.
IXh and IYh represent the upper 8 bits, and IXl and IYl represent the lower 8 bits.
7) A ′, F ′, B ′, C ′, D ′, E ′, H ′, L ′ registers;
A, F, B, C, D, E, H, and L are back registers that can exchange data by an exchange command. A 'and F' are AF ', B' and C 'are BC', D ''AndE' are the back registers of the pair, DE ', H' and L 'are HL', respectively.
使用領域では裏レジスタは未使用であり、使用領域の割込み処理INT1では、表レジスタAF,BC,DE,HLを、「PUSH GPR」という遊技機用拡張仕様で定義した命令により、一括して、使用領域のスタック領域F1C0H〜F1FFHに退避して保護し(ステップt1)、各種割込み処理を実行する(ステップt2)。各種割込み処理は、入力ポートI1に対する読込み処理、ステッピングモータSMのモーター制御処理、出力ポートO1への出力管理処理、周辺制御装置SCへのサブコマンド送信処理、各種センサの監視処理、各種タイマの更新処理、遊技機設置島側への外部信号出力制御処理等を含む。各種割込み処理の実行後、「POP GPR」という遊技機用拡張仕様で定義した命令により、一括して、使用領域のスタック領域に退避した表レジスタHL,DE,BC,AFを復帰させ(ステップt3)、割込みを許可して(ステップt4)、割込み処理からリターンする(ステップt5)。 In the use area, the back register is unused, and in the use area interrupt processing INT1, the table registers AF, BC, DE, and HL are collectively processed by an instruction defined in the extended specification for gaming machines called “PUSH GPR”. It saves and protects the stack areas F1C0H to F1FFH in the used area (step t1), and executes various interrupt processes (step t2). Various interrupt processing includes reading processing for the input port I1, motor control processing for the stepping motor SM, output management processing for the output port O1, subcommand transmission processing to the peripheral control device SC, monitoring processing for various sensors, and update of various timers. Processing, external signal output control processing to the game machine installation island side, etc. are included. After executing the various interrupt processes, the table registers HL, DE, BC, and AF that have been saved in the stack area of the used area are collectively restored by an instruction defined in the extended specification for gaming machines called “POP GPR” (step t3 ), The interrupt is permitted (step t4), and the process returns from the interrupt process (step t5).
別領域呼び出し処理1のSAMP1では、割込みを禁止した後(ステップS1)、「CALL E_SAMP1」により別領域処理1を呼び出して実行させる(ステップS2)。CALL命令の実行により、使用領域のスタック領域には、戻り先番地つまりCALL命令の次のアドレスの上位8ビットと下位8ビットとが記録される。
In SAMP1 of another
別領域に記述する別領域処理1のE_SAMP1では、交換命令EXによりAFとAF’を入れ替え(ステップS3)、交換命令EXXによりBCとBC’を、DEとDE’を、HLとHL’をそれぞれ入れ替え(ステップS4)、所定の別領域処理1を実行する(ステップS5)。この別領域処理1では、メダル投入時の逆流・滞留・異物検知処理、メダル払出時の逆流・滞留・異物検知処理、前扉開放検知処理、内部抽せん用乱数の異常確認処理、内部抽せんの当せん確率の組合せである設定値の異常確認処理、RWM異常確認処理、バックアップ異常確認処理等のセキュリティ関連処理の何れか一の処理又は二以上の組合せ処理を実行する。別領域処理2以降で、別領域処理1以外のセキュリティ関連処理、あるいは、遊技機規則で定める試験関連信号出力処理が記述される。別領域処理2,・・・は、使用領域に記述する別領域呼び出し処理2,・・・からそれぞれ呼び出される。
In E_SAMP1 of another
ステップS5の別領域処理1の実行後は、交換命令EXXによりBC’とBCを、DE’とDEを、HL’とHLをそれぞれ入れ替えると共に(ステップS6)、交換命令EXによりAF’とAFを入れ替え(ステップS7)、割込みを許可して(ステップS8)、「RET」命令により使用領域に戻る(ステップS9)。「RET」命令により、使用領域のスタック領域に保存した戻り番地先に復帰し、スタック領域のアドレスを指し示すスタックポインタSPはプラス2され、ステップS2の次アドレスの命令を実行することになる。
After the execution of the
使用領域に記述した別領域呼び出し処理1の命令コードは、「DI」が1バイト、「CALL E_SAMP1」が3バイトで計4バイトであり、別領域処理1が4バイトを超える命令で記述する場合、その4バイトを超える分について、使用領域の容量を節約できることになる。別領域処理は一つに限らず、複数となることが多いため、一つ一つの処理での節約バイト数は少なくとも、トータルでは大きな節約効果が得られる。特に、使用領域では、割込みを禁止した後、別処理モジュールを呼び出す命令のみを記述すればよいことから、使用領域の容量を大きく節約できる。
The instruction code of the separate
また、使用領域では裏レジスタを使用せず、裏レジスタは別領域処理1において表レジスタを保護するために用いるため、別領域のスタック領域を食わず、しかも、別領域処理1の呼び出しに際して使用領域のスタック領域には「CALL E_SAMP1」による戻り番地が2バイト分記録されるのみであり、RWMの節約にも寄与できる。しかも、ステップS8の「EI」命令は次の命令実行後に割込み許可となり、ステップ9の「RET」命令実行後に割込み許可状態となるため、別領域では割込み禁止という条件は満たされ、別領域から使用領域に復帰する際の割込み許可の命令を使用領域ではなく別領域に記述したことにより、使用領域の容量を一層低減できる。
Further, since the back register is not used in the use area, and the back register is used to protect the front register in the
以上の実施形態では、回胴式遊技機を例示したが、ぱちんこ遊技機にも同様に適用できる。なお、以上の説明中の具体的数字やアドレス等は一例示に過ぎないのは言うまでも無い。 In the above embodiment, the rotating type gaming machine is exemplified, but the invention can be similarly applied to a pachinko gaming machine. Needless to say, the specific numbers and addresses in the above description are merely examples.
1L;左リール,1C;中リール,1R;右リール
2;メダル投入口、3;ベットボタン、4;精算ボタン
5;スタートレバー、6L,6C,6R;各ストップスイッチ
7;演出表示装置、70;液晶表示装置
8;リールパネル、80;表示窓
CN;制御装置、MC;主制御装置、SC;周辺制御装置
K;内部抽せん手段、V;リール制御手段
V1;回胴回転装置制御手段、V2;回転停止装置制御手段
M;メダル払出手段、N;メダル自動投入手段、J;遊技状態移行手段
W;フリーズ抽せん手段、G;回胴演出実行手段
H1;AT作動決定手段、H2;AT上乗せ決定手段
H3;AT継続管理手段、H4;AT指示情報出力手段
X1;ナビ手段、X2;音声ナビ手段
Y1;演出表示手段、Y2;効果音出力手段
1L; left reel, 1C; middle reel, 1R;
Claims (3)
前記使用領域には、割込みを禁止した後、前記別領域に記述した前記別処理モジュールを呼び出して実行させる処理手続を記述していると共に、
前記別領域には、前記メインCPUの内部レジスタにおける表レジスタと裏レジスタとを交換した後に前記別処理モジュールを実行し、前記別処理モジュールの実行後に前記裏レジスタと前記表レジスタとを交換する処理手続を記述しており、
前記別領域から前記使用領域に復帰した際には割込みを許可する仕様にしており、
前記使用領域では前記裏レジスタは未使用で、かつ、前記使用領域での割込み処理では、前記表レジスタを前記使用領域のスタック領域に退避させて保護する仕様にしていることを特徴とする遊技機。 It has a memory in which a use area within a predetermined capacity describing a game control process for controlling the progress of a game and a separate area describing another processing module that does not describe the game control process and performs a process related to security are provided. In gaming machines with a main CPU,
In the use area, after prohibiting interruption, a processing procedure for calling and executing the separate processing module described in the separate area is described.
In the separate area, the separate processing module is executed after exchanging the front register and the back register in the internal register of the main CPU, and the back register and the front register are exchanged after the separate processing module is executed. Describes the procedure,
When returning from the separate area to the use area, it is designed to allow interrupts.
In the use area, the back register is not used, and in the interrupt processing in the use area, the table register is saved in the stack area of the use area and protected. .
前記使用領域には、割込みを禁止した後、前記別領域に記述した前記別処理モジュールを呼び出して実行させる処理手続を記述していると共に、
前記別領域には、前記メインCPUの内部レジスタにおける表レジスタと裏レジスタとを交換した後に前記別処理モジュールを実行し、前記別処理モジュールの実行後に前記裏レジスタと前記表レジスタとを交換する処理手続を記述しており、
前記別領域から前記使用領域に復帰した際には割込みを許可する仕様にしており、
前記使用領域では前記裏レジスタは未使用で、かつ、前記使用領域での割込み処理では、前記表レジスタを前記使用領域のスタック領域に退避させて保護する仕様にしていることを特徴とする遊技機。 It has a memory in which a use area within a predetermined capacity describing a game control process for controlling the progress of a game and a separate area describing another processing module that does not describe the game control process but performs a process related to a test In gaming machines with a main CPU,
In the use area, after prohibiting interruption, a processing procedure for calling and executing the separate processing module described in the separate area is described.
In the separate area, the separate processing module is executed after exchanging the front register and the back register in the internal register of the main CPU, and the back register and the front register are exchanged after the separate processing module is executed. Describes the procedure,
When returning from the separate area to the use area, it is designed to allow interrupts.
In the use area, the back register is not used, and in the interrupt processing in the use area, the table register is saved in the stack area of the use area and protected. .
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2017233635A JP6450955B2 (en) | 2017-12-05 | 2017-12-05 | Game machine |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2017233635A JP6450955B2 (en) | 2017-12-05 | 2017-12-05 | Game machine |
Related Parent Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2016003093A Division JP6298478B2 (en) | 2016-01-08 | 2016-01-08 | Game machine |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2018027503A JP2018027503A (en) | 2018-02-22 |
JP6450955B2 true JP6450955B2 (en) | 2019-01-16 |
Family
ID=61248155
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2017233635A Active JP6450955B2 (en) | 2017-12-05 | 2017-12-05 | Game machine |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP6450955B2 (en) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2018027502A (en) * | 2017-12-05 | 2018-02-22 | 株式会社オリンピア | Game machine |
JP2018047319A (en) * | 2017-12-05 | 2018-03-29 | 株式会社オリンピア | Game machine |
Family Cites Families (10)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3343998B2 (en) * | 1993-05-19 | 2002-11-11 | 株式会社三洋物産 | Control device |
JP4317960B2 (en) * | 2000-06-21 | 2009-08-19 | 株式会社大一商会 | Game machine |
JP5083886B2 (en) * | 2007-12-05 | 2012-11-28 | 株式会社大都技研 | Amusement stand |
JP5552609B2 (en) * | 2008-03-03 | 2014-07-16 | 株式会社高尾 | Game machine |
JP6055990B2 (en) * | 2011-08-25 | 2017-01-11 | 株式会社ソフイア | Game machine |
JP5990670B2 (en) * | 2013-02-22 | 2016-09-14 | 株式会社ソフイア | Game machine |
JP5835854B1 (en) * | 2014-07-15 | 2015-12-24 | サミー株式会社 | Game machine |
JP5838513B1 (en) * | 2015-01-29 | 2016-01-06 | 株式会社大都技研 | Amusement stand |
JP6283834B2 (en) * | 2015-07-13 | 2018-02-28 | Kpe株式会社 | Game machine |
JP6298478B2 (en) * | 2016-01-08 | 2018-03-20 | 株式会社オリンピア | Game machine |
-
2017
- 2017-12-05 JP JP2017233635A patent/JP6450955B2/en active Active
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2018027502A (en) * | 2017-12-05 | 2018-02-22 | 株式会社オリンピア | Game machine |
JP2018047319A (en) * | 2017-12-05 | 2018-03-29 | 株式会社オリンピア | Game machine |
Also Published As
Publication number | Publication date |
---|---|
JP2018027503A (en) | 2018-02-22 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP6298477B2 (en) | Game machine | |
JP6630200B2 (en) | Gaming machine | |
JP2017164252A (en) | Game machine | |
JP6283834B2 (en) | Game machine | |
JP2018086348A (en) | Game machine | |
JP6298478B2 (en) | Game machine | |
JP2017209459A (en) | Game machine | |
JP6371956B1 (en) | Game machine | |
JP6450955B2 (en) | Game machine | |
JP2019013346A (en) | Game machine | |
JP2017042461A (en) | Game machine | |
JP6615528B2 (en) | Game machine | |
JP6240831B2 (en) | Game machine | |
JP6466859B2 (en) | Game machine | |
JP6502545B2 (en) | Gaming machine | |
JP6302448B2 (en) | Slot machine | |
JP6736136B2 (en) | Amusement machine | |
JP6543322B2 (en) | Gaming machine | |
JP6546643B2 (en) | Gaming machine | |
JP6655912B2 (en) | Gaming machine | |
JP6349527B2 (en) | Game machine | |
JP2017038825A (en) | Game machine | |
JP7084050B2 (en) | Pachinko machine | |
JP2017158753A (en) | Game machine | |
JP7412031B2 (en) | gaming machine |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20171205 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20181022 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20181106 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20181116 |
|
R150 | Certificate of patent or registration of utility model |
Ref document number: 6450955 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |