JP6389752B2 - 回路シミュレーション装置 - Google Patents
回路シミュレーション装置 Download PDFInfo
- Publication number
- JP6389752B2 JP6389752B2 JP2014249492A JP2014249492A JP6389752B2 JP 6389752 B2 JP6389752 B2 JP 6389752B2 JP 2014249492 A JP2014249492 A JP 2014249492A JP 2014249492 A JP2014249492 A JP 2014249492A JP 6389752 B2 JP6389752 B2 JP 6389752B2
- Authority
- JP
- Japan
- Prior art keywords
- arm
- terminal
- voltage
- model
- circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Active
Links
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F30/00—Computer-aided design [CAD]
- G06F30/30—Circuit design
- G06F30/36—Circuit design at the analogue level
- G06F30/367—Design verification, e.g. using simulation, simulation program with integrated circuit emphasis [SPICE], direct methods or relaxation methods
Landscapes
- Engineering & Computer Science (AREA)
- Computer Hardware Design (AREA)
- Physics & Mathematics (AREA)
- Theoretical Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Evolutionary Computation (AREA)
- Geometry (AREA)
- General Engineering & Computer Science (AREA)
- Inverter Devices (AREA)
Description
または、回路計算を行う計算装置と、回路シミュレータと、インバータのアームモデルと、を格納する記憶装置と、を備え、前記アームモデルは、一体となった上アームおよび下アームを有し、前記上アームおよび前記下アームのそれぞれは、上端子と、下端子と、ゲート端子と、を有し、前記上アームおよび前記下アームの一方または両方は、互いに結線される2つの中間端子の組を1つ以上有し、前記上端子と前記中間端子の間または前記下端子と前記中間端子の間の一方に結線される電圧関数式の電源と、他方に結線される素子モデルとを有し、前記電圧関数式の電源は、前記アームモデルの電圧波形関数をこの電圧関数式に加えると一定値となるように設定され、電圧波形を発生させるものであり、前記アームモデルを用いてシミュレーションすることでスイッチング波形を計算することを特徴とする。
図1は、本実施形態に係る解析計算システムの構成例を示す図である。
以下、解析計算システム5で動作するモデル構成の具体的な例を説明する。
図2は、本発明に係るインバータのアームモデルの構成例を示す図である。
図3は、本発明に係る第2のインバータのアームモデルの構成例を示す図である。
図4は、本発明に係る第3のインバータのアームモデルの構成例を示す図である。
2 表示装置
3 入力装置
4 記憶装置
100,200 アームモデル
101,102,201,202 素子モデル
103,203,303,313 上端子
104,204,304,314 下端子
105,106,205,206,305,306,315,316 中間端子
300 一体化アームモデル
301 上アームモデル
302 下アームモデル
307,308,317,318 ゲート端子
604 電圧波形立ち上り部
Claims (4)
- 回路計算を行う計算装置と、
回路シミュレータと、インバータのアームモデルと、を格納する記憶装置と、を備え、
前記アームモデルは、上端子と、下端子と、前記上端子と前記下端子の間に配置される中間端子と、前記上端子と前記中間端子の間または前記下端子と前記中間端子の間の一方に結線される電圧関数式の電源と、他方に結線される素子モデルと、を有し、
前記電圧関数式の電源は、前記アームモデルの電圧波形関数をこの電圧関数式に加えると一定値となるように設定され、電圧波形を発生させるものであり、
前記アームモデルを用いてシミュレーションすることでスイッチング波形を計算する、
回路シミュレーション装置。 - 回路計算を行う計算装置と、
回路シミュレータと、インバータのアームモデルと、を格納する記憶装置と、を備え、
前記アームモデルは、一体となった上アームおよび下アームを有し、
前記上アームおよび前記下アームのそれぞれは、上端子と、下端子と、ゲート端子と、を有し、
前記上アームおよび前記下アームの一方または両方は、互いに結線される2つの中間端子の組を1つ以上有し、前記上端子と前記中間端子の間または前記下端子と前記中間端子の間の一方に結線される電圧関数式の電源と、他方に結線される素子モデルとを有し、
前記電圧関数式の電源は、前記アームモデルの電圧波形関数をこの電圧関数式に加えると一定値となるように設定され、電圧波形を発生させるものであり、
前記アームモデルを用いてシミュレーションすることでスイッチング波形を計算する、
回路シミュレーション装置。 - 請求項2に記載の回路シミュレーション装置であって、
前記上アームまたは前記下アームにおける、前記上端子と前記中間端子の間の素子モデルと、前記下端子と前記中間端子の間の素子モデルとが別の素子モデルである、
回路シミュレーション装置。 - 請求項1または請求項2に記載の回路シミュレーション装置であって、
前記アームモデルは、負荷式を有し、
前記負荷式は、ダイオードの理想電流電圧特性式であり、変動影響計算式電圧源と、変動影響計算負荷関数式と、を有し、
前記変動影響計算式電圧源は、前記電圧波形関数と直列に設けられ、
前記変動影響計算負荷関数式は、前記電圧波形関数と並列に設けられる、
回路シミュレーション装置。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2014249492A JP6389752B2 (ja) | 2014-12-10 | 2014-12-10 | 回路シミュレーション装置 |
US14/963,922 US10318679B2 (en) | 2014-12-10 | 2015-12-09 | Calculation method of switching waveform of the inverter and circuit simulation model |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2014249492A JP6389752B2 (ja) | 2014-12-10 | 2014-12-10 | 回路シミュレーション装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2016110523A JP2016110523A (ja) | 2016-06-20 |
JP6389752B2 true JP6389752B2 (ja) | 2018-09-12 |
Family
ID=56111401
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2014249492A Active JP6389752B2 (ja) | 2014-12-10 | 2014-12-10 | 回路シミュレーション装置 |
Country Status (2)
Country | Link |
---|---|
US (1) | US10318679B2 (ja) |
JP (1) | JP6389752B2 (ja) |
Families Citing this family (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2015048509A1 (en) | 2013-09-26 | 2015-04-02 | Synopsys, Inc. | First principles design automation tool |
US10489212B2 (en) | 2013-09-26 | 2019-11-26 | Synopsys, Inc. | Adaptive parallelization for multi-scale simulation |
US10516725B2 (en) | 2013-09-26 | 2019-12-24 | Synopsys, Inc. | Characterizing target material properties based on properties of similar materials |
US20160162625A1 (en) | 2013-09-26 | 2016-06-09 | Synopsys, Inc. | Mapping Intermediate Material Properties To Target Properties To Screen Materials |
US10417373B2 (en) | 2013-09-26 | 2019-09-17 | Synopsys, Inc. | Estimation of effective channel length for FinFETs and nano-wires |
US9836563B2 (en) | 2013-09-26 | 2017-12-05 | Synopsys, Inc. | Iterative simulation with DFT and non-DFT |
US10734097B2 (en) | 2015-10-30 | 2020-08-04 | Synopsys, Inc. | Atomic structure optimization |
US10078735B2 (en) | 2015-10-30 | 2018-09-18 | Synopsys, Inc. | Atomic structure optimization |
CN112421683B (zh) * | 2021-01-22 | 2021-06-25 | 中国电力科学研究院有限公司 | 一种并网逆变器的多回路控制参数辨识方法及系统 |
Family Cites Families (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP5117926B2 (ja) | 2007-06-20 | 2013-01-16 | 一般財団法人電力中央研究所 | インバータシミュレーション装置およびインバータシミュレーションプログラム |
JP5341842B2 (ja) * | 2010-08-31 | 2013-11-13 | 日立オートモティブシステムズ株式会社 | 電源回路及び電力変換装置 |
US9496805B2 (en) * | 2011-11-25 | 2016-11-15 | Tokyo Institute Of Technology | Single-phase power converter, three-phase two-phase power converter, and three-phase power converter |
EP2634917B1 (en) * | 2012-02-28 | 2015-04-08 | ST-Ericsson SA | Protection module for RF-amplifier |
DE112013006976T5 (de) * | 2013-04-23 | 2015-12-31 | Mitsubishi Electric Corporation | Steuereinheit eines elektrischen Wechselstrommotors |
-
2014
- 2014-12-10 JP JP2014249492A patent/JP6389752B2/ja active Active
-
2015
- 2015-12-09 US US14/963,922 patent/US10318679B2/en active Active
Also Published As
Publication number | Publication date |
---|---|
US10318679B2 (en) | 2019-06-11 |
JP2016110523A (ja) | 2016-06-20 |
US20160171139A1 (en) | 2016-06-16 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP6389752B2 (ja) | 回路シミュレーション装置 | |
Menezes et al. | A sequential quadratic programming approach to concurrent gate and wire sizing | |
US20160314230A1 (en) | Method and system for reducing power losses and state-overshoots in simulators for switched power electronic circuit | |
JP5117926B2 (ja) | インバータシミュレーション装置およびインバータシミュレーションプログラム | |
CN104598659B (zh) | 对数字电路进行仿真的方法和设备 | |
US20150199460A1 (en) | Custom circuit power analysis | |
Bai et al. | Artificial neural network aided real-time simulation of electric traction system | |
Duran | A practical guide to analog behavioral modeling for IC system design | |
Benedikt et al. | Relaxing stiff system integration by smoothing techniques for non-iterative co-simulation | |
US20170046470A1 (en) | Process design kit for efficient and accurate mismatch simulation of analog circuits | |
JP4966331B2 (ja) | 半導体回路劣化シミュレーション方法およびコンピュータプログラム媒体 | |
Zamiri et al. | Sub-harmonic oscillations attenuation in hardware-in-the-loop models using the integration oversampling method | |
Zhuang et al. | From Circuit Theory, Simulation to SPICE< sup> Diego<\/sup>: A Matrix Exponential Approach for Time-Domain Analysis of Large-Scale Circuits | |
US10024937B2 (en) | Gradient amplifier with compensation for dead time and forward voltage | |
Nastov | Spectral methods for circuit analysis | |
JP5069711B2 (ja) | Mosfetモデルのパラメータ抽出方法 | |
US20120143582A1 (en) | Characterization of nonlinear cell macro model for timing analysis | |
JP2002304434A (ja) | Emiシミュレーション用半導体集積回路電源モデルの作成方法、装置及びプログラム | |
Krim et al. | Modeling and hardware implementation on the FPGA of a variable structure control associated with a DTC-SVM of an induction motor | |
Goodfriend et al. | Large-eddy simulation of decaying isotropic turbulence across a grid refinement interface using explicit filtering and reconstruction | |
Li et al. | Characterizing multistage nonlinear drivers and variability for accurate timing and noise analysis | |
Xu et al. | Power delivery modeling for full switching voltage regulator on high performance computing system | |
JP6070002B2 (ja) | 設計支援装置、設計支援方法及びプログラム | |
Schönberger | An overview of simulation tools | |
US20240046017A1 (en) | Arithmetic method and arithmetic device |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
RD04 | Notification of resignation of power of attorney |
Free format text: JAPANESE INTERMEDIATE CODE: A7424 Effective date: 20170110 |
|
RD04 | Notification of resignation of power of attorney |
Free format text: JAPANESE INTERMEDIATE CODE: A7424 Effective date: 20170112 |
|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20170126 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20180222 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20180306 |
|
A601 | Written request for extension of time |
Free format text: JAPANESE INTERMEDIATE CODE: A601 Effective date: 20180425 |
|
A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20180704 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20180724 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20180820 |
|
R150 | Certificate of patent or registration of utility model |
Ref document number: 6389752 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 |