JP5942323B2 - 高度デジタルテレビに関するマルチメディアi/oシステムアーキテクチャ - Google Patents
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Description
本出願は、2010年12月10日出願の米国仮出願番号61/442,063の優先権主張するものであり、その開示内容は引用によって本明細書に組み込まれている。
(技術分野)
本発明の実施形態は、全体的には電子デバイスの分野に関し、詳細には高度デジタルテレビに関するマルチメディアI/Oシステムアーキテクチャに関する。
Claims (26)
- 1つ又はそれ以上のオーディオ/ビデオデータストリームを処理するための1つ又はそれ以上のオーディオ/ビデオサブプロセッシングエンジンと、1つ又はそれ以上のデジタルオーディオ/ビデオデータ入力を処理するためのポートプロセッサとを含む、I/O(入力/出力)制御チップと、
前記I/O制御チップから受信したオーディオ/ビデオデータを含むデータを処理するための、プロセッシングコアチップと、
前記I/O制御チップと前記プロセッシングコアチップとの間でデータを転送するための1つ又はそれ以上の共用I/Oチャンネルと、
を備えるマルチメディアシステム。 - 前記I/O制御チップは、前記プロセッシングコアチップにデータを転送するためのインタフェースブリッジを更に含む、請求項1に記載のマルチメディアシステム。
- 前記インタフェースブリッジは、1つ又はそれ以上の標準インタフェースに接続される、請求項2に記載のマルチメディアシステム。
- 前記1つ又はそれ以上の標準インタフェースは、1つ又はそれ以上のUSB(ユニバーサルシリアルポート)インタフェース又はEthernet(登録商標)インタフェースを含む、請求項3に記載のマルチメディアシステム。
- 前記1つ又はそれ以上の共用I/Oチャンネルは前記1つ又はそれ以上の標準インタフェースと前記プロセッシングコアチップとの間で通信データを伝送する、請求項3に記載のマルチメディアシステム。
- 前記1つ又はそれ以上の共用I/Oチャンネルの帯域幅は、データストリームのデータと標準インタフェースデータとの間で共用される、請求項5に記載のマルチメディアシステム。
- 前記I/O制御チップは、1つ又はそれ以上のアナログオーディオ/ビデオデータ入力をデジタルオーディオ/ビデオデータに変換するアナログ−デジタルコンバータを更に含み、変換されたデジタルオーディオ/ビデオデータは、前記ポートプロセッサに供給される、請求項1に記載のマルチメディアシステム。
- 前記ポートプロセッサは、更に1つ又はそれ以上の暗号化されていないオーディオ/ビデオデータ出力を生成して前記インタフェースブリッジに供給し、前記生成されたデータは、元の解像度又はスケール調整された解像度とすることができる、請求項2に記載のマルチメディアシステム。
- 前記ポートプロセッサは、HDMI(登録商標)(高精細マルチメディアインタフェース)/DVI(商標)(デジタルビジュアルインタフェース)互換プロセッサである、請求項1に記載のマルチメディアシステム。
- 前記I/O制御チップは、1つ又はそれ以上の共用I/Oチャンネル経由でプロセッシングコアチップから1つ又はそれ以上のオーディオ/ビデオデータ入力を受信する、請求項1に記載のマルチメディアシステム。
- 前記1つ又はそれ以上のオーディオ/ビデオサブプロセッシングエンジンは、1つ又はそれ以上のピクチャーインピクチャー生成、画像スケーリング、及び画像強調を含むオーディオ/ビデオ処理をもたらす、請求項1に記載のマルチメディアシステム。
- 1つ又はそれ以上のオーディオ/ビデオデータストリームを処理するための1つ又はそれ以上のオーディオ/ビデオサブプロセッシングエンジンを含む、I/O(入力/出力)制御チップと、
前記I/O制御チップから受信したオーディオ/ビデオデータを含むデータを処理するための、プロセッシングコアチップと、
前記I/O制御チップと前記プロセッシングコアチップとの間でデータを転送するための1つ又はそれ以上の共用I/Oチャンネルと、
を備え、
前記I/O制御チップは、1つ又はそれ以上の共用I/Oチャンネル経由でプロセッシングコアチップから1つ又はそれ以上のオーディオ/ビデオデータ入力を受信するマルチメディアシステム。 - オーディオ/ビデオデータを受信するための1つ又はそれ以上の入力部と、
前記1つ又はそれ以上の受信部で受信したデジタルデータを処理するためのポートプロセッサと、
前記ポートプロセッサから受信した1つ又はそれ以上のオーディオ/ビデオデータストリームを処理するための、1つ又はそれ以上のオーディオ/ビデオサブプロセッシングエンジンと、
1つ又はそれ以上の共用I/Oチャンネルに接続され、前記1つ又はそれ以上のオーディオ/ビデオサブプロセッシングエンジンから処理デジタルオーディオ/ビデオデータを受信して、前記処理データを共用I/Oチャンネルを経由して転送する、インタフェースブリッジと、
を備える装置。 - 1つ又はそれ以上のアナログオーディオ/ビデオデータ入力をデジタルオーディオ/ビデオデータに変換するアナログ−デジタルコンバータを更に備え、変換されたデジタルオーディオ/ビデオデータは、前記ポートプロセッサに供給される、請求項13に記載の装置。
- 前記ポートプロセッサは、更に未処理デジタルオーディオ/ビデオデータを、前記共用I/Oチャンネルを経由して転送するための前記インタフェースブリッジに供給する、請求項13に記載の装置。
- 1つ又はそれ以上のオーディオ/ビデオデータ入力を共用I/Oチャンネル経由でインタフェースブリッジを介して受信する、請求項13に記載の装置。
- 前記1つ又はそれ以上のオーディオ/ビデオサブプロセッシングエンジンは、1つ又はそれ以上のピクチャーインピクチャー生成、画像スケーリング、及び画像強調を可能にする、請求項13に記載の装置。
- 前記インタフェースブリッジに接続される、1つ又はそれ以上の標準インタフェースポートを更に備える、請求項13に記載の装置。
- 前記1つ又はそれ以上の標準インタフェースポートは、1つ又はそれ以上のUSB(ユニバーサルシリアルポート)ポート又はEthernet(登録商標)ポートを含む、請求項18に記載の装置。
- 前記1つ又はそれ以上の共用I/Oチャンネルは、前記1つ又はそれ以上の標準インタフェースポートに通信データを伝送するようになっている、請求項18に記載の装置。
- 前記1つ又はそれ以上の共用I/Oチャンネルの帯域幅は、前記1つ又はそれ以上の入力部で受信したデータと標準インタフェースポートデータとの間で共用される、請求項20に記載の装置。
- 前記ポートプロセッサは、HDMI(登録商標)(高精細マルチメディアインタフェース)/DVI(商標)(デジタルビジュアルインタフェース)互換プロセッサである、請求項13に記載の装置。
- 1つ又はそれ以上のデジタルオーディオ/ビデオデータストリームを受信する段階と、
処理のために第1のデジタルオーディオ/ビデオデータストリームをオーディオ/ビデオサブプロセッシングエンジンに提供することを含む、前記デジタルオーディオ/ビデオデータストリームをポートプロセッサで処理する段階と、
前記第1のデジタルオーディオ/ビデオデータストリームを処理して第1の処理データ出力を生成する段階と、
インタフェースブリッジで前記第1の処理データ出力を受信する段階と、
前記第1の処理データ出力を1つ又はそれ以上の共用I/Oチャンネル経由でプロセッシングコアチップに転送する段階と、
を含む方法。 - 1つ又はそれ以上のアナログオーディオ/ビデオデータ入力を受信する段階と、前記アナログデータ入力をデジタルオーディオ/ビデオデータに変換する段階と、前記変換デジタルオーディオ/ビデオデータを前記ポートプロセッサに供給する段階とを含む、請求項23に記載の方法。
- 前記オーディオ/ビデオサブプロセッシングエンジンによる処理は、1つ又はそれ以上のピクチャーインピクチャー生成、画像スケーリング、及び画像強調を含む、請求項23に記載の方法。
- 1つ又はそれ以上のオーディオ/ビデオデータ入力を1つ又はそれ以上の共用I/Oチャンネル経由で前記プロセッシングコアチップから受信する段階と、処理のために前記プロセッシングコアチップから受信した前記1つ又はそれ以上のデータ入力を前記ポートプロセッサに転送する段階と、を更に含む、請求項23に記載の方法。
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