JP5895512B2 - 環線系統保護継電システムのサンプリング同期回路 - Google Patents
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Description
前記中央継電装置と各端末装置のサンプリング同期回路は、多重分離装置の伝送情報入出力部と共通にして通信ボードに搭載し、
前記中央継電装置の通信部と各端末装置の通信部の間で同期したサンプリング同期信号をそれぞれ生成し、このサンプリング同期信号を中央継電装置のリレー部および各端末装置のリレー部による系統信号のサンプリング同期信号とし、
前記中央継電装置の通信部がもつ親局としてのサンプリング同期回路は自走発振回路として動作し、前記各端末装置の通信部がもつサンプリング同期回路は従属同期回路として動作することをノードアドレスで切り替えるよう構成すると共に、
前記サンプリング同期回路は、
ループ伝送路の光−電気変換器(1,2)で変換した受信信号から1系と2系の分離インタフェース(21、22)が受信フレーム内のサンプリング同期用タイムスロットからサンプリング同期タイミング信号を抽出し、1系と2系の遅延測定回路(23、24)が1系と2系の伝送遅延(T1、T2)を測定し、遅延測定回路(25)が1系と2系の伝送路から得られたサンプリング同期タイミング信号の伝送時間差(T3)を測定し、監視・設定回路(3)が伝送時間差(T3)からサンプリング同期点を演算して受信SPタイミング回路(26)に同期点を設定し、発振器(27)とDPLL(28)と位相比較器(29)との間で従属同期をとるサンプリング同期ロジック構成としたことを特徴とする。
図1は、従来と本発明におけるサンプリング同期回路のブロック構成を示す。図4で説明するように、従来、中央通信装置MSと端末装置RSにおけるサンプリング同期には、2つのサンプリング同期回路で構成されていた。すなわち、サンプリング同期SA1では1系と2系の伝送路上の情報に対して中央通信装置MSと端末装置RSの通信部TRにおいてサンプリング同期を得ている。一方、サンプリング同期SA2は、中央継電装置MRで取り込む計測情報のサンプリング同期と、端末装置RSのリレー部RYで取り込む計測情報のサンプリング同期を得ている。
図3は、本実施形態によるサンプリング同期回路の構成図であり、多重分離装置100の伝送情報入出力部と共通にして通信ボード300に搭載される。200は中央継電装置MRまたは端末装置のリレー部RYになる継電装置である。
200 リレー部
300 通信ボード
3 監視・設定回路
9 送信タイミング回路
10、11 多重インタフェース
13,14 送信選択回路
15,16 送信インタフェース
21,22 分離インタフェース(S/P、P/S)
23、24 遅延測定回路
25 遅延測定回路
26 受信SPタイミング回路
27 発振器
28 DPLL
29 位相比較器
30 逓倍回路
Claims (1)
- 電力系統は電源変電所から各需要家までを環線で接続し、電源変電所端に配置する中央継電装置と各需要家端に配置する端末装置との間は1系と2系のループ伝送路で接続し、変電所側の中央継電装置と各端末装置で系統信号を同時サンプリングし、各端末装置で同時サンプリングした系統信号を時分割で多重化して中央継電装置にループ伝送し、中央継電装置は各端末装置からの系統信号を分離し、これら系統信号と変電所端での系統信号から保護演算を行い、必要に応じて各需要家端の機器操作信号を各端末装置にループ伝送する環線系統保護継電システムにおいて、
前記中央継電装置と各端末装置のサンプリング同期回路は、多重分離装置の伝送情報入出力部と共通にして通信ボードに搭載し、
前記中央継電装置の通信部と各端末装置の通信部の間で同期したサンプリング同期信号をそれぞれ生成し、このサンプリング同期信号を中央継電装置のリレー部および各端末装置のリレー部による系統信号のサンプリング同期信号とし、
前記中央継電装置の通信部がもつ親局としてのサンプリング同期回路は自走発振回路として動作し、前記各端末装置の通信部がもつサンプリング同期回路は従属同期回路として動作することをノードアドレスで切り替えるよう構成すると共に、
前記サンプリング同期回路は、
ループ伝送路の光−電気変換器(1,2)で変換した受信信号から1系と2系の分離インタフェース(21、22)が受信フレーム内のサンプリング同期用タイムスロットからサンプリング同期タイミング信号を抽出し、1系と2系の遅延測定回路(23、24)が1系と2系の伝送遅延(T1、T2)を測定し、遅延測定回路(25)が1系と2系の伝送路から得られたサンプリング同期タイミング信号の伝送時間差(T3)を測定し、監視・設定回路(3)が伝送時間差(T3)からサンプリング同期点を演算して受信SPタイミング回路(26)に同期点を設定し、発振器(27)とDPLL(28)と位相比較器(29)との間で従属同期をとるサンプリング同期ロジック構成としたことを特徴とする環線系統保護継電システムのサンプリング同期回路。
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