JP5784433B2 - D級アンプ - Google Patents
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Description
本発明は、この不都合を解消し、各トランジスタの駆動能力を落とすことなく、電池の消耗を少なくしたD級アンプを提供することを目的とする。
図1に示すように、D級アンプは、外部の電池10から供給される電圧から昇圧電圧を生成するDCDCコンバータなどの昇圧回路20と、前記電池10を電源として駆動される前記電池10の正負極間に直列接続されたPMOSトランジスタ30及びNMOSトランジスタ40と、昇圧電圧及び接地電圧を電源とし入力信号をPWM変調回路50でPWM変調したパルス信号に基づいて前記PMOSトランジスタ30及び前記NMOSトランジスタ40を交互にオンオフ駆動する駆動回路60を備えている。
20 昇圧回路
30 PMOSトランジスタ
40 NMOSトランジスタ
50 PWM変調回路
60 駆動回路
61 インバータ
62 PMOSトランジスタ用ドライバ
62a,62b インバータ
63 NMOS用トランジスタ用ドライバ
63a,63b インバータ
70 容量素子
80 スイッチ素子(PMOSトランジスタ)
90 LPF
100 負荷
Claims (1)
- 外部電池から供給される電圧から昇圧電圧を生成する昇圧回路と、前記電池を電源として駆動される前記電池の正負極間に直列接続されたPMOSトランジスタ及びNMOSトランジスタと、昇圧電圧及び接地電圧を電源とし入力信号をPWM変調したパルスに基づいて前記昇圧電圧及び前記接地電圧とを交互に出力しかつ前記PMOSトランジスタ及び前記NMOSトランジスタを交互にオンオフ駆動する駆動回路と、この駆動回路の出力端と前記PMOSトランジスタのゲートとの間に接続された容量素子と、前記駆動回路の出力が前記昇圧電圧であるタイミングに同期して前記電池の正電極と前記PMOSトランジスタのゲートとを接続するスイッチ素子とを備え、前記PMOSトランジスタ及び前記NMOSトランジスタの接続点の電圧に基づき負荷を駆動することを特徴とするD級アンプ。
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