JP5759871B2 - 液晶表示装置 - Google Patents
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Description
第1基板と、
前記第1基板に隙間を置いて対向配置された第2基板と、
前記第1基板と前記第2基板との間に挟持された液晶層と、
それぞれ、前記第1基板に形成され第1方向に延出した第1ゲート配線及び第2ゲート配線と、
前記第1基板に形成され、前記第1ゲート配線と前記第2ゲート配線との間の画素の略中央部に配置され、前記第1方向に延出した補助容量線と、
前記第1基板に形成され、前記画素に配置された画素電極と、を備え、
前記画素電極は、
前記補助容量線に対向し前記第1方向に延出した第1副画素電極と、
前記第1方向に交差する第2方向に沿って前記第1副画素電極から前記第1ゲート配線側に延出し前記第2方向にわたって略同一の前記第1方向の第1幅を有し帯状に形成された第1主画素電極と、
前記第2方向に沿って前記第1副画素電極から前記第2ゲート配線側に延出し前記第2方向にわたって略同一の前記第1方向の第2幅を有し帯状に形成された第2主画素電極と、を備え、
前記第2幅は前記第1幅より大きいことを特徴としている。
図1は、一実施形態に係る液晶表示装置の構成及び等価回路を概略的に示す図である。
各画素PXの複数の領域R3、R4は、第2方向Yに隣合っている。
図3に示すように、液晶表示パネルLPNを構成するアレイ基板ARの背面側には、バックライトユニット4が配置されている。バックライトユニット4としては、種々の形態が適用可能であり、また、光源として発光ダイオード(LED)を利用したものや冷陰極管(CCFL)を利用したものなどのいずれでも適用可能であり、詳細な構造については説明を省略する。
なお、アレイ基板ARは、さらに、共通電極CEの一部を備えていても良い。
図2及び図3に示すように、液晶層LQに電圧が印加されていない状態、つまり、画素電極PEと共通電極CEとの間に電界が形成されていない状態(OFF時)には、液晶層LQの液晶分子LMは、その長軸が第1配向膜AL1の第1配向処理方向PD1及び第2配向膜AL2の第2配向処理方向PD2を向くように配向している。このようなOFF時が初期配向状態に相当し、OFF時の液晶分子LMの配向方向が初期配向方向に相当する。
図5は、上記実施形態に係る比較例の液晶表示装置の液晶表示パネルLPNを対向基板CT側から見たときの一画素PXの構造例を概略的に示す平面図である。
図7に示すように、本実施形態に係る液晶表示装置の正面方向(0deg)の明度と、比較例の液晶表示装置の正面方向の明度は、同様であることが分かる。
上記のことから、視野角の広い液晶表示装置を得ることができる。
図8に示すように、画素電極PEは、互いに電気的に接続された主画素電極PA、副画素電極PF及び副画素電極PGを含んでいる。以下では、主画素電極PAを区別するために、図中の上側の主画素電極をPAUと称し、図中の左下側の主画素電極をPALBと称し、図中の右下側の主画素電極をPARBと称する。
副画素電極PF、PGは、主画素電極PALB、PARB、PAUよりも幅広に形成されている。画素電極PEは、画素PXの中央に配置されている。
各画素PXの複数の領域R3、R4は、第2方向Yに隣合っている。
図9は、図8に示した液晶表示装置の比較例の液晶表示装置の液晶表示パネルLPNを対向基板CT側から見たときの一画素PXの構造例を概略的に示す平面図である。
副画素電極PF、PGは、主画素電極PALU、PARUよりも幅広に形成されている。画素電極PEは、画素PXの中央に配置されている。
その他、上記比較例の液晶表示装置は、上記変形例の液晶表示装置と同様に形成されている。上記比較例の液晶表示装置の各画素PXは、領域R3のみ有しているため、斜め方向における光抜けの発生を抑制できないものである(図6及び図7)。
各画素PXにおいて、第1方向に沿った主画素電極PA及び主共通電極CA間の隙間が互いに異なる複数の領域は、第1方向Xに隣合っていてもよく、第1方向X及び第2方向Xの少なくとも一方に隣合っていればよい。
以下に、本願出願の当初の特許請求の範囲に記載された発明を付記する。
[1]第1基板と、
前記第1基板に隙間を置いて対向配置された第2基板と、
前記第1基板及び第2基板間に挟持された液晶層と、
互いに直交した第1方向及び第2方向にマトリクス状に設けられ、それぞれ、前記第1方向に沿った長さが前記第2方向に沿った長さよりも短く、前記第1基板上に形成され前記第2方向に沿って延出した1つ又は複数の主画素電極と、前記第2基板上に形成され前記第1方向に前記主画素電極を挟んで位置し前記第2方向に沿って延出した複数の主共通電極と、を有した複数の画素と、を備え、
前記各画素は、前記第1方向に沿った前記主画素電極及び主共通電極間の隙間が互いに異なる複数の領域を有していることを特徴とする液晶表示装置。
[2]前記各画素の複数の領域において、前記第1方向に沿った前記主画素電極及び主共通電極の間隔が互いに異なっていることを特徴とする[1]に記載の液晶表示装置。
[3]前記主画素電極及び主共通電極の少なくとも一方の幅は、前記各画素の複数の領域毎に異なっていることを特徴とする[1]に記載の液晶表示装置。
[4]前記第1基板又は第2基板上に形成され前記第1方向に沿って延出した複数の配線をさらに備え、
前記各画素の複数の領域は、前記配線と対向した領域を境界に分離されていることを特徴とする[1]に記載の液晶表示装置。
[5]前記各画素の複数の領域は、前記第2方向に隣合っていることを特徴とする[1]に記載の液晶表示装置。
Claims (6)
- 第1基板と、
前記第1基板に隙間を置いて対向配置された第2基板と、
前記第1基板と前記第2基板との間に挟持された液晶層と、
それぞれ、前記第1基板に形成され第1方向に延出した第1ゲート配線及び第2ゲート配線と、
前記第1基板に形成され、前記第1ゲート配線と前記第2ゲート配線との間の画素の略中央部に配置され、前記第1方向に延出した補助容量線と、
前記第1基板に形成され、前記画素に配置された画素電極と、を備え、
前記画素電極は、
前記補助容量線に対向し前記第1方向に延出した第1副画素電極と、
前記第1方向に交差する第2方向に沿って前記第1副画素電極から前記第1ゲート配線側に延出し前記第2方向にわたって略同一の前記第1方向の第1幅を有し帯状に形成された第1主画素電極と、
前記第2方向に沿って前記第1副画素電極から前記第2ゲート配線側に延出し前記第2方向にわたって略同一の前記第1方向の第2幅を有し帯状に形成された第2主画素電極と、を備え、
前記第2幅は前記第1幅より大きいことを特徴とする液晶表示装置。 - 前記画素電極は、前記第1ゲート配線に対向し前記第1方向に延出した第2副画素電極をさらに備えることを特徴とする請求項1に記載の液晶表示装置。
- 前記第1基板に形成されたソース配線と、
前記第2基板に形成され前記ソース配線に沿って延出し前記ソース配線と対向した主共通電極と、をさらに備えることを特徴とする請求項1に記載の液晶表示装置。 - 前記第1方向における前記主共通電極と前記第1主画素電極との第1間隔は、前記第1方向における前記主共通電極と前記第2主画素電極との第2間隔より大きいことを特徴とする請求項3に記載の液晶表示装置。
- 前記第2間隔は前記液晶層の厚みより大きいことを特徴とする請求項4に記載の液晶表示装置。
- 前記第2基板に形成され前記主共通電極と一体に形成された副共通電極をさらに備え、
前記主共通電極は、前記第2方向に延出し、
前記副共通電極は、前記第1方向に延出しそれぞれ前記補助容量線及び前記第1副画素電極と対向することを特徴とする請求項3に記載の液晶表示装置。
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