JP5630396B2 - Dma制御装置 - Google Patents
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Description
101 更新管理装置
102 調停装置
103 計算装置
104 パラメータメモリ
105 共有メモリ
111 パイプライン
112 パイプライン
113 パイプライン
114 パイプライン
Claims (6)
- 更新管理装置と、調停装置と、計算装置と、パラメータメモリと、共有メモリと、複数のパイプライン装置で構成するDMA制御装置であって、
前記パラメータメモリは複数のDMA情報を保持し、前記更新管理装置は前記DMA情報に記載されるDMAの状態を前記調停装置に与え、前記調停装置は起動状態のDMA番号を1つ選択し前記計算装置に与え、前記計算装置はDMA番号に対応するDMA情報を前記パラメータメモリから取り出しDMA情報に記載されるパイプライン番号に対応する前記パイプライン装置にDMA実施用の入力指標と転送単位を与え前記更新管理装置にDMA更新用の入力指標を与え、前記パイプライン装置は入力指標と転送単位に従って前記共有メモリをアクセスし前記更新管理装置にDMA更新用の出力指標を与え、
前記更新管理装置は前記計算装置が示す入力指標と前記パイプライン装置が示す出力指標を前記パラメータメモリに対して更新し、出力指標の最終更新時もしくは外部アクセスによる該当DMAの起動・停止操作もしくはパラメータ操作により前記パラメータメモリの内容を更新することを特徴としたDMA制御装置。 - 請求項1記載のDMA制御装置であって、
前記調停装置は前記パラメータメモリから起動状態でありDMA情報に記載されるパイプライン番号がラウンドロビン方式で管理する番号に一致し起動状態であるDMAを全て選択し、その中から別のラウンドロビン方式でDMA番号を1つ選択することを特徴としたDMA制御装置。 - 請求項1記載のDMA制御装置であって、
前記更新管理装置は、DMAが終了する時点でDMA情報に記載される次のDMA情報のアドレスを前記パラメータメモリから取り出し、前記アドレスが示すDMA情報を前記共有メモリから取り出して前記パラメータメモリに該当DMA情報として書き込むことを特徴としたDMA制御装置。 - 請求項1記載のDMA制御装置であって、
前記計算装置はDMA情報に記載される参照DMA番号に対応するDMA情報を前記パラメータメモリから取り出しその中の出力指標と処理中の入力指標とを比較し前記パイプライン装置が実行できるか否かの判断に従って前記パイプライン装置を起動し、
前記計算装置の比較において入力準備が整ったか否かを入力指標+転送単位が出力指標より大きいかとしこれを前記判断の1つ目の条件とし、
出力準備が整ったか否かを入力指標+転送量が出力指標+転送量より大きいかとしてこれを前記判断の2つ目の条件とし、
前記1つ目もしくは前記2つ目の条件が成立する場合に前記パイプライン装置を起動することを特徴としたDMA制御装置。 - 請求項1記載のDMA制御装置であって、
前記入力指標と出力指標はN-1次元を示すN個を用意し、前記計算装置はDMA情報に記載されるN-1次元の転送量と転送単位に従って0次元からN-1次元までの転送量の積を転送単位ごとに分割し入力指標を生成することを特徴としたDMA制御装置。 - 請求項4記載および請求項5記載のDMA制御装置であって、
前記計算装置はDMA情報に記載される参照次元だけの前記出力指標と前記入力指標とを比較し前記パイプライン装置を起動するか否かを決定することを特徴としたDMA制御装置。
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