JP5605255B2 - Manufacturing method of electronic parts - Google Patents
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Description
本発明は、電子部品の製造方法に関し、さらに詳しくは、基板上に、高い精度で、形成不良なく電極を形成し得る電子部品の製造方法に関する。 The present invention relates to a method for manufacturing an electronic component, and more particularly to a method for manufacturing an electronic component capable of forming an electrode on a substrate with high accuracy and without forming defects.
従来から、弾性表面波素子、弾性境界波素子などの圧電部品や、半導体部品などの電子部品の製造工程においては、圧電ウエハ、半導体ウエハなどの基板上に、蒸着、スパッタリングなどの薄膜技術を用いて、精度高く、電極を形成することがおこなわれている。 Conventionally, in the manufacturing process of piezoelectric parts such as surface acoustic wave elements and boundary acoustic wave elements, and electronic parts such as semiconductor parts, thin film technologies such as vapor deposition and sputtering have been used on substrates such as piezoelectric wafers and semiconductor wafers. Therefore, the electrodes are formed with high accuracy.
たとえば、特許文献1(WO2008/044411)には、電子部品の製造方法の一例として、蒸着により基板上に電極を形成した、弾性境界波素子の製造方法が開示されている。 For example, Patent Document 1 (WO2008 / 044411) discloses a boundary acoustic wave element manufacturing method in which electrodes are formed on a substrate by vapor deposition, as an example of an electronic component manufacturing method.
図6(A)〜(E)に、特許文献1に開示された、弾性境界波素子の製造方法を示す。
6A to 6E show a method for manufacturing a boundary acoustic wave device disclosed in
この従来の方法においては、まず、図6(A)に示すように、基板(たとえばLiNbO3からなる圧電基板)101の上側の主面の全面に、フォトレジスト102を形成する。
In this conventional method, first, as shown in FIG. 6A, a
次に、図6(B)に示すように、フォトレジスト102を感光し、現像して、所望の形状からなるレジストパターン102aを形成する。
Next, as shown in FIG. 6B, the
次に、図6(C)に示すように、反応性イオンエッチングをおこない、基板101のレジストパターン102aが形成されていない部分に、溝101aを形成する。この結果、複数本の溝が形成される。
Next, as shown in FIG. 6C, reactive ion etching is performed to form a
次に、図6(D)に示すように、たとえばAlを蒸着源にして、真空装置内での蒸着により、基板101に形成された溝101a内に電極104を形成する。このとき、レジストパターン102a上にも金属膜105が形成される。
Next, as shown in FIG. 6D, the
次に、図6(E)に示すように、基板101をアセトンなどの剥離溶液に浸漬し、レジストパターン102a、およびレジストパターン102a上に形成された金属膜105を除去する。この結果、基板101の上側の主面には、埋め込まれた状態で電極104が形成される。
Next, as shown in FIG. 6E, the
この弾性境界波素子は、この後、基板101上に誘電体層(図示せず)を形成するなどして完成される。
The boundary acoustic wave element is then completed by forming a dielectric layer (not shown) on the
上述した従来の電子部品の製造方法は、高い精度で電極を形成することができるため、精密な構造からなる電子部品の製造に適したものである。しかしながら、蒸着などの薄膜技術により電極を形成する際に、蒸着源から基板への蒸着金属の垂直入射性が悪いと、電極の形成不良をまねいてしまうという問題があった。すなわち、電極の形成される基板が大きい場合、複数本の溝が形成されているため、蒸着源から基板の直下部分へは、蒸着金属が垂直に入射するが、蒸着源から基板の外周近傍部分へは、蒸着金属が斜めに入射してしまう。このため、基板の外周近傍部分において、電極が圧電基板に乗り上げたような、電極の形成不良が発生してしまうことがあった。また、電極がウエハ内で対称に形成されないため、得られる電子部品の製造ばらつきが大きくなる、という問題もあった。 The above-described conventional method for manufacturing an electronic component is suitable for manufacturing an electronic component having a precise structure because an electrode can be formed with high accuracy. However, when forming an electrode by thin film technology such as vapor deposition, there is a problem that if the perpendicular incidence property of the vapor deposition metal from the vapor deposition source to the substrate is poor, an electrode formation defect is imitated. That is, when the substrate on which the electrode is formed is large, a plurality of grooves are formed, so that the vapor deposition metal is perpendicularly incident on the portion directly below the substrate from the vapor deposition source. The deposited metal is incident obliquely on the surface. For this reason, in the vicinity of the outer periphery of the substrate, an electrode formation defect such as the electrode riding on the piezoelectric substrate may occur. In addition, since the electrodes are not formed symmetrically within the wafer, there is a problem in that manufacturing variations of the obtained electronic components are increased.
なお、蒸着源から基板への蒸着金属の垂直入射性を高めるためには、蒸着源から基板までの距離を大きくすれば良いが、この場合には、蒸着をおこなう真空装置が大型化してしまうという別の問題が発生する。 In addition, in order to improve the perpendicular incidence property of the vapor deposition metal from the vapor deposition source to the substrate, it is sufficient to increase the distance from the vapor deposition source to the substrate. However, in this case, the vacuum apparatus for performing vapor deposition increases in size. Another problem occurs.
図7(A)は、基板上に蒸着により電極を形成した際に、基板の外周近傍部分において、電極の形成不良が発生した状態を示す。すなわち、基板101の上側の主面には、所望の形状からなるレジストパターン102aが形成され、またレジストパターン102aが形成されていない部分に溝101aが形成されており、蒸着により溝101aの内部に電極104が形成されているが、基板101の外周近傍部分においては、矢印Xで示す蒸着金属の入射角度が、基板101の主面に対して垂直ではなく、斜めになってしまう。このため、本来、溝101a内のみに形成されるべき電極104が、溝101aからはみ出し、図中、溝101aの左側壁部から基板101の上側の主面にかけて乗り上げ、電極乗り上げ部104aが形成されることとなる。
FIG. 7A shows a state in which an electrode formation defect has occurred in the vicinity of the outer periphery of the substrate when the electrode is formed on the substrate by vapor deposition. That is, a
そして、図7(B)に示すように、電極104の電極乗り上げ部104aは、基板101から、レジストパターン102a、およびレジストパターン102a上に形成された金属膜105を除去した後も残存する。
As shown in FIG. 7B, the
このように、電子部品(弾性境界波素子)において、電極104が不良形成され、電極乗り上げ部104aが形成されると、電子部品の電気的特性が劣化してしまうという問題があった。あるいは、その電子部品が不良品になってしまい、廃棄しなければならないという問題があった。
As described above, in the electronic component (boundary acoustic wave element), when the
なお、特許文献1に開示された、弾性境界波素子の製造方法では、溝101a内に電極104を形成しているが、この場合に限らず、基板の平坦な主面に電極を形成する場合においても、基板の外周近傍部分において、蒸着金属が垂直に入射せず、電極が不良形成されるという問題があった。すなわち、電極が、設計上形成されるべき位置よりも弾性波伝搬方向にずれて形成されてしまい、電気的特性が劣化してしまうという問題があった。
In the boundary acoustic wave device manufacturing method disclosed in
本発明は、上述した従来の電子部品の製造方法の有する課題を解決するためになされたものであり、その手段として本発明の電子部品の製造方法は、1対の主面を有する平板状の基板を準備する基板準備工程と、基板の一方の主面上に、所望の形状からなるレジストパターンを形成するレジストパターン形成工程と、基板の一方の主面上の、レジストパターンが形成されていない部分に、電極を薄膜技術により形成する電極形成工程と、基板の一方の主面上から、レジストパターンを除去するレジストパターン除去工程とを含み、電極形成工程は、基板を、電極が形成される側の主面が凹むように反らせておこなう工程を備える。 The present invention has been made in order to solve the problems of the above-described conventional method for manufacturing an electronic component, and as its means, the method for manufacturing an electronic component of the present invention is a flat plate having a pair of main surfaces. A substrate preparing step for preparing a substrate, a resist pattern forming step for forming a resist pattern having a desired shape on one main surface of the substrate, and a resist pattern on one main surface of the substrate is not formed The portion includes an electrode forming step of forming an electrode by thin film technology and a resist pattern removing step of removing a resist pattern from one main surface of the substrate, and the electrode forming step forms an electrode on the substrate. A step of performing warping so that the main surface on the side is recessed.
電極形成工程における薄膜技術としては、たとえば、蒸着またはスパッタリングなどを用いることができる。 As a thin film technique in the electrode forming step, for example, vapor deposition or sputtering can be used.
基板には、たとえば、圧電基板または半導体基板などを用いることができる。 As the substrate, for example, a piezoelectric substrate or a semiconductor substrate can be used.
また、電極形成工程に先立ち、基板の一方の主面上のレジストパターンが形成されていない部分に複数本の溝を形成し、電極形成工程においては、その溝の内部に前記電極を形成するようにしても良い。 Prior to the electrode formation step, a plurality of grooves are formed in a portion where the resist pattern on one main surface of the substrate is not formed. In the electrode formation step, the electrodes are formed inside the grooves. Anyway.
また、基板を反らせる方法としては、たとえば、電極形成工程に先立ち、基板の電極が形成されない側の主面上に応力の大きな膜を形成することにより、基板を、電極が形成される側の主面が凹むように反らせることができる。この場合において、応力の大きな膜に紫外線を吸収する特性のものを用い、レジストパターン形成工程に先立ち、基板の電極が形成されない側の主面上に形成するようにすれば、その応力の大きな膜を、レジストパターン形成工程における紫外線反射防止膜としても利用することができる。 Further, as a method of warping the substrate, for example, prior to the electrode forming step, a film having a large stress is formed on the main surface of the substrate on which the electrode is not formed, so that the substrate is formed on the main surface on which the electrode is formed. The surface can be warped so as to be recessed. In this case, if a film having a characteristic of absorbing ultraviolet rays is used for a film having a large stress, and the film is formed on the main surface of the substrate on which the electrode is not formed prior to the resist pattern forming step, the film having a large stress is obtained. Can also be used as an ultraviolet antireflection film in the resist pattern forming step.
また、電極形成工程において基板を反らせる別の方法としては、たとえば、基板を、保持面が曲面状に凹んだ基板保持冶具で吸着することにより、電極が形成される側の主面が凹むように反らせることができる。 Further, as another method of warping the substrate in the electrode forming step, for example, the main surface on the side on which the electrode is formed is recessed by adsorbing the substrate with a substrate holding jig whose holding surface is curved in a curved shape. Can be warped.
本発明の電子部品の製造方法によれば、基板上に、精度の高い電極を、形成不良を発生させることなく形成することができる。 According to the method for manufacturing an electronic component of the present invention, an electrode with high accuracy can be formed on a substrate without causing formation defects.
以下、図面とともに、本発明を実施するための形態について説明する。 Hereinafter, embodiments for carrying out the present invention will be described with reference to the drawings.
[第1実施形態]
図1(A)〜(F)は、本発明の第1実施形態にかかる、電子部品の製造方法において適用される各工程を示す。なお、以下の説明では、電子部品として、弾性境界波素子の製造方法を例に説明する。
[First Embodiment]
1A to 1F show each process applied in the method for manufacturing an electronic component according to the first embodiment of the present invention. In the following description, a method for manufacturing a boundary acoustic wave device will be described as an example of the electronic component.
本実施形態にかかる電子部品の製造方法においては、図1(A)に示すように、まず1対の主面を有する平板状の基板1を準備し、基板1の一方の主面(図面における上側の主面)上に、全面にわたってフォトレジスト2を形成する。基板1としては、たとえば、LiNbO3やLiTaO3からなる圧電基板を用いることができる。また、フォトレジスト2としては、たとえば、KrFレジストやi線レジストを用い、形成方法としては、たとえば、スピンコータを用いることができる。
In the method of manufacturing an electronic component according to the present embodiment, as shown in FIG. 1A, first, a
次に、図1(B)に示すように、フォトレジスト2を、マスクパターン(図示せず)を用い、紫外線を照射して感光し、現像して、基板1の一方の主面に、レジストパターン2aを形成する。後に、レジストパターン2aを形成した部分には電極(後述するIDT電極4)は形成されず、レジストパターン2aを形成しなかった部分に電極が形成されるため、形成したい電極の形状に合わせてマスクパターンを形成する。なお、マスクパターンの形状は、フォトレジスト2が、ポジ型である場合と、ネガ型である場合とで、異なる形状(裏返しの形状)になる。
Next, as shown in FIG. 1B, the
次に、図1(C)に示すように、真空装置内において、レジストパターン2aを用いて反応性イオンエッチングをおこない、基板1の一方の主面上に、溝1aを形成する。このエッチング深さは電極の膜厚よりも若干大きくともよく、小さくともよい。
Next, as shown in FIG. 1C, reactive ion etching is performed using a resist
次に、図1(D)に示すように、基板1の他方の主面上に、応力の大きな膜3を形成する。応力の大きな膜としては、たとえば、SiNなど用いることができ、形成方法としては、たとえば、スパッタを用いることができる。この結果、基板1は、一方の主面側が凹むように反る。凹み量は、0.7μmであった。
Next, as shown in FIG. 1D, a
次に、図1(E)に示すように、真空装置内において、蒸着をおこない、基板1の溝1a内に、IDT電極4を形成する。このとき、レジストパターン2a上にも、金属膜5が形成される。ここで、形成されたIDT電極は、圧電基板の主面と面一であってもよいし、溝から突き出していてもよい。また、圧電基板の主面の面一から凹んでいてもよい。蒸着金属としては、たとえば、Al,AlCu,Ti,Pt,NiCr,Cuからなる群から選ばれた金属、もしくは、Al,AlCu,Ti,Pt,NiCr,Cuからなる群から選ばれた一種以上の金属を含む合金を用いることができる。また、IDT電極4は、上記金属や合金からなる複数の導電層の積層体により構成されていてもよい。また、密着層や拡散防止層が積層されていてもよい。
Next, as shown in FIG. 1E, vapor deposition is performed in a vacuum apparatus to form an
この蒸着による電極形成工程においては、図2に示すように、他方の主面上に形成された応力の大きな膜3により、基板1が、IDT電極4が形成される一方の主面側が凹むように反っているため、矢印Yで示す蒸着源6から基板1への蒸着金属の入射角度が、基板1の一方の主面の全面において、ほぼ垂直となる。この結果、IDT電極4は、複数の溝1a内に高い精度で形成され、電極乗り上げ部が形成されることがない。
In the electrode forming step by vapor deposition, as shown in FIG. 2, the
特に、電極乗り上げ部が形成されてしまうと、電極形成不良となって、弾性波素子の特性に大きな影響を及ぼす。また、溝1a内に密着層や拡散防止層などを積層する場合、従来のような電極形成方法では、電極の端部においてはこれらの層が形成されず、密着層や拡散防止層の役割を果たさない、という不具合が発生してしまうことがあった。しかし、本実施形態によれば、電極が高い精度で溝内に形成されるため、電極乗り上げ部が形成されたり、積層電極が形成されないような不具合は発生せず、特性の良好な弾性波素子を得ることができる。
In particular, if the electrode run-up portion is formed, an electrode formation failure occurs, which greatly affects the characteristics of the acoustic wave device. Further, when an adhesion layer, a diffusion prevention layer, or the like is laminated in the
次に、図1(F)に示すように、基板1から、応力の大きな膜3と、レジストパターン2aと、レジストパターン2a上に形成された金属膜5とを除去する。これらの除去は、基板1をNMP(N−メチル−2−ピロリドン)などの剥離溶液に浸漬し、一括しておこなっても良い。あるいは、応力の大きな膜3の除去と、レジストパターン2aおよびレジストパターン2a上に形成された金属膜5の除去とを別々におこなっても良く、その前後は問わない。
Next, as shown in FIG. 1F, the
基板1の他方の主面から応力の大きな膜3を除去したことにより、基板1は反りがなくなり平坦な板状となる。そして、平坦となった基板1の一方の主面には、埋め込まれた状態で、IDT電極4が精度よく形成されている。
By removing the
その後、図1(G)に示すように、基板1の主面を覆うように絶縁膜8を蒸着やスパッタなどにより形成する。このようにして、弾性境界波素子が製造される。
Thereafter, as shown in FIG. 1G, an insulating
以上、本発明の第1実施形態にかかる、電子部品の製造方法について説明した。しかしながら、本発明が本実施形態の内容に限定されることはなく、発明の主旨に沿って、種々の変更をなすことができる。 The electronic component manufacturing method according to the first embodiment of the present invention has been described above. However, the present invention is not limited to the contents of the present embodiment, and various modifications can be made in accordance with the gist of the invention.
たとえば、基板1として、多数個分の子基板が一括して形成された、大きな母基板を用い、IDT電極4形成後に、個々の子基板に分割するようにしても良い。
For example, a large mother substrate in which a large number of child substrates are collectively formed as the
また、IDT電極4は、基板1の一方の主面だけに形成するのではなく、他方の主面にも形成するようにしても良い。この場合には、一方の主面にIDT電極4を形成した後、他方の主面に、同様の工程を施すなどの方法をとることができる。
Further, the
[第2実施形態]
以下、本発明の第2実施形態にかかる、電子部品の製造方法について説明する。
[Second Embodiment]
Hereinafter, an electronic component manufacturing method according to the second embodiment of the present invention will be described.
図3(A)〜(F)は、本発明の第2実施形態にかかる、電子部品の製造方法において適用される各工程を示す。以下の説明では、電子部品として、弾性境界波素子の製造方法を例に説明する。 3A to 3F show each step applied in the method for manufacturing an electronic component according to the second embodiment of the present invention. In the following description, a method for manufacturing a boundary acoustic wave element will be described as an example of an electronic component.
本実施形態にかかる電子部品の製造方法においては、図3(A)に示すように、まず、基板1の他方の主面(図面における下側の主面)上に、応力の大きい膜13を形成する。この結果、基板1は、一方の主面側が凹むように反る。なお、本実施形態においては、応力の大きな膜13に、酸化膜(ZnO,SiO2,SiON)や窒化膜(SiN,AlN,TiN)などの、紫外線を吸収する特性のものを用いる。
In the method for manufacturing an electronic component according to the present embodiment, as shown in FIG. 3A, first, a
次に、図3(B)に示すように、基板1の一方の主面(図面における上側の主面)上に、全面にわたってフォトレジスト2を形成する。なお、図3(A)に示す基板1の他方の主面上への応力の大きな膜13の形成と、図3(B)に示す基板1の一方の主面上へのフォトレジスト2の形成とは、順序を逆にしても良い。
Next, as shown in FIG. 3B, a
次に、図3(C)に示すように、フォトレジスト2を、マスクパターン(図示せず)を用い、紫外線を照射して感光し、現像して、基板1の一方の主面に、レジストパターン2aを形成する。なお、紫外線を照射して感光する際には、基板1の他方の主面に形成された、紫外線を吸収する特性を備えた、応力の大きな膜13が紫外線反射防止膜としても機能する。この結果、フォトレジスト2は、基板1の他方の主面側からの、反射による不要な照射を受けることが抑制されるため、レジストパターン2aは、所望するどおりの正確な形状になる。
Next, as shown in FIG. 3C, the
次に、図3(D)に示すように、真空装置内において、レジストパターン2aを用いて反応性イオンエッチングをおこない、基板1の一方の主面上に、溝1aを形成する。
Next, as shown in FIG. 3D, reactive ion etching is performed using a resist
次に、図3(E)に示すように、真空装置内において、蒸着をおこない、基板1の溝1a内に、IDT電極4を形成する。この蒸着による電極形成工程においては、他方の主面上に形成された応力の大きな膜13により、基板1が、IDT電極4が形成される一方の主面側が凹むように反っているため、蒸着源から基板1への蒸着金属の入射角度が、基板1の一方の主面の全面において、ほぼ垂直となる。この結果、IDT電極4は、複数の溝1a内に高い精度で形成される。
Next, as shown in FIG. 3E, vapor deposition is performed in a vacuum apparatus to form an
次に、図3(F)に示すように、基板1から、応力の大きな膜13と、レジストパターン2aと、レジストパターン2a上に形成された金属膜5とを除去する。 基板1の他方の主面から応力の大きな膜13を除去したことにより、基板1は反りがなくなり平坦な板状となる。そして、平坦となった基板1の一方の主面には、埋め込まれた状態で、IDT電極4が形成されている。
Next, as shown in FIG. 3F, the
その後、図3(G)に示すように、基板1の主面を覆うように絶縁膜8を蒸着やスパッタなどにより形成し、弾性境界波素子が製造される。
Thereafter, as shown in FIG. 3G, an insulating
本実施形態においては、基板1の他方の主面上に形成される応力の大きな膜13に、紫外線を吸収する特性のものを用いており、フォトレジスト2に紫外線を照射して感光する際に、応力の大きな膜13により、基板1の他方の主面側から不要な紫外線が反射するのを抑制することができる。したがって、本実施形態においては、レジストパターン2aをより正確に形成することができ、基板1に形成されるIDT電極4を、より精度の高いものとすることができる。
In the present embodiment, the
[第3実施形態]
図4(A)〜(E)は、本発明の第3実施形態にかかる、電子部品の製造方法において適用される各工程を示す。以下の説明では、電子部品として、弾性境界波素子の製造方法を例に説明する。
[Third Embodiment]
4A to 4E show the respective steps applied in the electronic component manufacturing method according to the third embodiment of the present invention. In the following description, a method for manufacturing a boundary acoustic wave element will be described as an example of an electronic component.
本実施形態にかかる電子部品の製造方法においては、図4(A)に示すように、まず基板1を準備し、基板1の一方の主面上に、全面にわたってフォトレジスト2を形成する。
In the method of manufacturing an electronic component according to the present embodiment, as shown in FIG. 4A, first, a
次に、図4(B)に示すように、フォトレジスト2を、マスクパターン(図示せず)を用い、紫外線を照射して感光し、現像して、基板1の一方の主面に、レジストパターン2aを形成する。
Next, as shown in FIG. 4B, the
次に、図4(C)に示すように、基板1の他方の主面上に、応力の大きな膜3を形成する。この結果、基板1は、一方の主面側が凹むように反る。
Next, as shown in FIG. 4C, a
次に、図4(D)に示すように、真空装置内において、蒸着をおこない、基板1の一方の主面上に、IDT電極14を形成する。このとき、レジストパターン2a上にも、金属膜5が形成される。第1実施形態および第2実施形態においては、基板1の一方の主面上に溝を形成し、その溝の内部に電極を形成しているが、本実施形態においては、溝を形成することなく、基板1の平坦な一方の主面上にIDT電極14を形成している。
Next, as shown in FIG. 4D, vapor deposition is performed in a vacuum apparatus, and an
次に、図4(E)に示すように、基板1から、応力の大きな膜3と、レジストパターン2aと、レジストパターン2a上に形成された金属膜5とを除去する。
Next, as shown in FIG. 4E, the
基板1の他方の主面から応力の大きな膜3を除去したことにより、基板1は反りがなくなり平坦な板状となる。そして、平坦となった基板1の一方の主面上には、IDT電極14が弾性波伝搬方向にずれることなく、精度よく形成されている。
By removing the
その後、図4(F)に示すように、基板1の主面を覆うように絶縁膜8を蒸着やスパッタなどにより形成し、弾性境界波素子が製造される。
Thereafter, as shown in FIG. 4F, an insulating
このように、第3実施形態においては、溝を形成することなく、基板1の平坦な一方の主面上にIDT電極14を形成している。
Thus, in the third embodiment, the
[第4実施形態]
図5に、本発明の第4実施形態かかる電子部品の製造方法における、電極形成工程を示す。以下の説明では、電子部品として、弾性境界波素子の製造方法を例に説明する。
[Fourth Embodiment]
FIG. 5 shows an electrode forming step in the method for manufacturing an electronic component according to the fourth embodiment of the present invention. In the following description, a method for manufacturing a boundary acoustic wave element will be described as an example of an electronic component.
第1実施形態〜第3実施形態においては、図1(D)、図3(A)、図4(C)などに示すように、基板1の他方の主面上に、応力の大きな膜3または13を形成することによって、基板1を一方の主面側が凹むように反らせ、その上で、図1(E)、図3(E)、図4(D)などに示すように、基板1の一方の主面上にIDT電極4を形成している。
In the first to third embodiments, as shown in FIG. 1D, FIG. 3A, FIG. 4C and the like, a
これに対し、本実施形態においては、応力の大きな膜3を使用することなく、図5に示すように、上側に凹んだ曲面7aを備え、曲面7aの全面にわたって、複数の真空吸着孔7bが形成された基板保持冶具7を用い、基板保持冶具7の曲面7aに基板1を吸着させて、基板1を一方の主面側が凹むように反らせる。そして、基板1を一方の主面側が凹むように反らせた上で、基板1の一方の主面上にIDT電極4を形成する。本実施形態においても、蒸着源から基板1への蒸着金属の入射角度(図5において矢印Yで示す)が、基板1の一方の主面の全面において、ほぼ垂直となるため、IDT電極4は、複数の溝1a内に高い精度で形成され、電極乗り上げ部が形成されたり、溝1a内に電極非形成部が形成されることがない。
On the other hand, in the present embodiment, as shown in FIG. 5, without using the
本実施形態における他の工程は、たとえば、図1(A)〜(F)に示した第1実施形態の工程と同様にすることができる。 Other steps in the present embodiment can be made similar to the steps of the first embodiment shown in FIGS. 1 (A) to (F), for example.
すなわち、まず、図1(A)に示すように、基板1の一方の主面上に、全面にわたってフォトレジスト2を形成し、図1(B)に示すように、フォトレジスト2を感光し、現像して、レジストパターン2aを形成し、図1(C)に示すように、反応性イオンエッチングをおこない、基板1の一方の主面上に、溝1aを形成する。そして、上述したとおり、図5に示すように、基板保持冶具7を用い、基板保持冶具7の曲面7aに基板1を吸着させて、基板1を一方の主面側が凹むように反らせた上で、基板1の一方の主面上の溝1a内に、蒸着などによりIDT電極4を形成する。この後、基板1を基板保持冶具7から取出した上で、図1(F)に示すように、基板1から、レジストパターン2aと、レジストパターン2a上に形成された金属膜5とを除去し、埋め込まれた状態でIDT電極4が形成された基板1を得る。その後、基板1の主面を覆うように絶縁膜を蒸着やスパッタなどにより形成し、弾性境界波素子が製造される。
That is, first, as shown in FIG. 1A, a
本実施形態においては、基板1の他方の主面上に応力の大きな膜を形成するのではなく、基板保持冶具7を用いて基板1を一方の主面側が凹むように反らせ、その上で基板1の一方の主面上にIDT電極4を形成している。したがって、製造が容易であり、生産性の高い、電子部品の製造方法となっている。
In the present embodiment, instead of forming a film having a large stress on the other main surface of the
なお、上述の実施形態においては、電子部品として弾性境界波素子を製造したが、本発明は弾性境界波素子以外にも、例えば弾性表面波素子などに適用でき、形成される電極もIDT電極には限定されない。また、上述の実施形態における電極構造も特に限定されず、たとえば1ポート型の弾性波共振子を構成してもよいし、弾性波フィルタを構成してもよい。1ポート型の弾性波共振子を構成した場合は、IDT電極を構成している電極の弾性波伝搬方向両側に、同じく電極膜により反射器が形成される。 In the above-described embodiment, the boundary acoustic wave element is manufactured as the electronic component. However, the present invention can be applied to, for example, a surface acoustic wave element other than the boundary acoustic wave element, and the formed electrode is also an IDT electrode. Is not limited. Further, the electrode structure in the above-described embodiment is not particularly limited, and for example, a 1-port type elastic wave resonator may be configured, or an elastic wave filter may be configured. When a 1-port type acoustic wave resonator is configured, reflectors are similarly formed by electrode films on both sides of the electrode constituting the IDT electrode in the acoustic wave propagation direction.
1:基板
1a:溝
2:フォトレジスト
2a:レジストパターン
3、13:応力の大きな膜
4、14:IDT電極
5:金属膜
6:蒸着源
7:基板保持冶具
7a:曲面
7b:真空吸着孔
1:
Claims (4)
前記基板の一方の主面上に、所望の形状からなるレジストパターンを形成するレジストパターン形成工程と、
前記基板の一方の主面上の、前記レジストパターンが形成されていない部分に、電極を薄膜技術により形成する電極形成工程と、
前記基板の一方の主面上から、前記レジストパターンを除去するレジストパターン除去工程と、を含んでなる電子部品の製造方法であって、
前記電極形成工程は、前記基板を、前記電極が形成される側の主面が凹むように反らせておこない、
前記電極形成工程に先立ち、前記基板の前記電極が形成されない側の主面上に応力の大きな膜を形成し、前記基板を、前記電極が形成される側の主面が凹むように反らせ、
前記応力の大きな膜が、前記レジストパターン形成工程に先立ち、前記基板の前記電極が形成されない側の主面上に形成され、当該応力の大きな膜は、前記レジストパターン形成工程において紫外線反射防止膜としても利用される、電子部品の製造方法。 A substrate preparation step of preparing a flat substrate having a pair of main surfaces;
A resist pattern forming step of forming a resist pattern having a desired shape on one main surface of the substrate;
An electrode forming step of forming an electrode by a thin film technique on a portion of the main surface of the substrate where the resist pattern is not formed;
A resist pattern removing step for removing the resist pattern from one main surface of the substrate, and a method for producing an electronic component comprising:
The electrode forming step, the substrate, have such keep warped as the main surface on the side where the electrode is formed is recessed,
Prior to the electrode formation step, a large stress film is formed on the main surface of the substrate on which the electrode is not formed, and the substrate is warped so that the main surface on which the electrode is formed is recessed,
Prior to the resist pattern forming step, the high stress film is formed on the main surface of the substrate where the electrode is not formed, and the high stress film is used as an ultraviolet antireflection film in the resist pattern forming step. Is also used for manufacturing electronic components.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
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Applications Claiming Priority (1)
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Publications (2)
Publication Number | Publication Date |
---|---|
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Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2011028963A Active JP5605255B2 (en) | 2011-02-14 | 2011-02-14 | Manufacturing method of electronic parts |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP5605255B2 (en) |
Family Cites Families (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH08120443A (en) * | 1994-10-21 | 1996-05-14 | Fuji Elelctrochem Co Ltd | Formation of film pattern by lifting-off |
CH692000A5 (en) * | 1995-11-13 | 2001-12-31 | Unaxis Balzers Ag | Coating chamber, substrate carrier therefor, method of vacuum deposition and coating methods. |
JP3753525B2 (en) * | 1997-11-28 | 2006-03-08 | 宮城沖電気株式会社 | Sputtering method |
CN101523720B (en) * | 2006-10-12 | 2012-07-04 | 株式会社村田制作所 | Elastic boundary-wave device |
-
2011
- 2011-02-14 JP JP2011028963A patent/JP5605255B2/en active Active
Also Published As
Publication number | Publication date |
---|---|
JP2012167322A (en) | 2012-09-06 |
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