JP5457230B2 - 保護継電装置、並びに電流差動保護継電装置 - Google Patents
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Description
1b…しゃ断器
1c…変流器
1d…変成器
1e…アナログ入力手段
1f…アナログ/ディジタル変換手段
1g…演算手段
1h…出力手段(DO手段)
1i…タイミング制御手段
1j…同期信号選択手段
1k…LAN通信手段
1l…送信手段
1m…受信手段
1n…双方向アクセス可能なメモリ手段
1o…伝送制御手段
1p…伝送制御ボードの送信手段
1q…伝送制御ボードの受信手段
1r…サンプリング同期制御手段
1s…多重化装置
100…ディジタルプロセッシングボード
101…伝送制御ボード
100a…サンプリング同期信号(伝送制御ボード)
100b…サンプリング同期信号(ディジタルシグナルプロセッシングボード)
100c…サンプリング同期信号
100d…A/D変換指令信号
100e…A端子よりB端子へ送信する送信信号(B端子の受信信号)
100f…A端子よりB端子へ送信する送信信号(A端子の受信信号)
100g…LAN経由したA端子よりB端子への送信信号(B端子の受信信号)
100h…LAN経由したB端子よりA端子への送信信号(A端子の受信信号)
100i…電流信号
100j…電圧信号
100k…遮断器に対する遮断信号
2a…保護アプリケーション手段
2b…送受信データバッファ手段
2c…データコピー手段
2e…伝送制御内の送受信データバッファ手段
2f…サイクリックデータ転送手段
2h…LAN通信手段内送受信データバッファ手段
4a…伝送制御における従局から主局に対する送信信号
4b…伝送制御における主局から従局に対する送信信号
4c…LAN通信手段における主局から従局への同期開始信号
4d…LAN通信手段における主局から従局へのフォローアップ信号
4e…LAN通信手段における従局から主局への遅延情報送信依頼信号
4f…LAN通信手段における従局から主局への遅延情報応答信号
5a…入力変換器
5b…抵抗
5c…コンデンサ
5d…演算増幅器(OPアンプ)
5e…サンプルホールドアンプ
5f…A/D変換用基準信号源
5g…逐次比較回路
5h…A/D変換器用CLK発生器
5i…A/D制御回路
5j…出力ドライバ回路
6a…アナログ入力信号波形例
6b…サンプルホールド波形例
6c…A/D変換動作ステータス信号例
6d…A/D変換動作例
6e…A/D変換器出力データ例
7a…エッジ検出回路
7b…パルス生成回路
7c…選択回路、
7d、7e…同期カウンタ
7g…組合せ回路
7f…CLK発生回路、
70a…選択信号
70b…カウンタクリア信号、
7h、7j、7l…カウンタクリア信号例
7i、7k、7m…A/D変換データ出力例
11a…IP網対応通信手段
11b…IP通信網
Claims (5)
- 送電線の電流を入力してディジタル量に変換する入力部と、該入力部におけるサンプリングタイミングを決定するタイミング制御部と、前記入力部からのディジタル量を用いて保護演算を行う演算部と、該演算部の演算結果に応じて前記送電線に設けられた遮断器の制御信号を与える出力部と、前記入力部のディジタル量を、サイクリックにパケット転送することでデータ送信し、サイクリックにパケット転送されてきたデータを受信して前記演算部に与える内部の通信部と、内部の通信部におけるサンプリング同期制御のための第1のサンプリングパルスと、外部の通信部からのサンプリング同期制御のための第2のサンプリングパルスを入力し、いずれかのサンプリングパルスを選択して前記タイミング制御部に与える選択部を備え、
前記外部の通信部は、専用回線通信網で前記入力部のディジタル量をサイクリックにデータ送受信し、相手端とのサンプリング同期タイミング合せを行う通信部であり、前記内部の通信部はインターネットプロトコル通信網でサイクリックにパケット転送することでデータ送受信し、相手端とのサンプリング同期タイミング合せを行うLAN通信部とされることを特徴とする保護継電装置。 - 送電線の電流を入力してディジタル量に変換する入力部と、該入力部におけるサンプリングタイミングを決定するタイミング制御部と、前記入力部からのディジタル量を用いて保護演算を行う演算部と、該演算部の演算結果に応じて前記送電線に設けられた遮断器の制御信号を与える出力部と、前記入力部のディジタル量を、サイクリックにパケット転送することでデータ送信し、サイクリックにパケット転送されてきたデータを受信して前記演算部に与える内部の通信部と、該内部の通信部におけるサンプリング同期制御のための第1のサンプリングパルスと、前記外部の通信部からのサンプリング同期制御のための第2のサンプリングパルスを入力し、いずれかのサンプリングパルスを選択して前記タイミング制御部に与える選択部から構成される保護継電装置を前記送電線の各端子に備え、前記演算部では、各端子で検出した電流の差を求めるとともに、
前記外部の通信部は、専用回線通信網で前記入力部のディジタル量をサイクリックにデータ送受信し、相手端とのサンプリング同期タイミング合せを行う通信部であり、内部の通信部はインターネットプロトコル通信網でサイクリックにパケット転送することでデータ送受信し、相手端とのサンプリング同期タイミング合せを行うLAN通信部とされることを特徴とする電流差動保護継電装置。 - 請求項2記載の電流差動保護継電装置において、
前記保護継電装置の内部の通信部と、外部の通信部のいずれか一方、または双方を用いて信号伝送を行なうことを特徴とする電流差動保護継電装置。 - 請求項3記載の電流差動保護継電装置において、
保護継電装置の内部の通信部と、外部の通信部の双方を用いて信号伝送を行なうとともに、内部の通信部と、外部の通信部の切替のときに、前記出力部が前記送電線に設けられた遮断器の制御信号を与えることを阻止することを特徴とする電流差動保護継電装置。 - 請求項2から請求項4のいずれか1項に記載の電流差動保護継電装置において、
前記内部の通信部は、サンプリング同期制御用の遅延時間、オフセット時間を求めるための遅延時間計測パケットを送受信することで、サンプリングタイミングの同期誤差を計測し、サンプリング同期制御する機能を有することを特徴とする電流差動保護継電装置。
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JP2010048677A JP5457230B2 (ja) | 2010-03-05 | 2010-03-05 | 保護継電装置、並びに電流差動保護継電装置 |
Applications Claiming Priority (1)
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JP2010048677A JP5457230B2 (ja) | 2010-03-05 | 2010-03-05 | 保護継電装置、並びに電流差動保護継電装置 |
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Family Applications (1)
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JP2010048677A Active JP5457230B2 (ja) | 2010-03-05 | 2010-03-05 | 保護継電装置、並びに電流差動保護継電装置 |
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