JP5396169B2 - データアクセス制御装置 - Google Patents
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Description
図1は、本実施の形態1のデジタルカメラのデータアクセス制御装置周りの構成例を示す概略ブロック図である。本実施の形態1のデータアクセス制御装置1は、SDRAM10と、メモリ制御部11と、複数のDMA要求信号生成部13,14,…,15とを備える。
つづいて、本発明の実施の形態2について説明する。本実施の形態2は、前述の実施の形態1に加えて、メモリ制御部11に接続されるモジュール数が、より多くなる場合に好適な適用例を示す。ここで、図1中には特に図示しないが、本実施の形態2では、モジュール1,2,Nに加えて、モジュール(DMA要求信号生成部)3を備えるものとする。このモジュール3から転送されるデータは、SDRAM10に保存された画像データを例えばカード式の記録媒体(メディア)に記憶させるためのものである。よって、モジュール3は、常に一定のレートでのデータ転送を必要としないデータアクセス優先度が相対的に低い低速モジュールである。
10 SDRAM
11 メモリ制御部
13 DMA要求信号生成部
14 DMA要求信号生成部
15 DMA要求信号生成部
A〜D バンク
Claims (4)
- 複数のバンクを有するアドレス空間からなるメモリに対して、データアクセス要求を行う際の連続する書き込み要求数が設定可能な複数のモジュールからデータアクセスを行うデータアクセス制御装置であって、
前記複数のモジュールのうち、前記メモリに対するデータアクセスの優先度が相対的に高いデータを出力する高速モジュールと、
前記複数のモジュールのうち、前記メモリに対するデータアクセスの優先度が相対的に低いデータを出力する低速モジュールと、
前記各モジュールから前記メモリへのデータアクセスの要求を受付け、該要求の優先度に応じてデータアクセス要求を許可する信号を対応する前記モジュールへ送信するとともに、許可した該モジュールから要求されたメモリアクセス条件に基づいて前記メモリへのデータアクセスを制御するメモリ制御部と、
を備え、
前記高速モジュールは、
前記連続する書き込み要求数を、転送レートとデータ量とに基づいて、前記メモリのバンク数の整数倍に設定し、
前記メモリ制御部に対して、前記複数バンクへの書き込み要求数だけ連続したデータアクセス要求を、隣接する要求で異なるバンクに連続して行い、アクセス要求元モジュールから前記メモリへ連続的にデータ書き込みを行う場合において、前記メモリの異なる複数のバンクへのアクセスであって、かつこれらのアクセスが最短時間となるような書き込みデータが所定以上溜まったときに、前記アクセス要求元モジュールから前記メモリ制御部への書き込み要求信号が発せられることを特徴とするデータアクセス制御装置。 - 前記高速モジュールを含むデータアクセスの優先度が相対的に高い複数のモジュールを1グループとして扱い、グループ外の他のモジュールよりもデータアクセスの優先度を高くしたことを特徴とする請求項1に記載のデータアクセス制御装置。
- 前記メモリ制御部は、グループ化された前記複数のモジュールの全てのデータアクセス要求がなくなるまで該グループにバスを占有させ、グループ外の他のモジュールのデータアクセス要求をマスクすることを特徴とする請求項2に記載のデータアクセス制御装置。
- 前記マスク処理は、前記メモリ制御部の設定によりグループ別に行うことを特徴とする請求項3に記載のデータアクセス制御装置。
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