JP5365098B2 - 表示装置及びその表示駆動方法 - Google Patents
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前記データ信号線に供給される階調信号が前記第1の画素電極を介して印加される第2の画素電極と、
前記データ信号線に供給される階調信号が前記第1の画素電極と第2の画素電極とを直列的に介して印加される第3の画素電極と、
前記データ信号線と前記第1の画素電極との間の導通/非導通を切り換える第1のスイッチング素子と、
前記第1の画素電極と前記第2の画素電極との間の導通/非導通を切り換える第2のスイッチング素子と、
前記第2の画素電極と前記第3の画素電極との間の導通/非導通を切り換える第3のスイッチング素子と、を備え、
前記第1の画素電極と前記第2の画素電極と前記第3の画素電極とが同一の画素行として配置されていて、
一の水平期間を時系列で第1乃至第3の水平期間に分割したときに、前記一の水平期間の第1の水平期間において、第4の画素行の前記第3の画素電極に保持させる階調信号を前記データ信号線に供給した後に、前記一の水平期間の第2の水平期間において、前記第4の画素行とは異なる第3の画素行の前記第2の画素電極に保持させる階調信号を前記データ信号線に供給し、さらにその後に、前記一の水平期間の第3の水平期間において、前記第4の画素行及び第3の画素行とは異なる第2の画素行の前記第1の画素電極に保持させる階調信号を前記データ信号線に供給し、
前記一の水平期間の直前の水平期間を時系列で第1乃至第3の水平期間に分割したときに、前記直前の水平期間の第1の水平期間において、第3の画素行の前記第3の画素電極に保持させる階調信号を前記データ信号線に供給した後に、前記直前の水平期間の第2の水平期間において、前記第2の画素行の前記第2の画素電極に保持させる階調信号を前記データ信号線に供給し、さらにその後に、前記直前の水平期間の第3の水平期間において、前記第4の画素行、第3の画素行、及び、第2の画素行とは異なる第1の画素行の前記第1の画素電極に保持させる階調信号を前記データ信号線に供給し、
前記一の水平期間の直後の水平期間を時系列で第1乃至第3の水平期間に分割したときに、前記直後の水平期間の第1の水平期間において、前記第4の画素行、第3の画素行、第2の画素行、及び、第1の画素行とは異なる第5の画素行の前記第3の画素電極に保持させる階調信号を前記データ信号線に供給した後に、前記直後の水平期間の第2の水平期間において、前記第4の画素行の前記第2の画素電極に保持させる階調信号を前記データ信号線に供給し、さらにその後に、前記直前の水平期間の第3の水平期間において、前記第3の画素行の前記第1の画素電極に保持させる階調信号を前記データ信号線に供給する信号側駆動回路と、
前記直前の水平期間の第2の水平期間から前記一の水平期間の第1の水平期間にかけて連続的に、前記第3の画素行の第1のスイッチング素子、前記第4の画素行の第2のスイッチング素子及び前記第5の画素行の第3のスイッチング素子をそれぞれ前記導通とし、
前記直前の水平期間の第3の水平期間から前記一の水平期間の第2の水平期間にかけて連続的に、前記第2の画素行の第1のスイッチング素子及び前記第3の画素行の第2のスイッチング素子及び前記第4の画素行の第3のスイッチング素子をそれぞれ前記導通とし、
前記一の水平期間の第1の水平期間から前記一の水平期間の第3の水平期間にかけて連続的に、前記第1の画素行の第1のスイッチング素子を前記導通とするとともに前記第2の画素行の第2のスイッチング素子及び前記第3の画素行の第3のスイッチング素子をそれぞれ前記導通とする走査側駆動回路と、
をさらに備えたことを特徴とする。
一の水平期間を時系列で第1乃至第3の水平期間に分割したときに、前記一の水平期間の第1の水平期間において、第4の画素行の前記第3の画素電極に保持させる階調信号を前記データ信号線に供給した後に、前記一の水平期間の第2の水平期間において、前記第4の画素行とは異なる第3の画素行の前記第2の画素電極に保持させる階調信号を前記データ信号線に供給し、さらにその後に、前記一の水平期間の第3の水平期間において、前記第4の画素行、及び、第3の画素行とは異なる第2の画素行の前記第1の画素電極に保持させる階調信号を前記データ信号線に供給し、
前記一の水平期間の直前の水平期間を時系列で第1乃至第3の水平期間に分割したときに、前記直前の水平期間の第1の水平期間において、第3の画素行の前記第3の画素電極に保持させる階調信号を前記データ信号線に供給した後に、前記直前の水平期間の第2の水平期間において、前記第2の画素行の前記第2の画素電極に保持させる階調信号を前記データ信号線に供給し、さらにその後に、前記直前の水平期間の第3の水平期間において、前記第4の画素行、第3の画素行、及び、第2の画素行とは異なる第1の画素行の前記第1の画素電極に保持させる階調信号を前記データ信号線に供給し、
前記一の水平期間の直後の水平期間を時系列で第1乃至第3の水平期間に分割したときに、前記直後の水平期間の第1の水平期間において、前記第4の画素行、第3の画素行、第2の画素行、及び、乃至第1の画素行とは異なる第5の画素行の前記第3の画素電極に保持させる階調信号を前記データ信号線に供給した後に、前記直後の水平期間の第2の水平期間において、前記第4の画素行の前記第2の画素電極に保持させる階調信号を前記データ信号線に供給し、さらにその後に、前記直前の水平期間の第3の水平期間において、前記第3の画素行の前記第1の画素電極に保持させる階調信号を前記データ信号線に供給する信号側駆動ステップと、
前記直前の水平期間の第2の水平期間から前記一の水平期間の第1の水平期間にかけて連続的に、前記第3の画素行の第1のスイッチング素子、前記第4の画素行の第2のスイッチング素子及び前記第5の画素行の第3のスイッチング素子をそれぞれ前記導通とし、
前記直前の水平期間の第3の水平期間から前記一の水平期間の第2の水平期間にかけて連続的に、前記第2の画素行の第1のスイッチング素子及び前記第3の画素行の第2のスイッチング素子及び前記第4の画素行の第3のスイッチング素子をそれぞれ前記導通とし、
前記一の水平期間の第1の水平期間から前記一の水平期間の第3の水平期間にかけて連続的に、前記第1の画素行の第1のスイッチング素子を前記導通とするとともに前記第2の画素行の第2のスイッチング素子及び前記第3の画素行の第3のスイッチング素子をそれぞれ前記導通とする走査側駆動ステップと、を有することを特徴とする。
18:共通電極
20:ソースドライバ
30:ゲートドライバ
40:画素データ発生回路
50:コモン信号生成回路
60:タイミング制御回路
70:電源発生回
E、E(i,j,g)、E(i,j,r)、E(i,j,b):画素電極
P、P(i,j,g)、P(i,j,r)、P(i,j,b):表示画素
T(i,j,g)、T(i,j,r)、T(i,j,b):薄膜トランジスタ
G(j):走査信号線
S(i):データ信号線
Claims (2)
- 走査信号線とデータ信号線との交点に対応させて配置された第1の画素電極と、
前記データ信号線に供給される階調信号が前記第1の画素電極を介して印加される第2の画素電極と、
前記データ信号線に供給される階調信号が前記第1の画素電極と第2の画素電極とを直列的に介して印加される第3の画素電極と、
前記データ信号線と前記第1の画素電極との間の導通/非導通を切り換える第1のスイッチング素子と、
前記第1の画素電極と前記第2の画素電極との間の導通/非導通を切り換える第2のスイッチング素子と、
前記第2の画素電極と前記第3の画素電極との間の導通/非導通を切り換える第3のスイッチング素子と、を備え、
前記第1の画素電極と前記第2の画素電極と前記第3の画素電極とが同一の画素行として配置されていて、
一の水平期間を時系列で第1乃至第3の水平期間に分割したときに、前記一の水平期間の第1の水平期間において、第4の画素行の前記第3の画素電極に保持させる階調信号を前記データ信号線に供給した後に、前記一の水平期間の第2の水平期間において、前記第4の画素行とは異なる第3の画素行の前記第2の画素電極に保持させる階調信号を前記データ信号線に供給し、さらにその後に、前記一の水平期間の第3の水平期間において、前記第4の画素行及び第3の画素行とは異なる第2の画素行の前記第1の画素電極に保持させる階調信号を前記データ信号線に供給し、
前記一の水平期間の直前の水平期間を時系列で第1乃至第3の水平期間に分割したときに、前記直前の水平期間の第1の水平期間において、第3の画素行の前記第3の画素電極に保持させる階調信号を前記データ信号線に供給した後に、前記直前の水平期間の第2の水平期間において、前記第2の画素行の前記第2の画素電極に保持させる階調信号を前記データ信号線に供給し、さらにその後に、前記直前の水平期間の第3の水平期間において、前記第4の画素行、第3の画素行、及び、第2の画素行とは異なる第1の画素行の前記第1の画素電極に保持させる階調信号を前記データ信号線に供給し、
前記一の水平期間の直後の水平期間を時系列で第1乃至第3の水平期間に分割したときに、前記直後の水平期間の第1の水平期間において、前記第4の画素行、第3の画素行、第2の画素行、及び、第1の画素行とは異なる第5の画素行の前記第3の画素電極に保持させる階調信号を前記データ信号線に供給した後に、前記直後の水平期間の第2の水平期間において、前記第4の画素行の前記第2の画素電極に保持させる階調信号を前記データ信号線に供給し、さらにその後に、前記直前の水平期間の第3の水平期間において、前記第3の画素行の前記第1の画素電極に保持させる階調信号を前記データ信号線に供給する信号側駆動回路と、
前記直前の水平期間の第2の水平期間から前記一の水平期間の第1の水平期間にかけて連続的に、前記第3の画素行の第1のスイッチング素子、前記第4の画素行の第2のスイッチング素子及び前記第5の画素行の第3のスイッチング素子をそれぞれ前記導通とし、
前記直前の水平期間の第3の水平期間から前記一の水平期間の第2の水平期間にかけて連続的に、前記第2の画素行の第1のスイッチング素子及び前記第3の画素行の第2のスイッチング素子及び前記第4の画素行の第3のスイッチング素子をそれぞれ前記導通とし、
前記一の水平期間の第1の水平期間から前記一の水平期間の第3の水平期間にかけて連続的に、前記第1の画素行の第1のスイッチング素子を前記導通とするとともに前記第2の画素行の第2のスイッチング素子及び前記第3の画素行の第3のスイッチング素子をそれぞれ前記導通とする走査側駆動回路と、
をさらに備えたことを特徴とする表示装置。 - 走査信号線とデータ信号線との交点に対応させて配置された第1の画素電極と、前記データ信号線に供給される階調信号が前記第1の画素電極を介して印加される第2の画素電極と、前記データ信号線に供給される階調信号が前記第1の画素電極と第2の画素電極とを直列的に介して印加される第3の画素電極と、前記データ信号線と前記第1の画素電極との間の導通/非導通を切り換える第1のスイッチング素子と、前記第1の画素電極と前記第2の画素電極との間の導通/非導通を切り換える第2のスイッチング素子と、前記第2の画素電極と前記第3の画素電極との間の導通/非導通を切り換える第3のスイッチング素子と、を備え、前記第1の画素電極と前記第2の画素電極と前記第3の画素電極とが同一の画素行として配置された表示装置の表示駆動方法であって、
一の水平期間を時系列で第1乃至第3の水平期間に分割したときに、前記一の水平期間の第1の水平期間において、第4の画素行の前記第3の画素電極に保持させる階調信号を前記データ信号線に供給した後に、前記一の水平期間の第2の水平期間において、前記第4の画素行とは異なる第3の画素行の前記第2の画素電極に保持させる階調信号を前記データ信号線に供給し、さらにその後に、前記一の水平期間の第3の水平期間において、前記第4の画素行、及び、第3の画素行とは異なる第2の画素行の前記第1の画素電極に保持させる階調信号を前記データ信号線に供給し、
前記一の水平期間の直前の水平期間を時系列で第1乃至第3の水平期間に分割したときに、前記直前の水平期間の第1の水平期間において、第3の画素行の前記第3の画素電極に保持させる階調信号を前記データ信号線に供給した後に、前記直前の水平期間の第2の水平期間において、前記第2の画素行の前記第2の画素電極に保持させる階調信号を前記データ信号線に供給し、さらにその後に、前記直前の水平期間の第3の水平期間において、前記第4の画素行、第3の画素行、及び、第2の画素行とは異なる第1の画素行の前記第1の画素電極に保持させる階調信号を前記データ信号線に供給し、
前記一の水平期間の直後の水平期間を時系列で第1乃至第3の水平期間に分割したときに、前記直後の水平期間の第1の水平期間において、前記第4の画素行、第3の画素行、第2の画素行、及び、乃至第1の画素行とは異なる第5の画素行の前記第3の画素電極に保持させる階調信号を前記データ信号線に供給した後に、前記直後の水平期間の第2の水平期間において、前記第4の画素行の前記第2の画素電極に保持させる階調信号を前記データ信号線に供給し、さらにその後に、前記直前の水平期間の第3の水平期間において、前記第3の画素行の前記第1の画素電極に保持させる階調信号を前記データ信号線に供給する信号側駆動ステップと、
前記直前の水平期間の第2の水平期間から前記一の水平期間の第1の水平期間にかけて連続的に、前記第3の画素行の第1のスイッチング素子、前記第4の画素行の第2のスイッチング素子及び前記第5の画素行の第3のスイッチング素子をそれぞれ前記導通とし、
前記直前の水平期間の第3の水平期間から前記一の水平期間の第2の水平期間にかけて連続的に、前記第2の画素行の第1のスイッチング素子及び前記第3の画素行の第2のスイッチング素子及び前記第4の画素行の第3のスイッチング素子をそれぞれ前記導通とし、
前記一の水平期間の第1の水平期間から前記一の水平期間の第3の水平期間にかけて連続的に、前記第1の画素行の第1のスイッチング素子を前記導通とするとともに前記第2の画素行の第2のスイッチング素子及び前記第3の画素行の第3のスイッチング素子をそれぞれ前記導通とする走査側駆動ステップと、
を有することを特徴とする表示駆動方法。
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JP2008216104A JP5365098B2 (ja) | 2008-08-26 | 2008-08-26 | 表示装置及びその表示駆動方法 |
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