JP5348859B2 - 受信回路及び半導体装置 - Google Patents
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Description
本実施の形態では、本発明のクロック同期回路の一例に関して図面を参照して説明する。
本実施の形態では、上記実施の形態と異なる構造を有するクロック同期回路の一例に関して図面を参照して説明する。
本実施の形態では、上記実施の形態で示したクロック同期回路を有し且つ無線で情報の送受信が可能な半導体装置に関して図面を参照して説明する。
本実施の形態では、上記実施の形態で示したRFIDタグ等の半導体装置を構成する素子の作製方法を説明する。本発明に係る半導体装置を構成する各回路の素子として薄膜トランジスタを用いて作製することができる。本実施の形態では、半導体装置を構成する回路を薄膜トランジスタで形成し、薄膜トランジスタの製造に使用した基板から、可撓性(フレキシブル)基板に回路を転載し、フレキシブルな半導体装置を製造する方法を示す。
本実施の形態では、上記実施の形態とは異なる半導体装置の作製方法について説明する。本発明におけるトランジスタは上記実施の形態で説明した絶縁基板上の薄膜トランジスタの他、単結晶基板上のMOSトランジスタで構成することもできる。
本実施の形態では、上記実施の形態とは異なる半導体装置の作製方法について説明する。本発明におけるトランジスタは上記実施の形態で説明した単結晶基板上のMOSトランジスタとは異なる作製方法で設けられたMOSトランジスタで構成することもできる。
図19を用いて、上記実施の形態で説明したRFIDタグとして機能する半導体装置3000の使用方法を説明する。
102 データ信号
103 信号
104 信号
105 反転信号
106 リセット信号
107 クロック信号
108 信号
110 送信回路
111 基準クロック発生回路
112 データ信号発生回路
114 NOT回路
115 AND回路
117 信号
120 受信回路
121 記憶手段
121 ラッチ回路
122 記憶手段
122 ラッチ回路
123 手段
123 NOT回路
124 手段
124 AND回路
125 基準クロック発生回路
126 基準クロックカウンター回路
127 分周回路
128 受信回路動作用基準クロック発生回路
306 基準クロックカウンター値
307 受信回路動作用基準クロック信号
308 時間差
309 時間差
310 期間
401 受信回路動作用基準クロック信号
402 データ信号
403 論理値
404 データ信号
405 論理値
406 期間
407 期間
410 送信回路
411 基準クロック発生回路
412 データ信号発生回路
420 受信回路
421 基準クロック発生回路
422 ロジック回路
423 分周回路
424 受信回路動作用基準クロック発生回路
501 信号
502 リセット信号
510 データ信号カウンター回路
511 カウンター値比較回路
Claims (7)
- 無線通信を用いて送信回路から送信されたデータ信号の受信を行う受信回路であって、
受信した前記データ信号の変化点を検出し、前記データ信号をカウントする第1の回路と、
前記第1の回路から出力された信号が入力され、前記第1の回路がカウントしたカウンター値と、所定の比較値とを比較する第2の回路と、
クロック信号を出力する第3の回路と、
前記クロック信号をカウントする第4の回路と、
前記第4の回路から出力された信号を分周する第5の回路と、
前記第5の回路から出力された信号により、前記受信回路の動作用基準クロック信号を生成する第6の回路とを有し、
前記第2の回路は、前記第1の回路がカウントした前記カウンター値と前記所定の比較値と比較して、一致する場合に、前記第4の回路へリセット信号を出力し、
前記第4の回路は、前記リセット信号によって、前記クロック信号をカウントして得られたカウンター値をリセットすることを特徴とする受信回路。 - 無線通信を用いて送信回路から送信されたデータ信号の受信を行う受信回路であって、
受信した前記データ信号の変化点を検出し、前記データ信号をカウントする第1の回路と、
前記第1の回路から出力された信号が入力され、前記第1の回路がカウントしたカウンター値と、所定の比較値とを比較する第2の回路と、
クロック信号を出力する第3の回路と、
前記クロック信号をカウントする第4の回路と、
前記第4の回路から出力された信号を分周する第5の回路と、
前記第5の回路から出力された信号により、前記受信回路の動作用基準クロック信号を生成する第6の回路とを有し、
前記第2の回路は、前記第1の回路がカウントした前記カウンター値と前記所定の比較値と比較して、一致する場合に、前記第4の回路へリセット信号を出力し、
前記第4の回路は、前記リセット信号によって、前記クロック信号をカウントして得られたカウンター値をリセットし、
前記第2の回路は、前記第1の回路がカウントした前記カウンター値と前記所定の比較値と比較して、一致しない場合に、前記第4の回路がカウントしたカウンター値を破棄することを特徴とする受信回路。 - 請求項1または請求項2において、
前記第3の回路は、リングオシレータ又は水晶発振器を有することを特徴とする受信回路。 - 請求項1乃至請求項3のいずれか一において、
前記受信回路はクロック同期回路であることを特徴とする受信回路。 - アンテナを備えリーダ/ライタと無線通信により信号の送受信を行う半導体装置であって、
前記リーダ/ライタから受信したデータ信号の変化点を検出し、前記データ信号をカウントする第1の回路と、
前記第1の回路から出力された信号が入力され、前記第1の回路がカウントしたカウンター値と、所定の比較値とを比較する第2の回路と、
クロック信号を出力する第3の回路と、
前記クロック信号をカウントする第4の回路と、
前記第4の回路から出力された信号を分周する第5の回路と、
前記第5の回路から出力された信号により、動作用基準クロック信号を生成する第6の回路とを有し、
前記第2の回路は、前記第1の回路がカウントしたカウンター値と前記所定の比較値とを比較して、一致する場合に、前記第4の回路へリセット信号を出力し、
前記第4の回路は、前記リセット信号によって、前記クロック信号をカウントして得られたカウンター値をリセットすることを特徴とする半導体装置。 - アンテナを備えリーダ/ライタと無線通信により信号の送受信を行う半導体装置であって、
前記リーダ/ライタから受信したデータ信号の変化点を検出し、前記データ信号をカウントする第1の回路と、
前記第1の回路から出力された信号が入力され、前記第1の回路がカウントしたカウンター値と、所定の比較値とを比較する第2の回路と、
クロック信号を出力する第3の回路と、
前記クロック信号をカウントする第4の回路と、
前記第4の回路から出力された信号を分周する第5の回路と、
前記第5の回路から出力された信号により、動作用基準クロック信号を生成する第6の回路とを有し、
前記第2の回路は、前記第1の回路がカウントしたカウンター値と前記所定の比較値とを比較して、一致する場合に、前記第4の回路へリセット信号を出力し、
前記第4の回路は、前記リセット信号によって、前記クロック信号をカウントして得られたカウンター値をリセットし、
前記第2の回路は、前記第1の回路がカウントしたカウンター値と前記所定の比較値とを比較して、一致しない場合に、前記第4の回路がカウントしたカウンター値を破棄することを特徴とする半導体装置。 - 請求項5または請求項6において、
前記第3の回路は、リングオシレータ又は水晶発振器を有することを特徴とする半導体装置。
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