JP5232018B2 - エラー処理方法およびエラー処理装置 - Google Patents
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Description
開示された装置は、第1記憶領域を有するメモリを備える。第1記憶領域は、データ領域とエラー訂正領域を備える。本装置は、第1記憶領域に関連する第1状態指標と、メモリに接続されるエラー訂正モジュールとを更に備える。エラー訂正を行なうエラー訂正モジュールは、第1記憶領域に関連する。本装置はアクセス制御モジュールを更に備える。アクセス制御モジュールは、第1状態指標に接続される第1入力と、エラー訂正モジュールに接続される出力とを有する。アクセス制御モジュールは、第1状態指標が第1状態になるのに応答して、第1記憶領域に対するエラー訂正、エラー検出、または任意のそれらの組合せのうちの1つを無効にする。
別の特定態様では、アクセス制御モジュールは、リセット信号を受信する第2入力を更に備える。アクセス制御モジュールは、第1状態指標を、リセット信号の受信に応答して第1状態にする。
特定態様では、第1状態指標は、第1記憶領域に関連する状態フラグビットである。
別の特定態様では、本方法は、リセット指示を受信することと、リセット指示の受信に応答して、エラー訂正状態指標を第1状態にすることとを含む。
特定態様では、本方法は、第1部分書込動作を第1全体書込動作に昇格後に、第1エラー訂正状態指標を第2状態に変更することを含む。
異なる図面中の同一の参照符号の使用は、同様または同一の要素を示す。
本発明の原理は、特定の装置に関して上述されるが、この記述が例示としてのみなされ、本発明の範囲に対する限定としてなされていないことが明白に理解されるべきである。
Claims (4)
- 第1記憶領域に関連する第1エラー訂正状態指標の状態を判定することであって、前記第1記憶領域には第1アクセス要求が行われることと;
前記第1エラー訂正状態指標が第1状態であるとの判定に応答して、前記第1アクセス要求に対するエラー処理を実行しないことと
を含むエラー処理方法であって、
前記エラー処理は、エラー検出とエラー訂正のうち少なくともエラー検出を含み、
前記第1アクセス要求が部分書込要求である場合、
前記第1エラー訂正状態指標が第1状態であるとの判定に応答して、前記第1アクセス要求に対するエラー処理を実行せずに、前記部分書込要求を全体書込要求に昇格させることと;
前記第1エラー訂正状態指標が第1状態でないとの判定に応答して、前記第1アクセス要求に対するエラー処理を実行し、前記部分書込要求を前記全体書込要求に昇格させないこととを含むことを特徴とする、エラー処理方法。 - 前記エラー処理方法は更に、前記全体書込要求に対するエラー訂正情報を算出することを含む、請求項1記載のエラー処理方法。
- 前記全体書込要求に基づく全体書込動作は、前記第1記憶領域に関連するエラー訂正データ単位の幅全体に亘って行なわれる、請求項1記載のエラー処理方法。
- データ領域とエラー訂正領域を含む記憶領域を備えるメモリと;
前記記憶領域に関連する状態指標と;
前記メモリに接続されるエラー処理モジュールであって、前記エラー処理モジュールは前記記憶領域に関連するエラー処理を行なうことと;
アクセス制御モジュールと
を備えるエラー処理装置であって、
前記アクセス制御モジュールは、前記状態指標に接続される第1入力と、前記エラー処理モジュールに接続される出力とを有し、
前記記憶領域に対して部分書込要求が行われた場合、前記アクセス制御モジュールは、
前記状態指標が所定状態であるとの判定に応答して、前記記憶領域に対するエラー処理を前記エラー処理モジュールに実行させないようにし、前記部分書込要求を全体書込要求に昇格させ、
前記状態指標が前記所定状態でないとの判定に応答して、前記記憶領域に対するエラー処理を前記エラー処理モジュールに実行させ、前記部分書込要求を全体書込要求に昇格させ、
前記エラー処理は、エラー検出とエラー訂正のうち少なくともエラー検出を含むことを特徴とする、エラー処理装置。
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